The x86 timer interrupt handler is the only handler not traced in the
[linux-2.6/next.git] / arch / mips / netlogic / xlr / smpboot.S
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32  * IF ADVISED OF THE POSSIBILITY OF SUCH DAMAGE.
33  */
35 #include <linux/init.h>
37 #include <asm/asm.h>
38 #include <asm/asm-offsets.h>
39 #include <asm/regdef.h>
40 #include <asm/mipsregs.h>
43  * Early code for secondary CPUs. This will get them out of the bootloader
44  * code and into linux. Needed because the bootloader area will be taken
45  * and initialized by linux.
46  */
47         __CPUINIT
48 NESTED(prom_pre_boot_secondary_cpus, 16, sp)
49         .set    mips64
50         mfc0    t0, $15, 1      # read ebase
51         andi    t0, 0x1f        # t0 has the processor_id()
52         sll     t0, 2           # offset in cpu array
54         PTR_LA  t1, nlm_cpu_ready # mark CPU ready
55         PTR_ADDU t1, t0
56         li      t2, 1
57         sw      t2, 0(t1)
59         PTR_LA  t1, nlm_cpu_unblock
60         PTR_ADDU t1, t0
61 1:      lw      t2, 0(t1)       # wait till unblocked
62         beqz    t2, 1b
63         nop
65         PTR_LA  t1, nlm_next_sp
66         PTR_L   sp, 0(t1)
67         PTR_LA  t1, nlm_next_gp
68         PTR_L   gp, 0(t1)
70         PTR_LA  t0, nlm_early_init_secondary
71         jalr    t0
72         nop
74         PTR_LA  t0, smp_bootstrap
75         jr      t0
76         nop
77 END(prom_pre_boot_secondary_cpus)
78         __FINIT
81  * NMI code, used for CPU wakeup, copied to reset entry
82  */
83 NESTED(nlm_boot_smp_nmi, 0, sp)
84         .set push
85         .set noat
86         .set mips64
87         .set noreorder
89         /* Clear the  NMI and BEV bits */
90         MFC0    k0, CP0_STATUS
91         li      k1, 0xffb7ffff
92         and     k0, k0, k1
93         MTC0    k0, CP0_STATUS
95         PTR_LA  k1, secondary_entry_point
96         PTR_L   k0, 0(k1)
97         jr      k0
98         nop
99         .set pop
100 END(nlm_boot_smp_nmi)