llvm/test/CodeGen/X86/vec_shift2.ll

   1 ; NOTE: Assertions have been autogenerated by utils/update_llc_test_checks.py
   2 ; RUN: llc < %s -mtriple=i686-unknown -mattr=+sse2 | FileCheck %s
   3 ; RUN: llc < %s -mtriple=x86_64-unknown -mattr=+sse2 | FileCheck %s
   4
   5 define <2 x i64> @t1(<2 x i64> %b1, <2 x i64> %c) nounwind  {
   6 ; CHECK-LABEL: t1:
   7 ; CHECK:       # %bb.0:
   8 ; CHECK-NEXT:    psrlw $14, %xmm0
   9 ; CHECK-NEXT:    ret{{[l|q]}}
  10         %tmp1 = bitcast <2 x i64> %b1 to <8 x i16>
  11         %tmp2 = tail call <8 x i16> @llvm.x86.sse2.psrl.w( <8 x i16> %tmp1, <8 x i16> bitcast (<4 x i32> < i32 14, i32 undef, i32 undef, i32 undef > to <8 x i16>) ) nounwind readnone
  12         %tmp3 = bitcast <8 x i16> %tmp2 to <2 x i64>
  13         ret <2 x i64> %tmp3
  14 }
  15
  16 define <4 x i32> @t2(<2 x i64> %b1, <2 x i64> %c) nounwind  {
  17 ; CHECK-LABEL: t2:
  18 ; CHECK:       # %bb.0:
  19 ; CHECK-NEXT:    movl $14, %eax
  20 ; CHECK-NEXT:    movd %eax, %xmm1
  21 ; CHECK-NEXT:    pslld %xmm1, %xmm0
  22 ; CHECK-NEXT:    ret{{[l|q]}}
  23         %tmp1 = bitcast <2 x i64> %b1 to <4 x i32>
  24         %tmp2 = tail call <4 x i32> @llvm.x86.sse2.psll.d( <4 x i32> %tmp1, <4 x i32> < i32 14, i32 undef, i32 undef, i32 undef > ) nounwind readnone
  25         ret <4 x i32> %tmp2
  26 }
  27
  28 declare <8 x i16> @llvm.x86.sse2.psrl.w(<8 x i16>, <8 x i16>) nounwind readnone
  29 declare <4 x i32> @llvm.x86.sse2.psll.d(<4 x i32>, <4 x i32>) nounwind readnone