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[PATCH 40/57][Arm][OBJDUMP] Add support for MVE instructions: vdup, veor, vfma, vfms...
[binutils-gdb.git] / ld / testsuite / ld-mmix / greg-7.d
blob3afd3abe44b63f424df8994379a449c2d12a73bb
1 #source: gregget1.s
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27 #source: greg-4.s
28 #source: greg-4.s
29 #source: greg-4.s
30 #source: a.s
31 #source: start.s
32 #as: -x
33 #ld: -m elf64mmix
34 #objdump: -dt
35
36 # Allocating the maximum number of gregs and referring to one at the
37 # *other* end still works.
38
39 .*: file format elf64-mmix
40
41 SYMBOL TABLE:
42 0+ l d \.text 0+ (|\.text)
43 0+100 l d \.MMIX\.reg_contents 0+ (|\.MMIX\.reg_contents)
44 0+ l df \*ABS\* 0+ .*
45 0+21 l \*REG\* 0+ P
46 0+22 l \*REG\* 0+ O
47 0+23 l \*REG\* 0+ N
48 0+24 l \*REG\* 0+ M
49 0+25 l \*REG\* 0+ L
50 0+26 l \*REG\* 0+ K
51 0+27 l \*REG\* 0+ J
52 0+28 l \*REG\* 0+ I
53 0+29 l \*REG\* 0+ H
54 0+2a l \*REG\* 0+ G
55 0+2b l \*REG\* 0+ F
56 0+2c l \*REG\* 0+ E
57 0+2d l \*REG\* 0+ D
58 0+2e l \*REG\* 0+ C
59 0+2f l \*REG\* 0+ B
60 0+30 l \*REG\* 0+ A
61 0+ l df \*ABS\* 0+ .*
62 0+31 l \*REG\* 0+ P
63 0+32 l \*REG\* 0+ O
64 0+33 l \*REG\* 0+ N
65 0+34 l \*REG\* 0+ M
66 0+35 l \*REG\* 0+ L
67 0+36 l \*REG\* 0+ K
68 0+37 l \*REG\* 0+ J
69 0+38 l \*REG\* 0+ I
70 0+39 l \*REG\* 0+ H
71 0+3a l \*REG\* 0+ G
72 0+3b l \*REG\* 0+ F
73 0+3c l \*REG\* 0+ E
74 0+3d l \*REG\* 0+ D
75 0+3e l \*REG\* 0+ C
76 0+3f l \*REG\* 0+ B
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78 0+ l df \*ABS\* 0+ .*
79 0+41 l \*REG\* 0+ P
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81 0+43 l \*REG\* 0+ N
82 0+44 l \*REG\* 0+ M
83 0+45 l \*REG\* 0+ L
84 0+46 l \*REG\* 0+ K
85 0+47 l \*REG\* 0+ J
86 0+48 l \*REG\* 0+ I
87 0+49 l \*REG\* 0+ H
88 0+4a l \*REG\* 0+ G
89 0+4b l \*REG\* 0+ F
90 0+4c l \*REG\* 0+ E
91 0+4d l \*REG\* 0+ D
92 0+4e l \*REG\* 0+ C
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95 0+ l df \*ABS\* 0+ .*
96 0+51 l \*REG\* 0+ P
97 0+52 l \*REG\* 0+ O
98 0+53 l \*REG\* 0+ N
99 0+54 l \*REG\* 0+ M
100 0+55 l \*REG\* 0+ L
101 0+56 l \*REG\* 0+ K
102 0+57 l \*REG\* 0+ J
103 0+58 l \*REG\* 0+ I
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106 0+5b l \*REG\* 0+ F
107 0+5c l \*REG\* 0+ E
108 0+5d l \*REG\* 0+ D
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112 0+ l df \*ABS\* 0+ .*
113 0+61 l \*REG\* 0+ P
114 0+62 l \*REG\* 0+ O
115 0+63 l \*REG\* 0+ N
116 0+64 l \*REG\* 0+ M
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132 0+73 l \*REG\* 0+ N
133 0+74 l \*REG\* 0+ M
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135 0+76 l \*REG\* 0+ K
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139 0+7a l \*REG\* 0+ G
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141 0+7c l \*REG\* 0+ E
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146 0+ l df \*ABS\* 0+ .*
147 0+81 l \*REG\* 0+ P
148 0+82 l \*REG\* 0+ O
149 0+83 l \*REG\* 0+ N
150 0+84 l \*REG\* 0+ M
151 0+85 l \*REG\* 0+ L
152 0+86 l \*REG\* 0+ K
153 0+87 l \*REG\* 0+ J
154 0+88 l \*REG\* 0+ I
155 0+89 l \*REG\* 0+ H
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164 0+91 l \*REG\* 0+ P
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190 0+aa l \*REG\* 0+ G
191 0+ab l \*REG\* 0+ F
192 0+ac l \*REG\* 0+ E
193 0+ad l \*REG\* 0+ D
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195 0+af l \*REG\* 0+ B
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207 0+ba l \*REG\* 0+ G
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300
301 Disassembly of section \.text:
302
303 0+ <a-0x10>:
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311
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313 14: e3fd0001 setl \$253,0x1
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