Documentation/mainboard/protectli/vp2420.md

   1 # Protectli Vault VP2420
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   3 This page describes how to run coreboot on the [Protectli VP2420].
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   5 ![](VP2420_back.jpg)
   6 ![](VP2420_front.jpg)
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   8 ## Required proprietary blobs
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  10 To build a minimal working coreboot image some blobs are required (assuming
  11 only the BIOS region is being modified).
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  13 ```{eval-rst}
  14 +-----------------+---------------------------------+---------------------+
  15 | Binary file     | Apply                           | Required / Optional |
  16 +=================+=================================+=====================+
  17 | FSP-M, FSP-S    | Intel Firmware Support Package  | Required            |
  18 +-----------------+---------------------------------+---------------------+
  19 | microcode       | CPU microcode                   | Required            |
  20 +-----------------+---------------------------------+---------------------+
  21 ```
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  23 FSP-M and FSP-S are obtained after splitting the Elkhart Lake FSP binary (done
  24 automatically by the coreboot build system and included into the image) from
  25 the `3rdparty/fsp` submodule.
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  27 Microcode updates are automatically included into the coreboot image by build
  28 system from the `3rdparty/intel-microcode` submodule.
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  30 ## Flashing coreboot
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  32 ### Internal programming
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  34 The main SPI flash can be accessed using [flashrom]. Firmware can be easily
  35 flashed with internal programmer (either BIOS region or full image).
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  37 ### External programming
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  39 The system has an internal flash chip which is a 16 MiB soldered SOIC-8 chip.
  40 This chip is located on the top side of the case (the lid side). One has to
  41 remove 4 top cover screws and lift up the lid. The flash chip is soldered in
  42 under RAM, easily accessed after taking out the memory. Specifically, it's a
  43 KH25L12835F (3.3V) which is a clone of Macronix
  44 MX25L12835F - [datasheet][MX25L12835F].
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  46 ![](VP2420_internal.jpg)
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  48 ## Working
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  50 - USB 3.0 front ports (SeaBIOS, Tianocore UEFIPayload and Linux)
  51 - 4 Ethernet ports
  52 - HDMI, DisplayPort
  53 - flashrom
  54 - M.2 WiFi
  55 - M.2 4G LTE
  56 - M.2 SATA and NVMe
  57 - 2.5'' SATA SSD
  58 - eMMC
  59 - Super I/O serial port 0 via front microUSB connector
  60 - SMBus (reading SPD from DIMMs)
  61 - Initialization with Elkhart Lake FSP 2.0
  62 - SeaBIOS payload (version rel-1.16.0)
  63 - TianoCore UEFIPayload
  64 - Reset switch
  65 - Booting Debian, Ubuntu, FreeBSD
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  67 ## Technology
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  69 ```{eval-rst}
  70 +------------------+--------------------------------------------------+
  71 | CPU              | Intel Celeron J6412                              |
  72 +------------------+--------------------------------------------------+
  73 | PCH              | Intel Elkhart Lake                               |
  74 +------------------+--------------------------------------------------+
  75 | Super I/O, EC    | ITE IT8613E                                      |
  76 +------------------+--------------------------------------------------+
  77 | Coprocessor      | Intel Management Engine                          |
  78 +------------------+--------------------------------------------------+
  79 ```
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  81 ## Useful links
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  83 - [VP2420 Hardware Overview](https://protectli.com/kb/vp2400-series-hardware-overview/)
  84 - [VP2420 Product Page](https://protectli.com/product/vp2420/)
  85 - [Protectli TPM module](https://protectli.com/product/tpm-module/)
  86 - [MX25L12835F](https://www.mxic.com.tw/Lists/Datasheet/Attachments/8653/MX25L12835F,%203V,%20128Mb,%20v1.6.pdf)
  87 - [flashrom](https://flashrom.org/Flashrom)