arch/blackfin/include/asm/portmux.h

   1 /*
   2  * Common header file for Blackfin family of processors
   3  *
   4  * Copyright 2007-2008 Analog Devices Inc.
   5  *
   6  * Licensed under the GPL-2 or later.
   7  */
   8
   9 #ifndef _PORTMUX_H_
  10 #define _PORTMUX_H_
  11
  12 #define P_IDENT(x)      ((x) & 0x1FF)
  13 #define P_FUNCT(x)      (((x) & 0x3) << 9)
  14 #define P_FUNCT2MUX(x)  (((x) >> 9) & 0x3)
  15 #define P_DEFINED       0x8000
  16 #define P_UNDEF         0x4000
  17 #define P_MAYSHARE      0x2000
  18 #define P_DONTCARE      0x1000
  19
  20 #ifdef CONFIG_PINCTRL
  21 int bfin_internal_set_wake(unsigned int irq, unsigned int state);
  22
  23 #define gpio_pint_regs bfin_pint_regs
  24 #define adi_internal_set_wake bfin_internal_set_wake
  25
  26 #define peripheral_request(per, label) (0)
  27 #define peripheral_free(per)
  28 #define peripheral_request_list(per, label) (0)
  29 #define peripheral_free_list(per)
  30 #else
  31 int peripheral_request(unsigned short per, const char *label);
  32 void peripheral_free(unsigned short per);
  33 int peripheral_request_list(const unsigned short per[], const char *label);
  34 void peripheral_free_list(const unsigned short per[]);
  35 #endif
  36
  37 #include <linux/err.h>
  38 #include <linux/pinctrl/pinctrl.h>
  39 #include <mach/portmux.h>
  40 #include <mach/gpio.h>
  41
  42 #ifndef P_SPORT2_TFS
  43 #define P_SPORT2_TFS P_UNDEF
  44 #endif
  45
  46 #ifndef P_SPORT2_DTSEC
  47 #define P_SPORT2_DTSEC P_UNDEF
  48 #endif
  49
  50 #ifndef P_SPORT2_DTPRI
  51 #define P_SPORT2_DTPRI P_UNDEF
  52 #endif
  53
  54 #ifndef P_SPORT2_TSCLK
  55 #define P_SPORT2_TSCLK P_UNDEF
  56 #endif
  57
  58 #ifndef P_SPORT2_RFS
  59 #define P_SPORT2_RFS P_UNDEF
  60 #endif
  61
  62 #ifndef P_SPORT2_DRSEC
  63 #define P_SPORT2_DRSEC P_UNDEF
  64 #endif
  65
  66 #ifndef P_SPORT2_DRPRI
  67 #define P_SPORT2_DRPRI P_UNDEF
  68 #endif
  69
  70 #ifndef P_SPORT2_RSCLK
  71 #define P_SPORT2_RSCLK P_UNDEF
  72 #endif
  73
  74 #ifndef P_SPORT3_TFS
  75 #define P_SPORT3_TFS P_UNDEF
  76 #endif
  77
  78 #ifndef P_SPORT3_DTSEC
  79 #define P_SPORT3_DTSEC P_UNDEF
  80 #endif
  81
  82 #ifndef P_SPORT3_DTPRI
  83 #define P_SPORT3_DTPRI P_UNDEF
  84 #endif
  85
  86 #ifndef P_SPORT3_TSCLK
  87 #define P_SPORT3_TSCLK P_UNDEF
  88 #endif
  89
  90 #ifndef P_SPORT3_RFS
  91 #define P_SPORT3_RFS P_UNDEF
  92 #endif
  93
  94 #ifndef P_SPORT3_DRSEC
  95 #define P_SPORT3_DRSEC P_UNDEF
  96 #endif
  97
  98 #ifndef P_SPORT3_DRPRI
  99 #define P_SPORT3_DRPRI P_UNDEF
 100 #endif
 101
 102 #ifndef P_SPORT3_RSCLK
 103 #define P_SPORT3_RSCLK P_UNDEF
 104 #endif
 105
 106 #ifndef P_TMR4
 107 #define P_TMR4 P_UNDEF
 108 #endif
 109
 110 #ifndef P_TMR5
 111 #define P_TMR5 P_UNDEF
 112 #endif
 113
 114 #ifndef P_TMR6
 115 #define P_TMR6 P_UNDEF
 116 #endif
 117
 118 #ifndef P_TMR7
 119 #define P_TMR7 P_UNDEF
 120 #endif
 121
 122 #ifndef P_TWI1_SCL
 123 #define P_TWI1_SCL P_UNDEF
 124 #endif
 125
 126 #ifndef P_TWI1_SDA
 127 #define P_TWI1_SDA P_UNDEF
 128 #endif
 129
 130 #ifndef P_UART3_RTS
 131 #define P_UART3_RTS P_UNDEF
 132 #endif
 133
 134 #ifndef P_UART3_CTS
 135 #define P_UART3_CTS P_UNDEF
 136 #endif
 137
 138 #ifndef P_UART2_TX
 139 #define P_UART2_TX P_UNDEF
 140 #endif
 141
 142 #ifndef P_UART2_RX
 143 #define P_UART2_RX P_UNDEF
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 145
 146 #ifndef P_UART3_TX
 147 #define P_UART3_TX P_UNDEF
 148 #endif
 149
 150 #ifndef P_UART3_RX
 151 #define P_UART3_RX P_UNDEF
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 153
 154 #ifndef P_SPI2_SS
 155 #define P_SPI2_SS P_UNDEF
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 157
 158 #ifndef P_SPI2_SSEL1
 159 #define P_SPI2_SSEL1 P_UNDEF
 160 #endif
 161
 162 #ifndef P_SPI2_SSEL2
 163 #define P_SPI2_SSEL2 P_UNDEF
 164 #endif
 165
 166 #ifndef P_SPI2_SSEL3
 167 #define P_SPI2_SSEL3 P_UNDEF
 168 #endif
 169
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 171 #define P_SPI2_SSEL4 P_UNDEF
 172 #endif
 173
 174 #ifndef P_SPI2_SSEL5
 175 #define P_SPI2_SSEL5 P_UNDEF
 176 #endif
 177
 178 #ifndef P_SPI2_SSEL6
 179 #define P_SPI2_SSEL6 P_UNDEF
 180 #endif
 181
 182 #ifndef P_SPI2_SSEL7
 183 #define P_SPI2_SSEL7 P_UNDEF
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 185
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 187 #define P_SPI2_SCK P_UNDEF
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 189
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 191 #define P_SPI2_MOSI P_UNDEF
 192 #endif
 193
 194 #ifndef P_SPI2_MISO
 195 #define P_SPI2_MISO P_UNDEF
 196 #endif
 197
 198 #ifndef P_TMR0
 199 #define P_TMR0 P_UNDEF
 200 #endif
 201
 202 #ifndef P_TMR1
 203 #define P_TMR1 P_UNDEF
 204 #endif
 205
 206 #ifndef P_TMR2
 207 #define P_TMR2 P_UNDEF
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 209
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 211 #define P_TMR3 P_UNDEF
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 213
 214 #ifndef P_SPORT0_TFS
 215 #define P_SPORT0_TFS P_UNDEF
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 217
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 219 #define P_SPORT0_DTSEC P_UNDEF
 220 #endif
 221
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 223 #define P_SPORT0_DTPRI P_UNDEF
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 225
 226 #ifndef P_SPORT0_TSCLK
 227 #define P_SPORT0_TSCLK P_UNDEF
 228 #endif
 229
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 231 #define P_SPORT0_RFS P_UNDEF
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 233
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 235 #define P_SPORT0_DRSEC P_UNDEF
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 237
 238 #ifndef P_SPORT0_DRPRI
 239 #define P_SPORT0_DRPRI P_UNDEF
 240 #endif
 241
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 243 #define P_SPORT0_RSCLK P_UNDEF
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 245
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 247 #define P_SD_D0 P_UNDEF
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 249
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 251 #define P_SD_D1 P_UNDEF
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 253
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 255 #define P_SD_D2 P_UNDEF
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 257
 258 #ifndef P_SD_D3
 259 #define P_SD_D3 P_UNDEF
 260 #endif
 261
 262 #ifndef P_SD_CLK
 263 #define P_SD_CLK P_UNDEF
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 265
 266 #ifndef P_SD_CMD
 267 #define P_SD_CMD P_UNDEF
 268 #endif
 269
 270 #ifndef P_MMCLK
 271 #define P_MMCLK P_UNDEF
 272 #endif
 273
 274 #ifndef P_MBCLK
 275 #define P_MBCLK P_UNDEF
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 277
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 279 #define P_PPI1_D0 P_UNDEF
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 281
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 287 #define P_PPI1_D2 P_UNDEF
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 289
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 291 #define P_PPI1_D3 P_UNDEF
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 293
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 295 #define P_PPI1_D4 P_UNDEF
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 297
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 299 #define P_PPI1_D5 P_UNDEF
 300 #endif
 301
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 303 #define P_PPI1_D6 P_UNDEF
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 305
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 307 #define P_PPI1_D7 P_UNDEF
 308 #endif
 309
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 311 #define P_PPI1_D8 P_UNDEF
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 313
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 315 #define P_PPI1_D9 P_UNDEF
 316 #endif
 317
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 319 #define P_PPI1_D10 P_UNDEF
 320 #endif
 321
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 323 #define P_PPI1_D11 P_UNDEF
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 327 #define P_PPI1_D12 P_UNDEF
 328 #endif
 329
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 331 #define P_PPI1_D13 P_UNDEF
 332 #endif
 333
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 335 #define P_PPI1_D14 P_UNDEF
 336 #endif
 337
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 339 #define P_PPI1_D15 P_UNDEF
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 341
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 349
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 351 #define P_HOST_D10 P_UNDEF
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 355 #define P_HOST_D11 P_UNDEF
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 359 #define P_HOST_D12 P_UNDEF
 360 #endif
 361
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 363 #define P_HOST_D13 P_UNDEF
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 367 #define P_HOST_D14 P_UNDEF
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 369
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 371 #define P_HOST_D15 P_UNDEF
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 375 #define P_HOST_D0 P_UNDEF
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 379 #define P_HOST_D1 P_UNDEF
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 397
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 399 #define P_HOST_D6 P_UNDEF
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 403 #define P_HOST_D7 P_UNDEF
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 407 #define P_SPORT1_TFS P_UNDEF
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 411 #define P_SPORT1_DTSEC P_UNDEF
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 415 #define P_SPORT1_DTPRI P_UNDEF
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 419 #define P_SPORT1_TSCLK P_UNDEF
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 423 #define P_SPORT1_RFS P_UNDEF
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 427 #define P_SPORT1_DRSEC P_UNDEF
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 431 #define P_SPORT1_DRPRI P_UNDEF
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 435 #define P_SPORT1_RSCLK P_UNDEF
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 439 #define P_PPI2_D0 P_UNDEF
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 443 #define P_PPI2_D1 P_UNDEF
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 447 #define P_PPI2_D2 P_UNDEF
 448 #endif
 449
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 451 #define P_PPI2_D3 P_UNDEF
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 453
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 455 #define P_PPI2_D4 P_UNDEF
 456 #endif
 457
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 459 #define P_PPI2_D5 P_UNDEF
 460 #endif
 461
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 463 #define P_PPI2_D6 P_UNDEF
 464 #endif
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 467 #define P_PPI2_D7 P_UNDEF
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 469
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 471 #define P_PPI0_D18 P_UNDEF
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 475 #define P_PPI0_D19 P_UNDEF
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 479 #define P_PPI0_D20 P_UNDEF
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 483 #define P_PPI0_D21 P_UNDEF
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 487 #define P_PPI0_D22 P_UNDEF
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 491 #define P_PPI0_D23 P_UNDEF
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 495 #define P_KEY_ROW0 P_UNDEF
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 499 #define P_KEY_ROW1 P_UNDEF
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 513
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 517
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 521
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 531 #define P_SPI0_MISO P_UNDEF
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 535 #define P_SPI0_MOSI P_UNDEF
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 541
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 547 #define P_SPI0_SSEL2 P_UNDEF
 548 #endif
 549
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 551 #define P_SPI0_SSEL3 P_UNDEF
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 553
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 555 #define P_SPI0_SSEL4 P_UNDEF
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 559 #define P_SPI0_SSEL5 P_UNDEF
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 563 #define P_SPI0_SSEL6 P_UNDEF
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 567 #define P_SPI0_SSEL7 P_UNDEF
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 579 #define P_UART1_RTS P_UNDEF
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 591 #define P_PPI1_FS1 P_UNDEF
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 595 #define P_PPI1_FS2 P_UNDEF
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 599 #define P_TWI0_SCL P_UNDEF
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 623 #define P_KEY_COL5 P_UNDEF
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 627 #define P_KEY_ROW4 P_UNDEF
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 631 #define P_KEY_COL4 P_UNDEF
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 639 #define P_PPI0_D0 P_UNDEF
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 641
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 647 #define P_PPI0_D2 P_UNDEF
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 651 #define P_PPI0_D3 P_UNDEF
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 653
 654 #ifndef P_PPI0_D4
 655 #define P_PPI0_D4 P_UNDEF
 656 #endif
 657
 658 #ifndef P_PPI0_D5
 659 #define P_PPI0_D5 P_UNDEF
 660 #endif
 661
 662 #ifndef P_PPI0_D6
 663 #define P_PPI0_D6 P_UNDEF
 664 #endif
 665
 666 #ifndef P_PPI0_D7
 667 #define P_PPI0_D7 P_UNDEF
 668 #endif
 669
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 671 #define P_PPI0_D8 P_UNDEF
 672 #endif
 673
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 675 #define P_PPI0_D9 P_UNDEF
 676 #endif
 677
 678 #ifndef P_PPI0_D10
 679 #define P_PPI0_D10 P_UNDEF
 680 #endif
 681
 682 #ifndef P_PPI0_D11
 683 #define P_PPI0_D11 P_UNDEF
 684 #endif
 685
 686 #ifndef P_PPI0_D12
 687 #define P_PPI0_D12 P_UNDEF
 688 #endif
 689
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 691 #define P_PPI0_D13 P_UNDEF
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 695 #define P_PPI0_D14 P_UNDEF
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 697
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 700 #endif
 701
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 703 #define P_ATAPI_D0A P_UNDEF
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 705
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 709
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 711 #define P_ATAPI_D2A P_UNDEF
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 713
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 717
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 721
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 723 #define P_ATAPI_D5A P_UNDEF
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 725
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 729
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 733
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 737
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 741
 742 #ifndef P_ATAPI_D10A
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 745
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 749
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 751 #define P_ATAPI_D12A P_UNDEF
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 761
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 765
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 769
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 777
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 785
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 789
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 793
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 797
 798
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 800 #define P_SPI1_SSEL4 P_UNDEF
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 802
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 806
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 810
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 812 #define P_SPI1_SSEL7 P_UNDEF
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 814
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 842
 843 #ifndef P_CAN1_RX
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 846
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 850
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 854
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 858
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 860 #define P_HOST_CE P_UNDEF
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 862
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 864 #define P_HOST_RD P_UNDEF
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 868 #define P_HOST_WR P_UNDEF
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 870
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 872 #define P_MTXONB P_UNDEF
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 874
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 882
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 886
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 898
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 900 #define P_ATAPI_RESET P_UNDEF
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 902
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 906
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 910
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 914
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 918
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 920 #define P_MRXONB P_UNDEF
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 922
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 926
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 930
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 934
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 938
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 942
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 946
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 958
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 960 #define P_TMR9 P_UNDEF
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 962
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 966 #ifndef P_TMR11
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 969
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 973
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 977
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 979 #define P_PPI0_FS3 P_UNDEF
 980 #endif
 981
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 985
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 989
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 997
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 999 #define P_A12 P_UNDEF
1000 #endif
1001
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1003 #define P_A13 P_UNDEF
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1009
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1011 #define P_A15 P_UNDEF
1012 #endif
1013
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1016 #endif
1017
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1019 #define P_A17 P_UNDEF
1020 #endif
1021
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1023 #define P_A18 P_UNDEF
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1025
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1031 #define P_A20 P_UNDEF
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1037
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1039 #define P_A22 P_UNDEF
1040 #endif
1041
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1043 #define P_A23 P_UNDEF
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1045
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1049
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1051 #define P_A25 P_UNDEF
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1053
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1057
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1060 #endif
1061
1062 #ifndef P_AMC_ARDY_NOR_WAIT
1063 #define P_AMC_ARDY_NOR_WAIT P_UNDEF
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1065
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1067 #define P_NAND_CE P_UNDEF
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1069
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1071 #define P_NAND_RB P_UNDEF
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1073
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1075 #define P_ATAPI_DIOR P_UNDEF
1076 #endif
1077
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1079 #define P_ATAPI_DIOW P_UNDEF
1080 #endif
1081
1082 #ifndef P_ATAPI_CS0
1083 #define P_ATAPI_CS0 P_UNDEF
1084 #endif
1085
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1087 #define P_ATAPI_CS1 P_UNDEF
1088 #endif
1089
1090 #ifndef P_ATAPI_DMACK
1091 #define P_ATAPI_DMACK P_UNDEF
1092 #endif
1093
1094 #ifndef P_ATAPI_DMARQ
1095 #define P_ATAPI_DMARQ P_UNDEF
1096 #endif
1097
1098 #ifndef P_ATAPI_INTRQ
1099 #define P_ATAPI_INTRQ P_UNDEF
1100 #endif
1101
1102 #ifndef P_ATAPI_IORDY
1103 #define P_ATAPI_IORDY P_UNDEF
1104 #endif
1105
1106 #ifndef P_AMC_BR
1107 #define P_AMC_BR P_UNDEF
1108 #endif
1109
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1111 #define P_AMC_BG P_UNDEF
1112 #endif
1113
1114 #ifndef P_AMC_BGH
1115 #define P_AMC_BGH P_UNDEF
1116 #endif
1117
1118 /* EMAC */
1119
1120 #ifndef P_MII0_ETxD0
1121 #define P_MII0_ETxD0 P_UNDEF
1122 #endif
1123
1124 #ifndef P_MII0_ETxD1
1125 #define P_MII0_ETxD1 P_UNDEF
1126 #endif
1127
1128 #ifndef P_MII0_ETxD2
1129 #define P_MII0_ETxD2 P_UNDEF
1130 #endif
1131
1132 #ifndef P_MII0_ETxD3
1133 #define P_MII0_ETxD3 P_UNDEF
1134 #endif
1135
1136 #ifndef P_MII0_ETxEN
1137 #define P_MII0_ETxEN P_UNDEF
1138 #endif
1139
1140 #ifndef P_MII0_TxCLK
1141 #define P_MII0_TxCLK P_UNDEF
1142 #endif
1143
1144 #ifndef P_MII0_PHYINT
1145 #define P_MII0_PHYINT P_UNDEF
1146 #endif
1147
1148 #ifndef P_MII0_COL
1149 #define P_MII0_COL P_UNDEF
1150 #endif
1151
1152 #ifndef P_MII0_ERxD0
1153 #define P_MII0_ERxD0 P_UNDEF
1154 #endif
1155
1156 #ifndef P_MII0_ERxD1
1157 #define P_MII0_ERxD1 P_UNDEF
1158 #endif
1159
1160 #ifndef P_MII0_ERxD2
1161 #define P_MII0_ERxD2 P_UNDEF
1162 #endif
1163
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1165 #define P_MII0_ERxD3 P_UNDEF
1166 #endif
1167
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1169 #define P_MII0_ERxDV P_UNDEF
1170 #endif
1171
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1173 #define P_MII0_ERxCLK P_UNDEF
1174 #endif
1175
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1177 #define P_MII0_ERxER P_UNDEF
1178 #endif
1179
1180 #ifndef P_MII0_CRS
1181 #define P_MII0_CRS P_UNDEF
1182 #endif
1183
1184 #ifndef P_RMII0_REF_CLK
1185 #define P_RMII0_REF_CLK P_UNDEF
1186 #endif
1187
1188 #ifndef P_RMII0_MDINT
1189 #define P_RMII0_MDINT P_UNDEF
1190 #endif
1191
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1193 #define P_RMII0_CRS_DV P_UNDEF
1194 #endif
1195
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1197 #define P_MDC P_UNDEF
1198 #endif
1199
1200 #ifndef P_MDIO
1201 #define P_MDIO P_UNDEF
1202 #endif
1203
1204 #endif                          /* _PORTMUX_H_ */