drivers/accel/habanalabs/include/goya/asic_reg/tpc6_cmdq_regs.h

   1 /* SPDX-License-Identifier: GPL-2.0
   2  *
   3  * Copyright 2016-2018 HabanaLabs, Ltd.
   4  * All Rights Reserved.
   5  *
   6  */
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   8 /************************************
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  10  **       DO NOT EDIT BELOW        **
  11  ************************************/
  12
  13 #ifndef ASIC_REG_TPC6_CMDQ_REGS_H_
  14 #define ASIC_REG_TPC6_CMDQ_REGS_H_
  15
  16 /*
  17  *****************************************
  18  *   TPC6_CMDQ (Prototype: CMDQ)
  19  *****************************************
  20  */
  21
  22 #define mmTPC6_CMDQ_GLBL_CFG0                                        0xF89000
  23
  24 #define mmTPC6_CMDQ_GLBL_CFG1                                        0xF89004
  25
  26 #define mmTPC6_CMDQ_GLBL_PROT                                        0xF89008
  27
  28 #define mmTPC6_CMDQ_GLBL_ERR_CFG                                     0xF8900C
  29
  30 #define mmTPC6_CMDQ_GLBL_ERR_ADDR_LO                                 0xF89010
  31
  32 #define mmTPC6_CMDQ_GLBL_ERR_ADDR_HI                                 0xF89014
  33
  34 #define mmTPC6_CMDQ_GLBL_ERR_WDATA                                   0xF89018
  35
  36 #define mmTPC6_CMDQ_GLBL_SECURE_PROPS                                0xF8901C
  37
  38 #define mmTPC6_CMDQ_GLBL_NON_SECURE_PROPS                            0xF89020
  39
  40 #define mmTPC6_CMDQ_GLBL_STS0                                        0xF89024
  41
  42 #define mmTPC6_CMDQ_GLBL_STS1                                        0xF89028
  43
  44 #define mmTPC6_CMDQ_CQ_CFG0                                          0xF890B0
  45
  46 #define mmTPC6_CMDQ_CQ_CFG1                                          0xF890B4
  47
  48 #define mmTPC6_CMDQ_CQ_ARUSER                                        0xF890B8
  49
  50 #define mmTPC6_CMDQ_CQ_PTR_LO                                        0xF890C0
  51
  52 #define mmTPC6_CMDQ_CQ_PTR_HI                                        0xF890C4
  53
  54 #define mmTPC6_CMDQ_CQ_TSIZE                                         0xF890C8
  55
  56 #define mmTPC6_CMDQ_CQ_CTL                                           0xF890CC
  57
  58 #define mmTPC6_CMDQ_CQ_PTR_LO_STS                                    0xF890D4
  59
  60 #define mmTPC6_CMDQ_CQ_PTR_HI_STS                                    0xF890D8
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  62 #define mmTPC6_CMDQ_CQ_TSIZE_STS                                     0xF890DC
  63
  64 #define mmTPC6_CMDQ_CQ_CTL_STS                                       0xF890E0
  65
  66 #define mmTPC6_CMDQ_CQ_STS0                                          0xF890E4
  67
  68 #define mmTPC6_CMDQ_CQ_STS1                                          0xF890E8
  69
  70 #define mmTPC6_CMDQ_CQ_RD_RATE_LIM_EN                                0xF890F0
  71
  72 #define mmTPC6_CMDQ_CQ_RD_RATE_LIM_RST_TOKEN                         0xF890F4
  73
  74 #define mmTPC6_CMDQ_CQ_RD_RATE_LIM_SAT                               0xF890F8
  75
  76 #define mmTPC6_CMDQ_CQ_RD_RATE_LIM_TOUT                              0xF890FC
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  78 #define mmTPC6_CMDQ_CQ_IFIFO_CNT                                     0xF89108
  79
  80 #define mmTPC6_CMDQ_CP_MSG_BASE0_ADDR_LO                             0xF89120
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  82 #define mmTPC6_CMDQ_CP_MSG_BASE0_ADDR_HI                             0xF89124
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  84 #define mmTPC6_CMDQ_CP_MSG_BASE1_ADDR_LO                             0xF89128
  85
  86 #define mmTPC6_CMDQ_CP_MSG_BASE1_ADDR_HI                             0xF8912C
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  88 #define mmTPC6_CMDQ_CP_MSG_BASE2_ADDR_LO                             0xF89130
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  90 #define mmTPC6_CMDQ_CP_MSG_BASE2_ADDR_HI                             0xF89134
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  92 #define mmTPC6_CMDQ_CP_MSG_BASE3_ADDR_LO                             0xF89138
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  94 #define mmTPC6_CMDQ_CP_MSG_BASE3_ADDR_HI                             0xF8913C
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  96 #define mmTPC6_CMDQ_CP_LDMA_TSIZE_OFFSET                             0xF89140
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  98 #define mmTPC6_CMDQ_CP_LDMA_SRC_BASE_LO_OFFSET                       0xF89144
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 100 #define mmTPC6_CMDQ_CP_LDMA_SRC_BASE_HI_OFFSET                       0xF89148
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 102 #define mmTPC6_CMDQ_CP_LDMA_DST_BASE_LO_OFFSET                       0xF8914C
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 104 #define mmTPC6_CMDQ_CP_LDMA_DST_BASE_HI_OFFSET                       0xF89150
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 106 #define mmTPC6_CMDQ_CP_LDMA_COMMIT_OFFSET                            0xF89154
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 108 #define mmTPC6_CMDQ_CP_FENCE0_RDATA                                  0xF89158
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 110 #define mmTPC6_CMDQ_CP_FENCE1_RDATA                                  0xF8915C
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 112 #define mmTPC6_CMDQ_CP_FENCE2_RDATA                                  0xF89160
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 114 #define mmTPC6_CMDQ_CP_FENCE3_RDATA                                  0xF89164
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 116 #define mmTPC6_CMDQ_CP_FENCE0_CNT                                    0xF89168
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 118 #define mmTPC6_CMDQ_CP_FENCE1_CNT                                    0xF8916C
 119
 120 #define mmTPC6_CMDQ_CP_FENCE2_CNT                                    0xF89170
 121
 122 #define mmTPC6_CMDQ_CP_FENCE3_CNT                                    0xF89174
 123
 124 #define mmTPC6_CMDQ_CP_STS                                           0xF89178
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 126 #define mmTPC6_CMDQ_CP_CURRENT_INST_LO                               0xF8917C
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 128 #define mmTPC6_CMDQ_CP_CURRENT_INST_HI                               0xF89180
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 130 #define mmTPC6_CMDQ_CP_BARRIER_CFG                                   0xF89184
 131
 132 #define mmTPC6_CMDQ_CP_DBG_0                                         0xF89188
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 134 #define mmTPC6_CMDQ_CQ_BUF_ADDR                                      0xF89308
 135
 136 #define mmTPC6_CMDQ_CQ_BUF_RDATA                                     0xF8930C
 137
 138 #endif /* ASIC_REG_TPC6_CMDQ_REGS_H_ */