llvm/test/CodeGen/RISCV/rvv/vfwcvtbf16-f-f.ll

   1 ; NOTE: Assertions have been autogenerated by utils/update_llc_test_checks.py
   2 ; RUN: sed 's/iXLen/i32/g' %s | llc -mtriple=riscv32 -mattr=+v,+experimental-zvfbfmin \
   3 ; RUN:   -verify-machineinstrs -target-abi=ilp32d | FileCheck %s
   4 ; RUN: sed 's/iXLen/i64/g' %s | llc -mtriple=riscv64 -mattr=+v,+experimental-zvfbfmin \
   5 ; RUN:   -verify-machineinstrs -target-abi=lp64d | FileCheck %s
   6
   7 declare <vscale x 1 x float> @llvm.riscv.vfwcvtbf16.f.f.v.nxv1f32.nxv1bf16(
   8   <vscale x 1 x float>,
   9   <vscale x 1 x bfloat>,
  10   iXLen);
  11
  12 define <vscale x 1 x float> @intrinsic_vfwcvtbf16_f.f.v_nxv1f32_nxv1bf16(<vscale x 1 x bfloat> %0, iXLen %1) nounwind {
  13 ; CHECK-LABEL: intrinsic_vfwcvtbf16_f.f.v_nxv1f32_nxv1bf16:
  14 ; CHECK:       # %bb.0: # %entry
  15 ; CHECK-NEXT:    vsetvli zero, a0, e16, mf4, ta, ma
  16 ; CHECK-NEXT:    vfwcvtbf16.f.f.v v9, v8
  17 ; CHECK-NEXT:    vmv1r.v v8, v9
  18 ; CHECK-NEXT:    ret
  19 entry:
  20   %a = call <vscale x 1 x float> @llvm.riscv.vfwcvtbf16.f.f.v.nxv1f32.nxv1bf16(
  21     <vscale x 1 x float> undef,
  22     <vscale x 1 x bfloat> %0,
  23     iXLen %1)
  24
  25   ret <vscale x 1 x float> %a
  26 }
  27
  28 declare <vscale x 1 x float> @llvm.riscv.vfwcvtbf16.f.f.v.mask.nxv1f32.nxv1bf16(
  29   <vscale x 1 x float>,
  30   <vscale x 1 x bfloat>,
  31   <vscale x 1 x i1>,
  32   iXLen,
  33   iXLen);
  34
  35 define <vscale x 1 x float> @intrinsic_vfwcvtbf16_mask_f.f.v_nxv1f32_nxv1bf16(<vscale x 1 x float> %0, <vscale x 1 x bfloat> %1, <vscale x 1 x i1> %2, iXLen %3) nounwind {
  36 ; CHECK-LABEL: intrinsic_vfwcvtbf16_mask_f.f.v_nxv1f32_nxv1bf16:
  37 ; CHECK:       # %bb.0: # %entry
  38 ; CHECK-NEXT:    vsetvli zero, a0, e16, mf4, ta, mu
  39 ; CHECK-NEXT:    vfwcvtbf16.f.f.v v8, v9, v0.t
  40 ; CHECK-NEXT:    ret
  41 entry:
  42   %a = call <vscale x 1 x float> @llvm.riscv.vfwcvtbf16.f.f.v.mask.nxv1f32.nxv1bf16(
  43     <vscale x 1 x float> %0,
  44     <vscale x 1 x bfloat> %1,
  45     <vscale x 1 x i1> %2,
  46     iXLen %3, iXLen 1)
  47
  48   ret <vscale x 1 x float> %a
  49 }
  50
  51 declare <vscale x 2 x float> @llvm.riscv.vfwcvtbf16.f.f.v.nxv2f32.nxv2bf16(
  52   <vscale x 2 x float>,
  53   <vscale x 2 x bfloat>,
  54   iXLen);
  55
  56 define <vscale x 2 x float> @intrinsic_vfwcvtbf16_f.f.v_nxv2f32_nxv2bf16(<vscale x 2 x bfloat> %0, iXLen %1) nounwind {
  57 ; CHECK-LABEL: intrinsic_vfwcvtbf16_f.f.v_nxv2f32_nxv2bf16:
  58 ; CHECK:       # %bb.0: # %entry
  59 ; CHECK-NEXT:    vsetvli zero, a0, e16, mf2, ta, ma
  60 ; CHECK-NEXT:    vfwcvtbf16.f.f.v v9, v8
  61 ; CHECK-NEXT:    vmv1r.v v8, v9
  62 ; CHECK-NEXT:    ret
  63 entry:
  64   %a = call <vscale x 2 x float> @llvm.riscv.vfwcvtbf16.f.f.v.nxv2f32.nxv2bf16(
  65     <vscale x 2 x float> undef,
  66     <vscale x 2 x bfloat> %0,
  67     iXLen %1)
  68
  69   ret <vscale x 2 x float> %a
  70 }
  71
  72 declare <vscale x 2 x float> @llvm.riscv.vfwcvtbf16.f.f.v.mask.nxv2f32.nxv2bf16(
  73   <vscale x 2 x float>,
  74   <vscale x 2 x bfloat>,
  75   <vscale x 2 x i1>,
  76   iXLen,
  77   iXLen);
  78
  79 define <vscale x 2 x float> @intrinsic_vfwcvtbf16_mask_f.f.v_nxv2f32_nxv2bf16(<vscale x 2 x float> %0, <vscale x 2 x bfloat> %1, <vscale x 2 x i1> %2, iXLen %3) nounwind {
  80 ; CHECK-LABEL: intrinsic_vfwcvtbf16_mask_f.f.v_nxv2f32_nxv2bf16:
  81 ; CHECK:       # %bb.0: # %entry
  82 ; CHECK-NEXT:    vsetvli zero, a0, e16, mf2, ta, mu
  83 ; CHECK-NEXT:    vfwcvtbf16.f.f.v v8, v9, v0.t
  84 ; CHECK-NEXT:    ret
  85 entry:
  86   %a = call <vscale x 2 x float> @llvm.riscv.vfwcvtbf16.f.f.v.mask.nxv2f32.nxv2bf16(
  87     <vscale x 2 x float> %0,
  88     <vscale x 2 x bfloat> %1,
  89     <vscale x 2 x i1> %2,
  90     iXLen %3, iXLen 1)
  91
  92   ret <vscale x 2 x float> %a
  93 }
  94
  95 declare <vscale x 4 x float> @llvm.riscv.vfwcvtbf16.f.f.v.nxv4f32.nxv4bf16(
  96   <vscale x 4 x float>,
  97   <vscale x 4 x bfloat>,
  98   iXLen);
  99
 100 define <vscale x 4 x float> @intrinsic_vfwcvtbf16_f.f.v_nxv4f32_nxv4bf16(<vscale x 4 x bfloat> %0, iXLen %1) nounwind {
 101 ; CHECK-LABEL: intrinsic_vfwcvtbf16_f.f.v_nxv4f32_nxv4bf16:
 102 ; CHECK:       # %bb.0: # %entry
 103 ; CHECK-NEXT:    vsetvli zero, a0, e16, m1, ta, ma
 104 ; CHECK-NEXT:    vfwcvtbf16.f.f.v v10, v8
 105 ; CHECK-NEXT:    vmv2r.v v8, v10
 106 ; CHECK-NEXT:    ret
 107 entry:
 108   %a = call <vscale x 4 x float> @llvm.riscv.vfwcvtbf16.f.f.v.nxv4f32.nxv4bf16(
 109     <vscale x 4 x float> undef,
 110     <vscale x 4 x bfloat> %0,
 111     iXLen %1)
 112
 113   ret <vscale x 4 x float> %a
 114 }
 115
 116 declare <vscale x 4 x float> @llvm.riscv.vfwcvtbf16.f.f.v.mask.nxv4f32.nxv4bf16(
 117   <vscale x 4 x float>,
 118   <vscale x 4 x bfloat>,
 119   <vscale x 4 x i1>,
 120   iXLen,
 121   iXLen);
 122
 123 define <vscale x 4 x float> @intrinsic_vfwcvtbf16_mask_f.f.v_nxv4f32_nxv4bf16(<vscale x 4 x float> %0, <vscale x 4 x bfloat> %1, <vscale x 4 x i1> %2, iXLen %3) nounwind {
 124 ; CHECK-LABEL: intrinsic_vfwcvtbf16_mask_f.f.v_nxv4f32_nxv4bf16:
 125 ; CHECK:       # %bb.0: # %entry
 126 ; CHECK-NEXT:    vsetvli zero, a0, e16, m1, ta, mu
 127 ; CHECK-NEXT:    vfwcvtbf16.f.f.v v8, v10, v0.t
 128 ; CHECK-NEXT:    ret
 129 entry:
 130   %a = call <vscale x 4 x float> @llvm.riscv.vfwcvtbf16.f.f.v.mask.nxv4f32.nxv4bf16(
 131     <vscale x 4 x float> %0,
 132     <vscale x 4 x bfloat> %1,
 133     <vscale x 4 x i1> %2,
 134     iXLen %3, iXLen 1)
 135
 136   ret <vscale x 4 x float> %a
 137 }
 138
 139 declare <vscale x 8 x float> @llvm.riscv.vfwcvtbf16.f.f.v.nxv8f32.nxv8bf16(
 140   <vscale x 8 x float>,
 141   <vscale x 8 x bfloat>,
 142   iXLen);
 143
 144 define <vscale x 8 x float> @intrinsic_vfwcvtbf16_f.f.v_nxv8f32_nxv8bf16(<vscale x 8 x bfloat> %0, iXLen %1) nounwind {
 145 ; CHECK-LABEL: intrinsic_vfwcvtbf16_f.f.v_nxv8f32_nxv8bf16:
 146 ; CHECK:       # %bb.0: # %entry
 147 ; CHECK-NEXT:    vsetvli zero, a0, e16, m2, ta, ma
 148 ; CHECK-NEXT:    vfwcvtbf16.f.f.v v12, v8
 149 ; CHECK-NEXT:    vmv4r.v v8, v12
 150 ; CHECK-NEXT:    ret
 151 entry:
 152   %a = call <vscale x 8 x float> @llvm.riscv.vfwcvtbf16.f.f.v.nxv8f32.nxv8bf16(
 153     <vscale x 8 x float> undef,
 154     <vscale x 8 x bfloat> %0,
 155     iXLen %1)
 156
 157   ret <vscale x 8 x float> %a
 158 }
 159
 160 declare <vscale x 8 x float> @llvm.riscv.vfwcvtbf16.f.f.v.mask.nxv8f32.nxv8bf16(
 161   <vscale x 8 x float>,
 162   <vscale x 8 x bfloat>,
 163   <vscale x 8 x i1>,
 164   iXLen,
 165   iXLen);
 166
 167 define <vscale x 8 x float> @intrinsic_vfwcvtbf16_mask_f.f.v_nxv8f32_nxv8bf16(<vscale x 8 x float> %0, <vscale x 8 x bfloat> %1, <vscale x 8 x i1> %2, iXLen %3) nounwind {
 168 ; CHECK-LABEL: intrinsic_vfwcvtbf16_mask_f.f.v_nxv8f32_nxv8bf16:
 169 ; CHECK:       # %bb.0: # %entry
 170 ; CHECK-NEXT:    vsetvli zero, a0, e16, m2, ta, mu
 171 ; CHECK-NEXT:    vfwcvtbf16.f.f.v v8, v12, v0.t
 172 ; CHECK-NEXT:    ret
 173 entry:
 174   %a = call <vscale x 8 x float> @llvm.riscv.vfwcvtbf16.f.f.v.mask.nxv8f32.nxv8bf16(
 175     <vscale x 8 x float> %0,
 176     <vscale x 8 x bfloat> %1,
 177     <vscale x 8 x i1> %2,
 178     iXLen %3, iXLen 1)
 179
 180   ret <vscale x 8 x float> %a
 181 }
 182
 183 declare <vscale x 16 x float> @llvm.riscv.vfwcvtbf16.f.f.v.nxv16f32.nxv16bf16(
 184   <vscale x 16 x float>,
 185   <vscale x 16 x bfloat>,
 186   iXLen);
 187
 188 define <vscale x 16 x float> @intrinsic_vfwcvtbf16_f.f.v_nxv16f32_nxv16bf16(<vscale x 16 x bfloat> %0, iXLen %1) nounwind {
 189 ; CHECK-LABEL: intrinsic_vfwcvtbf16_f.f.v_nxv16f32_nxv16bf16:
 190 ; CHECK:       # %bb.0: # %entry
 191 ; CHECK-NEXT:    vsetvli zero, a0, e16, m4, ta, ma
 192 ; CHECK-NEXT:    vfwcvtbf16.f.f.v v16, v8
 193 ; CHECK-NEXT:    vmv8r.v v8, v16
 194 ; CHECK-NEXT:    ret
 195 entry:
 196   %a = call <vscale x 16 x float> @llvm.riscv.vfwcvtbf16.f.f.v.nxv16f32.nxv16bf16(
 197     <vscale x 16 x float> undef,
 198     <vscale x 16 x bfloat> %0,
 199     iXLen %1)
 200
 201   ret <vscale x 16 x float> %a
 202 }
 203
 204 declare <vscale x 16 x float> @llvm.riscv.vfwcvtbf16.f.f.v.mask.nxv16f32.nxv16bf16(
 205   <vscale x 16 x float>,
 206   <vscale x 16 x bfloat>,
 207   <vscale x 16 x i1>,
 208   iXLen,
 209   iXLen);
 210
 211 define <vscale x 16 x float> @intrinsic_vfwcvtbf16_mask_f.f.v_nxv16f32_nxv16bf16(<vscale x 16 x float> %0, <vscale x 16 x bfloat> %1, <vscale x 16 x i1> %2, iXLen %3) nounwind {
 212 ; CHECK-LABEL: intrinsic_vfwcvtbf16_mask_f.f.v_nxv16f32_nxv16bf16:
 213 ; CHECK:       # %bb.0: # %entry
 214 ; CHECK-NEXT:    vsetvli zero, a0, e16, m4, ta, mu
 215 ; CHECK-NEXT:    vfwcvtbf16.f.f.v v8, v16, v0.t
 216 ; CHECK-NEXT:    ret
 217 entry:
 218   %a = call <vscale x 16 x float> @llvm.riscv.vfwcvtbf16.f.f.v.mask.nxv16f32.nxv16bf16(
 219     <vscale x 16 x float> %0,
 220     <vscale x 16 x bfloat> %1,
 221     <vscale x 16 x i1> %2,
 222     iXLen %3, iXLen 1)
 223
 224   ret <vscale x 16 x float> %a
 225 }