llvm/test/CodeGen/ARM/lsr-scale-addr-mode.ll

   1 ; RUN: llc -mtriple=arm-eabi %s -o - | FileCheck %s
   2 ; Should use scaled addressing mode.
   3
   4 ; RUN: llc -mtriple=arm-eabi -mcpu=cortex-a53 %s -o - | FileCheck %s -check-prefix CHECK-NONEGOFF
   5 ; RUN: llc -mtriple=arm-eabi -mcpu=cortex-a57 %s -o - | FileCheck %s -check-prefix CHECK-NONEGOFF
   6 ; RUN: llc -mtriple=arm-eabi -mcpu=cortex-r52 %s -o - | FileCheck %s -check-prefix CHECK-NONEGOFF
   7 ; RUN: llc -mtriple=arm-eabi -mcpu=cortex-r52plus %s -o - | FileCheck %s -check-prefix CHECK-NONEGOFF
   8 ; Should not generate negated register offset
   9
  10 define void @sintzero(ptr %a) nounwind {
  11 entry:
  12         store i32 0, ptr %a
  13         br label %cond_next
  14
  15 cond_next:              ; preds = %cond_next, %entry
  16         %indvar = phi i32 [ 0, %entry ], [ %tmp25, %cond_next ]         ; <i32> [#uses=1]
  17         %tmp25 = add i32 %indvar, 1             ; <i32> [#uses=3]
  18         %tmp36 = getelementptr i32, ptr %a, i32 %tmp25          ; <ptr> [#uses=1]
  19         store i32 0, ptr %tmp36
  20         icmp eq i32 %tmp25, -1          ; <i1>:0 [#uses=1]
  21         br i1 %0, label %return, label %cond_next
  22
  23 return:         ; preds = %cond_next
  24         ret void
  25 }
  26
  27 ; CHECK: lsl{{.*}}#2]
  28 ; CHECK-NONEGOFF: [{{r[0-9]+}}, {{r[0-9]+}}, lsl{{.*}}#2]
  29