llvm/test/CodeGen/Hexagon/alu64.ll

   1 ; RUN: llc -march=hexagon -O0 < %s | FileCheck %s
   2
   3 ; CHECK-LABEL: @test00
   4 ; CHECK: = cmp.eq(r1:0,r3:2)
   5 define i32 @test00(i64 %Rs, i64 %Rt) #0 {
   6 entry:
   7   %0 = tail call i32 @llvm.hexagon.C2.cmpeqp(i64 %Rs, i64 %Rt)
   8   ret i32 %0
   9 }
  10
  11 ; CHECK-LABEL: @test01
  12 ; CHECK: = cmp.gt(r1:0,r3:2)
  13 define i32 @test01(i64 %Rs, i64 %Rt) #0 {
  14 entry:
  15   %0 = tail call i32 @llvm.hexagon.C2.cmpgtp(i64 %Rs, i64 %Rt)
  16   ret i32 %0
  17 }
  18
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  21 define i32 @test02(i64 %Rs, i64 %Rt) #0 {
  22 entry:
  23   %0 = tail call i32 @llvm.hexagon.C2.cmpgtup(i64 %Rs, i64 %Rt)
  24   ret i32 %0
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  26
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  28 ; CHECK: = cmp.eq(r0,r1)
  29 define i32 @test10(i32 %Rs, i32 %Rt) #0 {
  30 entry:
  31   %0 = tail call i32 @llvm.hexagon.A4.rcmpeq(i32 %Rs, i32 %Rt)
  32   ret i32 %0
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  37 define i32 @test11(i32 %Rs, i32 %Rt) #0 {
  38 entry:
  39   %0 = tail call i32 @llvm.hexagon.A4.rcmpneq(i32 %Rs, i32 %Rt)
  40   ret i32 %0
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  45 define i32 @test12(i32 %Rs) #0 {
  46 entry:
  47   %0 = tail call i32 @llvm.hexagon.A4.rcmpeqi(i32 %Rs, i32 23)
  48   ret i32 %0
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  53 define i32 @test13(i32 %Rs) #0 {
  54 entry:
  55   %0 = tail call i32 @llvm.hexagon.A4.rcmpneqi(i32 %Rs, i32 47)
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  61 define i32 @test20(i32 %Rs, i32 %Rt) #0 {
  62 entry:
  63   %0 = tail call i32 @llvm.hexagon.A4.cmpbeq(i32 %Rs, i32 %Rt)
  64   ret i32 %0
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  69 define i32 @test21(i32 %Rs, i32 %Rt) #0 {
  70 entry:
  71   %0 = tail call i32 @llvm.hexagon.A4.cmpbgt(i32 %Rs, i32 %Rt)
  72   ret i32 %0
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  77 define i32 @test22(i32 %Rs, i32 %Rt) #0 {
  78 entry:
  79   %0 = tail call i32 @llvm.hexagon.A4.cmpbgtu(i32 %Rs, i32 %Rt)
  80   ret i32 %0
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  85 define i32 @test23(i32 %Rs) #0 {
  86 entry:
  87   %0 = tail call i32 @llvm.hexagon.A4.cmpbeqi(i32 %Rs, i32 56)
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  93 define i32 @test24(i32 %Rs) #0 {
  94 entry:
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 101 define i32 @test25(i32 %Rs) #0 {
 102 entry:
 103   %0 = tail call i32 @llvm.hexagon.A4.cmpbgtui(i32 %Rs, i32 111)
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 110 entry:
 111   %0 = tail call i32 @llvm.hexagon.A4.cmpheq(i32 %Rs, i32 %Rt)
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 118 entry:
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 133 define i32 @test33(i32 %Rs) #0 {
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 141 define i32 @test34(i32 %Rs) #0 {
 142 entry:
 143   %0 = tail call i32 @llvm.hexagon.A4.cmphgti(i32 %Rs, i32 -3)
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 157 define i64 @test40(i32 %Pu, i64 %Rs, i64 %Rt) #0 {
 158 entry:
 159   %0 = tail call i64 @llvm.hexagon.C2.vmux(i32 %Pu, i64 %Rs, i64 %Rt)
 160   ret i64 %0
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 166 entry:
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 174 entry:
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 181 define i64 @test51(i64 %Rs, i64 %Rt) #0 {
 182 entry:
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 198 entry:
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 206 entry:
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 270 entry:
 271   %0 = tail call i32 @llvm.hexagon.A2.addh.l16.sat.hl(i32 %Rs, i32 %Rt)
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 286 entry:
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 294 entry:
 295   %0 = tail call i32 @llvm.hexagon.A2.addh.h16.hl(i32 %Rs, i32 %Rt)
 296   ret i32 %0
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 301 define i32 @test67(i32 %Rs, i32 %Rt) #0 {
 302 entry:
 303   %0 = tail call i32 @llvm.hexagon.A2.addh.h16.hh(i32 %Rs, i32 %Rt)
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 342 entry:
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 350 entry:
 351   %0 = tail call i32 @llvm.hexagon.A2.subh.l16.hl(i32 %Rs, i32 %Rt)
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 358 entry:
 359   %0 = tail call i32 @llvm.hexagon.A2.subh.l16.sat.ll(i32 %Rs, i32 %Rt)
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 362
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 366 entry:
 367   %0 = tail call i32 @llvm.hexagon.A2.subh.l16.sat.hl(i32 %Rs, i32 %Rt)
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 370
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 373 define i32 @test74(i32 %Rs, i32 %Rt) #0 {
 374 entry:
 375   %0 = tail call i32 @llvm.hexagon.A2.subh.h16.ll(i32 %Rs, i32 %Rt)
 376   ret i32 %0
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 378
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 382 entry:
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 386
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 389 define i32 @test76(i32 %Rs, i32 %Rt) #0 {
 390 entry:
 391   %0 = tail call i32 @llvm.hexagon.A2.subh.h16.hl(i32 %Rs, i32 %Rt)
 392   ret i32 %0
 393 }
 394
 395 ; CHECK-LABEL: @test77
 396 ; CHECK: = sub(r0.h,r1.h):<<16
 397 define i32 @test77(i32 %Rs, i32 %Rt) #0 {
 398 entry:
 399   %0 = tail call i32 @llvm.hexagon.A2.subh.h16.hh(i32 %Rs, i32 %Rt)
 400   ret i32 %0
 401 }
 402
 403 ; CHECK-LABEL: @test78
 404 ; CHECK: = sub(r0.l,r1.l):sat:<<16
 405 define i32 @test78(i32 %Rs, i32 %Rt) #0 {
 406 entry:
 407   %0 = tail call i32 @llvm.hexagon.A2.subh.h16.sat.ll(i32 %Rs, i32 %Rt)
 408   ret i32 %0
 409 }
 410
 411 ; CHECK-LABEL: @test79
 412 ; CHECK: = sub(r0.l,r1.h):sat:<<16
 413 define i32 @test79(i32 %Rs, i32 %Rt) #0 {
 414 entry:
 415   %0 = tail call i32 @llvm.hexagon.A2.subh.h16.sat.lh(i32 %Rs, i32 %Rt)
 416   ret i32 %0
 417 }
 418
 419 ; CHECK-LABEL: @test7A
 420 ; CHECK: = sub(r0.h,r1.l):sat:<<16
 421 define i32 @test7A(i32 %Rs, i32 %Rt) #0 {
 422 entry:
 423   %0 = tail call i32 @llvm.hexagon.A2.subh.h16.sat.hl(i32 %Rs, i32 %Rt)
 424   ret i32 %0
 425 }
 426
 427 ; CHECK-LABEL: @test7B
 428 ; CHECK: = sub(r0.h,r1.h):sat:<<16
 429 define i32 @test7B(i32 %Rs, i32 %Rt) #0 {
 430 entry:
 431   %0 = tail call i32 @llvm.hexagon.A2.subh.h16.sat.hh(i32 %Rs, i32 %Rt)
 432   ret i32 %0
 433 }
 434
 435 ; CHECK-LABEL: @test90
 436 ; CHECK: = and(#1,asl(r0,#2))
 437 define i32 @test90(i32 %Rs) #0 {
 438 entry:
 439   %0 = tail call i32 @llvm.hexagon.S4.andi.asl.ri(i32 1, i32 %Rs, i32 2)
 440   ret i32 %0
 441 }
 442
 443 ; CHECK-LABEL: @test91
 444 ; CHECK: = or(#1,asl(r0,#2))
 445 define i32 @test91(i32 %Rs) #0 {
 446 entry:
 447   %0 = tail call i32 @llvm.hexagon.S4.ori.asl.ri(i32 1, i32 %Rs, i32 2)
 448   ret i32 %0
 449 }
 450
 451 ; CHECK-LABEL: @test92
 452 ; CHECK: = add(#1,asl(r0,#2))
 453 define i32 @test92(i32 %Rs) #0 {
 454 entry:
 455   %0 = tail call i32 @llvm.hexagon.S4.addi.asl.ri(i32 1, i32 %Rs, i32 2)
 456   ret i32 %0
 457 }
 458
 459 ; CHECK-LABEL: @test93
 460 ; CHECK: = sub(#1,asl(r0,#2))
 461 define i32 @test93(i32 %Rs) #0 {
 462 entry:
 463   %0 = tail call i32 @llvm.hexagon.S4.subi.asl.ri(i32 1, i32 %Rs, i32 2)
 464   ret i32 %0
 465 }
 466
 467 ; CHECK-LABEL: @test94
 468 ; CHECK: = and(#1,lsr(r0,#2))
 469 define i32 @test94(i32 %Rs) #0 {
 470 entry:
 471   %0 = tail call i32 @llvm.hexagon.S4.andi.lsr.ri(i32 1, i32 %Rs, i32 2)
 472   ret i32 %0
 473 }
 474
 475 ; CHECK-LABEL: @test95
 476 ; CHECK: = or(#1,lsr(r0,#2))
 477 define i32 @test95(i32 %Rs) #0 {
 478 entry:
 479   %0 = tail call i32 @llvm.hexagon.S4.ori.lsr.ri(i32 1, i32 %Rs, i32 2)
 480   ret i32 %0
 481 }
 482
 483 ; CHECK-LABEL: @test96
 484 ; CHECK: = add(#1,lsr(r0,#2))
 485 define i32 @test96(i32 %Rs) #0 {
 486 entry:
 487   %0 = tail call i32 @llvm.hexagon.S4.addi.lsr.ri(i32 1, i32 %Rs, i32 2)
 488   ret i32 %0
 489 }
 490
 491 ; CHECK-LABEL: @test97
 492 ; CHECK: = sub(#1,lsr(r0,#2))
 493 define i32 @test97(i32 %Rs) #0 {
 494 entry:
 495   %0 = tail call i32 @llvm.hexagon.S4.subi.lsr.ri(i32 1, i32 %Rs, i32 2)
 496   ret i32 %0
 497 }
 498
 499 ; CHECK-LABEL: @test100
 500 ; CHECK: = bitsplit(r0,r1)
 501 define i64 @test100(i32 %Rs, i32 %Rt) #0 {
 502 entry:
 503   %0 = tail call i64 @llvm.hexagon.A4.bitsplit(i32 %Rs, i32 %Rt)
 504   ret i64 %0
 505 }
 506
 507 ; CHECK-LABEL: @test101
 508 ; CHECK: = modwrap(r0,r1)
 509 define i32 @test101(i32 %Rs, i32 %Rt) #0 {
 510 entry:
 511   %0 = tail call i32 @llvm.hexagon.A4.modwrapu(i32 %Rs, i32 %Rt)
 512   ret i32 %0
 513 }
 514
 515 ; CHECK-LABEL: @test102
 516 ; CHECK: = parity(r1:0,r3:2)
 517 define i32 @test102(i64 %Rs, i64 %Rt) #0 {
 518 entry:
 519   %0 = tail call i32 @llvm.hexagon.S2.parityp(i64 %Rs, i64 %Rt)
 520   ret i32 %0
 521 }
 522
 523 ; CHECK-LABEL: @test103
 524 ; CHECK: = parity(r0,r1)
 525 define i32 @test103(i32 %Rs, i32 %Rt) #0 {
 526 entry:
 527   %0 = tail call i32 @llvm.hexagon.S4.parity(i32 %Rs, i32 %Rt)
 528   ret i32 %0
 529 }
 530
 531 declare i32 @llvm.hexagon.C2.cmpeqp(i64, i64) #1
 532 declare i32 @llvm.hexagon.C2.cmpgtp(i64, i64) #1
 533 declare i32 @llvm.hexagon.C2.cmpgtup(i64, i64) #1
 534 declare i32 @llvm.hexagon.A4.rcmpeq(i32, i32) #1
 535 declare i32 @llvm.hexagon.A4.rcmpneq(i32, i32) #1
 536 declare i32 @llvm.hexagon.A4.rcmpeqi(i32, i32) #1
 537 declare i32 @llvm.hexagon.A4.rcmpneqi(i32, i32) #1
 538 declare i32 @llvm.hexagon.A4.cmpbeq(i32, i32) #1
 539 declare i32 @llvm.hexagon.A4.cmpbgt(i32, i32) #1
 540 declare i32 @llvm.hexagon.A4.cmpbgtu(i32, i32) #1
 541 declare i32 @llvm.hexagon.A4.cmpbeqi(i32, i32) #1
 542 declare i32 @llvm.hexagon.A4.cmpbgti(i32, i32) #1
 543 declare i32 @llvm.hexagon.A4.cmpbgtui(i32, i32) #1
 544 declare i32 @llvm.hexagon.A4.cmpheq(i32, i32) #1
 545 declare i32 @llvm.hexagon.A4.cmphgt(i32, i32) #1
 546 declare i32 @llvm.hexagon.A4.cmphgtu(i32, i32) #1
 547 declare i32 @llvm.hexagon.A4.cmpheqi(i32, i32) #1
 548 declare i32 @llvm.hexagon.A4.cmphgti(i32, i32) #1
 549 declare i32 @llvm.hexagon.A4.cmphgtui(i32, i32) #1
 550 declare i64 @llvm.hexagon.C2.vmux(i32, i64, i64) #1
 551 declare i32 @llvm.hexagon.A4.vcmpbeq.any(i64, i64) #1
 552 declare i64 @llvm.hexagon.A2.addp(i64, i64) #1
 553 declare i64 @llvm.hexagon.A2.addpsat(i64, i64) #1
 554 declare i64 @llvm.hexagon.A2.subp(i64, i64) #1
 555 declare i64 @llvm.hexagon.A2.addsp(i32, i64) #1
 556 declare i64 @llvm.hexagon.A2.andp(i64, i64) #1
 557 declare i64 @llvm.hexagon.A2.orp(i64, i64) #1
 558 declare i64 @llvm.hexagon.A2.xorp(i64, i64) #1
 559 declare i64 @llvm.hexagon.A4.ornp(i64, i64) #1
 560 declare i64 @llvm.hexagon.A4.andnp(i64, i64) #1
 561 declare i32 @llvm.hexagon.A2.addh.l16.ll(i32, i32) #1
 562 declare i32 @llvm.hexagon.A2.addh.l16.hl(i32, i32) #1
 563 declare i32 @llvm.hexagon.A2.addh.l16.sat.ll(i32, i32) #1
 564 declare i32 @llvm.hexagon.A2.addh.l16.sat.hl(i32, i32) #1
 565 declare i32 @llvm.hexagon.A2.addh.h16.ll(i32, i32) #1
 566 declare i32 @llvm.hexagon.A2.addh.h16.lh(i32, i32) #1
 567 declare i32 @llvm.hexagon.A2.addh.h16.hl(i32, i32) #1
 568 declare i32 @llvm.hexagon.A2.addh.h16.hh(i32, i32) #1
 569 declare i32 @llvm.hexagon.A2.addh.h16.sat.ll(i32, i32) #1
 570 declare i32 @llvm.hexagon.A2.addh.h16.sat.lh(i32, i32) #1
 571 declare i32 @llvm.hexagon.A2.addh.h16.sat.hl(i32, i32) #1
 572 declare i32 @llvm.hexagon.A2.addh.h16.sat.hh(i32, i32) #1
 573 declare i32 @llvm.hexagon.A2.subh.l16.ll(i32, i32) #1
 574 declare i32 @llvm.hexagon.A2.subh.l16.hl(i32, i32) #1
 575 declare i32 @llvm.hexagon.A2.subh.l16.sat.ll(i32, i32) #1
 576 declare i32 @llvm.hexagon.A2.subh.l16.sat.hl(i32, i32) #1
 577 declare i32 @llvm.hexagon.A2.subh.h16.ll(i32, i32) #1
 578 declare i32 @llvm.hexagon.A2.subh.h16.lh(i32, i32) #1
 579 declare i32 @llvm.hexagon.A2.subh.h16.hl(i32, i32) #1
 580 declare i32 @llvm.hexagon.A2.subh.h16.hh(i32, i32) #1
 581 declare i32 @llvm.hexagon.A2.subh.h16.sat.ll(i32, i32) #1
 582 declare i32 @llvm.hexagon.A2.subh.h16.sat.lh(i32, i32) #1
 583 declare i32 @llvm.hexagon.A2.subh.h16.sat.hl(i32, i32) #1
 584 declare i32 @llvm.hexagon.A2.subh.h16.sat.hh(i32, i32) #1
 585 declare i64 @llvm.hexagon.A4.bitsplit(i32, i32) #1
 586 declare i32 @llvm.hexagon.A4.modwrapu(i32, i32) #1
 587 declare i32 @llvm.hexagon.S2.parityp(i64, i64) #1
 588 declare i32 @llvm.hexagon.S4.parity(i32, i32) #1
 589 declare i32 @llvm.hexagon.S4.andi.asl.ri(i32, i32, i32) #1
 590 declare i32 @llvm.hexagon.S4.ori.asl.ri(i32, i32, i32) #1
 591 declare i32 @llvm.hexagon.S4.addi.asl.ri(i32, i32, i32) #1
 592 declare i32 @llvm.hexagon.S4.subi.asl.ri(i32, i32, i32) #1
 593 declare i32 @llvm.hexagon.S4.andi.lsr.ri(i32, i32, i32) #1
 594 declare i32 @llvm.hexagon.S4.ori.lsr.ri(i32, i32, i32) #1
 595 declare i32 @llvm.hexagon.S4.addi.lsr.ri(i32, i32, i32) #1
 596 declare i32 @llvm.hexagon.S4.subi.lsr.ri(i32, i32, i32) #1
 597
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