llvm/test/CodeGen/RISCV/wide-scalar-shift-legalization.ll

   1 ; NOTE: Assertions have been autogenerated by utils/update_llc_test_checks.py
   2 ; RUN: llc -mtriple=riscv64 -verify-machineinstrs < %s | FileCheck %s -check-prefixes=RV64I
   3 ; RUN: llc -mtriple=riscv32 -verify-machineinstrs < %s | FileCheck %s -check-prefixes=RV32I
   4
   5 define void @lshr_4bytes(ptr %src.ptr, ptr %bitOff.ptr, ptr %dst) nounwind {
   6 ; RV64I-LABEL: lshr_4bytes:
   7 ; RV64I:       # %bb.0:
   8 ; RV64I-NEXT:    lbu a3, 1(a0)
   9 ; RV64I-NEXT:    lbu a4, 0(a0)
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  17 ; RV64I-NEXT:    or a0, a0, a5
  18 ; RV64I-NEXT:    or a0, a0, a3
  19 ; RV64I-NEXT:    srlw a0, a0, a1
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  25 ; RV64I-NEXT:    srli a0, a0, 8
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  27 ; RV64I-NEXT:    ret
  28 ;
  29 ; RV32I-LABEL: lshr_4bytes:
  30 ; RV32I:       # %bb.0:
  31 ; RV32I-NEXT:    lbu a3, 1(a0)
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  59 ; RV32I-NEXT:    ret
  60   %src = load i32, ptr %src.ptr, align 1
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  63   store i32 %res, ptr %dst, align 1
  64   ret void
  65 }
  66 define void @shl_4bytes(ptr %src.ptr, ptr %bitOff.ptr, ptr %dst) nounwind {
  67 ; RV64I-LABEL: shl_4bytes:
  68 ; RV64I:       # %bb.0:
  69 ; RV64I-NEXT:    lbu a3, 1(a0)
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  89 ;
  90 ; RV32I-LABEL: shl_4bytes:
  91 ; RV32I:       # %bb.0:
  92 ; RV32I-NEXT:    lbu a3, 1(a0)
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 106 ; RV32I-NEXT:    slli a3, a3, 8
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 110 ; RV32I-NEXT:    or a1, a1, a5
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 118 ; RV32I-NEXT:    srli a0, a0, 8
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 120 ; RV32I-NEXT:    ret
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 124   store i32 %res, ptr %dst, align 1
 125   ret void
 126 }
 127 define void @ashr_4bytes(ptr %src.ptr, ptr %bitOff.ptr, ptr %dst) nounwind {
 128 ; RV64I-LABEL: ashr_4bytes:
 129 ; RV64I:       # %bb.0:
 130 ; RV64I-NEXT:    lbu a3, 1(a0)
 131 ; RV64I-NEXT:    lbu a4, 0(a0)
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 133 ; RV64I-NEXT:    slli a3, a3, 8
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 149 ; RV64I-NEXT:    ret
 150 ;
 151 ; RV32I-LABEL: ashr_4bytes:
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 153 ; RV32I-NEXT:    lbu a3, 1(a0)
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 185   store i32 %res, ptr %dst, align 1
 186   ret void
 187 }
 188
 189 define void @lshr_8bytes(ptr %src.ptr, ptr %bitOff.ptr, ptr %dst) nounwind {
 190 ; RV64I-LABEL: lshr_8bytes:
 191 ; RV64I:       # %bb.0:
 192 ; RV64I-NEXT:    lbu a3, 1(a0)
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 203 ; RV64I-NEXT:    lbu a5, 4(a0)
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 209 ; RV64I-NEXT:    slli a0, a0, 24
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 253 ;
 254 ; RV32I-LABEL: lshr_8bytes:
 255 ; RV32I:       # %bb.0:
 256 ; RV32I-NEXT:    lbu a3, 5(a0)
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 279 ; RV32I-NEXT:  # %bb.1:
 280 ; RV32I-NEXT:    mv a0, a1
 281 ; RV32I-NEXT:    j .LBB3_3
 282 ; RV32I-NEXT:  .LBB3_2:
 283 ; RV32I-NEXT:    lbu a6, 1(a0)
 284 ; RV32I-NEXT:    lbu a7, 0(a0)
 285 ; RV32I-NEXT:    lbu t0, 2(a0)
 286 ; RV32I-NEXT:    lbu a0, 3(a0)
 287 ; RV32I-NEXT:    slli a6, a6, 8
 288 ; RV32I-NEXT:    or a6, a6, a7
 289 ; RV32I-NEXT:    slli t0, t0, 16
 290 ; RV32I-NEXT:    slli a0, a0, 24
 291 ; RV32I-NEXT:    or a0, a0, t0
 292 ; RV32I-NEXT:    or a0, a0, a6
 293 ; RV32I-NEXT:    srl a0, a0, a5
 294 ; RV32I-NEXT:    not a5, a5
 295 ; RV32I-NEXT:    slli a3, a3, 1
 296 ; RV32I-NEXT:    sll a3, a3, a5
 297 ; RV32I-NEXT:    or a0, a0, a3
 298 ; RV32I-NEXT:  .LBB3_3:
 299 ; RV32I-NEXT:    srai a4, a4, 31
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3024 ; RV64I-NEXT:    sb a6, 22(a2)
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