llvm/test/CodeGen/AMDGPU/llvm.amdgcn.ds.gws.barrier-fastregalloc.ll

   1 ; NOTE: Assertions have been autogenerated by utils/update_llc_test_checks.py
   2 ; RUN: llc -mtriple=amdgcn-mesa-mesa3d -mcpu=gfx900 -O0 -stop-after=postrapseudos -o - -verify-machineinstrs < %s | FileCheck -enable-var-scope -check-prefix=MIR %s
   3
   4
   5 ; MIR-LABEL: name: gws_barrier_offset0{{$}}
   6 ; MIR: BUNDLE implicit{{( killed)?( renamable)?}} $vgpr0, implicit $m0, implicit $exec {
   7 ; MIR-NEXT: DS_GWS_BARRIER renamable $vgpr0, 0, implicit $m0, implicit $exec :: (load (s32) from custom "GWSResource")
   8 ; MIR-NEXT: S_WAITCNT 0
   9 ; MIR-NEXT: }
  10 define amdgpu_kernel void @gws_barrier_offset0(i32 %val) #0 {
  11   call void @llvm.amdgcn.ds.gws.barrier(i32 %val, i32 0)
  12   ret void
  13 }
  14
  15
  16 declare void @llvm.amdgcn.ds.gws.barrier(i32, i32) #1
  17
  18 attributes #0 = { nounwind }
  19 attributes #1 = { convergent inaccessiblememonly nounwind }