llvm/test/CodeGen/AMDGPU/si-scheduler-exports.ll

   1 ; NOTE: Assertions have been autogenerated by utils/update_llc_test_checks.py
   2 ; RUN: llc -mtriple=amdgcn -mcpu=gfx1010 --misched=si -mattr=si-scheduler < %s | FileCheck %s
   3
   4 define amdgpu_gs void @_amdgpu_gs_main() {
   5 ; CHECK-LABEL: _amdgpu_gs_main:
   6 ; CHECK:       ; %bb.0: ; %entry
   7 ; CHECK-NEXT:    v_mov_b32_e32 v0, 0
   8 ; CHECK-NEXT:    s_mov_b32 s0, 0
   9 ; CHECK-NEXT:    s_mov_b32 s1, s0
  10 ; CHECK-NEXT:    s_mov_b32 s2, s0
  11 ; CHECK-NEXT:    v_mov_b32_e32 v1, v0
  12 ; CHECK-NEXT:    v_mov_b32_e32 v2, v0
  13 ; CHECK-NEXT:    v_mov_b32_e32 v3, v0
  14 ; CHECK-NEXT:    s_mov_b32 s3, s0
  15 ; CHECK-NEXT:    exp mrt0 off, off, off, off
  16 ; CHECK-NEXT:    buffer_store_dwordx4 v[0:3], v0, s[0:3], 0 idxen
  17 ; CHECK-NEXT:    s_endpgm
  18 entry:
  19   call void @llvm.amdgcn.exp.f32(i32 0, i32 0, float 0.000000e+00, float 0.000000e+00, float 0.000000e+00, float 0.000000e+00, i1 false, i1 false)
  20   call void @llvm.amdgcn.struct.ptr.buffer.store.v4f32(<4 x float> zeroinitializer, ptr addrspace(8) zeroinitializer, i32 0, i32 0, i32 0, i32 0)
  21   ret void
  22 }
  23
  24 declare void @llvm.amdgcn.exp.f32(i32 immarg, i32 immarg, float, float, float, float, i1 immarg, i1 immarg)
  25 declare void @llvm.amdgcn.struct.ptr.buffer.store.v4f32(<4 x float>, ptr addrspace(8), i32, i32, i32, i32 immarg)