llvm/test/CodeGen/PowerPC/p9-vector-compares-and-counts.ll

   1 ; RUN: llc -mcpu=pwr9 -mtriple=powerpc64le-unknown-linux-gnu \
   2 ; RUN:   -verify-machineinstrs < %s | FileCheck %s
   3
   4 ; Function Attrs: nounwind readnone
   5 define zeroext i32 @testCTZ32(i32 signext %a) {
   6 entry:
   7   %0 = tail call i32 @llvm.cttz.i32(i32 %a, i1 false)
   8   ret i32 %0
   9 ; CHECK-LABEL: testCTZ32
  10 ; CHECK: cnttzw 3, 3
  11 }
  12
  13 ; Function Attrs: nounwind readnone
  14 declare i32 @llvm.cttz.i32(i32, i1)
  15
  16 ; Function Attrs: nounwind readnone
  17 define zeroext i32 @testCTZ64(i64 %a) {
  18 entry:
  19   %0 = tail call i64 @llvm.cttz.i64(i64 %a, i1 false)
  20   %cast = trunc i64 %0 to i32
  21   ret i32 %cast
  22 ; CHECK-LABEL: testCTZ64
  23 ; CHECK: cnttzd 3, 3
  24 }
  25
  26 ; Function Attrs: nounwind readnone
  27 declare i64 @llvm.cttz.i64(i64, i1)
  28
  29 ; Function Attrs: nounwind readnone
  30 define <16 x i8> @testVCMPNEB(<16 x i8> %a, <16 x i8> %b) {
  31 entry:
  32   %0 = tail call <16 x i8> @llvm.ppc.altivec.vcmpneb(<16 x i8> %a, <16 x i8> %b)
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  37
  38 ; Function Attrs: nounwind readnone
  39 declare <16 x i8> @llvm.ppc.altivec.vcmpneb(<16 x i8>, <16 x i8>)
  40
  41 ; Function Attrs: nounwind readnone
  42 define <16 x i8> @testVCMPNEZB(<16 x i8> %a, <16 x i8> %b) {
  43 entry:
  44   %0 = tail call <16 x i8> @llvm.ppc.altivec.vcmpnezb(<16 x i8> %a, <16 x i8> %b)
  45   ret <16 x i8> %0
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  47 ; CHECK: vcmpnezb 2, 2
  48 }
  49
  50 ; Function Attrs: nounwind readnone
  51 declare <16 x i8> @llvm.ppc.altivec.vcmpnezb(<16 x i8>, <16 x i8>)
  52
  53 ; Function Attrs: nounwind readnone
  54 define <8 x i16> @testVCMPNEH(<8 x i16> %a, <8 x i16> %b) {
  55 entry:
  56   %0 = tail call <8 x i16> @llvm.ppc.altivec.vcmpneh(<8 x i16> %a, <8 x i16> %b)
  57   ret <8 x i16> %0
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  59 ; CHECK: vcmpneh 2, 2
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  62 ; Function Attrs: nounwind readnone
  63 declare <8 x i16> @llvm.ppc.altivec.vcmpneh(<8 x i16>, <8 x i16>)
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  65 ; Function Attrs: nounwind readnone
  66 define <8 x i16> @testVCMPNEZH(<8 x i16> %a, <8 x i16> %b) {
  67 entry:
  68   %0 = tail call <8 x i16> @llvm.ppc.altivec.vcmpnezh(<8 x i16> %a, <8 x i16> %b)
  69   ret <8 x i16> %0
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  72 }
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  74 ; Function Attrs: nounwind readnone
  75 declare <8 x i16> @llvm.ppc.altivec.vcmpnezh(<8 x i16>, <8 x i16>)
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  77 ; Function Attrs: nounwind readnone
  78 define <4 x i32> @testVCMPNEW(<4 x i32> %a, <4 x i32> %b) {
  79 entry:
  80   %0 = tail call <4 x i32> @llvm.ppc.altivec.vcmpnew(<4 x i32> %a, <4 x i32> %b)
  81   ret <4 x i32> %0
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  87 declare <4 x i32> @llvm.ppc.altivec.vcmpnew(<4 x i32>, <4 x i32>)
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  90 define <4 x i32> @testVCMPNEZW(<4 x i32> %a, <4 x i32> %b) {
  91 entry:
  92   %0 = tail call <4 x i32> @llvm.ppc.altivec.vcmpnezw(<4 x i32> %a, <4 x i32> %b)
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  99 declare <4 x i32> @llvm.ppc.altivec.vcmpnezw(<4 x i32>, <4 x i32>)
 100
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 102 define <16 x i8> @testVCNTTZB(<16 x i8> %a) {
 103 entry:
 104   %0 = tail call <16 x i8> @llvm.cttz.v16i8(<16 x i8> %a, i1 false)
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 111 define <8 x i16> @testVCNTTZH(<8 x i16> %a) {
 112 entry:
 113   %0 = tail call <8 x i16> @llvm.cttz.v8i16(<8 x i16> %a, i1 false)
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 120 define <4 x i32> @testVCNTTZW(<4 x i32> %a) {
 121 entry:
 122   %0 = tail call <4 x i32> @llvm.cttz.v4i32(<4 x i32> %a, i1 false)
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 129 define <2 x i64> @testVCNTTZD(<2 x i64> %a) {
 130 entry:
 131   %0 = tail call <2 x i64> @llvm.cttz.v2i64(<2 x i64> %a, i1 false)
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 150 define i32 @testVCLZLSBB(<16 x i8> %a) {
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 196   %0 = tail call <1 x i128> @llvm.ppc.altivec.vprtybq(<1 x i128> %a)
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