llvm/test/CodeGen/AMDGPU/shl_add_ptr_global.ll

   1 ; NOTE: Assertions have been autogenerated by utils/update_llc_test_checks.py UTC_ARGS: --version 2
   2 ; RUN: llc -mtriple=amdgcn-amd-amdhsa -mcpu=gfx908 -verify-machineinstrs < %s | FileCheck -enable-var-scope --check-prefix=GCN %s
   3
   4 define void @shl_base_atomicrmw_global_ptr(ptr addrspace(1) %out, ptr addrspace(1) %extra.use, ptr addrspace(1) %ptr) #0 {
   5 ; GCN-LABEL: shl_base_atomicrmw_global_ptr:
   6 ; GCN:       ; %bb.0:
   7 ; GCN-NEXT:    s_waitcnt vmcnt(0) expcnt(0) lgkmcnt(0)
   8 ; GCN-NEXT:    v_lshlrev_b64 v[0:1], 2, v[4:5]
   9 ; GCN-NEXT:    v_mov_b32_e32 v6, 3
  10 ; GCN-NEXT:    s_waitcnt vmcnt(0) lgkmcnt(0)
  11 ; GCN-NEXT:    global_atomic_and v[0:1], v6, off offset:512
  12 ; GCN-NEXT:    s_waitcnt vmcnt(0)
  13 ; GCN-NEXT:    buffer_wbinvl1_vol
  14 ; GCN-NEXT:    v_add_co_u32_e32 v0, vcc, 0x80, v4
  15 ; GCN-NEXT:    v_addc_co_u32_e32 v1, vcc, 0, v5, vcc
  16 ; GCN-NEXT:    global_store_dwordx2 v[2:3], v[0:1], off
  17 ; GCN-NEXT:    s_waitcnt vmcnt(0)
  18 ; GCN-NEXT:    s_setpc_b64 s[30:31]
  19   %arrayidx0 = getelementptr inbounds [512 x i32], ptr addrspace(1) %ptr, i64 0, i64 32
  20   %cast = ptrtoint ptr addrspace(1) %arrayidx0 to i64
  21   %shl = shl i64 %cast, 2
  22   %castback = inttoptr i64 %shl to ptr addrspace(1)
  23   %val = atomicrmw and ptr addrspace(1) %castback, i32 3 syncscope("agent") seq_cst
  24   store volatile i64 %cast, ptr addrspace(1) %extra.use, align 4
  25   ret void
  26 }
  27
  28 define void @shl_base_global_ptr_global_atomic_fadd(ptr addrspace(1) %out, ptr addrspace(1) %extra.use, ptr addrspace(1) %ptr) #0 {
  29 ; GCN-LABEL: shl_base_global_ptr_global_atomic_fadd:
  30 ; GCN:       ; %bb.0:
  31 ; GCN-NEXT:    s_waitcnt vmcnt(0) expcnt(0) lgkmcnt(0)
  32 ; GCN-NEXT:    v_lshlrev_b64 v[0:1], 2, v[4:5]
  33 ; GCN-NEXT:    v_mov_b32_e32 v6, 0x42c80000
  34 ; GCN-NEXT:    global_atomic_add_f32 v[0:1], v6, off offset:512
  35 ; GCN-NEXT:    v_add_co_u32_e32 v0, vcc, 0x80, v4
  36 ; GCN-NEXT:    v_addc_co_u32_e32 v1, vcc, 0, v5, vcc
  37 ; GCN-NEXT:    global_store_dwordx2 v[2:3], v[0:1], off
  38 ; GCN-NEXT:    s_waitcnt vmcnt(0)
  39 ; GCN-NEXT:    s_setpc_b64 s[30:31]
  40   %arrayidx0 = getelementptr inbounds [512 x i32], ptr addrspace(1) %ptr, i64 0, i64 32
  41   %cast = ptrtoint ptr addrspace(1) %arrayidx0 to i64
  42   %shl = shl i64 %cast, 2
  43   %castback = inttoptr i64 %shl to ptr addrspace(1)
  44   call float @llvm.amdgcn.global.atomic.fadd.f32.p1.f32(ptr addrspace(1) %castback, float 100.0)
  45   store volatile i64 %cast, ptr addrspace(1) %extra.use, align 4
  46   ret void
  47 }
  48
  49 declare float @llvm.amdgcn.global.atomic.fadd.f32.p1.f32(ptr addrspace(1) nocapture, float) #1
  50
  51 attributes #0 = { nounwind }
  52 attributes #1 = { argmemonly nounwind willreturn }