2 * This declarations of the PIC18F25K22 MCU.
4 * This file is part of the GNU PIC library for SDCC, originally
5 * created by Molnar Karoly <molnarkaroly@users.sf.net> 2016.
7 * This file is generated automatically by the cinc2h.pl, 2016-04-13 17:23:27 UTC.
9 * SDCC is licensed under the GNU Public license (GPL) v2. Note that
10 * this license covers the code to the compiler and other executables,
11 * but explicitly does not cover any code or objects generated by sdcc.
13 * For pic device libraries and header files which are derived from
14 * Microchip header (.inc) and linker script (.lkr) files Microchip
15 * requires that "The header files should state that they are only to be
16 * used with authentic Microchip devices" which makes them incompatible
17 * with the GPL. Pic device libraries and header files are located at
18 * non-free/lib and non-free/include directories respectively.
19 * Sdcc should be run with the --use-non-free command line option in
20 * order to include non-free header files and libraries.
22 * See http://sdcc.sourceforge.net/ for the latest information on sdcc.
25 #ifndef __PIC18F25K22_H__
26 #define __PIC18F25K22_H__
28 //==============================================================================
30 //==============================================================================
32 // Register Definitions
34 //==============================================================================
37 //==============================================================================
40 extern __at(0x0F38) __sfr ANSELA
;
54 extern __at(0x0F38) volatile __ANSELAbits_t ANSELAbits
;
62 //==============================================================================
65 //==============================================================================
68 extern __at(0x0F39) __sfr ANSELB
;
91 extern __at(0x0F39) volatile __ANSELBbits_t ANSELBbits
;
100 //==============================================================================
103 //==============================================================================
106 extern __at(0x0F3A) __sfr ANSELC
;
120 extern __at(0x0F3A) volatile __ANSELCbits_t ANSELCbits
;
129 //==============================================================================
132 //==============================================================================
135 extern __at(0x0F3D) __sfr PMD2
;
149 extern __at(0x0F3D) volatile __PMD2bits_t PMD2bits
;
156 //==============================================================================
159 //==============================================================================
162 extern __at(0x0F3E) __sfr PMD1
;
172 unsigned MSSP1MD
: 1;
173 unsigned MSSP2MD
: 1;
176 extern __at(0x0F3E) volatile __PMD1bits_t PMD1bits
;
183 #define _MSSP1MD 0x40
184 #define _MSSP2MD 0x80
186 //==============================================================================
189 //==============================================================================
192 extern __at(0x0F3F) __sfr PMD0
;
202 unsigned UART1MD
: 1;
203 unsigned UART2MD
: 1;
206 extern __at(0x0F3F) volatile __PMD0bits_t PMD0bits
;
214 #define _UART1MD 0x40
215 #define _UART2MD 0x80
217 //==============================================================================
220 //==============================================================================
223 extern __at(0x0F40) __sfr DACCON1
;
246 extern __at(0x0F40) volatile __DACCON1bits_t DACCON1bits
;
254 //==============================================================================
257 //==============================================================================
260 extern __at(0x0F40) __sfr VREFCON2
;
283 extern __at(0x0F40) volatile __VREFCON2bits_t VREFCON2bits
;
285 #define _VREFCON2_DACR0 0x01
286 #define _VREFCON2_DACR1 0x02
287 #define _VREFCON2_DACR2 0x04
288 #define _VREFCON2_DACR3 0x08
289 #define _VREFCON2_DACR4 0x10
291 //==============================================================================
294 //==============================================================================
297 extern __at(0x0F41) __sfr DACCON0
;
305 unsigned DACPSS0
: 1;
306 unsigned DACPSS1
: 1;
321 extern __at(0x0F41) volatile __DACCON0bits_t DACCON0bits
;
324 #define _DACPSS0 0x04
325 #define _DACPSS1 0x08
330 //==============================================================================
333 //==============================================================================
336 extern __at(0x0F41) __sfr VREFCON1
;
344 unsigned DACPSS0
: 1;
345 unsigned DACPSS1
: 1;
360 extern __at(0x0F41) volatile __VREFCON1bits_t VREFCON1bits
;
362 #define _VREFCON1_DACNSS 0x01
363 #define _VREFCON1_DACPSS0 0x04
364 #define _VREFCON1_DACPSS1 0x08
365 #define _VREFCON1_DACOE 0x20
366 #define _VREFCON1_DACLPS 0x40
367 #define _VREFCON1_DACEN 0x80
369 //==============================================================================
372 //==============================================================================
375 extern __at(0x0F42) __sfr FVRCON
;
399 extern __at(0x0F42) volatile __FVRCONbits_t FVRCONbits
;
406 //==============================================================================
409 //==============================================================================
412 extern __at(0x0F42) __sfr VREFCON0
;
436 extern __at(0x0F42) volatile __VREFCON0bits_t VREFCON0bits
;
438 #define _VREFCON0_FVRS0 0x10
439 #define _VREFCON0_FVRS1 0x20
440 #define _VREFCON0_FVRST 0x40
441 #define _VREFCON0_FVREN 0x80
443 //==============================================================================
446 //==============================================================================
449 extern __at(0x0F43) __sfr CTMUICON
;
478 extern __at(0x0F43) volatile __CTMUICONbits_t CTMUICONbits
;
489 //==============================================================================
492 //==============================================================================
495 extern __at(0x0F43) __sfr CTMUICONH
;
524 extern __at(0x0F43) volatile __CTMUICONHbits_t CTMUICONHbits
;
526 #define _CTMUICONH_IRNG0 0x01
527 #define _CTMUICONH_IRNG1 0x02
528 #define _CTMUICONH_ITRIM0 0x04
529 #define _CTMUICONH_ITRIM1 0x08
530 #define _CTMUICONH_ITRIM2 0x10
531 #define _CTMUICONH_ITRIM3 0x20
532 #define _CTMUICONH_ITRIM4 0x40
533 #define _CTMUICONH_ITRIM5 0x80
535 //==============================================================================
538 //==============================================================================
541 extern __at(0x0F44) __sfr CTMUCON1
;
547 unsigned EDG1STAT
: 1;
548 unsigned EDG2STAT
: 1;
549 unsigned EDG1SEL0
: 1;
550 unsigned EDG1SEL1
: 1;
551 unsigned EDG1POL
: 1;
552 unsigned EDG2SEL0
: 1;
553 unsigned EDG2SEL1
: 1;
554 unsigned EDG2POL
: 1;
560 unsigned EDG1SEL
: 2;
567 unsigned EDG2SEL
: 2;
572 extern __at(0x0F44) volatile __CTMUCON1bits_t CTMUCON1bits
;
574 #define _EDG1STAT 0x01
575 #define _EDG2STAT 0x02
576 #define _EDG1SEL0 0x04
577 #define _EDG1SEL1 0x08
578 #define _EDG1POL 0x10
579 #define _EDG2SEL0 0x20
580 #define _EDG2SEL1 0x40
581 #define _EDG2POL 0x80
583 //==============================================================================
586 //==============================================================================
589 extern __at(0x0F44) __sfr CTMUCONL
;
595 unsigned EDG1STAT
: 1;
596 unsigned EDG2STAT
: 1;
597 unsigned EDG1SEL0
: 1;
598 unsigned EDG1SEL1
: 1;
599 unsigned EDG1POL
: 1;
600 unsigned EDG2SEL0
: 1;
601 unsigned EDG2SEL1
: 1;
602 unsigned EDG2POL
: 1;
608 unsigned EDG1SEL
: 2;
615 unsigned EDG2SEL
: 2;
620 extern __at(0x0F44) volatile __CTMUCONLbits_t CTMUCONLbits
;
622 #define _CTMUCONL_EDG1STAT 0x01
623 #define _CTMUCONL_EDG2STAT 0x02
624 #define _CTMUCONL_EDG1SEL0 0x04
625 #define _CTMUCONL_EDG1SEL1 0x08
626 #define _CTMUCONL_EDG1POL 0x10
627 #define _CTMUCONL_EDG2SEL0 0x20
628 #define _CTMUCONL_EDG2SEL1 0x40
629 #define _CTMUCONL_EDG2POL 0x80
631 //==============================================================================
634 //==============================================================================
637 extern __at(0x0F45) __sfr CTMUCON0
;
642 unsigned IDISSEN
: 1;
643 unsigned EDGSEQEN
: 1;
646 unsigned CTMUSIDL
: 1;
651 extern __at(0x0F45) volatile __CTMUCON0bits_t CTMUCON0bits
;
654 #define _IDISSEN 0x02
655 #define _EDGSEQEN 0x04
658 #define _CTMUSIDL 0x20
661 //==============================================================================
664 //==============================================================================
667 extern __at(0x0F45) __sfr CTMUCONH
;
672 unsigned IDISSEN
: 1;
673 unsigned EDGSEQEN
: 1;
676 unsigned CTMUSIDL
: 1;
681 extern __at(0x0F45) volatile __CTMUCONHbits_t CTMUCONHbits
;
683 #define _CTMUCONH_CTTRIG 0x01
684 #define _CTMUCONH_IDISSEN 0x02
685 #define _CTMUCONH_EDGSEQEN 0x04
686 #define _CTMUCONH_EDGEN 0x08
687 #define _CTMUCONH_TGEN 0x10
688 #define _CTMUCONH_CTMUSIDL 0x20
689 #define _CTMUCONH_CTMUEN 0x80
691 //==============================================================================
694 //==============================================================================
697 extern __at(0x0F46) __sfr SRCON1
;
711 extern __at(0x0F46) volatile __SRCON1bits_t SRCON1bits
;
722 //==============================================================================
725 //==============================================================================
728 extern __at(0x0F47) __sfr SRCON0
;
752 extern __at(0x0F47) volatile __SRCON0bits_t SRCON0bits
;
763 //==============================================================================
766 //==============================================================================
769 extern __at(0x0F48) __sfr CCPTMRS1
;
775 unsigned C4TSEL0
: 1;
776 unsigned C4TSEL1
: 1;
777 unsigned C5TSEL0
: 1;
778 unsigned C5TSEL1
: 1;
799 extern __at(0x0F48) volatile __CCPTMRS1bits_t CCPTMRS1bits
;
801 #define _C4TSEL0 0x01
802 #define _C4TSEL1 0x02
803 #define _C5TSEL0 0x04
804 #define _C5TSEL1 0x08
806 //==============================================================================
809 //==============================================================================
812 extern __at(0x0F49) __sfr CCPTMRS0
;
818 unsigned C1TSEL0
: 1;
819 unsigned C1TSEL1
: 1;
821 unsigned C2TSEL0
: 1;
822 unsigned C2TSEL1
: 1;
824 unsigned C3TSEL0
: 1;
825 unsigned C3TSEL1
: 1;
848 extern __at(0x0F49) volatile __CCPTMRS0bits_t CCPTMRS0bits
;
850 #define _C1TSEL0 0x01
851 #define _C1TSEL1 0x02
852 #define _C2TSEL0 0x08
853 #define _C2TSEL1 0x10
854 #define _C3TSEL0 0x40
855 #define _C3TSEL1 0x80
857 //==============================================================================
860 //==============================================================================
863 extern __at(0x0F4A) __sfr T6CON
;
869 unsigned T6CKPS0
: 1;
870 unsigned T6CKPS1
: 1;
872 unsigned T6OUTPS0
: 1;
873 unsigned T6OUTPS1
: 1;
874 unsigned T6OUTPS2
: 1;
875 unsigned T6OUTPS3
: 1;
888 unsigned T6OUTPS
: 4;
893 extern __at(0x0F4A) volatile __T6CONbits_t T6CONbits
;
895 #define _T6CKPS0 0x01
896 #define _T6CKPS1 0x02
898 #define _T6OUTPS0 0x08
899 #define _T6OUTPS1 0x10
900 #define _T6OUTPS2 0x20
901 #define _T6OUTPS3 0x40
903 //==============================================================================
905 extern __at(0x0F4B) __sfr PR6
;
906 extern __at(0x0F4C) __sfr TMR6
;
908 //==============================================================================
911 extern __at(0x0F4D) __sfr T5GCON
;
920 unsigned T5GGO_NOT_DONE
: 1;
944 unsigned T5G_DONE
: 1;
958 extern __at(0x0F4D) volatile __T5GCONbits_t T5GCONbits
;
963 #define _T5GGO_NOT_DONE 0x08
965 #define _T5G_DONE 0x08
971 //==============================================================================
974 //==============================================================================
977 extern __at(0x0F4E) __sfr T5CON
;
985 unsigned NOT_T5SYNC
: 1;
986 unsigned T5SOSCEN
: 1;
987 unsigned T5CKPS0
: 1;
988 unsigned T5CKPS1
: 1;
989 unsigned TMR5CS0
: 1;
990 unsigned TMR5CS1
: 1;
1008 unsigned T5CKPS
: 2;
1015 unsigned TMR5CS
: 2;
1019 extern __at(0x0F4E) volatile __T5CONbits_t T5CONbits
;
1021 #define _TMR5ON 0x01
1022 #define _T5RD16 0x02
1023 #define _NOT_T5SYNC 0x04
1024 #define _T5SYNC 0x04
1025 #define _T5SOSCEN 0x08
1026 #define _T5CKPS0 0x10
1027 #define _T5CKPS1 0x20
1028 #define _TMR5CS0 0x40
1029 #define _TMR5CS1 0x80
1031 //==============================================================================
1033 extern __at(0x0F4F) __sfr TMR5
;
1034 extern __at(0x0F4F) __sfr TMR5L
;
1035 extern __at(0x0F50) __sfr TMR5H
;
1037 //==============================================================================
1040 extern __at(0x0F51) __sfr T4CON
;
1046 unsigned T4CKPS0
: 1;
1047 unsigned T4CKPS1
: 1;
1048 unsigned TMR4ON
: 1;
1049 unsigned T4OUTPS0
: 1;
1050 unsigned T4OUTPS1
: 1;
1051 unsigned T4OUTPS2
: 1;
1052 unsigned T4OUTPS3
: 1;
1058 unsigned T4CKPS
: 2;
1065 unsigned T4OUTPS
: 4;
1070 extern __at(0x0F51) volatile __T4CONbits_t T4CONbits
;
1072 #define _T4CKPS0 0x01
1073 #define _T4CKPS1 0x02
1074 #define _TMR4ON 0x04
1075 #define _T4OUTPS0 0x08
1076 #define _T4OUTPS1 0x10
1077 #define _T4OUTPS2 0x20
1078 #define _T4OUTPS3 0x40
1080 //==============================================================================
1082 extern __at(0x0F52) __sfr PR4
;
1083 extern __at(0x0F53) __sfr TMR4
;
1085 //==============================================================================
1088 extern __at(0x0F54) __sfr CCP5CON
;
1094 unsigned CCP5M0
: 1;
1095 unsigned CCP5M1
: 1;
1096 unsigned CCP5M2
: 1;
1097 unsigned CCP5M3
: 1;
1118 extern __at(0x0F54) volatile __CCP5CONbits_t CCP5CONbits
;
1120 #define _CCP5M0 0x01
1121 #define _CCP5M1 0x02
1122 #define _CCP5M2 0x04
1123 #define _CCP5M3 0x08
1127 //==============================================================================
1129 extern __at(0x0F55) __sfr CCPR5
;
1130 extern __at(0x0F55) __sfr CCPR5L
;
1131 extern __at(0x0F56) __sfr CCPR5H
;
1133 //==============================================================================
1136 extern __at(0x0F57) __sfr CCP4CON
;
1142 unsigned CCP4M0
: 1;
1143 unsigned CCP4M1
: 1;
1144 unsigned CCP4M2
: 1;
1145 unsigned CCP4M3
: 1;
1166 extern __at(0x0F57) volatile __CCP4CONbits_t CCP4CONbits
;
1168 #define _CCP4M0 0x01
1169 #define _CCP4M1 0x02
1170 #define _CCP4M2 0x04
1171 #define _CCP4M3 0x08
1175 //==============================================================================
1177 extern __at(0x0F58) __sfr CCPR4
;
1178 extern __at(0x0F58) __sfr CCPR4L
;
1179 extern __at(0x0F59) __sfr CCPR4H
;
1181 //==============================================================================
1184 extern __at(0x0F5A) __sfr PSTR3CON
;
1192 unsigned STR3SYNC
: 1;
1198 extern __at(0x0F5A) volatile __PSTR3CONbits_t PSTR3CONbits
;
1204 #define _STR3SYNC 0x10
1206 //==============================================================================
1209 //==============================================================================
1212 extern __at(0x0F5B) __sfr CCP3AS
;
1218 unsigned P3SSBD0
: 1;
1219 unsigned P3SSBD1
: 1;
1220 unsigned P3SSAC0
: 1;
1221 unsigned P3SSAC1
: 1;
1222 unsigned CCP3AS0
: 1;
1223 unsigned CCP3AS1
: 1;
1224 unsigned CCP3AS2
: 1;
1225 unsigned CCP3ASE
: 1;
1230 unsigned PSS3BD0
: 1;
1231 unsigned PSS3BD1
: 1;
1232 unsigned PSS3AC0
: 1;
1233 unsigned PSS3AC1
: 1;
1242 unsigned P3SSBD
: 2;
1248 unsigned PSS3BD
: 2;
1255 unsigned PSS3AC
: 2;
1262 unsigned P3SSAC
: 2;
1269 unsigned CCP3AS
: 3;
1274 extern __at(0x0F5B) volatile __CCP3ASbits_t CCP3ASbits
;
1276 #define _P3SSBD0 0x01
1277 #define _PSS3BD0 0x01
1278 #define _P3SSBD1 0x02
1279 #define _PSS3BD1 0x02
1280 #define _P3SSAC0 0x04
1281 #define _PSS3AC0 0x04
1282 #define _P3SSAC1 0x08
1283 #define _PSS3AC1 0x08
1284 #define _CCP3AS0 0x10
1285 #define _CCP3AS1 0x20
1286 #define _CCP3AS2 0x40
1287 #define _CCP3ASE 0x80
1289 //==============================================================================
1292 //==============================================================================
1295 extern __at(0x0F5B) __sfr ECCP3AS
;
1301 unsigned P3SSBD0
: 1;
1302 unsigned P3SSBD1
: 1;
1303 unsigned P3SSAC0
: 1;
1304 unsigned P3SSAC1
: 1;
1305 unsigned CCP3AS0
: 1;
1306 unsigned CCP3AS1
: 1;
1307 unsigned CCP3AS2
: 1;
1308 unsigned CCP3ASE
: 1;
1313 unsigned PSS3BD0
: 1;
1314 unsigned PSS3BD1
: 1;
1315 unsigned PSS3AC0
: 1;
1316 unsigned PSS3AC1
: 1;
1325 unsigned PSS3BD
: 2;
1331 unsigned P3SSBD
: 2;
1338 unsigned P3SSAC
: 2;
1345 unsigned PSS3AC
: 2;
1352 unsigned CCP3AS
: 3;
1357 extern __at(0x0F5B) volatile __ECCP3ASbits_t ECCP3ASbits
;
1359 #define _ECCP3AS_P3SSBD0 0x01
1360 #define _ECCP3AS_PSS3BD0 0x01
1361 #define _ECCP3AS_P3SSBD1 0x02
1362 #define _ECCP3AS_PSS3BD1 0x02
1363 #define _ECCP3AS_P3SSAC0 0x04
1364 #define _ECCP3AS_PSS3AC0 0x04
1365 #define _ECCP3AS_P3SSAC1 0x08
1366 #define _ECCP3AS_PSS3AC1 0x08
1367 #define _ECCP3AS_CCP3AS0 0x10
1368 #define _ECCP3AS_CCP3AS1 0x20
1369 #define _ECCP3AS_CCP3AS2 0x40
1370 #define _ECCP3AS_CCP3ASE 0x80
1372 //==============================================================================
1375 //==============================================================================
1378 extern __at(0x0F5C) __sfr PWM3CON
;
1391 unsigned P3RSEN
: 1;
1401 extern __at(0x0F5C) volatile __PWM3CONbits_t PWM3CONbits
;
1410 #define _P3RSEN 0x80
1412 //==============================================================================
1415 //==============================================================================
1418 extern __at(0x0F5D) __sfr CCP3CON
;
1424 unsigned CCP3M0
: 1;
1425 unsigned CCP3M1
: 1;
1426 unsigned CCP3M2
: 1;
1427 unsigned CCP3M3
: 1;
1454 extern __at(0x0F5D) volatile __CCP3CONbits_t CCP3CONbits
;
1456 #define _CCP3M0 0x01
1457 #define _CCP3M1 0x02
1458 #define _CCP3M2 0x04
1459 #define _CCP3M3 0x08
1465 //==============================================================================
1467 extern __at(0x0F5E) __sfr CCPR3
;
1468 extern __at(0x0F5E) __sfr CCPR3L
;
1469 extern __at(0x0F5F) __sfr CCPR3H
;
1471 //==============================================================================
1474 extern __at(0x0F60) __sfr SLRCON
;
1488 extern __at(0x0F60) volatile __SLRCONbits_t SLRCONbits
;
1494 //==============================================================================
1497 //==============================================================================
1500 extern __at(0x0F61) __sfr WPUB
;
1514 extern __at(0x0F61) volatile __WPUBbits_t WPUBbits
;
1525 //==============================================================================
1528 //==============================================================================
1531 extern __at(0x0F62) __sfr IOCB
;
1545 extern __at(0x0F62) volatile __IOCBbits_t IOCBbits
;
1552 //==============================================================================
1555 //==============================================================================
1558 extern __at(0x0F63) __sfr PSTR2CON
;
1566 unsigned STR2SYNC
: 1;
1572 extern __at(0x0F63) volatile __PSTR2CONbits_t PSTR2CONbits
;
1578 #define _STR2SYNC 0x10
1580 //==============================================================================
1583 //==============================================================================
1586 extern __at(0x0F64) __sfr CCP2AS
;
1592 unsigned P2SSBD0
: 1;
1593 unsigned P2SSBD1
: 1;
1594 unsigned P2SSAC0
: 1;
1595 unsigned P2SSAC1
: 1;
1596 unsigned CCP2AS0
: 1;
1597 unsigned CCP2AS1
: 1;
1598 unsigned CCP2AS2
: 1;
1599 unsigned CCP2ASE
: 1;
1604 unsigned PSS2BD0
: 1;
1605 unsigned PSS2BD1
: 1;
1606 unsigned PSS2AC0
: 1;
1607 unsigned PSS2AC1
: 1;
1616 unsigned PSS2BD
: 2;
1622 unsigned P2SSBD
: 2;
1629 unsigned PSS2AC
: 2;
1636 unsigned P2SSAC
: 2;
1643 unsigned CCP2AS
: 3;
1648 extern __at(0x0F64) volatile __CCP2ASbits_t CCP2ASbits
;
1650 #define _P2SSBD0 0x01
1651 #define _PSS2BD0 0x01
1652 #define _P2SSBD1 0x02
1653 #define _PSS2BD1 0x02
1654 #define _P2SSAC0 0x04
1655 #define _PSS2AC0 0x04
1656 #define _P2SSAC1 0x08
1657 #define _PSS2AC1 0x08
1658 #define _CCP2AS0 0x10
1659 #define _CCP2AS1 0x20
1660 #define _CCP2AS2 0x40
1661 #define _CCP2ASE 0x80
1663 //==============================================================================
1666 //==============================================================================
1669 extern __at(0x0F64) __sfr ECCP2AS
;
1675 unsigned P2SSBD0
: 1;
1676 unsigned P2SSBD1
: 1;
1677 unsigned P2SSAC0
: 1;
1678 unsigned P2SSAC1
: 1;
1679 unsigned CCP2AS0
: 1;
1680 unsigned CCP2AS1
: 1;
1681 unsigned CCP2AS2
: 1;
1682 unsigned CCP2ASE
: 1;
1687 unsigned PSS2BD0
: 1;
1688 unsigned PSS2BD1
: 1;
1689 unsigned PSS2AC0
: 1;
1690 unsigned PSS2AC1
: 1;
1699 unsigned P2SSBD
: 2;
1705 unsigned PSS2BD
: 2;
1712 unsigned P2SSAC
: 2;
1719 unsigned PSS2AC
: 2;
1726 unsigned CCP2AS
: 3;
1731 extern __at(0x0F64) volatile __ECCP2ASbits_t ECCP2ASbits
;
1733 #define _ECCP2AS_P2SSBD0 0x01
1734 #define _ECCP2AS_PSS2BD0 0x01
1735 #define _ECCP2AS_P2SSBD1 0x02
1736 #define _ECCP2AS_PSS2BD1 0x02
1737 #define _ECCP2AS_P2SSAC0 0x04
1738 #define _ECCP2AS_PSS2AC0 0x04
1739 #define _ECCP2AS_P2SSAC1 0x08
1740 #define _ECCP2AS_PSS2AC1 0x08
1741 #define _ECCP2AS_CCP2AS0 0x10
1742 #define _ECCP2AS_CCP2AS1 0x20
1743 #define _ECCP2AS_CCP2AS2 0x40
1744 #define _ECCP2AS_CCP2ASE 0x80
1746 //==============================================================================
1749 //==============================================================================
1752 extern __at(0x0F65) __sfr PWM2CON
;
1765 unsigned P2RSEN
: 1;
1775 extern __at(0x0F65) volatile __PWM2CONbits_t PWM2CONbits
;
1784 #define _P2RSEN 0x80
1786 //==============================================================================
1789 //==============================================================================
1792 extern __at(0x0F66) __sfr CCP2CON
;
1798 unsigned CCP2M0
: 1;
1799 unsigned CCP2M1
: 1;
1800 unsigned CCP2M2
: 1;
1801 unsigned CCP2M3
: 1;
1828 extern __at(0x0F66) volatile __CCP2CONbits_t CCP2CONbits
;
1830 #define _CCP2M0 0x01
1831 #define _CCP2M1 0x02
1832 #define _CCP2M2 0x04
1833 #define _CCP2M3 0x08
1839 //==============================================================================
1841 extern __at(0x0F67) __sfr CCPR2
;
1842 extern __at(0x0F67) __sfr CCPR2L
;
1843 extern __at(0x0F68) __sfr CCPR2H
;
1845 //==============================================================================
1848 extern __at(0x0F69) __sfr SSP2CON3
;
1859 unsigned ACKTIM
: 1;
1862 extern __at(0x0F69) volatile __SSP2CON3bits_t SSP2CON3bits
;
1864 #define _SSP2CON3_DHEN 0x01
1865 #define _SSP2CON3_AHEN 0x02
1866 #define _SSP2CON3_SBCDE 0x04
1867 #define _SSP2CON3_SDAHT 0x08
1868 #define _SSP2CON3_BOEN 0x10
1869 #define _SSP2CON3_SCIE 0x20
1870 #define _SSP2CON3_PCIE 0x40
1871 #define _SSP2CON3_ACKTIM 0x80
1873 //==============================================================================
1876 //==============================================================================
1879 extern __at(0x0F6A) __sfr SSP2MSK
;
1893 extern __at(0x0F6A) volatile __SSP2MSKbits_t SSP2MSKbits
;
1895 #define _SSP2MSK_MSK0 0x01
1896 #define _SSP2MSK_MSK1 0x02
1897 #define _SSP2MSK_MSK2 0x04
1898 #define _SSP2MSK_MSK3 0x08
1899 #define _SSP2MSK_MSK4 0x10
1900 #define _SSP2MSK_MSK5 0x20
1901 #define _SSP2MSK_MSK6 0x40
1902 #define _SSP2MSK_MSK7 0x80
1904 //==============================================================================
1907 //==============================================================================
1910 extern __at(0x0F6B) __sfr SSP2CON2
;
1920 unsigned ACKSTAT
: 1;
1924 extern __at(0x0F6B) volatile __SSP2CON2bits_t SSP2CON2bits
;
1926 #define _SSP2CON2_SEN 0x01
1927 #define _SSP2CON2_RSEN 0x02
1928 #define _SSP2CON2_PEN 0x04
1929 #define _SSP2CON2_RCEN 0x08
1930 #define _SSP2CON2_ACKEN 0x10
1931 #define _SSP2CON2_ACKDT 0x20
1932 #define _SSP2CON2_ACKSTAT 0x40
1933 #define _SSP2CON2_GCEN 0x80
1935 //==============================================================================
1938 //==============================================================================
1941 extern __at(0x0F6C) __sfr SSP2CON1
;
1964 extern __at(0x0F6C) volatile __SSP2CON1bits_t SSP2CON1bits
;
1966 #define _SSP2CON1_SSPM0 0x01
1967 #define _SSP2CON1_SSPM1 0x02
1968 #define _SSP2CON1_SSPM2 0x04
1969 #define _SSP2CON1_SSPM3 0x08
1970 #define _SSP2CON1_CKP 0x10
1971 #define _SSP2CON1_SSPEN 0x20
1972 #define _SSP2CON1_SSPOV 0x40
1973 #define _SSP2CON1_WCOL 0x80
1975 //==============================================================================
1978 //==============================================================================
1981 extern __at(0x0F6D) __sfr SSP2STAT
;
1989 unsigned R_NOT_W
: 1;
1992 unsigned D_NOT_A
: 1;
2037 unsigned NOT_WRITE
: 1;
2040 unsigned NOT_ADDRESS
: 1;
2046 extern __at(0x0F6D) volatile __SSP2STATbits_t SSP2STATbits
;
2048 #define _SSP2STAT_BF 0x01
2049 #define _SSP2STAT_UA 0x02
2050 #define _SSP2STAT_R_NOT_W 0x04
2051 #define _SSP2STAT_R 0x04
2052 #define _SSP2STAT_NOT_W 0x04
2053 #define _SSP2STAT_R_W 0x04
2054 #define _SSP2STAT_NOT_WRITE 0x04
2055 #define _SSP2STAT_S 0x08
2056 #define _SSP2STAT_P 0x10
2057 #define _SSP2STAT_D_NOT_A 0x20
2058 #define _SSP2STAT_D 0x20
2059 #define _SSP2STAT_NOT_A 0x20
2060 #define _SSP2STAT_D_A 0x20
2061 #define _SSP2STAT_NOT_ADDRESS 0x20
2062 #define _SSP2STAT_CKE 0x40
2063 #define _SSP2STAT_SMP 0x80
2065 //==============================================================================
2067 extern __at(0x0F6E) __sfr SSP2ADD
;
2068 extern __at(0x0F6F) __sfr SSP2BUF
;
2070 //==============================================================================
2073 extern __at(0x0F70) __sfr BAUD2CON
;
2086 unsigned ABDOVF
: 1;
2102 extern __at(0x0F70) volatile __BAUD2CONbits_t BAUD2CONbits
;
2104 #define _BAUD2CON_ABDEN 0x01
2105 #define _BAUD2CON_WUE 0x02
2106 #define _BAUD2CON_BRG16 0x08
2107 #define _BAUD2CON_CKTXP 0x10
2108 #define _BAUD2CON_SCKP 0x10
2109 #define _BAUD2CON_DTRXP 0x20
2110 #define _BAUD2CON_RCIDL 0x40
2111 #define _BAUD2CON_ABDOVF 0x80
2113 //==============================================================================
2116 //==============================================================================
2119 extern __at(0x0F70) __sfr BAUDCON2
;
2132 unsigned ABDOVF
: 1;
2148 extern __at(0x0F70) volatile __BAUDCON2bits_t BAUDCON2bits
;
2150 #define _BAUDCON2_ABDEN 0x01
2151 #define _BAUDCON2_WUE 0x02
2152 #define _BAUDCON2_BRG16 0x08
2153 #define _BAUDCON2_CKTXP 0x10
2154 #define _BAUDCON2_SCKP 0x10
2155 #define _BAUDCON2_DTRXP 0x20
2156 #define _BAUDCON2_RCIDL 0x40
2157 #define _BAUDCON2_ABDOVF 0x80
2159 //==============================================================================
2162 //==============================================================================
2165 extern __at(0x0F71) __sfr RC2STA
;
2198 unsigned ADDEN2
: 1;
2206 extern __at(0x0F71) volatile __RC2STAbits_t RC2STAbits
;
2208 #define _RC2STA_RX9D 0x01
2209 #define _RC2STA_RX9D2 0x01
2210 #define _RC2STA_OERR 0x02
2211 #define _RC2STA_OERR2 0x02
2212 #define _RC2STA_FERR 0x04
2213 #define _RC2STA_FERR2 0x04
2214 #define _RC2STA_ADDEN 0x08
2215 #define _RC2STA_ADEN 0x08
2216 #define _RC2STA_ADDEN2 0x08
2217 #define _RC2STA_CREN 0x10
2218 #define _RC2STA_CREN2 0x10
2219 #define _RC2STA_SREN 0x20
2220 #define _RC2STA_SREN2 0x20
2221 #define _RC2STA_RX9 0x40
2222 #define _RC2STA_RX92 0x40
2223 #define _RC2STA_SPEN 0x80
2224 #define _RC2STA_SPEN2 0x80
2226 //==============================================================================
2229 //==============================================================================
2232 extern __at(0x0F71) __sfr RCSTA2
;
2265 unsigned ADDEN2
: 1;
2273 extern __at(0x0F71) volatile __RCSTA2bits_t RCSTA2bits
;
2275 #define _RCSTA2_RX9D 0x01
2276 #define _RCSTA2_RX9D2 0x01
2277 #define _RCSTA2_OERR 0x02
2278 #define _RCSTA2_OERR2 0x02
2279 #define _RCSTA2_FERR 0x04
2280 #define _RCSTA2_FERR2 0x04
2281 #define _RCSTA2_ADDEN 0x08
2282 #define _RCSTA2_ADEN 0x08
2283 #define _RCSTA2_ADDEN2 0x08
2284 #define _RCSTA2_CREN 0x10
2285 #define _RCSTA2_CREN2 0x10
2286 #define _RCSTA2_SREN 0x20
2287 #define _RCSTA2_SREN2 0x20
2288 #define _RCSTA2_RX9 0x40
2289 #define _RCSTA2_RX92 0x40
2290 #define _RCSTA2_SPEN 0x80
2291 #define _RCSTA2_SPEN2 0x80
2293 //==============================================================================
2296 //==============================================================================
2299 extern __at(0x0F72) __sfr TX2STA
;
2320 unsigned SENDB2
: 1;
2328 extern __at(0x0F72) volatile __TX2STAbits_t TX2STAbits
;
2330 #define _TX2STA_TX9D 0x01
2331 #define _TX2STA_TX9D2 0x01
2332 #define _TX2STA_TRMT 0x02
2333 #define _TX2STA_TRMT2 0x02
2334 #define _TX2STA_BRGH 0x04
2335 #define _TX2STA_BRGH2 0x04
2336 #define _TX2STA_SENDB 0x08
2337 #define _TX2STA_SENDB2 0x08
2338 #define _TX2STA_SYNC 0x10
2339 #define _TX2STA_SYNC2 0x10
2340 #define _TX2STA_TXEN 0x20
2341 #define _TX2STA_TXEN2 0x20
2342 #define _TX2STA_TX9 0x40
2343 #define _TX2STA_TX92 0x40
2344 #define _TX2STA_CSRC 0x80
2345 #define _TX2STA_CSRC2 0x80
2347 //==============================================================================
2350 //==============================================================================
2353 extern __at(0x0F72) __sfr TXSTA2
;
2374 unsigned SENDB2
: 1;
2382 extern __at(0x0F72) volatile __TXSTA2bits_t TXSTA2bits
;
2384 #define _TXSTA2_TX9D 0x01
2385 #define _TXSTA2_TX9D2 0x01
2386 #define _TXSTA2_TRMT 0x02
2387 #define _TXSTA2_TRMT2 0x02
2388 #define _TXSTA2_BRGH 0x04
2389 #define _TXSTA2_BRGH2 0x04
2390 #define _TXSTA2_SENDB 0x08
2391 #define _TXSTA2_SENDB2 0x08
2392 #define _TXSTA2_SYNC 0x10
2393 #define _TXSTA2_SYNC2 0x10
2394 #define _TXSTA2_TXEN 0x20
2395 #define _TXSTA2_TXEN2 0x20
2396 #define _TXSTA2_TX9 0x40
2397 #define _TXSTA2_TX92 0x40
2398 #define _TXSTA2_CSRC 0x80
2399 #define _TXSTA2_CSRC2 0x80
2401 //==============================================================================
2403 extern __at(0x0F73) __sfr TX2REG
;
2404 extern __at(0x0F73) __sfr TXREG2
;
2405 extern __at(0x0F74) __sfr RC2REG
;
2406 extern __at(0x0F74) __sfr RCREG2
;
2407 extern __at(0x0F75) __sfr SP2BRG
;
2408 extern __at(0x0F75) __sfr SPBRG2
;
2409 extern __at(0x0F76) __sfr SP2BRGH
;
2410 extern __at(0x0F76) __sfr SPBRGH2
;
2412 //==============================================================================
2415 extern __at(0x0F77) __sfr CM12CON
;
2419 unsigned C2SYNC
: 1;
2420 unsigned C1SYNC
: 1;
2423 unsigned C2RSEL
: 1;
2424 unsigned C1RSEL
: 1;
2425 unsigned MC2OUT
: 1;
2426 unsigned MC1OUT
: 1;
2429 extern __at(0x0F77) volatile __CM12CONbits_t CM12CONbits
;
2431 #define _CM12CON_C2SYNC 0x01
2432 #define _CM12CON_C1SYNC 0x02
2433 #define _CM12CON_C2HYS 0x04
2434 #define _CM12CON_C1HYS 0x08
2435 #define _CM12CON_C2RSEL 0x10
2436 #define _CM12CON_C1RSEL 0x20
2437 #define _CM12CON_MC2OUT 0x40
2438 #define _CM12CON_MC1OUT 0x80
2440 //==============================================================================
2443 //==============================================================================
2446 extern __at(0x0F77) __sfr CM2CON1
;
2450 unsigned C2SYNC
: 1;
2451 unsigned C1SYNC
: 1;
2454 unsigned C2RSEL
: 1;
2455 unsigned C1RSEL
: 1;
2456 unsigned MC2OUT
: 1;
2457 unsigned MC1OUT
: 1;
2460 extern __at(0x0F77) volatile __CM2CON1bits_t CM2CON1bits
;
2462 #define _C2SYNC 0x01
2463 #define _C1SYNC 0x02
2466 #define _C2RSEL 0x10
2467 #define _C1RSEL 0x20
2468 #define _MC2OUT 0x40
2469 #define _MC1OUT 0x80
2471 //==============================================================================
2474 //==============================================================================
2477 extern __at(0x0F78) __sfr CM2CON
;
2500 extern __at(0x0F78) volatile __CM2CONbits_t CM2CONbits
;
2511 //==============================================================================
2514 //==============================================================================
2517 extern __at(0x0F78) __sfr CM2CON0
;
2540 extern __at(0x0F78) volatile __CM2CON0bits_t CM2CON0bits
;
2542 #define _CM2CON0_C2CH0 0x01
2543 #define _CM2CON0_C2CH1 0x02
2544 #define _CM2CON0_C2R 0x04
2545 #define _CM2CON0_C2SP 0x08
2546 #define _CM2CON0_C2POL 0x10
2547 #define _CM2CON0_C2OE 0x20
2548 #define _CM2CON0_C2OUT 0x40
2549 #define _CM2CON0_C2ON 0x80
2551 //==============================================================================
2554 //==============================================================================
2557 extern __at(0x0F79) __sfr CM1CON
;
2580 extern __at(0x0F79) volatile __CM1CONbits_t CM1CONbits
;
2591 //==============================================================================
2594 //==============================================================================
2597 extern __at(0x0F79) __sfr CM1CON0
;
2620 extern __at(0x0F79) volatile __CM1CON0bits_t CM1CON0bits
;
2622 #define _CM1CON0_C1CH0 0x01
2623 #define _CM1CON0_C1CH1 0x02
2624 #define _CM1CON0_C1R 0x04
2625 #define _CM1CON0_C1SP 0x08
2626 #define _CM1CON0_C1POL 0x10
2627 #define _CM1CON0_C1OE 0x20
2628 #define _CM1CON0_C1OUT 0x40
2629 #define _CM1CON0_C1ON 0x80
2631 //==============================================================================
2634 //==============================================================================
2637 extern __at(0x0F7A) __sfr PIE4
;
2641 unsigned CCP3IE
: 1;
2642 unsigned CCP4IE
: 1;
2643 unsigned CCP5IE
: 1;
2651 extern __at(0x0F7A) volatile __PIE4bits_t PIE4bits
;
2653 #define _CCP3IE 0x01
2654 #define _CCP4IE 0x02
2655 #define _CCP5IE 0x04
2657 //==============================================================================
2660 //==============================================================================
2663 extern __at(0x0F7B) __sfr PIR4
;
2667 unsigned CCP3IF
: 1;
2668 unsigned CCP4IF
: 1;
2669 unsigned CCP5IF
: 1;
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;
2679 #define _CCP3IF 0x01
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2681 #define _CCP5IF 0x04
2683 //==============================================================================
2686 //==============================================================================
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;
2693 unsigned CCP3IP
: 1;
2694 unsigned CCP4IP
: 1;
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: 1;
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;
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: 1;
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: 1;
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: 1;
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;
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;
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: 1;
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: 1;
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: 1;
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;
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: 1;
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: 1;
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: 1;
2781 extern __at(0x0F7F) volatile __IPR5bits_t IPR5bits
;
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2790 //==============================================================================
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;
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: 1;
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2836 unsigned C12IN1N
: 1;
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: 1;
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: 1;
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: 1;
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;
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2960 //==============================================================================
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;
3006 unsigned C12IN3M
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: 1;
3020 unsigned C12IN2N
: 1;
3053 unsigned NOT_SS2
: 1;
3076 extern __at(0x0F81) volatile __PORTBbits_t PORTBbits
;
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3133 //==============================================================================
3136 //==============================================================================
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;
3240 extern __at(0x0F82) volatile __PORTCbits_t PORTCbits
;
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3289 //==============================================================================
3292 //==============================================================================
3295 extern __at(0x0F84) __sfr PORTE
;
3328 unsigned NOT_MCLR
: 1;
3348 extern __at(0x0F84) volatile __PORTEbits_t PORTEbits
;
3352 #define _NOT_MCLR 0x08
3355 //==============================================================================
3358 //==============================================================================
3361 extern __at(0x0F89) __sfr LATA
;
3375 extern __at(0x0F89) volatile __LATAbits_t LATAbits
;
3386 //==============================================================================
3389 //==============================================================================
3392 extern __at(0x0F8A) __sfr LATB
;
3406 extern __at(0x0F8A) volatile __LATBbits_t LATBbits
;
3417 //==============================================================================
3420 //==============================================================================
3423 extern __at(0x0F8B) __sfr LATC
;
3437 extern __at(0x0F8B) volatile __LATCbits_t LATCbits
;
3448 //==============================================================================
3451 //==============================================================================
3454 extern __at(0x0F92) __sfr DDRA
;
3460 unsigned TRISA0
: 1;
3461 unsigned TRISA1
: 1;
3462 unsigned TRISA2
: 1;
3463 unsigned TRISA3
: 1;
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: 1;
3465 unsigned TRISA5
: 1;
3466 unsigned TRISA6
: 1;
3467 unsigned TRISA7
: 1;
3483 extern __at(0x0F92) volatile __DDRAbits_t DDRAbits
;
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3502 //==============================================================================
3505 //==============================================================================
3508 extern __at(0x0F92) __sfr TRISA
;
3514 unsigned TRISA0
: 1;
3515 unsigned TRISA1
: 1;
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: 1;
3517 unsigned TRISA3
: 1;
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: 1;
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: 1;
3520 unsigned TRISA6
: 1;
3521 unsigned TRISA7
: 1;
3537 extern __at(0x0F92) volatile __TRISAbits_t TRISAbits
;
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3556 //==============================================================================
3559 //==============================================================================
3562 extern __at(0x0F93) __sfr DDRB
;
3568 unsigned TRISB0
: 1;
3569 unsigned TRISB1
: 1;
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: 1;
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: 1;
3575 unsigned TRISB7
: 1;
3591 extern __at(0x0F93) volatile __DDRBbits_t DDRBbits
;
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3613 //==============================================================================
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;
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: 1;
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: 1;
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: 1;
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: 1;
3645 extern __at(0x0F93) volatile __TRISBbits_t TRISBbits
;
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3664 //==============================================================================
3667 //==============================================================================
3670 extern __at(0x0F94) __sfr DDRC
;
3676 unsigned TRISC0
: 1;
3677 unsigned TRISC1
: 1;
3678 unsigned TRISC2
: 1;
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: 1;
3680 unsigned TRISC4
: 1;
3681 unsigned TRISC5
: 1;
3682 unsigned TRISC6
: 1;
3683 unsigned TRISC7
: 1;
3699 extern __at(0x0F94) volatile __DDRCbits_t DDRCbits
;
3701 #define _TRISC0 0x01
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3718 //==============================================================================
3721 //==============================================================================
3724 extern __at(0x0F94) __sfr TRISC
;
3730 unsigned TRISC0
: 1;
3731 unsigned TRISC1
: 1;
3732 unsigned TRISC2
: 1;
3733 unsigned TRISC3
: 1;
3734 unsigned TRISC4
: 1;
3735 unsigned TRISC5
: 1;
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: 1;
3737 unsigned TRISC7
: 1;
3753 extern __at(0x0F94) volatile __TRISCbits_t TRISCbits
;
3755 #define _TRISC_TRISC0 0x01
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3772 //==============================================================================
3775 //==============================================================================
3778 extern __at(0x0F96) __sfr TRISE
;
3792 extern __at(0x0F96) volatile __TRISEbits_t TRISEbits
;
3796 //==============================================================================
3799 //==============================================================================
3802 extern __at(0x0F9B) __sfr OSCTUNE
;
3815 unsigned INTSRC
: 1;
3825 extern __at(0x0F9B) volatile __OSCTUNEbits_t OSCTUNEbits
;
3834 #define _INTSRC 0x80
3836 //==============================================================================
3839 //==============================================================================
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;
3848 unsigned HLVDL0
: 1;
3849 unsigned HLVDL1
: 1;
3850 unsigned HLVDL2
: 1;
3851 unsigned HLVDL3
: 1;
3852 unsigned HLVDEN
: 1;
3855 unsigned VDIRMAG
: 1;
3901 extern __at(0x0F9C) volatile __HLVDCONbits_t HLVDCONbits
;
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3923 //==============================================================================
3926 //==============================================================================
3929 extern __at(0x0F9C) __sfr LVDCON
;
3935 unsigned HLVDL0
: 1;
3936 unsigned HLVDL1
: 1;
3937 unsigned HLVDL2
: 1;
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: 1;
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: 1;
3942 unsigned VDIRMAG
: 1;
3988 extern __at(0x0F9C) volatile __LVDCONbits_t LVDCONbits
;
3990 #define _LVDCON_HLVDL0 0x01
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3993 #define _LVDCON_HLVDL1 0x02
3994 #define _LVDCON_LVDL1 0x02
3995 #define _LVDCON_LVV1 0x02
3996 #define _LVDCON_HLVDL2 0x04
3997 #define _LVDCON_LVDL2 0x04
3998 #define _LVDCON_LVV2 0x04
3999 #define _LVDCON_HLVDL3 0x08
4000 #define _LVDCON_LVDL3 0x08
4001 #define _LVDCON_LVV3 0x08
4002 #define _LVDCON_HLVDEN 0x10
4003 #define _LVDCON_LVDEN 0x10
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4005 #define _LVDCON_IVRST 0x20
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4008 #define _LVDCON_VDIRMAG 0x80
4010 //==============================================================================
4013 //==============================================================================
4016 extern __at(0x0F9D) __sfr PIE1
;
4022 unsigned TMR1IE
: 1;
4023 unsigned TMR2IE
: 1;
4024 unsigned CCP1IE
: 1;
4025 unsigned SSP1IE
: 1;
4045 extern __at(0x0F9D) volatile __PIE1bits_t PIE1bits
;
4047 #define _TMR1IE 0x01
4048 #define _TMR2IE 0x02
4049 #define _CCP1IE 0x04
4050 #define _SSP1IE 0x08
4058 //==============================================================================
4061 //==============================================================================
4064 extern __at(0x0F9E) __sfr PIR1
;
4070 unsigned TMR1IF
: 1;
4071 unsigned TMR2IF
: 1;
4072 unsigned CCP1IF
: 1;
4073 unsigned SSP1IF
: 1;
4093 extern __at(0x0F9E) volatile __PIR1bits_t PIR1bits
;
4095 #define _TMR1IF 0x01
4096 #define _TMR2IF 0x02
4097 #define _CCP1IF 0x04
4098 #define _SSP1IF 0x08
4106 //==============================================================================
4109 //==============================================================================
4112 extern __at(0x0F9F) __sfr IPR1
;
4118 unsigned TMR1IP
: 1;
4119 unsigned TMR2IP
: 1;
4120 unsigned CCP1IP
: 1;
4121 unsigned SSP1IP
: 1;
4141 extern __at(0x0F9F) volatile __IPR1bits_t IPR1bits
;
4143 #define _TMR1IP 0x01
4144 #define _TMR2IP 0x02
4145 #define _CCP1IP 0x04
4146 #define _SSP1IP 0x08
4154 //==============================================================================
4157 //==============================================================================
4160 extern __at(0x0FA0) __sfr PIE2
;
4166 unsigned CCP2IE
: 1;
4167 unsigned TMR3IE
: 1;
4168 unsigned HLVDIE
: 1;
4169 unsigned BCL1IE
: 1;
4173 unsigned OSCFIE
: 1;
4189 extern __at(0x0FA0) volatile __PIE2bits_t PIE2bits
;
4191 #define _CCP2IE 0x01
4192 #define _TMR3IE 0x02
4193 #define _HLVDIE 0x04
4195 #define _BCL1IE 0x08
4200 #define _OSCFIE 0x80
4202 //==============================================================================
4205 //==============================================================================
4208 extern __at(0x0FA1) __sfr PIR2
;
4214 unsigned CCP2IF
: 1;
4215 unsigned TMR3IF
: 1;
4216 unsigned HLVDIF
: 1;
4217 unsigned BCL1IF
: 1;
4221 unsigned OSCFIF
: 1;
4237 extern __at(0x0FA1) volatile __PIR2bits_t PIR2bits
;
4239 #define _CCP2IF 0x01
4240 #define _TMR3IF 0x02
4241 #define _HLVDIF 0x04
4243 #define _BCL1IF 0x08
4248 #define _OSCFIF 0x80
4250 //==============================================================================
4253 //==============================================================================
4256 extern __at(0x0FA2) __sfr IPR2
;
4262 unsigned CCP2IP
: 1;
4263 unsigned TMR3IP
: 1;
4264 unsigned HLVDIP
: 1;
4265 unsigned BCL1IP
: 1;
4269 unsigned OSCFIP
: 1;
4285 extern __at(0x0FA2) volatile __IPR2bits_t IPR2bits
;
4287 #define _CCP2IP 0x01
4288 #define _TMR3IP 0x02
4289 #define _HLVDIP 0x04
4291 #define _BCL1IP 0x08
4296 #define _OSCFIP 0x80
4298 //==============================================================================
4301 //==============================================================================
4304 extern __at(0x0FA3) __sfr PIE3
;
4308 unsigned TMR1GIE
: 1;
4309 unsigned TMR3GIE
: 1;
4310 unsigned TMR5GIE
: 1;
4311 unsigned CTMUIE
: 1;
4314 unsigned BCL2IE
: 1;
4315 unsigned SSP2IE
: 1;
4318 extern __at(0x0FA3) volatile __PIE3bits_t PIE3bits
;
4320 #define _TMR1GIE 0x01
4321 #define _TMR3GIE 0x02
4322 #define _TMR5GIE 0x04
4323 #define _CTMUIE 0x08
4326 #define _BCL2IE 0x40
4327 #define _SSP2IE 0x80
4329 //==============================================================================
4332 //==============================================================================
4335 extern __at(0x0FA4) __sfr PIR3
;
4339 unsigned TMR1GIF
: 1;
4340 unsigned TMR3GIF
: 1;
4341 unsigned TMR5GIF
: 1;
4342 unsigned CTMUIF
: 1;
4345 unsigned BCL2IF
: 1;
4346 unsigned SSP2IF
: 1;
4349 extern __at(0x0FA4) volatile __PIR3bits_t PIR3bits
;
4351 #define _TMR1GIF 0x01
4352 #define _TMR3GIF 0x02
4353 #define _TMR5GIF 0x04
4354 #define _CTMUIF 0x08
4357 #define _BCL2IF 0x40
4358 #define _SSP2IF 0x80
4360 //==============================================================================
4363 //==============================================================================
4366 extern __at(0x0FA5) __sfr IPR3
;
4370 unsigned TMR1GIP
: 1;
4371 unsigned TMR3GIP
: 1;
4372 unsigned TMR5GIP
: 1;
4373 unsigned CTMUIP
: 1;
4376 unsigned BCL2IP
: 1;
4377 unsigned SSP2IP
: 1;
4380 extern __at(0x0FA5) volatile __IPR3bits_t IPR3bits
;
4382 #define _TMR1GIP 0x01
4383 #define _TMR3GIP 0x02
4384 #define _TMR5GIP 0x04
4385 #define _CTMUIP 0x08
4388 #define _BCL2IP 0x40
4389 #define _SSP2IP 0x80
4391 //==============================================================================
4394 //==============================================================================
4397 extern __at(0x0FA6) __sfr EECON1
;
4411 extern __at(0x0FA6) volatile __EECON1bits_t EECON1bits
;
4421 //==============================================================================
4423 extern __at(0x0FA7) __sfr EECON2
;
4424 extern __at(0x0FA8) __sfr EEDATA
;
4426 //==============================================================================
4429 extern __at(0x0FA9) __sfr EEADR
;
4433 unsigned EEADR0
: 1;
4434 unsigned EEADR1
: 1;
4435 unsigned EEADR2
: 1;
4436 unsigned EEADR3
: 1;
4437 unsigned EEADR4
: 1;
4438 unsigned EEADR5
: 1;
4439 unsigned EEADR6
: 1;
4440 unsigned EEADR7
: 1;
4443 extern __at(0x0FA9) volatile __EEADRbits_t EEADRbits
;
4445 #define _EEADR0 0x01
4446 #define _EEADR1 0x02
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4450 #define _EEADR5 0x20
4451 #define _EEADR6 0x40
4452 #define _EEADR7 0x80
4454 //==============================================================================
4457 //==============================================================================
4460 extern __at(0x0FAB) __sfr RC1STA
;
4493 unsigned ADDEN1
: 1;
4501 extern __at(0x0FAB) volatile __RC1STAbits_t RC1STAbits
;
4511 #define _ADDEN1 0x08
4521 //==============================================================================
4524 //==============================================================================
4527 extern __at(0x0FAB) __sfr RCSTA
;
4560 unsigned ADDEN1
: 1;
4568 extern __at(0x0FAB) volatile __RCSTAbits_t RCSTAbits
;
4570 #define _RCSTA_RX9D 0x01
4571 #define _RCSTA_RX9D1 0x01
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4577 #define _RCSTA_ADEN 0x08
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4582 #define _RCSTA_SREN1 0x20
4583 #define _RCSTA_RX9 0x40
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4586 #define _RCSTA_SPEN1 0x80
4588 //==============================================================================
4591 //==============================================================================
4594 extern __at(0x0FAB) __sfr RCSTA1
;
4627 unsigned ADDEN1
: 1;
4635 extern __at(0x0FAB) volatile __RCSTA1bits_t RCSTA1bits
;
4637 #define _RCSTA1_RX9D 0x01
4638 #define _RCSTA1_RX9D1 0x01
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4643 #define _RCSTA1_ADDEN 0x08
4644 #define _RCSTA1_ADEN 0x08
4645 #define _RCSTA1_ADDEN1 0x08
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4647 #define _RCSTA1_CREN1 0x10
4648 #define _RCSTA1_SREN 0x20
4649 #define _RCSTA1_SREN1 0x20
4650 #define _RCSTA1_RX9 0x40
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4653 #define _RCSTA1_SPEN1 0x80
4655 //==============================================================================
4658 //==============================================================================
4661 extern __at(0x0FAC) __sfr TX1STA
;
4682 unsigned SENDB1
: 1;
4690 extern __at(0x0FAC) volatile __TX1STAbits_t TX1STAbits
;
4699 #define _SENDB1 0x08
4709 //==============================================================================
4712 //==============================================================================
4715 extern __at(0x0FAC) __sfr TXSTA
;
4736 unsigned SENDB1
: 1;
4744 extern __at(0x0FAC) volatile __TXSTAbits_t TXSTAbits
;
4746 #define _TXSTA_TX9D 0x01
4747 #define _TXSTA_TX9D1 0x01
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4749 #define _TXSTA_TRMT1 0x02
4750 #define _TXSTA_BRGH 0x04
4751 #define _TXSTA_BRGH1 0x04
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4753 #define _TXSTA_SENDB1 0x08
4754 #define _TXSTA_SYNC 0x10
4755 #define _TXSTA_SYNC1 0x10
4756 #define _TXSTA_TXEN 0x20
4757 #define _TXSTA_TXEN1 0x20
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4759 #define _TXSTA_TX91 0x40
4760 #define _TXSTA_CSRC 0x80
4761 #define _TXSTA_CSRC1 0x80
4763 //==============================================================================
4766 //==============================================================================
4769 extern __at(0x0FAC) __sfr TXSTA1
;
4790 unsigned SENDB1
: 1;
4798 extern __at(0x0FAC) volatile __TXSTA1bits_t TXSTA1bits
;
4800 #define _TXSTA1_TX9D 0x01
4801 #define _TXSTA1_TX9D1 0x01
4802 #define _TXSTA1_TRMT 0x02
4803 #define _TXSTA1_TRMT1 0x02
4804 #define _TXSTA1_BRGH 0x04
4805 #define _TXSTA1_BRGH1 0x04
4806 #define _TXSTA1_SENDB 0x08
4807 #define _TXSTA1_SENDB1 0x08
4808 #define _TXSTA1_SYNC 0x10
4809 #define _TXSTA1_SYNC1 0x10
4810 #define _TXSTA1_TXEN 0x20
4811 #define _TXSTA1_TXEN1 0x20
4812 #define _TXSTA1_TX9 0x40
4813 #define _TXSTA1_TX91 0x40
4814 #define _TXSTA1_CSRC 0x80
4815 #define _TXSTA1_CSRC1 0x80
4817 //==============================================================================
4819 extern __at(0x0FAD) __sfr TX1REG
;
4820 extern __at(0x0FAD) __sfr TXREG
;
4821 extern __at(0x0FAD) __sfr TXREG1
;
4822 extern __at(0x0FAE) __sfr RC1REG
;
4823 extern __at(0x0FAE) __sfr RCREG
;
4824 extern __at(0x0FAE) __sfr RCREG1
;
4825 extern __at(0x0FAF) __sfr SP1BRG
;
4826 extern __at(0x0FAF) __sfr SPBRG
;
4827 extern __at(0x0FAF) __sfr SPBRG1
;
4828 extern __at(0x0FB0) __sfr SP1BRGH
;
4829 extern __at(0x0FB0) __sfr SPBRGH
;
4830 extern __at(0x0FB0) __sfr SPBRGH1
;
4832 //==============================================================================
4835 extern __at(0x0FB1) __sfr T3CON
;
4841 unsigned TMR3ON
: 1;
4842 unsigned T3RD16
: 1;
4843 unsigned NOT_T3SYNC
: 1;
4844 unsigned T3SOSCEN
: 1;
4845 unsigned T3CKPS0
: 1;
4846 unsigned T3CKPS1
: 1;
4847 unsigned TMR3CS0
: 1;
4848 unsigned TMR3CS1
: 1;
4856 unsigned T3OSCEN
: 1;
4866 unsigned T3CKPS
: 2;
4873 unsigned TMR3CS
: 2;
4877 extern __at(0x0FB1) volatile __T3CONbits_t T3CONbits
;
4879 #define _TMR3ON 0x01
4880 #define _T3RD16 0x02
4881 #define _NOT_T3SYNC 0x04
4882 #define _T3SOSCEN 0x08
4883 #define _T3OSCEN 0x08
4884 #define _T3CKPS0 0x10
4885 #define _T3CKPS1 0x20
4886 #define _TMR3CS0 0x40
4887 #define _TMR3CS1 0x80
4889 //==============================================================================
4891 extern __at(0x0FB2) __sfr TMR3
;
4892 extern __at(0x0FB2) __sfr TMR3L
;
4893 extern __at(0x0FB3) __sfr TMR3H
;
4895 //==============================================================================
4898 extern __at(0x0FB4) __sfr T3GCON
;
4904 unsigned T3GSS0
: 1;
4905 unsigned T3GSS1
: 1;
4906 unsigned T3GVAL
: 1;
4907 unsigned T3GGO_NOT_DONE
: 1;
4908 unsigned T3GSPM
: 1;
4910 unsigned T3GPOL
: 1;
4911 unsigned TMR3GE
: 1;
4919 unsigned T3G_DONE
: 1;
4945 extern __at(0x0FB4) volatile __T3GCONbits_t T3GCONbits
;
4947 #define _T3GSS0 0x01
4948 #define _T3GSS1 0x02
4949 #define _T3GVAL 0x04
4950 #define _T3GGO_NOT_DONE 0x08
4951 #define _T3G_DONE 0x08
4953 #define _T3GSPM 0x10
4955 #define _T3GPOL 0x40
4956 #define _TMR3GE 0x80
4958 //==============================================================================
4961 //==============================================================================
4964 extern __at(0x0FB6) __sfr ECCP1AS
;
4970 unsigned P1SSBD0
: 1;
4971 unsigned P1SSBD1
: 1;
4972 unsigned P1SSAC0
: 1;
4973 unsigned P1SSAC1
: 1;
4974 unsigned CCP1AS0
: 1;
4975 unsigned CCP1AS1
: 1;
4976 unsigned CCP1AS2
: 1;
4977 unsigned CCP1ASE
: 1;
4982 unsigned PSS1BD0
: 1;
4983 unsigned PSS1BD1
: 1;
4984 unsigned PSS1AC0
: 1;
4985 unsigned PSS1AC1
: 1;
4986 unsigned ECCPAS0
: 1;
4987 unsigned ECCPAS1
: 1;
4988 unsigned ECCPAS2
: 1;
4989 unsigned ECCPASE
: 1;
4994 unsigned PSSBD0
: 1;
4995 unsigned PSSBD1
: 1;
4996 unsigned PSSAC0
: 1;
4997 unsigned PSSAC1
: 1;
5006 unsigned P1SSBD
: 2;
5018 unsigned PSS1BD
: 2;
5025 unsigned PSS1AC
: 2;
5032 unsigned P1SSAC
: 2;
5046 unsigned ECCPAS
: 3;
5053 unsigned CCP1AS
: 3;
5058 extern __at(0x0FB6) volatile __ECCP1ASbits_t ECCP1ASbits
;
5060 #define _P1SSBD0 0x01
5061 #define _PSS1BD0 0x01
5062 #define _PSSBD0 0x01
5063 #define _P1SSBD1 0x02
5064 #define _PSS1BD1 0x02
5065 #define _PSSBD1 0x02
5066 #define _P1SSAC0 0x04
5067 #define _PSS1AC0 0x04
5068 #define _PSSAC0 0x04
5069 #define _P1SSAC1 0x08
5070 #define _PSS1AC1 0x08
5071 #define _PSSAC1 0x08
5072 #define _CCP1AS0 0x10
5073 #define _ECCPAS0 0x10
5074 #define _CCP1AS1 0x20
5075 #define _ECCPAS1 0x20
5076 #define _CCP1AS2 0x40
5077 #define _ECCPAS2 0x40
5078 #define _CCP1ASE 0x80
5079 #define _ECCPASE 0x80
5081 //==============================================================================
5084 //==============================================================================
5087 extern __at(0x0FB6) __sfr ECCPAS
;
5093 unsigned P1SSBD0
: 1;
5094 unsigned P1SSBD1
: 1;
5095 unsigned P1SSAC0
: 1;
5096 unsigned P1SSAC1
: 1;
5097 unsigned CCP1AS0
: 1;
5098 unsigned CCP1AS1
: 1;
5099 unsigned CCP1AS2
: 1;
5100 unsigned CCP1ASE
: 1;
5105 unsigned PSS1BD0
: 1;
5106 unsigned PSS1BD1
: 1;
5107 unsigned PSS1AC0
: 1;
5108 unsigned PSS1AC1
: 1;
5109 unsigned ECCPAS0
: 1;
5110 unsigned ECCPAS1
: 1;
5111 unsigned ECCPAS2
: 1;
5112 unsigned ECCPASE
: 1;
5117 unsigned PSSBD0
: 1;
5118 unsigned PSSBD1
: 1;
5119 unsigned PSSAC0
: 1;
5120 unsigned PSSAC1
: 1;
5129 unsigned PSS1BD
: 2;
5141 unsigned P1SSBD
: 2;
5148 unsigned PSS1AC
: 2;
5162 unsigned P1SSAC
: 2;
5169 unsigned CCP1AS
: 3;
5176 unsigned ECCPAS
: 3;
5181 extern __at(0x0FB6) volatile __ECCPASbits_t ECCPASbits
;
5183 #define _ECCPAS_P1SSBD0 0x01
5184 #define _ECCPAS_PSS1BD0 0x01
5185 #define _ECCPAS_PSSBD0 0x01
5186 #define _ECCPAS_P1SSBD1 0x02
5187 #define _ECCPAS_PSS1BD1 0x02
5188 #define _ECCPAS_PSSBD1 0x02
5189 #define _ECCPAS_P1SSAC0 0x04
5190 #define _ECCPAS_PSS1AC0 0x04
5191 #define _ECCPAS_PSSAC0 0x04
5192 #define _ECCPAS_P1SSAC1 0x08
5193 #define _ECCPAS_PSS1AC1 0x08
5194 #define _ECCPAS_PSSAC1 0x08
5195 #define _ECCPAS_CCP1AS0 0x10
5196 #define _ECCPAS_ECCPAS0 0x10
5197 #define _ECCPAS_CCP1AS1 0x20
5198 #define _ECCPAS_ECCPAS1 0x20
5199 #define _ECCPAS_CCP1AS2 0x40
5200 #define _ECCPAS_ECCPAS2 0x40
5201 #define _ECCPAS_CCP1ASE 0x80
5202 #define _ECCPAS_ECCPASE 0x80
5204 //==============================================================================
5207 //==============================================================================
5210 extern __at(0x0FB7) __sfr PWM1CON
;
5223 unsigned P1RSEN
: 1;
5251 extern __at(0x0FB7) volatile __PWM1CONbits_t PWM1CONbits
;
5267 #define _P1RSEN 0x80
5270 //==============================================================================
5273 //==============================================================================
5276 extern __at(0x0FB7) __sfr PWMCON
;
5289 unsigned P1RSEN
: 1;
5317 extern __at(0x0FB7) volatile __PWMCONbits_t PWMCONbits
;
5319 #define _PWMCON_P1DC0 0x01
5320 #define _PWMCON_PDC0 0x01
5321 #define _PWMCON_P1DC1 0x02
5322 #define _PWMCON_PDC1 0x02
5323 #define _PWMCON_P1DC2 0x04
5324 #define _PWMCON_PDC2 0x04
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5326 #define _PWMCON_PDC3 0x08
5327 #define _PWMCON_P1DC4 0x10
5328 #define _PWMCON_PDC4 0x10
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5332 #define _PWMCON_PDC6 0x40
5333 #define _PWMCON_P1RSEN 0x80
5334 #define _PWMCON_PRSEN 0x80
5336 //==============================================================================
5339 //==============================================================================
5342 extern __at(0x0FB8) __sfr BAUD1CON
;
5355 unsigned ABDOVF
: 1;
5371 extern __at(0x0FB8) volatile __BAUD1CONbits_t BAUD1CONbits
;
5380 #define _ABDOVF 0x80
5382 //==============================================================================
5385 //==============================================================================
5388 extern __at(0x0FB8) __sfr BAUDCON
;
5401 unsigned ABDOVF
: 1;
5417 extern __at(0x0FB8) volatile __BAUDCONbits_t BAUDCONbits
;
5419 #define _BAUDCON_ABDEN 0x01
5420 #define _BAUDCON_WUE 0x02
5421 #define _BAUDCON_BRG16 0x08
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5425 #define _BAUDCON_RCIDL 0x40
5426 #define _BAUDCON_ABDOVF 0x80
5428 //==============================================================================
5431 //==============================================================================
5434 extern __at(0x0FB8) __sfr BAUDCON1
;
5447 unsigned ABDOVF
: 1;
5463 extern __at(0x0FB8) volatile __BAUDCON1bits_t BAUDCON1bits
;
5465 #define _BAUDCON1_ABDEN 0x01
5466 #define _BAUDCON1_WUE 0x02
5467 #define _BAUDCON1_BRG16 0x08
5468 #define _BAUDCON1_CKTXP 0x10
5469 #define _BAUDCON1_SCKP 0x10
5470 #define _BAUDCON1_DTRXP 0x20
5471 #define _BAUDCON1_RCIDL 0x40
5472 #define _BAUDCON1_ABDOVF 0x80
5474 //==============================================================================
5477 //==============================================================================
5480 extern __at(0x0FB8) __sfr BAUDCTL
;
5493 unsigned ABDOVF
: 1;
5509 extern __at(0x0FB8) volatile __BAUDCTLbits_t BAUDCTLbits
;
5511 #define _BAUDCTL_ABDEN 0x01
5512 #define _BAUDCTL_WUE 0x02
5513 #define _BAUDCTL_BRG16 0x08
5514 #define _BAUDCTL_CKTXP 0x10
5515 #define _BAUDCTL_SCKP 0x10
5516 #define _BAUDCTL_DTRXP 0x20
5517 #define _BAUDCTL_RCIDL 0x40
5518 #define _BAUDCTL_ABDOVF 0x80
5520 //==============================================================================
5523 //==============================================================================
5526 extern __at(0x0FB9) __sfr PSTR1CON
;
5534 unsigned STR1SYNC
: 1;
5540 extern __at(0x0FB9) volatile __PSTR1CONbits_t PSTR1CONbits
;
5546 #define _STR1SYNC 0x10
5548 //==============================================================================
5551 //==============================================================================
5554 extern __at(0x0FB9) __sfr PSTRCON
;
5562 unsigned STR1SYNC
: 1;
5568 extern __at(0x0FB9) volatile __PSTRCONbits_t PSTRCONbits
;
5570 #define _PSTRCON_STR1A 0x01
5571 #define _PSTRCON_STR1B 0x02
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5574 #define _PSTRCON_STR1SYNC 0x10
5576 //==============================================================================
5579 //==============================================================================
5582 extern __at(0x0FBA) __sfr T2CON
;
5588 unsigned T2CKPS0
: 1;
5589 unsigned T2CKPS1
: 1;
5590 unsigned TMR2ON
: 1;
5591 unsigned T2OUTPS0
: 1;
5592 unsigned T2OUTPS1
: 1;
5593 unsigned T2OUTPS2
: 1;
5594 unsigned T2OUTPS3
: 1;
5600 unsigned T2CKPS
: 2;
5607 unsigned T2OUTPS
: 4;
5612 extern __at(0x0FBA) volatile __T2CONbits_t T2CONbits
;
5614 #define _T2CKPS0 0x01
5615 #define _T2CKPS1 0x02
5616 #define _TMR2ON 0x04
5617 #define _T2OUTPS0 0x08
5618 #define _T2OUTPS1 0x10
5619 #define _T2OUTPS2 0x20
5620 #define _T2OUTPS3 0x40
5622 //==============================================================================
5624 extern __at(0x0FBB) __sfr PR2
;
5625 extern __at(0x0FBC) __sfr TMR2
;
5627 //==============================================================================
5630 extern __at(0x0FBD) __sfr CCP1CON
;
5636 unsigned CCP1M0
: 1;
5637 unsigned CCP1M1
: 1;
5638 unsigned CCP1M2
: 1;
5639 unsigned CCP1M3
: 1;
5666 extern __at(0x0FBD) volatile __CCP1CONbits_t CCP1CONbits
;
5668 #define _CCP1M0 0x01
5669 #define _CCP1M1 0x02
5670 #define _CCP1M2 0x04
5671 #define _CCP1M3 0x08
5677 //==============================================================================
5679 extern __at(0x0FBE) __sfr CCPR1
;
5680 extern __at(0x0FBE) __sfr CCPR1L
;
5681 extern __at(0x0FBF) __sfr CCPR1H
;
5683 //==============================================================================
5686 extern __at(0x0FC0) __sfr ADCON2
;
5716 extern __at(0x0FC0) volatile __ADCON2bits_t ADCON2bits
;
5726 //==============================================================================
5729 //==============================================================================
5732 extern __at(0x0FC1) __sfr ADCON1
;
5738 unsigned NVCFG0
: 1;
5739 unsigned NVCFG1
: 1;
5740 unsigned PVCFG0
: 1;
5741 unsigned PVCFG1
: 1;
5745 unsigned TRIGSEL
: 1;
5762 extern __at(0x0FC1) volatile __ADCON1bits_t ADCON1bits
;
5764 #define _NVCFG0 0x01
5765 #define _NVCFG1 0x02
5766 #define _PVCFG0 0x04
5767 #define _PVCFG1 0x08
5768 #define _TRIGSEL 0x80
5770 //==============================================================================
5773 //==============================================================================
5776 extern __at(0x0FC2) __sfr ADCON0
;
5783 unsigned GO_NOT_DONE
: 1;
5819 unsigned NOT_DONE
: 1;
5831 unsigned GO_DONE
: 1;
5848 extern __at(0x0FC2) volatile __ADCON0bits_t ADCON0bits
;
5851 #define _GO_NOT_DONE 0x02
5854 #define _NOT_DONE 0x02
5855 #define _GO_DONE 0x02
5862 //==============================================================================
5864 extern __at(0x0FC3) __sfr ADRES
;
5865 extern __at(0x0FC3) __sfr ADRESL
;
5866 extern __at(0x0FC4) __sfr ADRESH
;
5868 //==============================================================================
5871 extern __at(0x0FC5) __sfr SSP1CON2
;
5881 unsigned ACKSTAT
: 1;
5885 extern __at(0x0FC5) volatile __SSP1CON2bits_t SSP1CON2bits
;
5893 #define _ACKSTAT 0x40
5896 //==============================================================================
5899 //==============================================================================
5902 extern __at(0x0FC5) __sfr SSPCON2
;
5912 unsigned ACKSTAT
: 1;
5916 extern __at(0x0FC5) volatile __SSPCON2bits_t SSPCON2bits
;
5918 #define _SSPCON2_SEN 0x01
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5927 //==============================================================================
5930 //==============================================================================
5933 extern __at(0x0FC6) __sfr SSP1CON1
;
5956 extern __at(0x0FC6) volatile __SSP1CON1bits_t SSP1CON1bits
;
5967 //==============================================================================
5970 //==============================================================================
5973 extern __at(0x0FC6) __sfr SSPCON1
;
5996 extern __at(0x0FC6) volatile __SSPCON1bits_t SSPCON1bits
;
5998 #define _SSPCON1_SSPM0 0x01
5999 #define _SSPCON1_SSPM1 0x02
6000 #define _SSPCON1_SSPM2 0x04
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6005 #define _SSPCON1_WCOL 0x80
6007 //==============================================================================
6010 //==============================================================================
6013 extern __at(0x0FC7) __sfr SSP1STAT
;
6021 unsigned R_NOT_W
: 1;
6024 unsigned D_NOT_A
: 1;
6069 unsigned NOT_WRITE
: 1;
6072 unsigned NOT_ADDRESS
: 1;
6078 extern __at(0x0FC7) volatile __SSP1STATbits_t SSP1STATbits
;
6082 #define _R_NOT_W 0x04
6086 #define _NOT_WRITE 0x04
6089 #define _D_NOT_A 0x20
6093 #define _NOT_ADDRESS 0x20
6097 //==============================================================================
6100 //==============================================================================
6103 extern __at(0x0FC7) __sfr SSPSTAT
;
6111 unsigned R_NOT_W
: 1;
6114 unsigned D_NOT_A
: 1;
6159 unsigned NOT_WRITE
: 1;
6162 unsigned NOT_ADDRESS
: 1;
6168 extern __at(0x0FC7) volatile __SSPSTATbits_t SSPSTATbits
;
6170 #define _SSPSTAT_BF 0x01
6171 #define _SSPSTAT_UA 0x02
6172 #define _SSPSTAT_R_NOT_W 0x04
6173 #define _SSPSTAT_R 0x04
6174 #define _SSPSTAT_NOT_W 0x04
6175 #define _SSPSTAT_R_W 0x04
6176 #define _SSPSTAT_NOT_WRITE 0x04
6177 #define _SSPSTAT_S 0x08
6178 #define _SSPSTAT_P 0x10
6179 #define _SSPSTAT_D_NOT_A 0x20
6180 #define _SSPSTAT_D 0x20
6181 #define _SSPSTAT_NOT_A 0x20
6182 #define _SSPSTAT_D_A 0x20
6183 #define _SSPSTAT_NOT_ADDRESS 0x20
6184 #define _SSPSTAT_CKE 0x40
6185 #define _SSPSTAT_SMP 0x80
6187 //==============================================================================
6189 extern __at(0x0FC8) __sfr SSP1ADD
;
6190 extern __at(0x0FC8) __sfr SSPADD
;
6191 extern __at(0x0FC9) __sfr SSP1BUF
;
6192 extern __at(0x0FC9) __sfr SSPBUF
;
6194 //==============================================================================
6197 extern __at(0x0FCA) __sfr SSP1MSK
;
6211 extern __at(0x0FCA) volatile __SSP1MSKbits_t SSP1MSKbits
;
6222 //==============================================================================
6225 //==============================================================================
6228 extern __at(0x0FCA) __sfr SSPMSK
;
6242 extern __at(0x0FCA) volatile __SSPMSKbits_t SSPMSKbits
;
6244 #define _SSPMSK_MSK0 0x01
6245 #define _SSPMSK_MSK1 0x02
6246 #define _SSPMSK_MSK2 0x04
6247 #define _SSPMSK_MSK3 0x08
6248 #define _SSPMSK_MSK4 0x10
6249 #define _SSPMSK_MSK5 0x20
6250 #define _SSPMSK_MSK6 0x40
6251 #define _SSPMSK_MSK7 0x80
6253 //==============================================================================
6256 //==============================================================================
6259 extern __at(0x0FCB) __sfr SSP1CON3
;
6270 unsigned ACKTIM
: 1;
6273 extern __at(0x0FCB) volatile __SSP1CON3bits_t SSP1CON3bits
;
6282 #define _ACKTIM 0x80
6284 //==============================================================================
6287 //==============================================================================
6290 extern __at(0x0FCB) __sfr SSPCON3
;
6301 unsigned ACKTIM
: 1;
6304 extern __at(0x0FCB) volatile __SSPCON3bits_t SSPCON3bits
;
6306 #define _SSPCON3_DHEN 0x01
6307 #define _SSPCON3_AHEN 0x02
6308 #define _SSPCON3_SBCDE 0x04
6309 #define _SSPCON3_SDAHT 0x08
6310 #define _SSPCON3_BOEN 0x10
6311 #define _SSPCON3_SCIE 0x20
6312 #define _SSPCON3_PCIE 0x40
6313 #define _SSPCON3_ACKTIM 0x80
6315 //==============================================================================
6318 //==============================================================================
6321 extern __at(0x0FCC) __sfr T1GCON
;
6327 unsigned T1GSS0
: 1;
6328 unsigned T1GSS1
: 1;
6329 unsigned T1GVAL
: 1;
6330 unsigned T1GGO_NOT_DONE
: 1;
6331 unsigned T1GSPM
: 1;
6333 unsigned T1GPOL
: 1;
6334 unsigned TMR1GE
: 1;
6342 unsigned T1G_DONE
: 1;
6368 extern __at(0x0FCC) volatile __T1GCONbits_t T1GCONbits
;
6370 #define _T1GSS0 0x01
6371 #define _T1GSS1 0x02
6372 #define _T1GVAL 0x04
6373 #define _T1GGO_NOT_DONE 0x08
6374 #define _T1G_DONE 0x08
6376 #define _T1GSPM 0x10
6378 #define _T1GPOL 0x40
6379 #define _TMR1GE 0x80
6381 //==============================================================================
6384 //==============================================================================
6387 extern __at(0x0FCD) __sfr T1CON
;
6393 unsigned TMR1ON
: 1;
6394 unsigned T1RD16
: 1;
6395 unsigned NOT_T1SYNC
: 1;
6396 unsigned T1SOSCEN
: 1;
6397 unsigned T1CKPS0
: 1;
6398 unsigned T1CKPS1
: 1;
6399 unsigned TMR1CS0
: 1;
6400 unsigned TMR1CS1
: 1;
6407 unsigned T1SYNC
: 1;
6408 unsigned T1OSCEN
: 1;
6418 unsigned T1CKPS
: 2;
6425 unsigned TMR1CS
: 2;
6429 extern __at(0x0FCD) volatile __T1CONbits_t T1CONbits
;
6431 #define _TMR1ON 0x01
6432 #define _T1RD16 0x02
6434 #define _NOT_T1SYNC 0x04
6435 #define _T1SYNC 0x04
6436 #define _T1SOSCEN 0x08
6437 #define _T1OSCEN 0x08
6438 #define _T1CKPS0 0x10
6439 #define _T1CKPS1 0x20
6440 #define _TMR1CS0 0x40
6441 #define _TMR1CS1 0x80
6443 //==============================================================================
6445 extern __at(0x0FCE) __sfr TMR1
;
6446 extern __at(0x0FCE) __sfr TMR1L
;
6447 extern __at(0x0FCF) __sfr TMR1H
;
6449 //==============================================================================
6452 extern __at(0x0FD0) __sfr RCON
;
6458 unsigned NOT_BOR
: 1;
6459 unsigned NOT_POR
: 1;
6460 unsigned NOT_PD
: 1;
6461 unsigned NOT_TO
: 1;
6462 unsigned NOT_RI
: 1;
6464 unsigned SBOREN
: 1;
6481 extern __at(0x0FD0) volatile __RCONbits_t RCONbits
;
6483 #define _NOT_BOR 0x01
6485 #define _NOT_POR 0x02
6487 #define _NOT_PD 0x04
6489 #define _NOT_TO 0x08
6491 #define _NOT_RI 0x10
6493 #define _SBOREN 0x40
6496 //==============================================================================
6499 //==============================================================================
6502 extern __at(0x0FD1) __sfr WDTCON
;
6508 unsigned SWDTEN
: 1;
6531 extern __at(0x0FD1) volatile __WDTCONbits_t WDTCONbits
;
6533 #define _SWDTEN 0x01
6536 //==============================================================================
6539 //==============================================================================
6542 extern __at(0x0FD2) __sfr OSCCON2
;
6546 unsigned LFIOFS
: 1;
6547 unsigned MFIOFS
: 1;
6549 unsigned SOSCGO
: 1;
6550 unsigned MFIOSEL
: 1;
6552 unsigned SOSCRUN
: 1;
6553 unsigned PLLRDY
: 1;
6556 extern __at(0x0FD2) volatile __OSCCON2bits_t OSCCON2bits
;
6558 #define _LFIOFS 0x01
6559 #define _MFIOFS 0x02
6561 #define _SOSCGO 0x08
6562 #define _MFIOSEL 0x10
6563 #define _SOSCRUN 0x40
6564 #define _PLLRDY 0x80
6566 //==============================================================================
6569 //==============================================================================
6572 extern __at(0x0FD3) __sfr OSCCON
;
6580 unsigned HFIOFS
: 1;
6614 extern __at(0x0FD3) volatile __OSCCONbits_t OSCCONbits
;
6618 #define _HFIOFS 0x04
6626 //==============================================================================
6629 //==============================================================================
6632 extern __at(0x0FD5) __sfr T0CON
;
6644 unsigned T08BIT
: 1;
6645 unsigned TMR0ON
: 1;
6655 extern __at(0x0FD5) volatile __T0CONbits_t T0CONbits
;
6663 #define _T08BIT 0x40
6664 #define _TMR0ON 0x80
6666 //==============================================================================
6668 extern __at(0x0FD6) __sfr TMR0
;
6669 extern __at(0x0FD6) __sfr TMR0L
;
6670 extern __at(0x0FD7) __sfr TMR0H
;
6672 //==============================================================================
6675 extern __at(0x0FD8) __sfr STATUS
;
6689 extern __at(0x0FD8) volatile __STATUSbits_t STATUSbits
;
6697 //==============================================================================
6699 extern __at(0x0FD9) __sfr FSR2L
;
6700 extern __at(0x0FDA) __sfr FSR2H
;
6701 extern __at(0x0FDB) __sfr PLUSW2
;
6702 extern __at(0x0FDC) __sfr PREINC2
;
6703 extern __at(0x0FDD) __sfr POSTDEC2
;
6704 extern __at(0x0FDE) __sfr POSTINC2
;
6705 extern __at(0x0FDF) __sfr INDF2
;
6706 extern __at(0x0FE0) __sfr BSR
;
6707 extern __at(0x0FE1) __sfr FSR1L
;
6708 extern __at(0x0FE2) __sfr FSR1H
;
6709 extern __at(0x0FE3) __sfr PLUSW1
;
6710 extern __at(0x0FE4) __sfr PREINC1
;
6711 extern __at(0x0FE5) __sfr POSTDEC1
;
6712 extern __at(0x0FE6) __sfr POSTINC1
;
6713 extern __at(0x0FE7) __sfr INDF1
;
6714 extern __at(0x0FE8) __sfr WREG
;
6715 extern __at(0x0FE9) __sfr FSR0L
;
6716 extern __at(0x0FEA) __sfr FSR0H
;
6717 extern __at(0x0FEB) __sfr PLUSW0
;
6718 extern __at(0x0FEC) __sfr PREINC0
;
6719 extern __at(0x0FED) __sfr POSTDEC0
;
6720 extern __at(0x0FEE) __sfr POSTINC0
;
6721 extern __at(0x0FEF) __sfr INDF0
;
6723 //==============================================================================
6726 extern __at(0x0FF0) __sfr INTCON3
;
6732 unsigned INT1IF
: 1;
6733 unsigned INT2IF
: 1;
6735 unsigned INT1IE
: 1;
6736 unsigned INT2IE
: 1;
6738 unsigned INT1IP
: 1;
6739 unsigned INT2IP
: 1;
6755 extern __at(0x0FF0) volatile __INTCON3bits_t INTCON3bits
;
6757 #define _INT1IF 0x01
6759 #define _INT2IF 0x02
6761 #define _INT1IE 0x08
6763 #define _INT2IE 0x10
6765 #define _INT1IP 0x40
6767 #define _INT2IP 0x80
6770 //==============================================================================
6773 //==============================================================================
6776 extern __at(0x0FF1) __sfr INTCON2
;
6784 unsigned TMR0IP
: 1;
6786 unsigned INTEDG2
: 1;
6787 unsigned INTEDG1
: 1;
6788 unsigned INTEDG0
: 1;
6789 unsigned NOT_RBPU
: 1;
6805 extern __at(0x0FF1) volatile __INTCON2bits_t INTCON2bits
;
6808 #define _TMR0IP 0x04
6809 #define _INTEDG2 0x10
6810 #define _INTEDG1 0x20
6811 #define _INTEDG0 0x40
6812 #define _NOT_RBPU 0x80
6815 //==============================================================================
6818 //==============================================================================
6821 extern __at(0x0FF2) __sfr INTCON
;
6828 unsigned INT0IF
: 1;
6829 unsigned TMR0IF
: 1;
6831 unsigned INT0IE
: 1;
6832 unsigned TMR0IE
: 1;
6833 unsigned PEIE_GIEL
: 1;
6834 unsigned GIE_GIEH
: 1;
6862 extern __at(0x0FF2) volatile __INTCONbits_t INTCONbits
;
6865 #define _INT0IF 0x02
6867 #define _TMR0IF 0x04
6870 #define _INT0IE 0x10
6872 #define _TMR0IE 0x20
6874 #define _PEIE_GIEL 0x40
6877 #define _GIE_GIEH 0x80
6881 //==============================================================================
6883 extern __at(0x0FF3) __sfr PROD
;
6884 extern __at(0x0FF3) __sfr PRODL
;
6885 extern __at(0x0FF4) __sfr PRODH
;
6886 extern __at(0x0FF5) __sfr TABLAT
;
6887 extern __at(0x0FF6) __sfr TBLPTR
;
6888 extern __at(0x0FF6) __sfr TBLPTRL
;
6889 extern __at(0x0FF7) __sfr TBLPTRH
;
6890 extern __at(0x0FF8) __sfr TBLPTRU
;
6891 extern __at(0x0FF9) __sfr PC
;
6892 extern __at(0x0FF9) __sfr PCL
;
6893 extern __at(0x0FFA) __sfr PCLATH
;
6894 extern __at(0x0FFB) __sfr PCLATU
;
6896 //==============================================================================
6899 extern __at(0x0FFC) __sfr STKPTR
;
6905 unsigned STKPTR0
: 1;
6906 unsigned STKPTR1
: 1;
6907 unsigned STKPTR2
: 1;
6908 unsigned STKPTR3
: 1;
6909 unsigned STKPTR4
: 1;
6911 unsigned STKUNF
: 1;
6912 unsigned STKFUL
: 1;
6924 unsigned STKOVF
: 1;
6935 unsigned STKPTR
: 5;
6940 extern __at(0x0FFC) volatile __STKPTRbits_t STKPTRbits
;
6942 #define _STKPTR0 0x01
6944 #define _STKPTR1 0x02
6946 #define _STKPTR2 0x04
6948 #define _STKPTR3 0x08
6950 #define _STKPTR4 0x10
6952 #define _STKUNF 0x40
6953 #define _STKFUL 0x80
6954 #define _STKOVF 0x80
6956 //==============================================================================
6958 extern __at(0x0FFD) __sfr TOS
;
6959 extern __at(0x0FFD) __sfr TOSL
;
6960 extern __at(0x0FFE) __sfr TOSH
;
6961 extern __at(0x0FFF) __sfr TOSU
;
6963 //==============================================================================
6965 // Configuration Bits
6967 //==============================================================================
6969 #define __CONFIG1H 0x300001
6970 #define __CONFIG2L 0x300002
6971 #define __CONFIG2H 0x300003
6972 #define __CONFIG3H 0x300005
6973 #define __CONFIG4L 0x300006
6974 #define __CONFIG5L 0x300008
6975 #define __CONFIG5H 0x300009
6976 #define __CONFIG6L 0x30000A
6977 #define __CONFIG6H 0x30000B
6978 #define __CONFIG7L 0x30000C
6979 #define __CONFIG7H 0x30000D
6981 //----------------------------- CONFIG1H Options -------------------------------
6983 #define _FOSC_LP_1H 0xF0 // LP oscillator.
6984 #define _FOSC_XT_1H 0xF1 // XT oscillator.
6985 #define _FOSC_HSHP_1H 0xF2 // HS oscillator (high power > 16 MHz).
6986 #define _FOSC_HSMP_1H 0xF3 // HS oscillator (medium power 4-16 MHz).
6987 #define _FOSC_ECHP_1H 0xF4 // EC oscillator, CLKOUT function on OSC2 (high power, >16 MHz).
6988 #define _FOSC_ECHPIO6_1H 0xF5 // EC oscillator (high power, >16 MHz).
6989 #define _FOSC_RC_1H 0xF6 // External RC oscillator, CLKOUT function on OSC2.
6990 #define _FOSC_RCIO6_1H 0xF7 // External RC oscillator.
6991 #define _FOSC_INTIO67_1H 0xF8 // Internal oscillator block.
6992 #define _FOSC_INTIO7_1H 0xF9 // Internal oscillator block, CLKOUT function on OSC2.
6993 #define _FOSC_ECMP_1H 0xFA // EC oscillator, CLKOUT function on OSC2 (medium power, 500 kHz-16 MHz).
6994 #define _FOSC_ECMPIO6_1H 0xFB // EC oscillator (medium power, 500 kHz-16 MHz).
6995 #define _FOSC_ECLP_1H 0xFC // EC oscillator, CLKOUT function on OSC2 (low power, <500 kHz).
6996 #define _FOSC_ECLPIO6_1H 0xFD // EC oscillator (low power, <500 kHz).
6997 #define _PLLCFG_OFF_1H 0xEF // Oscillator used directly.
6998 #define _PLLCFG_ON_1H 0xFF // Oscillator multiplied by 4.
6999 #define _PRICLKEN_OFF_1H 0xDF // Primary clock can be disabled by software.
7000 #define _PRICLKEN_ON_1H 0xFF // Primary clock enabled.
7001 #define _FCMEN_OFF_1H 0xBF // Fail-Safe Clock Monitor disabled.
7002 #define _FCMEN_ON_1H 0xFF // Fail-Safe Clock Monitor enabled.
7003 #define _IESO_OFF_1H 0x7F // Oscillator Switchover mode disabled.
7004 #define _IESO_ON_1H 0xFF // Oscillator Switchover mode enabled.
7006 //----------------------------- CONFIG2L Options -------------------------------
7008 #define _PWRTEN_ON_2L 0xFE // Power up timer enabled.
7009 #define _PWRTEN_OFF_2L 0xFF // Power up timer disabled.
7010 #define _BOREN_OFF_2L 0xF9 // Brown-out Reset disabled in hardware and software.
7011 #define _BOREN_ON_2L 0xFB // Brown-out Reset enabled and controlled by software (SBOREN is enabled).
7012 #define _BOREN_NOSLP_2L 0xFD // Brown-out Reset enabled in hardware only and disabled in Sleep mode (SBOREN is disabled).
7013 #define _BOREN_SBORDIS_2L 0xFF // Brown-out Reset enabled in hardware only (SBOREN is disabled).
7014 #define _BORV_285_2L 0xE7 // VBOR set to 2.85 V nominal.
7015 #define _BORV_250_2L 0xEF // VBOR set to 2.50 V nominal.
7016 #define _BORV_220_2L 0xF7 // VBOR set to 2.20 V nominal.
7017 #define _BORV_190_2L 0xFF // VBOR set to 1.90 V nominal.
7019 //----------------------------- CONFIG2H Options -------------------------------
7021 #define _WDTEN_OFF_2H 0xFC // Watch dog timer is always disabled. SWDTEN has no effect.
7022 #define _WDTEN_NOSLP_2H 0xFD // WDT is disabled in sleep, otherwise enabled. SWDTEN bit has no effect.
7023 #define _WDTEN_SWON_2H 0xFE // WDT is controlled by SWDTEN bit of the WDTCON register.
7024 #define _WDTEN_ON_2H 0xFF // WDT is always enabled. SWDTEN bit has no effect.
7025 #define _WDTPS_1_2H 0xC3 // 1:1.
7026 #define _WDTPS_2_2H 0xC7 // 1:2.
7027 #define _WDTPS_4_2H 0xCB // 1:4.
7028 #define _WDTPS_8_2H 0xCF // 1:8.
7029 #define _WDTPS_16_2H 0xD3 // 1:16.
7030 #define _WDTPS_32_2H 0xD7 // 1:32.
7031 #define _WDTPS_64_2H 0xDB // 1:64.
7032 #define _WDTPS_128_2H 0xDF // 1:128.
7033 #define _WDTPS_256_2H 0xE3 // 1:256.
7034 #define _WDTPS_512_2H 0xE7 // 1:512.
7035 #define _WDTPS_1024_2H 0xEB // 1:1024.
7036 #define _WDTPS_2048_2H 0xEF // 1:2048.
7037 #define _WDTPS_4096_2H 0xF3 // 1:4096.
7038 #define _WDTPS_8192_2H 0xF7 // 1:8192.
7039 #define _WDTPS_16384_2H 0xFB // 1:16384.
7040 #define _WDTPS_32768_2H 0xFF // 1:32768.
7042 //----------------------------- CONFIG3H Options -------------------------------
7044 #define _CCP2MX_PORTB3_3H 0xFE // CCP2 input/output is multiplexed with RB3.
7045 #define _CCP2MX_PORTC1_3H 0xFF // CCP2 input/output is multiplexed with RC1.
7046 #define _PBADEN_OFF_3H 0xFD // PORTB<5:0> pins are configured as digital I/O on Reset.
7047 #define _PBADEN_ON_3H 0xFF // PORTB<5:0> pins are configured as analog input channels on Reset.
7048 #define _CCP3MX_PORTC6_3H 0xFB // P3A/CCP3 input/output is mulitplexed with RC6.
7049 #define _CCP3MX_PORTB5_3H 0xFF // P3A/CCP3 input/output is multiplexed with RB5.
7050 #define _HFOFST_OFF_3H 0xF7 // HFINTOSC output and ready status are delayed by the oscillator stable status.
7051 #define _HFOFST_ON_3H 0xFF // HFINTOSC output and ready status are not delayed by the oscillator stable status.
7052 #define _T3CMX_PORTB5_3H 0xEF // T3CKI is on RB5.
7053 #define _T3CMX_PORTC0_3H 0xFF // T3CKI is on RC0.
7054 #define _P2BMX_PORTC0_3H 0xDF // P2B is on RC0.
7055 #define _P2BMX_PORTB5_3H 0xFF // P2B is on RB5.
7056 #define _MCLRE_INTMCLR_3H 0x7F // RE3 input pin enabled; MCLR disabled.
7057 #define _MCLRE_EXTMCLR_3H 0xFF // MCLR pin enabled, RE3 input pin disabled.
7059 //----------------------------- CONFIG4L Options -------------------------------
7061 #define _STVREN_OFF_4L 0xFE // Stack full/underflow will not cause Reset.
7062 #define _STVREN_ON_4L 0xFF // Stack full/underflow will cause Reset.
7063 #define _LVP_OFF_4L 0xFB // Single-Supply ICSP disabled.
7064 #define _LVP_ON_4L 0xFF // Single-Supply ICSP enabled if MCLRE is also 1.
7065 #define _XINST_OFF_4L 0xBF // Instruction set extension and Indexed Addressing mode disabled (Legacy mode).
7066 #define _XINST_ON_4L 0xFF // Instruction set extension and Indexed Addressing mode enabled.
7067 #define _DEBUG_ON_4L 0x7F // Enabled.
7068 #define _DEBUG_OFF_4L 0xFF // Disabled.
7070 //----------------------------- CONFIG5L Options -------------------------------
7072 #define _CP0_ON_5L 0xFE // Block 0 (000800-001FFFh) code-protected.
7073 #define _CP0_OFF_5L 0xFF // Block 0 (000800-001FFFh) not code-protected.
7074 #define _CP1_ON_5L 0xFD // Block 1 (002000-003FFFh) code-protected.
7075 #define _CP1_OFF_5L 0xFF // Block 1 (002000-003FFFh) not code-protected.
7076 #define _CP2_ON_5L 0xFB // Block 2 (004000-005FFFh) code-protected.
7077 #define _CP2_OFF_5L 0xFF // Block 2 (004000-005FFFh) not code-protected.
7078 #define _CP3_ON_5L 0xF7 // Block 3 (006000-007FFFh) code-protected.
7079 #define _CP3_OFF_5L 0xFF // Block 3 (006000-007FFFh) not code-protected.
7081 //----------------------------- CONFIG5H Options -------------------------------
7083 #define _CPB_ON_5H 0xBF // Boot block (000000-0007FFh) code-protected.
7084 #define _CPB_OFF_5H 0xFF // Boot block (000000-0007FFh) not code-protected.
7085 #define _CPD_ON_5H 0x7F // Data EEPROM code-protected.
7086 #define _CPD_OFF_5H 0xFF // Data EEPROM not code-protected.
7088 //----------------------------- CONFIG6L Options -------------------------------
7090 #define _WRT0_ON_6L 0xFE // Block 0 (000800-001FFFh) write-protected.
7091 #define _WRT0_OFF_6L 0xFF // Block 0 (000800-001FFFh) not write-protected.
7092 #define _WRT1_ON_6L 0xFD // Block 1 (002000-003FFFh) write-protected.
7093 #define _WRT1_OFF_6L 0xFF // Block 1 (002000-003FFFh) not write-protected.
7094 #define _WRT2_ON_6L 0xFB // Block 2 (004000-005FFFh) write-protected.
7095 #define _WRT2_OFF_6L 0xFF // Block 2 (004000-005FFFh) not write-protected.
7096 #define _WRT3_ON_6L 0xF7 // Block 3 (006000-007FFFh) write-protected.
7097 #define _WRT3_OFF_6L 0xFF // Block 3 (006000-007FFFh) not write-protected.
7099 //----------------------------- CONFIG6H Options -------------------------------
7101 #define _WRTC_ON_6H 0xDF // Configuration registers (300000-3000FFh) write-protected.
7102 #define _WRTC_OFF_6H 0xFF // Configuration registers (300000-3000FFh) not write-protected.
7103 #define _WRTB_ON_6H 0xBF // Boot Block (000000-0007FFh) write-protected.
7104 #define _WRTB_OFF_6H 0xFF // Boot Block (000000-0007FFh) not write-protected.
7105 #define _WRTD_ON_6H 0x7F // Data EEPROM write-protected.
7106 #define _WRTD_OFF_6H 0xFF // Data EEPROM not write-protected.
7108 //----------------------------- CONFIG7L Options -------------------------------
7110 #define _EBTR0_ON_7L 0xFE // Block 0 (000800-001FFFh) protected from table reads executed in other blocks.
7111 #define _EBTR0_OFF_7L 0xFF // Block 0 (000800-001FFFh) not protected from table reads executed in other blocks.
7112 #define _EBTR1_ON_7L 0xFD // Block 1 (002000-003FFFh) protected from table reads executed in other blocks.
7113 #define _EBTR1_OFF_7L 0xFF // Block 1 (002000-003FFFh) not protected from table reads executed in other blocks.
7114 #define _EBTR2_ON_7L 0xFB // Block 2 (004000-005FFFh) protected from table reads executed in other blocks.
7115 #define _EBTR2_OFF_7L 0xFF // Block 2 (004000-005FFFh) not protected from table reads executed in other blocks.
7116 #define _EBTR3_ON_7L 0xF7 // Block 3 (006000-007FFFh) protected from table reads executed in other blocks.
7117 #define _EBTR3_OFF_7L 0xFF // Block 3 (006000-007FFFh) not protected from table reads executed in other blocks.
7119 //----------------------------- CONFIG7H Options -------------------------------
7121 #define _EBTRB_ON_7H 0xBF // Boot Block (000000-0007FFh) protected from table reads executed in other blocks.
7122 #define _EBTRB_OFF_7H 0xFF // Boot Block (000000-0007FFh) not protected from table reads executed in other blocks.
7124 //==============================================================================
7126 #define __DEVID1 0x3FFFFE
7127 #define __DEVID2 0x3FFFFF
7129 #define __IDLOC0 0x200000
7130 #define __IDLOC1 0x200001
7131 #define __IDLOC2 0x200002
7132 #define __IDLOC3 0x200003
7133 #define __IDLOC4 0x200004
7134 #define __IDLOC5 0x200005
7135 #define __IDLOC6 0x200006
7136 #define __IDLOC7 0x200007
7138 #endif // #ifndef __PIC18F25K22_H__