2 * This declarations of the PIC18F8621 MCU.
4 * This file is part of the GNU PIC library for SDCC, originally
5 * created by Molnar Karoly <molnarkaroly@users.sf.net> 2016.
7 * This file is generated automatically by the cinc2h.pl, 2016-04-13 17:23:52 UTC.
9 * SDCC is licensed under the GNU Public license (GPL) v2. Note that
10 * this license covers the code to the compiler and other executables,
11 * but explicitly does not cover any code or objects generated by sdcc.
13 * For pic device libraries and header files which are derived from
14 * Microchip header (.inc) and linker script (.lkr) files Microchip
15 * requires that "The header files should state that they are only to be
16 * used with authentic Microchip devices" which makes them incompatible
17 * with the GPL. Pic device libraries and header files are located at
18 * non-free/lib and non-free/include directories respectively.
19 * Sdcc should be run with the --use-non-free command line option in
20 * order to include non-free header files and libraries.
22 * See http://sdcc.sourceforge.net/ for the latest information on sdcc.
25 #ifndef __PIC18F8621_H__
26 #define __PIC18F8621_H__
28 //==============================================================================
30 //==============================================================================
32 // Register Definitions
34 //==============================================================================
37 //==============================================================================
40 extern __at(0x0F67) __sfr ECCP2DEL
;
81 extern __at(0x0F67) volatile __ECCP2DELbits_t ECCP2DELbits
;
83 #define _ECCP2DEL_P2DC0 0x01
84 #define _ECCP2DEL_PDC0 0x01
85 #define _ECCP2DEL_P2DC1 0x02
86 #define _ECCP2DEL_PDC1 0x02
87 #define _ECCP2DEL_P2DC2 0x04
88 #define _ECCP2DEL_PDC2 0x04
89 #define _ECCP2DEL_P2DC3 0x08
90 #define _ECCP2DEL_PDC3 0x08
91 #define _ECCP2DEL_P2DC4 0x10
92 #define _ECCP2DEL_PDC4 0x10
93 #define _ECCP2DEL_P2DC5 0x20
94 #define _ECCP2DEL_PDC5 0x20
95 #define _ECCP2DEL_P2DC6 0x40
96 #define _ECCP2DEL_PDC6 0x40
97 #define _ECCP2DEL_P2RSEN 0x80
98 #define _ECCP2DEL_PRSEN 0x80
100 //==============================================================================
103 //==============================================================================
106 extern __at(0x0F67) __sfr PWM2CON
;
147 extern __at(0x0F67) volatile __PWM2CONbits_t PWM2CONbits
;
149 #define _PWM2CON_P2DC0 0x01
150 #define _PWM2CON_PDC0 0x01
151 #define _PWM2CON_P2DC1 0x02
152 #define _PWM2CON_PDC1 0x02
153 #define _PWM2CON_P2DC2 0x04
154 #define _PWM2CON_PDC2 0x04
155 #define _PWM2CON_P2DC3 0x08
156 #define _PWM2CON_PDC3 0x08
157 #define _PWM2CON_P2DC4 0x10
158 #define _PWM2CON_PDC4 0x10
159 #define _PWM2CON_P2DC5 0x20
160 #define _PWM2CON_PDC5 0x20
161 #define _PWM2CON_P2DC6 0x40
162 #define _PWM2CON_PDC6 0x40
163 #define _PWM2CON_P2RSEN 0x80
164 #define _PWM2CON_PRSEN 0x80
166 //==============================================================================
169 //==============================================================================
172 extern __at(0x0F68) __sfr ECCP2AS
;
178 unsigned PSS2BD0
: 1;
179 unsigned PSS2BD1
: 1;
180 unsigned PSS2AC0
: 1;
181 unsigned PSS2AC1
: 1;
182 unsigned ECCP2AS0
: 1;
183 unsigned ECCP2AS1
: 1;
184 unsigned ECCP2AS2
: 1;
185 unsigned ECCP2ASE
: 1;
229 unsigned ECCP2AS
: 3;
234 extern __at(0x0F68) volatile __ECCP2ASbits_t ECCP2ASbits
;
236 #define _ECCP2AS_PSS2BD0 0x01
237 #define _ECCP2AS_PSSBD0 0x01
238 #define _ECCP2AS_PSS2BD1 0x02
239 #define _ECCP2AS_PSSBD1 0x02
240 #define _ECCP2AS_PSS2AC0 0x04
241 #define _ECCP2AS_PSSAC0 0x04
242 #define _ECCP2AS_PSS2AC1 0x08
243 #define _ECCP2AS_PSSAC1 0x08
244 #define _ECCP2AS_ECCP2AS0 0x10
245 #define _ECCP2AS_ECCP2AS1 0x20
246 #define _ECCP2AS_ECCP2AS2 0x40
247 #define _ECCP2AS_ECCP2ASE 0x80
249 //==============================================================================
252 //==============================================================================
255 extern __at(0x0F69) __sfr ECCP3DEL
;
296 extern __at(0x0F69) volatile __ECCP3DELbits_t ECCP3DELbits
;
298 #define _ECCP3DEL_P3DC0 0x01
299 #define _ECCP3DEL_PDC0 0x01
300 #define _ECCP3DEL_P3DC1 0x02
301 #define _ECCP3DEL_PDC1 0x02
302 #define _ECCP3DEL_P3DC2 0x04
303 #define _ECCP3DEL_PDC2 0x04
304 #define _ECCP3DEL_P3DC3 0x08
305 #define _ECCP3DEL_PDC3 0x08
306 #define _ECCP3DEL_P3DC4 0x10
307 #define _ECCP3DEL_PDC4 0x10
308 #define _ECCP3DEL_P3DC5 0x20
309 #define _ECCP3DEL_PDC5 0x20
310 #define _ECCP3DEL_P3DC6 0x40
311 #define _ECCP3DEL_PDC6 0x40
312 #define _ECCP3DEL_P3RSEN 0x80
313 #define _ECCP3DEL_PRSEN 0x80
315 //==============================================================================
318 //==============================================================================
321 extern __at(0x0F69) __sfr PWM3CON
;
362 extern __at(0x0F69) volatile __PWM3CONbits_t PWM3CONbits
;
364 #define _PWM3CON_P3DC0 0x01
365 #define _PWM3CON_PDC0 0x01
366 #define _PWM3CON_P3DC1 0x02
367 #define _PWM3CON_PDC1 0x02
368 #define _PWM3CON_P3DC2 0x04
369 #define _PWM3CON_PDC2 0x04
370 #define _PWM3CON_P3DC3 0x08
371 #define _PWM3CON_PDC3 0x08
372 #define _PWM3CON_P3DC4 0x10
373 #define _PWM3CON_PDC4 0x10
374 #define _PWM3CON_P3DC5 0x20
375 #define _PWM3CON_PDC5 0x20
376 #define _PWM3CON_P3DC6 0x40
377 #define _PWM3CON_PDC6 0x40
378 #define _PWM3CON_P3RSEN 0x80
379 #define _PWM3CON_PRSEN 0x80
381 //==============================================================================
384 //==============================================================================
387 extern __at(0x0F6A) __sfr ECCP3AS
;
393 unsigned PSS3BD0
: 1;
394 unsigned PSS3BD1
: 1;
395 unsigned PSS3AC0
: 1;
396 unsigned PSS3AC1
: 1;
397 unsigned ECCP3AS0
: 1;
398 unsigned ECCP3AS1
: 1;
399 unsigned ECCP3AS2
: 1;
400 unsigned ECCP3ASE
: 1;
444 unsigned ECCP3AS
: 3;
449 extern __at(0x0F6A) volatile __ECCP3ASbits_t ECCP3ASbits
;
451 #define _ECCP3AS_PSS3BD0 0x01
452 #define _ECCP3AS_PSSBD0 0x01
453 #define _ECCP3AS_PSS3BD1 0x02
454 #define _ECCP3AS_PSSBD1 0x02
455 #define _ECCP3AS_PSS3AC0 0x04
456 #define _ECCP3AS_PSSAC0 0x04
457 #define _ECCP3AS_PSS3AC1 0x08
458 #define _ECCP3AS_PSSAC1 0x08
459 #define _ECCP3AS_ECCP3AS0 0x10
460 #define _ECCP3AS_ECCP3AS1 0x20
461 #define _ECCP3AS_ECCP3AS2 0x40
462 #define _ECCP3AS_ECCP3ASE 0x80
464 //==============================================================================
467 //==============================================================================
470 extern __at(0x0F6B) __sfr RCSTA2
;
523 extern __at(0x0F6B) volatile __RCSTA2bits_t RCSTA2bits
;
525 #define _RCSTA2_RX9D 0x01
526 #define _RCSTA2_RX9D2 0x01
527 #define _RCSTA2_OERR 0x02
528 #define _RCSTA2_OERR2 0x02
529 #define _RCSTA2_FERR 0x04
530 #define _RCSTA2_FERR2 0x04
531 #define _RCSTA2_ADDEN 0x08
532 #define _RCSTA2_ADEN 0x08
533 #define _RCSTA2_ADDEN2 0x08
534 #define _RCSTA2_ADEN2 0x08
535 #define _RCSTA2_CREN 0x10
536 #define _RCSTA2_CREN2 0x10
537 #define _RCSTA2_SREN 0x20
538 #define _RCSTA2_SREN2 0x20
539 #define _RCSTA2_RX9 0x40
540 #define _RCSTA2_RX92 0x40
541 #define _RCSTA2_SPEN 0x80
542 #define _RCSTA2_SPEN2 0x80
544 //==============================================================================
547 //==============================================================================
550 extern __at(0x0F6C) __sfr TXSTA2
;
579 extern __at(0x0F6C) volatile __TXSTA2bits_t TXSTA2bits
;
581 #define _TXSTA2_TX9D 0x01
582 #define _TXSTA2_TX9D2 0x01
583 #define _TXSTA2_TRMT 0x02
584 #define _TXSTA2_TRMT2 0x02
585 #define _TXSTA2_BRGH 0x04
586 #define _TXSTA2_BRGH2 0x04
587 #define _TXSTA2_SENDB 0x08
588 #define _TXSTA2_SENDB2 0x08
589 #define _TXSTA2_SYNC 0x10
590 #define _TXSTA2_SYNC2 0x10
591 #define _TXSTA2_TXEN 0x20
592 #define _TXSTA2_TXEN2 0x20
593 #define _TXSTA2_TX9 0x40
594 #define _TXSTA2_TX92 0x40
595 #define _TXSTA2_CSRC 0x80
596 #define _TXSTA2_CSRC2 0x80
598 //==============================================================================
600 extern __at(0x0F6D) __sfr TXREG2
;
601 extern __at(0x0F6E) __sfr RCREG2
;
602 extern __at(0x0F6F) __sfr SPBRG2
;
604 //==============================================================================
607 extern __at(0x0F70) __sfr CCP5CON
;
649 extern __at(0x0F70) volatile __CCP5CONbits_t CCP5CONbits
;
660 //==============================================================================
662 extern __at(0x0F71) __sfr CCPR5
;
663 extern __at(0x0F71) __sfr CCPR5L
;
664 extern __at(0x0F72) __sfr CCPR5H
;
666 //==============================================================================
669 extern __at(0x0F73) __sfr CCP4CON
;
711 extern __at(0x0F73) volatile __CCP4CONbits_t CCP4CONbits
;
722 //==============================================================================
724 extern __at(0x0F74) __sfr CCPR4
;
725 extern __at(0x0F74) __sfr CCPR4L
;
726 extern __at(0x0F75) __sfr CCPR4H
;
728 //==============================================================================
731 extern __at(0x0F76) __sfr T4CON
;
737 unsigned T4CKPS0
: 1;
738 unsigned T4CKPS1
: 1;
740 unsigned TOUTPS0
: 1;
741 unsigned TOUTPS1
: 1;
742 unsigned TOUTPS2
: 1;
743 unsigned TOUTPS3
: 1;
752 unsigned T4OUTPS0
: 1;
753 unsigned T4OUTPS1
: 1;
754 unsigned T4OUTPS2
: 1;
755 unsigned T4OUTPS3
: 1;
775 unsigned T4OUTPS
: 4;
780 extern __at(0x0F76) volatile __T4CONbits_t T4CONbits
;
782 #define _T4CKPS0 0x01
783 #define _T4CKPS1 0x02
785 #define _TOUTPS0 0x08
786 #define _T4OUTPS0 0x08
787 #define _TOUTPS1 0x10
788 #define _T4OUTPS1 0x10
789 #define _TOUTPS2 0x20
790 #define _T4OUTPS2 0x20
791 #define _TOUTPS3 0x40
792 #define _T4OUTPS3 0x40
794 //==============================================================================
796 extern __at(0x0F77) __sfr PR4
;
797 extern __at(0x0F78) __sfr TMR4
;
799 //==============================================================================
802 extern __at(0x0F79) __sfr ECCP1DEL
;
849 extern __at(0x0F79) volatile __ECCP1DELbits_t ECCP1DELbits
;
869 //==============================================================================
872 //==============================================================================
875 extern __at(0x0F79) __sfr PWM1CON
;
922 extern __at(0x0F79) volatile __PWM1CONbits_t PWM1CONbits
;
924 #define _PWM1CON_P1DC0 0x01
925 #define _PWM1CON_PDC0 0x01
926 #define _PWM1CON_P1DC1 0x02
927 #define _PWM1CON_PDC1 0x02
928 #define _PWM1CON_P1DC2 0x04
929 #define _PWM1CON_PDC2 0x04
930 #define _PWM1CON_P1DC3 0x08
931 #define _PWM1CON_PDC3 0x08
932 #define _PWM1CON_P1DC4 0x10
933 #define _PWM1CON_PDC4 0x10
934 #define _PWM1CON_P1DC5 0x20
935 #define _PWM1CON_PDC5 0x20
936 #define _PWM1CON_P1DC6 0x40
937 #define _PWM1CON_PDC6 0x40
938 #define _PWM1CON_P1RSEN 0x80
939 #define _PWM1CON_P1DC7 0x80
940 #define _PWM1CON_PRSEN 0x80
942 //==============================================================================
945 //==============================================================================
948 extern __at(0x0F7C) __sfr BAUDCON2
;
989 extern __at(0x0F7C) volatile __BAUDCON2bits_t BAUDCON2bits
;
991 #define _BAUDCON2_ABDEN 0x01
992 #define _BAUDCON2_ABDEN2 0x01
993 #define _BAUDCON2_WUE 0x02
994 #define _BAUDCON2_WUE2 0x02
995 #define _BAUDCON2_BRG16 0x08
996 #define _BAUDCON2_BRG162 0x08
997 #define _BAUDCON2_SCKP 0x10
998 #define _BAUDCON2_SCKP2 0x10
999 #define _BAUDCON2_RCIDL 0x40
1000 #define _BAUDCON2_RCMT 0x40
1001 #define _BAUDCON2_RCIDL2 0x40
1003 //==============================================================================
1006 //==============================================================================
1009 extern __at(0x0F7C) __sfr BAUDCTL2
;
1027 unsigned ABDEN2
: 1;
1030 unsigned BRG162
: 1;
1045 unsigned RCIDL2
: 1;
1050 extern __at(0x0F7C) volatile __BAUDCTL2bits_t BAUDCTL2bits
;
1052 #define _BAUDCTL2_ABDEN 0x01
1053 #define _BAUDCTL2_ABDEN2 0x01
1054 #define _BAUDCTL2_WUE 0x02
1055 #define _BAUDCTL2_WUE2 0x02
1056 #define _BAUDCTL2_BRG16 0x08
1057 #define _BAUDCTL2_BRG162 0x08
1058 #define _BAUDCTL2_SCKP 0x10
1059 #define _BAUDCTL2_SCKP2 0x10
1060 #define _BAUDCTL2_RCIDL 0x40
1061 #define _BAUDCTL2_RCMT 0x40
1062 #define _BAUDCTL2_RCIDL2 0x40
1064 //==============================================================================
1066 extern __at(0x0F7D) __sfr SPBRGH2
;
1068 //==============================================================================
1071 extern __at(0x0F7E) __sfr BAUDCON
;
1100 extern __at(0x0F7E) volatile __BAUDCONbits_t BAUDCONbits
;
1109 //==============================================================================
1112 //==============================================================================
1115 extern __at(0x0F7E) __sfr BAUDCON1
;
1144 extern __at(0x0F7E) volatile __BAUDCON1bits_t BAUDCON1bits
;
1146 #define _BAUDCON1_ABDEN 0x01
1147 #define _BAUDCON1_WUE 0x02
1148 #define _BAUDCON1_BRG16 0x08
1149 #define _BAUDCON1_SCKP 0x10
1150 #define _BAUDCON1_RCIDL 0x40
1151 #define _BAUDCON1_RCMT 0x40
1153 //==============================================================================
1156 //==============================================================================
1159 extern __at(0x0F7E) __sfr BAUDCTL1
;
1188 extern __at(0x0F7E) volatile __BAUDCTL1bits_t BAUDCTL1bits
;
1190 #define _BAUDCTL1_ABDEN 0x01
1191 #define _BAUDCTL1_WUE 0x02
1192 #define _BAUDCTL1_BRG16 0x08
1193 #define _BAUDCTL1_SCKP 0x10
1194 #define _BAUDCTL1_RCIDL 0x40
1195 #define _BAUDCTL1_RCMT 0x40
1197 //==============================================================================
1199 extern __at(0x0F7F) __sfr SPBRGH
;
1200 extern __at(0x0F7F) __sfr SPBRGH1
;
1202 //==============================================================================
1205 extern __at(0x0F80) __sfr PORTA
;
1252 extern __at(0x0F80) volatile __PORTAbits_t PORTAbits
;
1254 #define _PORTA_RA0 0x01
1255 #define _PORTA_AN0 0x01
1256 #define _PORTA_RA1 0x02
1257 #define _PORTA_AN1 0x02
1258 #define _PORTA_RA2 0x04
1259 #define _PORTA_AN2 0x04
1260 #define _PORTA_VREFM 0x04
1261 #define _PORTA_RA3 0x08
1262 #define _PORTA_AN3 0x08
1263 #define _PORTA_VREFP 0x08
1264 #define _PORTA_RA4 0x10
1265 #define _PORTA_T0CKI 0x10
1266 #define _PORTA_RA5 0x20
1267 #define _PORTA_AN4 0x20
1268 #define _PORTA_LVDIN 0x20
1269 #define _PORTA_RA6 0x40
1270 #define _PORTA_OSC2 0x40
1271 #define _PORTA_CLKO 0x40
1273 //==============================================================================
1276 //==============================================================================
1279 extern __at(0x0F81) __sfr PORTB
;
1332 extern __at(0x0F81) volatile __PORTBbits_t PORTBbits
;
1334 #define _PORTB_RB0 0x01
1335 #define _PORTB_INT0 0x01
1336 #define _PORTB_RB1 0x02
1337 #define _PORTB_INT1 0x02
1338 #define _PORTB_RB2 0x04
1339 #define _PORTB_INT2 0x04
1340 #define _PORTB_RB3 0x08
1341 #define _PORTB_INT3 0x08
1342 #define _PORTB_RB4 0x10
1343 #define _PORTB_KBI0 0x10
1344 #define _PORTB_RB5 0x20
1345 #define _PORTB_KBI1 0x20
1346 #define _PORTB_PGM 0x20
1347 #define _PORTB_RB6 0x40
1348 #define _PORTB_KBI2 0x40
1349 #define _PORTB_PGC 0x40
1350 #define _PORTB_RB7 0x80
1351 #define _PORTB_KBI3 0x80
1352 #define _PORTB_PGD 0x80
1354 //==============================================================================
1357 //==============================================================================
1360 extern __at(0x0F82) __sfr PORTC
;
1390 unsigned T13CKI
: 1;
1401 extern __at(0x0F82) volatile __PORTCbits_t PORTCbits
;
1403 #define _PORTC_RC0 0x01
1404 #define _PORTC_T1OSO 0x01
1405 #define _PORTC_T13CKI 0x01
1406 #define _PORTC_RC1 0x02
1407 #define _PORTC_T1OSI 0x02
1408 #define _PORTC_RC2 0x04
1409 #define _PORTC_CCP1 0x04
1410 #define _PORTC_P1A 0x04
1411 #define _PORTC_RC3 0x08
1412 #define _PORTC_SCK 0x08
1413 #define _PORTC_SCL 0x08
1414 #define _PORTC_RC4 0x10
1415 #define _PORTC_SDI 0x10
1416 #define _PORTC_SDA 0x10
1417 #define _PORTC_RC5 0x20
1418 #define _PORTC_SDO 0x20
1419 #define _PORTC_RC6 0x40
1420 #define _PORTC_TX1 0x40
1421 #define _PORTC_CK1 0x40
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1473 extern __at(0x0F83) volatile __PORTDbits_t PORTDbits
;
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1500 //==============================================================================
1503 //==============================================================================
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;
1559 extern __at(0x0F84) volatile __PORTEbits_t PORTEbits
;
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1591 //==============================================================================
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1625 unsigned C2OUTF
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1626 unsigned C1OUTF
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;
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1657 //==============================================================================
1660 //==============================================================================
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1710 extern __at(0x0F86) volatile __PORTGbits_t PORTGbits
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1731 //==============================================================================
1734 //==============================================================================
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;
1766 extern __at(0x0F87) volatile __PORTHbits_t PORTHbits
;
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1785 //==============================================================================
1788 //==============================================================================
1791 extern __at(0x0F88) __sfr PORTJ
;
1820 extern __at(0x0F88) volatile __PORTJbits_t PORTJbits
;
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1868 extern __at(0x0F89) volatile __LATAbits_t LATAbits
;
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1960 extern __at(0x0F8C) volatile __LATDbits_t LATDbits
;
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1991 extern __at(0x0F8D) volatile __LATEbits_t LATEbits
;
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;
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;
2062 extern __at(0x0F8F) volatile __LATGbits_t LATGbits
;
2070 //==============================================================================
2073 //==============================================================================
2076 extern __at(0x0F90) __sfr LATH
;
2090 extern __at(0x0F90) volatile __LATHbits_t LATHbits
;
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;
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;
2132 //==============================================================================
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2138 extern __at(0x0F92) __sfr DDRA
;
2144 unsigned TRISA0
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
2150 unsigned TRISA6
: 1;
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;
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2199 //==============================================================================
2202 extern __at(0x0F92) __sfr TRISA
;
2208 unsigned TRISA0
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
2243 extern __at(0x0F92) volatile __TRISAbits_t TRISAbits
;
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2260 //==============================================================================
2263 //==============================================================================
2266 extern __at(0x0F93) __sfr DDRB
;
2272 unsigned TRISB0
: 1;
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: 1;
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;
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2317 //==============================================================================
2320 extern __at(0x0F93) __sfr TRISB
;
2326 unsigned TRISB0
: 1;
2327 unsigned TRISB1
: 1;
2328 unsigned TRISB2
: 1;
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: 1;
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: 1;
2331 unsigned TRISB5
: 1;
2332 unsigned TRISB6
: 1;
2333 unsigned TRISB7
: 1;
2349 extern __at(0x0F93) volatile __TRISBbits_t TRISBbits
;
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;
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: 1;
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;
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;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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;
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;
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2533 //==============================================================================
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;
2542 unsigned TRISD0
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: 1;
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: 1;
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: 1;
2549 unsigned TRISD7
: 1;
2565 extern __at(0x0F95) volatile __TRISDbits_t TRISDbits
;
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2584 //==============================================================================
2587 //==============================================================================
2590 extern __at(0x0F96) __sfr DDRE
;
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: 1;
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: 1;
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: 1;
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;
2621 #define _TRISE0 0x01
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2641 //==============================================================================
2644 extern __at(0x0F96) __sfr TRISE
;
2650 unsigned TRISE0
: 1;
2651 unsigned TRISE1
: 1;
2652 unsigned TRISE2
: 1;
2653 unsigned TRISE3
: 1;
2654 unsigned TRISE4
: 1;
2655 unsigned TRISE5
: 1;
2656 unsigned TRISE6
: 1;
2657 unsigned TRISE7
: 1;
2673 extern __at(0x0F96) volatile __TRISEbits_t TRISEbits
;
2675 #define _TRISE_TRISE0 0x01
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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;
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: 1;
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: 1;
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: 1;
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;
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;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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;
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;
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;
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: 1;
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: 1;
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2992 unsigned TRISH6
: 1;
2993 unsigned TRISH7
: 1;
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;
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3088 extern __at(0x0F9A) __sfr TRISJ
;
3094 unsigned TRISJ0
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: 1;
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: 1;
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: 1;
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;
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3172 extern __at(0x0F9C) volatile __MEMCONbits_t MEMCONbits
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;
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: 1;
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: 1;
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;
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;
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3385 //==============================================================================
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3392 unsigned CCP2IP
: 1;
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: 1;
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;
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3414 //==============================================================================
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: 1;
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: 1;
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: 1;
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;
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3440 //==============================================================================
3443 //==============================================================================
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;
3450 unsigned CCP3IF
: 1;
3451 unsigned CCP4IF
: 1;
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: 1;
3453 unsigned TMR4IF
: 1;
3460 extern __at(0x0FA4) volatile __PIR3bits_t PIR3bits
;
3462 #define _CCP3IF 0x01
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3472 //==============================================================================
3475 extern __at(0x0FA5) __sfr IPR3
;
3479 unsigned CCP3IP
: 1;
3480 unsigned CCP4IP
: 1;
3481 unsigned CCP5IP
: 1;
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: 1;
3489 extern __at(0x0FA5) volatile __IPR3bits_t IPR3bits
;
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3498 //==============================================================================
3501 //==============================================================================
3504 extern __at(0x0FA6) __sfr EECON1
;
3518 extern __at(0x0FA6) volatile __EECON1bits_t EECON1bits
;
3528 //==============================================================================
3530 extern __at(0x0FA7) __sfr EECON2
;
3531 extern __at(0x0FA8) __sfr EEDATA
;
3532 extern __at(0x0FA9) __sfr EEADR
;
3533 extern __at(0x0FAA) __sfr EEADRH
;
3535 //==============================================================================
3538 extern __at(0x0FAB) __sfr RCSTA
;
3571 unsigned ADDEN1
: 1;
3579 extern __at(0x0FAB) volatile __RCSTAbits_t RCSTAbits
;
3589 #define _ADDEN1 0x08
3599 //==============================================================================
3602 //==============================================================================
3605 extern __at(0x0FAB) __sfr RCSTA1
;
3638 unsigned ADDEN1
: 1;
3646 extern __at(0x0FAB) volatile __RCSTA1bits_t RCSTA1bits
;
3648 #define _RCSTA1_RX9D 0x01
3649 #define _RCSTA1_RX9D1 0x01
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3655 #define _RCSTA1_ADEN 0x08
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3658 #define _RCSTA1_CREN1 0x10
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3660 #define _RCSTA1_SREN1 0x20
3661 #define _RCSTA1_RX9 0x40
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3664 #define _RCSTA1_SPEN1 0x80
3666 //==============================================================================
3669 //==============================================================================
3672 extern __at(0x0FAC) __sfr TXSTA
;
3693 unsigned SENDB1
: 1;
3701 extern __at(0x0FAC) volatile __TXSTAbits_t TXSTAbits
;
3710 #define _SENDB1 0x08
3720 //==============================================================================
3723 //==============================================================================
3726 extern __at(0x0FAC) __sfr TXSTA1
;
3747 unsigned SENDB1
: 1;
3755 extern __at(0x0FAC) volatile __TXSTA1bits_t TXSTA1bits
;
3757 #define _TXSTA1_TX9D 0x01
3758 #define _TXSTA1_TX9D1 0x01
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3772 #define _TXSTA1_CSRC1 0x80
3774 //==============================================================================
3776 extern __at(0x0FAD) __sfr TXREG
;
3777 extern __at(0x0FAD) __sfr TXREG1
;
3778 extern __at(0x0FAE) __sfr RCREG
;
3779 extern __at(0x0FAE) __sfr RCREG1
;
3780 extern __at(0x0FAF) __sfr SPBRG
;
3781 extern __at(0x0FAF) __sfr SPBRG1
;
3783 //==============================================================================
3786 extern __at(0x0FB0) __sfr PSPCON
;
3794 unsigned PSPMODE
: 1;
3800 extern __at(0x0FB0) volatile __PSPCONbits_t PSPCONbits
;
3802 #define _PSPMODE 0x10
3807 //==============================================================================
3810 //==============================================================================
3813 extern __at(0x0FB1) __sfr T3CON
;
3819 unsigned TMR3ON
: 1;
3820 unsigned TMR3CS
: 1;
3821 unsigned NOT_T3SYNC
: 1;
3822 unsigned T3CCP1
: 1;
3823 unsigned T3CKPS0
: 1;
3824 unsigned T3CKPS1
: 1;
3825 unsigned T3CCP2
: 1;
3833 unsigned T3SYNC
: 1;
3845 unsigned T3NSYNC
: 1;
3856 unsigned T3CKPS
: 2;
3861 extern __at(0x0FB1) volatile __T3CONbits_t T3CONbits
;
3863 #define _T3CON_TMR3ON 0x01
3864 #define _T3CON_TMR3CS 0x02
3865 #define _T3CON_NOT_T3SYNC 0x04
3866 #define _T3CON_T3SYNC 0x04
3867 #define _T3CON_T3NSYNC 0x04
3868 #define _T3CON_T3CCP1 0x08
3869 #define _T3CON_T3CKPS0 0x10
3870 #define _T3CON_T3CKPS1 0x20
3871 #define _T3CON_T3CCP2 0x40
3872 #define _T3CON_RD16 0x80
3874 //==============================================================================
3876 extern __at(0x0FB2) __sfr TMR3
;
3877 extern __at(0x0FB2) __sfr TMR3L
;
3878 extern __at(0x0FB3) __sfr TMR3H
;
3880 //==============================================================================
3883 extern __at(0x0FB4) __sfr CMCON
;
3906 extern __at(0x0FB4) volatile __CMCONbits_t CMCONbits
;
3917 //==============================================================================
3920 //==============================================================================
3923 extern __at(0x0FB5) __sfr CVRCON
;
3958 extern __at(0x0FB5) volatile __CVRCONbits_t CVRCONbits
;
3970 //==============================================================================
3973 //==============================================================================
3976 extern __at(0x0FB6) __sfr ECCP1AS
;
3982 unsigned PSS1BD0
: 1;
3983 unsigned PSS1BD1
: 1;
3984 unsigned PSS1AC0
: 1;
3985 unsigned PSS1AC1
: 1;
3986 unsigned ECCP1AS0
: 1;
3987 unsigned ECCP1AS1
: 1;
3988 unsigned ECCP1AS2
: 1;
3989 unsigned ECCP1ASE
: 1;
3994 unsigned PSSBD0
: 1;
3995 unsigned PSSBD1
: 1;
3996 unsigned PSSAC0
: 1;
3997 unsigned PSSAC1
: 1;
4012 unsigned PSS1BD
: 2;
4019 unsigned PSS1AC
: 2;
4033 unsigned ECCP1AS
: 3;
4038 extern __at(0x0FB6) volatile __ECCP1ASbits_t ECCP1ASbits
;
4040 #define _PSS1BD0 0x01
4041 #define _PSSBD0 0x01
4042 #define _PSS1BD1 0x02
4043 #define _PSSBD1 0x02
4044 #define _PSS1AC0 0x04
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4047 #define _PSSAC1 0x08
4048 #define _ECCP1AS0 0x10
4049 #define _ECCP1AS1 0x20
4050 #define _ECCP1AS2 0x40
4051 #define _ECCP1ASE 0x80
4053 //==============================================================================
4056 //==============================================================================
4059 extern __at(0x0FB7) __sfr CCP3CON
;
4065 unsigned CCP3M0
: 1;
4066 unsigned CCP3M1
: 1;
4067 unsigned CCP3M2
: 1;
4068 unsigned CCP3M3
: 1;
4107 extern __at(0x0FB7) volatile __CCP3CONbits_t CCP3CONbits
;
4109 #define _CCP3M0 0x01
4110 #define _CCP3M1 0x02
4111 #define _CCP3M2 0x04
4112 #define _CCP3M3 0x08
4120 //==============================================================================
4122 extern __at(0x0FB8) __sfr CCPR3
;
4123 extern __at(0x0FB8) __sfr CCPR3L
;
4124 extern __at(0x0FB9) __sfr CCPR3H
;
4126 //==============================================================================
4129 extern __at(0x0FBA) __sfr CCP2CON
;
4135 unsigned CCP2M0
: 1;
4136 unsigned CCP2M1
: 1;
4137 unsigned CCP2M2
: 1;
4138 unsigned CCP2M3
: 1;
4177 extern __at(0x0FBA) volatile __CCP2CONbits_t CCP2CONbits
;
4179 #define _CCP2M0 0x01
4180 #define _CCP2M1 0x02
4181 #define _CCP2M2 0x04
4182 #define _CCP2M3 0x08
4190 //==============================================================================
4192 extern __at(0x0FBB) __sfr CCPR2
;
4193 extern __at(0x0FBB) __sfr CCPR2L
;
4194 extern __at(0x0FBC) __sfr CCPR2H
;
4196 //==============================================================================
4199 extern __at(0x0FBD) __sfr CCP1CON
;
4205 unsigned CCP1M0
: 1;
4206 unsigned CCP1M1
: 1;
4207 unsigned CCP1M2
: 1;
4208 unsigned CCP1M3
: 1;
4247 extern __at(0x0FBD) volatile __CCP1CONbits_t CCP1CONbits
;
4249 #define _CCP1M0 0x01
4250 #define _CCP1M1 0x02
4251 #define _CCP1M2 0x04
4252 #define _CCP1M3 0x08
4260 //==============================================================================
4262 extern __at(0x0FBE) __sfr CCPR1
;
4263 extern __at(0x0FBE) __sfr CCPR1L
;
4264 extern __at(0x0FBF) __sfr CCPR1H
;
4266 //==============================================================================
4269 extern __at(0x0FC0) __sfr ADCON2
;
4299 extern __at(0x0FC0) volatile __ADCON2bits_t ADCON2bits
;
4309 //==============================================================================
4312 //==============================================================================
4315 extern __at(0x0FC1) __sfr ADCON1
;
4345 extern __at(0x0FC1) volatile __ADCON1bits_t ADCON1bits
;
4354 //==============================================================================
4357 //==============================================================================
4360 extern __at(0x0FC2) __sfr ADCON0
;
4367 unsigned GO_NOT_DONE
: 1;
4379 unsigned GO_DONE
: 1;
4415 unsigned NOT_DONE
: 1;
4427 unsigned GODONE
: 1;
4444 extern __at(0x0FC2) volatile __ADCON0bits_t ADCON0bits
;
4447 #define _GO_NOT_DONE 0x02
4448 #define _GO_DONE 0x02
4451 #define _NOT_DONE 0x02
4452 #define _GODONE 0x02
4458 //==============================================================================
4460 extern __at(0x0FC3) __sfr ADRES
;
4461 extern __at(0x0FC3) __sfr ADRESL
;
4462 extern __at(0x0FC4) __sfr ADRESH
;
4464 //==============================================================================
4467 extern __at(0x0FC5) __sfr SSPCON2
;
4477 unsigned ACKSTAT
: 1;
4481 extern __at(0x0FC5) volatile __SSPCON2bits_t SSPCON2bits
;
4489 #define _ACKSTAT 0x40
4492 //==============================================================================
4495 //==============================================================================
4498 extern __at(0x0FC6) __sfr SSPCON1
;
4521 extern __at(0x0FC6) volatile __SSPCON1bits_t SSPCON1bits
;
4532 //==============================================================================
4535 //==============================================================================
4538 extern __at(0x0FC7) __sfr SSPSTAT
;
4546 unsigned R_NOT_W
: 1;
4549 unsigned D_NOT_A
: 1;
4559 unsigned I2C_START
: 1;
4560 unsigned I2C_STOP
: 1;
4570 unsigned I2C_READ
: 1;
4573 unsigned I2C_DAT
: 1;
4594 unsigned NOT_WRITE
: 1;
4597 unsigned NOT_ADDRESS
: 1;
4606 unsigned READ_WRITE
: 1;
4609 unsigned DATA_ADDRESS
: 1;
4627 extern __at(0x0FC7) volatile __SSPSTATbits_t SSPSTATbits
;
4631 #define _R_NOT_W 0x04
4633 #define _I2C_READ 0x04
4635 #define _NOT_WRITE 0x04
4636 #define _READ_WRITE 0x04
4639 #define _I2C_START 0x08
4641 #define _I2C_STOP 0x10
4642 #define _D_NOT_A 0x20
4644 #define _I2C_DAT 0x20
4646 #define _NOT_ADDRESS 0x20
4647 #define _DATA_ADDRESS 0x20
4652 //==============================================================================
4654 extern __at(0x0FC8) __sfr SSPADD
;
4655 extern __at(0x0FC9) __sfr SSPBUF
;
4657 //==============================================================================
4660 extern __at(0x0FCA) __sfr T2CON
;
4666 unsigned T2CKPS0
: 1;
4667 unsigned T2CKPS1
: 1;
4668 unsigned TMR2ON
: 1;
4669 unsigned T2OUTPS0
: 1;
4670 unsigned T2OUTPS1
: 1;
4671 unsigned T2OUTPS2
: 1;
4672 unsigned T2OUTPS3
: 1;
4678 unsigned T2CKPS
: 2;
4685 unsigned T2OUTPS
: 4;
4690 extern __at(0x0FCA) volatile __T2CONbits_t T2CONbits
;
4692 #define _T2CKPS0 0x01
4693 #define _T2CKPS1 0x02
4694 #define _TMR2ON 0x04
4695 #define _T2OUTPS0 0x08
4696 #define _T2OUTPS1 0x10
4697 #define _T2OUTPS2 0x20
4698 #define _T2OUTPS3 0x40
4700 //==============================================================================
4702 extern __at(0x0FCB) __sfr PR2
;
4703 extern __at(0x0FCC) __sfr TMR2
;
4705 //==============================================================================
4708 extern __at(0x0FCD) __sfr T1CON
;
4714 unsigned TMR1ON
: 1;
4715 unsigned TMR1CS
: 1;
4716 unsigned NOT_T1SYNC
: 1;
4717 unsigned T1OSCEN
: 1;
4718 unsigned T1CKPS0
: 1;
4719 unsigned T1CKPS1
: 1;
4728 unsigned T1SYNC
: 1;
4740 unsigned T1INSYNC
: 1;
4751 unsigned T1CKPS
: 2;
4756 extern __at(0x0FCD) volatile __T1CONbits_t T1CONbits
;
4758 #define _TMR1ON 0x01
4759 #define _TMR1CS 0x02
4760 #define _NOT_T1SYNC 0x04
4761 #define _T1SYNC 0x04
4762 #define _T1INSYNC 0x04
4763 #define _T1OSCEN 0x08
4764 #define _T1CKPS0 0x10
4765 #define _T1CKPS1 0x20
4768 //==============================================================================
4770 extern __at(0x0FCE) __sfr TMR1
;
4771 extern __at(0x0FCE) __sfr TMR1L
;
4772 extern __at(0x0FCF) __sfr TMR1H
;
4774 //==============================================================================
4777 extern __at(0x0FD0) __sfr RCON
;
4783 unsigned NOT_BOR
: 1;
4784 unsigned NOT_POR
: 1;
4785 unsigned NOT_PD
: 1;
4786 unsigned NOT_TO
: 1;
4787 unsigned NOT_RI
: 1;
4802 unsigned NOT_IPEN
: 1;
4806 extern __at(0x0FD0) volatile __RCONbits_t RCONbits
;
4808 #define _NOT_BOR 0x01
4810 #define _NOT_POR 0x02
4812 #define _NOT_PD 0x04
4814 #define _NOT_TO 0x08
4816 #define _NOT_RI 0x10
4819 #define _NOT_IPEN 0x80
4821 //==============================================================================
4824 //==============================================================================
4827 extern __at(0x0FD1) __sfr WDTCON
;
4833 unsigned SWDTEN
: 1;
4856 extern __at(0x0FD1) volatile __WDTCONbits_t WDTCONbits
;
4858 #define _SWDTEN 0x01
4861 //==============================================================================
4864 //==============================================================================
4867 extern __at(0x0FD2) __sfr LVDCON
;
4908 extern __at(0x0FD2) volatile __LVDCONbits_t LVDCONbits
;
4922 //==============================================================================
4925 //==============================================================================
4928 extern __at(0x0FD3) __sfr OSCCON
;
4951 extern __at(0x0FD3) volatile __OSCCONbits_t OSCCONbits
;
4958 //==============================================================================
4961 //==============================================================================
4964 extern __at(0x0FD5) __sfr T0CON
;
4976 unsigned T08BIT
: 1;
4977 unsigned TMR0ON
: 1;
4987 extern __at(0x0FD5) volatile __T0CONbits_t T0CONbits
;
4995 #define _T08BIT 0x40
4996 #define _TMR0ON 0x80
4998 //==============================================================================
5000 extern __at(0x0FD6) __sfr TMR0
;
5001 extern __at(0x0FD6) __sfr TMR0L
;
5002 extern __at(0x0FD7) __sfr TMR0H
;
5004 //==============================================================================
5007 extern __at(0x0FD8) __sfr STATUS
;
5021 extern __at(0x0FD8) volatile __STATUSbits_t STATUSbits
;
5029 //==============================================================================
5031 extern __at(0x0FD9) __sfr FSR2L
;
5032 extern __at(0x0FDA) __sfr FSR2H
;
5033 extern __at(0x0FDB) __sfr PLUSW2
;
5034 extern __at(0x0FDC) __sfr PREINC2
;
5035 extern __at(0x0FDD) __sfr POSTDEC2
;
5036 extern __at(0x0FDE) __sfr POSTINC2
;
5037 extern __at(0x0FDF) __sfr INDF2
;
5038 extern __at(0x0FE0) __sfr BSR
;
5039 extern __at(0x0FE1) __sfr FSR1L
;
5040 extern __at(0x0FE2) __sfr FSR1H
;
5041 extern __at(0x0FE3) __sfr PLUSW1
;
5042 extern __at(0x0FE4) __sfr PREINC1
;
5043 extern __at(0x0FE5) __sfr POSTDEC1
;
5044 extern __at(0x0FE6) __sfr POSTINC1
;
5045 extern __at(0x0FE7) __sfr INDF1
;
5046 extern __at(0x0FE8) __sfr WREG
;
5047 extern __at(0x0FE9) __sfr FSR0L
;
5048 extern __at(0x0FEA) __sfr FSR0H
;
5049 extern __at(0x0FEB) __sfr PLUSW0
;
5050 extern __at(0x0FEC) __sfr PREINC0
;
5051 extern __at(0x0FED) __sfr POSTDEC0
;
5052 extern __at(0x0FEE) __sfr POSTINC0
;
5053 extern __at(0x0FEF) __sfr INDF0
;
5055 //==============================================================================
5058 extern __at(0x0FF0) __sfr INTCON3
;
5064 unsigned INT1IF
: 1;
5065 unsigned INT2IF
: 1;
5066 unsigned INT3IF
: 1;
5067 unsigned INT1IE
: 1;
5068 unsigned INT2IE
: 1;
5069 unsigned INT3IE
: 1;
5070 unsigned INT1IP
: 1;
5071 unsigned INT2IP
: 1;
5087 extern __at(0x0FF0) volatile __INTCON3bits_t INTCON3bits
;
5089 #define _INT1IF 0x01
5091 #define _INT2IF 0x02
5093 #define _INT3IF 0x04
5095 #define _INT1IE 0x08
5097 #define _INT2IE 0x10
5099 #define _INT3IE 0x20
5101 #define _INT1IP 0x40
5103 #define _INT2IP 0x80
5106 //==============================================================================
5109 //==============================================================================
5112 extern __at(0x0FF1) __sfr INTCON2
;
5119 unsigned INT3IP
: 1;
5120 unsigned TMR0IP
: 1;
5121 unsigned INTEDG3
: 1;
5122 unsigned INTEDG2
: 1;
5123 unsigned INTEDG1
: 1;
5124 unsigned INTEDG0
: 1;
5125 unsigned NOT_RBPU
: 1;
5141 extern __at(0x0FF1) volatile __INTCON2bits_t INTCON2bits
;
5144 #define _INT3IP 0x02
5146 #define _TMR0IP 0x04
5148 #define _INTEDG3 0x08
5149 #define _INTEDG2 0x10
5150 #define _INTEDG1 0x20
5151 #define _INTEDG0 0x40
5152 #define _NOT_RBPU 0x80
5155 //==============================================================================
5158 //==============================================================================
5161 extern __at(0x0FF2) __sfr INTCON
;
5168 unsigned INT0IF
: 1;
5169 unsigned TMR0IF
: 1;
5171 unsigned INT0IE
: 1;
5172 unsigned TMR0IE
: 1;
5173 unsigned PEIE_GIEL
: 1;
5174 unsigned GIE_GIEH
: 1;
5202 extern __at(0x0FF2) volatile __INTCONbits_t INTCONbits
;
5205 #define _INT0IF 0x02
5207 #define _TMR0IF 0x04
5210 #define _INT0IE 0x10
5212 #define _TMR0IE 0x20
5214 #define _PEIE_GIEL 0x40
5217 #define _GIE_GIEH 0x80
5221 //==============================================================================
5223 extern __at(0x0FF3) __sfr PROD
;
5224 extern __at(0x0FF3) __sfr PRODL
;
5225 extern __at(0x0FF4) __sfr PRODH
;
5226 extern __at(0x0FF5) __sfr TABLAT
;
5227 extern __at(0x0FF6) __sfr TBLPTR
;
5228 extern __at(0x0FF6) __sfr TBLPTRL
;
5229 extern __at(0x0FF7) __sfr TBLPTRH
;
5230 extern __at(0x0FF8) __sfr TBLPTRU
;
5231 extern __at(0x0FF9) __sfr PC
;
5232 extern __at(0x0FF9) __sfr PCL
;
5233 extern __at(0x0FFA) __sfr PCLATH
;
5234 extern __at(0x0FFB) __sfr PCLATU
;
5236 //==============================================================================
5239 extern __at(0x0FFC) __sfr STKPTR
;
5245 unsigned STKPTR0
: 1;
5246 unsigned STKPTR1
: 1;
5247 unsigned STKPTR2
: 1;
5248 unsigned STKPTR3
: 1;
5249 unsigned STKPTR4
: 1;
5251 unsigned STKUNF
: 1;
5252 unsigned STKFUL
: 1;
5264 unsigned STKOVF
: 1;
5269 unsigned STKPTR
: 5;
5274 extern __at(0x0FFC) volatile __STKPTRbits_t STKPTRbits
;
5276 #define _STKPTR0 0x01
5277 #define _STKPTR1 0x02
5278 #define _STKPTR2 0x04
5279 #define _STKPTR3 0x08
5280 #define _STKPTR4 0x10
5281 #define _STKUNF 0x40
5282 #define _STKFUL 0x80
5283 #define _STKOVF 0x80
5285 //==============================================================================
5287 extern __at(0x0FFD) __sfr TOS
;
5288 extern __at(0x0FFD) __sfr TOSL
;
5289 extern __at(0x0FFE) __sfr TOSH
;
5290 extern __at(0x0FFF) __sfr TOSU
;
5292 //==============================================================================
5294 // Configuration Bits
5296 //==============================================================================
5298 #define __CONFIG1H 0x300001
5299 #define __CONFIG2L 0x300002
5300 #define __CONFIG2H 0x300003
5301 #define __CONFIG3L 0x300004
5302 #define __CONFIG3H 0x300005
5303 #define __CONFIG4L 0x300006
5304 #define __CONFIG5L 0x300008
5305 #define __CONFIG5H 0x300009
5306 #define __CONFIG6L 0x30000A
5307 #define __CONFIG6H 0x30000B
5308 #define __CONFIG7L 0x30000C
5309 #define __CONFIG7H 0x30000D
5311 //----------------------------- CONFIG1H Options -------------------------------
5313 #define _OSC_LP_1H 0xF0 // LP oscillator.
5314 #define _OSC_XT_1H 0xF1 // XT oscillator.
5315 #define _OSC_HS_1H 0xF2 // HS oscillator.
5316 #define _OSC_RC_1H 0xF3 // RC oscillator with OSC2 configured as divide by 4 clock output.
5317 #define _OSC_EC_1H 0xF4 // EC oscillator with OSC2 configured as divide by 4 clock output.
5318 #define _OSC_ECIO_1H 0xF5 // EC oscillator with OSC2 configured as RA6.
5319 #define _OSC_HSPLL_1H 0xF6 // HS oscillator with HW enabled 4x PLL.
5320 #define _OSC_RCIO_1H 0xF7 // RC oscillator with OSC2 configured as RA6.
5321 #define _OSC_ECIOPLL_1H 0xFC // EC oscillator with OSC2 configured as RA6 and HW enabled 4x PLL.
5322 #define _OSC_ECIOSWPLL_1H 0xFD // EC oscillator with OSC2 configured as RA6 and SW enabled 4x PLL.
5323 #define _OSC_HSSWPLL_1H 0xFE // HS oscillator with SW enabled 4x PLL.
5324 #define _OSCS_ON_1H 0xDF // Timer1 oscillator system clock switch option is enabled (oscillator switching is enabled).
5325 #define _OSCS_OFF_1H 0xFF // Oscillator system clock switch option is disabled (main oscillator is source).
5327 //----------------------------- CONFIG2L Options -------------------------------
5329 #define _PWRT_ON_2L 0xFE // PWRT enabled.
5330 #define _PWRT_OFF_2L 0xFF // PWRT disabled.
5331 #define _BOR_OFF_2L 0xFD // Brown-out Reset disabled.
5332 #define _BOR_ON_2L 0xFF // Brown-out Reset enabled.
5333 #define _BORV_45_2L 0xF3 // VBOR set to 4.5V.
5334 #define _BORV_42_2L 0xF7 // VBOR set to 4.2V.
5335 #define _BORV_27_2L 0xFB // VBOR set to 2.7V.
5336 #define _BORV_20_2L 0xFF // VBOR set to 2.0V.
5338 //----------------------------- CONFIG2H Options -------------------------------
5340 #define _WDT_OFF_2H 0xFE // WDT disabled (control is placed on the SWDTEN bit).
5341 #define _WDT_ON_2H 0xFF // WDT enabled.
5342 #define _WDTPS_1_2H 0xE1 // 1:1.
5343 #define _WDTPS_2_2H 0xE3 // 1:2.
5344 #define _WDTPS_4_2H 0xE5 // 1:4.
5345 #define _WDTPS_8_2H 0xE7 // 1:8.
5346 #define _WDTPS_16_2H 0xE9 // 1:16.
5347 #define _WDTPS_32_2H 0xEB // 1:32.
5348 #define _WDTPS_64_2H 0xED // 1:64.
5349 #define _WDTPS_128_2H 0xEF // 1:128.
5350 #define _WDTPS_256_2H 0xF1 // 1:256.
5351 #define _WDTPS_512_2H 0xF3 // 1:512.
5352 #define _WDTPS_1024_2H 0xF5 // 1:1024.
5353 #define _WDTPS_2048_2H 0xF7 // 1:2048.
5354 #define _WDTPS_4096_2H 0xF9 // 1:4096.
5355 #define _WDTPS_8192_2H 0xFB // 1:8192.
5356 #define _WDTPS_16384_2H 0xFD // 1:16384.
5357 #define _WDTPS_32768_2H 0xFF // 1:32768.
5359 //----------------------------- CONFIG3L Options -------------------------------
5361 #define _MODE_EM_3L 0xFC // Extended Microcontroller mode.
5362 #define _MODE_MPB_3L 0xFD // Microprocessor with Boot Block mode.
5363 #define _MODE_MP_3L 0xFE // Microprocessor mode.
5364 #define _MODE_MC_3L 0xFF // Microcontroller mode.
5365 #define _WAIT_ON_3L 0x7F // Wait selections for table reads and table writes are determined by WAIT1:WAIT0 bits (MEMCOM<5:4>).
5366 #define _WAIT_OFF_3L 0xFF // Wait selections unavailable for table reads and table writes.
5368 //----------------------------- CONFIG3H Options -------------------------------
5370 #define _CCP2MX_PORTBE_3H 0xFE // Multiplexed with RB3 or RE7.
5371 #define _CCP2MX_PORTC_3H 0xFF // Multiplexed with RC1.
5372 #define _ECCPMX_PORTH_3H 0xFD // ECCP1 (P1B/P1C) and ECCP3 (P3B/P3C) PWM outputs are multiplexed with RH7 through RH4.
5373 #define _ECCPMX_PORTE_3H 0xFF // ECCP1 (P1B/P1C) and ECCP3 (P3B/P3C) PWM outputs are multiplexed with RE6 through RE3.
5374 #define _MCLRE_OFF_3H 0x7F // RG5 input enabled, MCLR disabled.
5375 #define _MCLRE_ON_3H 0xFF // MCLR pin enabled, RG5 input pin disabled.
5377 //----------------------------- CONFIG4L Options -------------------------------
5379 #define _STVR_OFF_4L 0xFE // Stack full/underflow will not cause Reset.
5380 #define _STVR_ON_4L 0xFF // Stack full/underflow will cause Reset.
5381 #define _LVP_OFF_4L 0xFB // Low-Voltage ICSP disabled.
5382 #define _LVP_ON_4L 0xFF // Low-Voltage ICSP enabled.
5383 #define _DEBUG_ON_4L 0x7F // Background debugger enabled. RB6 and RB7 are dedicated to in-circuit debug.
5384 #define _DEBUG_OFF_4L 0xFF // Background debugger disabled. RB6 and RB7 configured as general purpose I/O pins.
5386 //----------------------------- CONFIG5L Options -------------------------------
5388 #define _CP0_ON_5L 0xFE // Block 0 (000800-003FFFh) code-protected.
5389 #define _CP0_OFF_5L 0xFF // Block 0 (000800-003FFFh) not code-protected.
5390 #define _CP1_ON_5L 0xFD // Block 1 (004000-007FFFh) code-protected.
5391 #define _CP1_OFF_5L 0xFF // Block 1 (004000-007FFFh) not code-protected.
5392 #define _CP2_ON_5L 0xFB // Block 2 (008000-00BFFFh) code-protected.
5393 #define _CP2_OFF_5L 0xFF // Block 2 (008000-00BFFFh) not code-protected.
5394 #define _CP3_ON_5L 0xF7 // Block 3 (00C000-00FFFFh) code-protected.
5395 #define _CP3_OFF_5L 0xFF // Block 3 (00C000-00FFFFh) not code-protected.
5397 //----------------------------- CONFIG5H Options -------------------------------
5399 #define _CPB_ON_5H 0xBF // Boot block (000000-0007FFh) code-protected.
5400 #define _CPB_OFF_5H 0xFF // Boot block (000000-0007FFh) not code-protected.
5401 #define _CPD_ON_5H 0x7F // Data EEPROM code-protected.
5402 #define _CPD_OFF_5H 0xFF // Data EEPROM not code-protected.
5404 //----------------------------- CONFIG6L Options -------------------------------
5406 #define _WRT0_ON_6L 0xFE // Block 0 (000800-003FFFh) write-protected.
5407 #define _WRT0_OFF_6L 0xFF // Block 0 (000800-003FFFh) not write-protected.
5408 #define _WRT1_ON_6L 0xFD // Block 1 (004000-007FFFh) write-protected.
5409 #define _WRT1_OFF_6L 0xFF // Block 1 (004000-007FFFh) not write-protected.
5410 #define _WRT2_ON_6L 0xFB // Block 2 (008000-00BFFFh) write-protected.
5411 #define _WRT2_OFF_6L 0xFF // Block 2 (008000-00BFFFh) not write-protected.
5412 #define _WRT3_ON_6L 0xF7 // Block 3 (00C000-00FFFFh) write-protected.
5413 #define _WRT3_OFF_6L 0xFF // Block 3 (00C000-00FFFFh) not write-protected.
5415 //----------------------------- CONFIG6H Options -------------------------------
5417 #define _WRTC_ON_6H 0xDF // Configuration registers (300000-3000FFh) write-protected.
5418 #define _WRTC_OFF_6H 0xFF // Configuration registers (300000-3000FFh) not write-protected.
5419 #define _WRTB_ON_6H 0xBF // Boot block (000000-0007FFh) write-protected.
5420 #define _WRTB_OFF_6H 0xFF // Boot block (000000-0007FFh) not write-protected.
5421 #define _WRTD_ON_6H 0x7F // Data EEPROM write-protected.
5422 #define _WRTD_OFF_6H 0xFF // Data EEPROM not write-protected.
5424 //----------------------------- CONFIG7L Options -------------------------------
5426 #define _EBTR0_ON_7L 0xFE // Block 0 (000800-003FFFh) protected from table reads executed in other blocks.
5427 #define _EBTR0_OFF_7L 0xFF // Block 0 (000800-003FFFh) not protected from table reads executed in other blocks.
5428 #define _EBTR1_ON_7L 0xFD // Block 1 (004000-007FFFh) protected from table reads executed in other blocks.
5429 #define _EBTR1_OFF_7L 0xFF // Block 1 (004000-007FFFh) not protected from table reads executed in other blocks.
5430 #define _EBTR2_ON_7L 0xFB // Block 2 (008000-00BFFFh) protected from table reads executed in other blocks.
5431 #define _EBTR2_OFF_7L 0xFF // Block 2 (008000-00BFFFh) not protected from table reads executed in other blocks.
5432 #define _EBTR3_ON_7L 0xF7 // Block 3 (00C000-00FFFFh) protected from table reads executed in other blocks.
5433 #define _EBTR3_OFF_7L 0xFF // Block 3 (00C000-00FFFFh) not protected from table reads executed in other blocks.
5435 //----------------------------- CONFIG7H Options -------------------------------
5437 #define _EBTRB_ON_7H 0xBF // Boot block (000000-0007FFh) protected from table reads executed in other blocks.
5438 #define _EBTRB_OFF_7H 0xFF // Boot block (000000-0007FFh) not protected from table reads executed in other blocks.
5440 //==============================================================================
5442 #define __DEVID1 0x3FFFFE
5443 #define __DEVID2 0x3FFFFF
5445 #define __IDLOC0 0x200000
5446 #define __IDLOC1 0x200001
5447 #define __IDLOC2 0x200002
5448 #define __IDLOC3 0x200003
5449 #define __IDLOC4 0x200004
5450 #define __IDLOC5 0x200005
5451 #define __IDLOC6 0x200006
5452 #define __IDLOC7 0x200007
5454 #endif // #ifndef __PIC18F8621_H__