2 * This declarations of the PIC18LF65K80 MCU.
4 * This file is part of the GNU PIC library for SDCC, originally
5 * created by Molnar Karoly <molnarkaroly@users.sf.net> 2016.
7 * This file is generated automatically by the cinc2h.pl, 2016-04-13 17:23:58 UTC.
9 * SDCC is licensed under the GNU Public license (GPL) v2. Note that
10 * this license covers the code to the compiler and other executables,
11 * but explicitly does not cover any code or objects generated by sdcc.
13 * For pic device libraries and header files which are derived from
14 * Microchip header (.inc) and linker script (.lkr) files Microchip
15 * requires that "The header files should state that they are only to be
16 * used with authentic Microchip devices" which makes them incompatible
17 * with the GPL. Pic device libraries and header files are located at
18 * non-free/lib and non-free/include directories respectively.
19 * Sdcc should be run with the --use-non-free command line option in
20 * order to include non-free header files and libraries.
22 * See http://sdcc.sourceforge.net/ for the latest information on sdcc.
25 #ifndef __PIC18LF65K80_H__
26 #define __PIC18LF65K80_H__
28 //==============================================================================
30 //==============================================================================
32 // Register Definitions
34 //==============================================================================
37 //==============================================================================
40 extern __at(0x0E41) __sfr RXERRCNT
;
54 extern __at(0x0E41) volatile __RXERRCNTbits_t RXERRCNTbits
;
65 //==============================================================================
68 //==============================================================================
71 extern __at(0x0E42) __sfr TXERRCNT
;
85 extern __at(0x0E42) volatile __TXERRCNTbits_t TXERRCNTbits
;
96 //==============================================================================
99 //==============================================================================
102 extern __at(0x0E43) __sfr BRGCON1
;
131 extern __at(0x0E43) volatile __BRGCON1bits_t BRGCON1bits
;
142 //==============================================================================
145 //==============================================================================
148 extern __at(0x0E44) __sfr BRGCON2
;
157 unsigned SEG1PH0
: 1;
158 unsigned SEG1PH1
: 1;
159 unsigned SEG1PH2
: 1;
161 unsigned SEG2PHTS
: 1;
178 extern __at(0x0E44) volatile __BRGCON2bits_t BRGCON2bits
;
183 #define _SEG1PH0 0x08
184 #define _SEG1PH1 0x10
185 #define _SEG1PH2 0x20
187 #define _SEG2PHTS 0x80
189 //==============================================================================
192 //==============================================================================
195 extern __at(0x0E45) __sfr BRGCON3
;
201 unsigned SEG2PH0
: 1;
202 unsigned SEG2PH1
: 1;
203 unsigned SEG2PH2
: 1;
218 extern __at(0x0E45) volatile __BRGCON3bits_t BRGCON3bits
;
220 #define _SEG2PH0 0x01
221 #define _SEG2PH1 0x02
222 #define _SEG2PH2 0x04
226 //==============================================================================
229 //==============================================================================
232 extern __at(0x0E46) __sfr RXFCON0
;
246 extern __at(0x0E46) volatile __RXFCON0bits_t RXFCON0bits
;
257 //==============================================================================
260 //==============================================================================
263 extern __at(0x0E47) __sfr RXFCON1
;
269 unsigned RXF10EN
: 1;
270 unsigned RXF11EN
: 1;
271 unsigned RXF12EN
: 1;
272 unsigned RXF13EN
: 1;
273 unsigned RXF14EN
: 1;
274 unsigned RXF15EN
: 1;
277 extern __at(0x0E47) volatile __RXFCON1bits_t RXFCON1bits
;
281 #define _RXF10EN 0x04
282 #define _RXF11EN 0x08
283 #define _RXF12EN 0x10
284 #define _RXF13EN 0x20
285 #define _RXF14EN 0x40
286 #define _RXF15EN 0x80
288 //==============================================================================
291 //==============================================================================
294 extern __at(0x0E48) __sfr RXF6SIDH
;
308 extern __at(0x0E48) volatile __RXF6SIDHbits_t RXF6SIDHbits
;
310 #define _RXF6SIDH_SID3 0x01
311 #define _RXF6SIDH_SID4 0x02
312 #define _RXF6SIDH_SID5 0x04
313 #define _RXF6SIDH_SID6 0x08
314 #define _RXF6SIDH_SID7 0x10
315 #define _RXF6SIDH_SID8 0x20
316 #define _RXF6SIDH_SID9 0x40
317 #define _RXF6SIDH_SID10 0x80
319 //==============================================================================
322 //==============================================================================
325 extern __at(0x0E49) __sfr RXF6SIDL
;
348 extern __at(0x0E49) volatile __RXF6SIDLbits_t RXF6SIDLbits
;
350 #define _RXF6SIDL_EID16 0x01
351 #define _RXF6SIDL_EID17 0x02
352 #define _RXF6SIDL_EXIDEN 0x08
353 #define _RXF6SIDL_SID0 0x20
354 #define _RXF6SIDL_SID1 0x40
355 #define _RXF6SIDL_SID2 0x80
357 //==============================================================================
360 //==============================================================================
363 extern __at(0x0E4A) __sfr RXF6EIDH
;
377 extern __at(0x0E4A) volatile __RXF6EIDHbits_t RXF6EIDHbits
;
379 #define _RXF6EIDH_EID8 0x01
380 #define _RXF6EIDH_EID9 0x02
381 #define _RXF6EIDH_EID10 0x04
382 #define _RXF6EIDH_EID11 0x08
383 #define _RXF6EIDH_EID12 0x10
384 #define _RXF6EIDH_EID13 0x20
385 #define _RXF6EIDH_EID14 0x40
386 #define _RXF6EIDH_EID15 0x80
388 //==============================================================================
391 //==============================================================================
394 extern __at(0x0E4B) __sfr RXF6EIDL
;
408 extern __at(0x0E4B) volatile __RXF6EIDLbits_t RXF6EIDLbits
;
410 #define _RXF6EIDL_EID0 0x01
411 #define _RXF6EIDL_EID1 0x02
412 #define _RXF6EIDL_EID2 0x04
413 #define _RXF6EIDL_EID3 0x08
414 #define _RXF6EIDL_EID4 0x10
415 #define _RXF6EIDL_EID5 0x20
416 #define _RXF6EIDL_EID6 0x40
417 #define _RXF6EIDL_EID7 0x80
419 //==============================================================================
422 //==============================================================================
425 extern __at(0x0E4C) __sfr RXF7SIDH
;
439 extern __at(0x0E4C) volatile __RXF7SIDHbits_t RXF7SIDHbits
;
441 #define _RXF7SIDH_SID3 0x01
442 #define _RXF7SIDH_SID4 0x02
443 #define _RXF7SIDH_SID5 0x04
444 #define _RXF7SIDH_SID6 0x08
445 #define _RXF7SIDH_SID7 0x10
446 #define _RXF7SIDH_SID8 0x20
447 #define _RXF7SIDH_SID9 0x40
448 #define _RXF7SIDH_SID10 0x80
450 //==============================================================================
453 //==============================================================================
456 extern __at(0x0E4D) __sfr RXF7SIDL
;
479 extern __at(0x0E4D) volatile __RXF7SIDLbits_t RXF7SIDLbits
;
481 #define _RXF7SIDL_EID16 0x01
482 #define _RXF7SIDL_EID17 0x02
483 #define _RXF7SIDL_EXIDEN 0x08
484 #define _RXF7SIDL_SID0 0x20
485 #define _RXF7SIDL_SID1 0x40
486 #define _RXF7SIDL_SID2 0x80
488 //==============================================================================
491 //==============================================================================
494 extern __at(0x0E4E) __sfr RXF7EIDH
;
508 extern __at(0x0E4E) volatile __RXF7EIDHbits_t RXF7EIDHbits
;
510 #define _RXF7EIDH_EID8 0x01
511 #define _RXF7EIDH_EID9 0x02
512 #define _RXF7EIDH_EID10 0x04
513 #define _RXF7EIDH_EID11 0x08
514 #define _RXF7EIDH_EID12 0x10
515 #define _RXF7EIDH_EID13 0x20
516 #define _RXF7EIDH_EID14 0x40
517 #define _RXF7EIDH_EID15 0x80
519 //==============================================================================
522 //==============================================================================
525 extern __at(0x0E4F) __sfr RXF7EIDL
;
539 extern __at(0x0E4F) volatile __RXF7EIDLbits_t RXF7EIDLbits
;
541 #define _RXF7EIDL_EID0 0x01
542 #define _RXF7EIDL_EID1 0x02
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545 #define _RXF7EIDL_EID4 0x10
546 #define _RXF7EIDL_EID5 0x20
547 #define _RXF7EIDL_EID6 0x40
548 #define _RXF7EIDL_EID7 0x80
550 //==============================================================================
553 //==============================================================================
556 extern __at(0x0E50) __sfr RXF8SIDH
;
570 extern __at(0x0E50) volatile __RXF8SIDHbits_t RXF8SIDHbits
;
572 #define _RXF8SIDH_SID3 0x01
573 #define _RXF8SIDH_SID4 0x02
574 #define _RXF8SIDH_SID5 0x04
575 #define _RXF8SIDH_SID6 0x08
576 #define _RXF8SIDH_SID7 0x10
577 #define _RXF8SIDH_SID8 0x20
578 #define _RXF8SIDH_SID9 0x40
579 #define _RXF8SIDH_SID10 0x80
581 //==============================================================================
584 //==============================================================================
587 extern __at(0x0E51) __sfr RXF8SIDL
;
610 extern __at(0x0E51) volatile __RXF8SIDLbits_t RXF8SIDLbits
;
612 #define _RXF8SIDL_EID16 0x01
613 #define _RXF8SIDL_EID17 0x02
614 #define _RXF8SIDL_EXIDEN 0x08
615 #define _RXF8SIDL_SID0 0x20
616 #define _RXF8SIDL_SID1 0x40
617 #define _RXF8SIDL_SID2 0x80
619 //==============================================================================
622 //==============================================================================
625 extern __at(0x0E52) __sfr RXF8EIDH
;
639 extern __at(0x0E52) volatile __RXF8EIDHbits_t RXF8EIDHbits
;
641 #define _RXF8EIDH_EID8 0x01
642 #define _RXF8EIDH_EID9 0x02
643 #define _RXF8EIDH_EID10 0x04
644 #define _RXF8EIDH_EID11 0x08
645 #define _RXF8EIDH_EID12 0x10
646 #define _RXF8EIDH_EID13 0x20
647 #define _RXF8EIDH_EID14 0x40
648 #define _RXF8EIDH_EID15 0x80
650 //==============================================================================
653 //==============================================================================
656 extern __at(0x0E53) __sfr RXF8EIDL
;
670 extern __at(0x0E53) volatile __RXF8EIDLbits_t RXF8EIDLbits
;
672 #define _RXF8EIDL_EID0 0x01
673 #define _RXF8EIDL_EID1 0x02
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675 #define _RXF8EIDL_EID3 0x08
676 #define _RXF8EIDL_EID4 0x10
677 #define _RXF8EIDL_EID5 0x20
678 #define _RXF8EIDL_EID6 0x40
679 #define _RXF8EIDL_EID7 0x80
681 //==============================================================================
684 //==============================================================================
687 extern __at(0x0E54) __sfr RXF9SIDH
;
701 extern __at(0x0E54) volatile __RXF9SIDHbits_t RXF9SIDHbits
;
703 #define _RXF9SIDH_SID3 0x01
704 #define _RXF9SIDH_SID4 0x02
705 #define _RXF9SIDH_SID5 0x04
706 #define _RXF9SIDH_SID6 0x08
707 #define _RXF9SIDH_SID7 0x10
708 #define _RXF9SIDH_SID8 0x20
709 #define _RXF9SIDH_SID9 0x40
710 #define _RXF9SIDH_SID10 0x80
712 //==============================================================================
715 //==============================================================================
718 extern __at(0x0E55) __sfr RXF9SIDL
;
741 extern __at(0x0E55) volatile __RXF9SIDLbits_t RXF9SIDLbits
;
743 #define _RXF9SIDL_EID16 0x01
744 #define _RXF9SIDL_EID17 0x02
745 #define _RXF9SIDL_EXIDEN 0x08
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747 #define _RXF9SIDL_SID1 0x40
748 #define _RXF9SIDL_SID2 0x80
750 //==============================================================================
753 //==============================================================================
756 extern __at(0x0E56) __sfr RXF9EIDH
;
770 extern __at(0x0E56) volatile __RXF9EIDHbits_t RXF9EIDHbits
;
772 #define _RXF9EIDH_EID8 0x01
773 #define _RXF9EIDH_EID9 0x02
774 #define _RXF9EIDH_EID10 0x04
775 #define _RXF9EIDH_EID11 0x08
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777 #define _RXF9EIDH_EID13 0x20
778 #define _RXF9EIDH_EID14 0x40
779 #define _RXF9EIDH_EID15 0x80
781 //==============================================================================
784 //==============================================================================
787 extern __at(0x0E57) __sfr RXF9EIDL
;
801 extern __at(0x0E57) volatile __RXF9EIDLbits_t RXF9EIDLbits
;
803 #define _RXF9EIDL_EID0 0x01
804 #define _RXF9EIDL_EID1 0x02
805 #define _RXF9EIDL_EID2 0x04
806 #define _RXF9EIDL_EID3 0x08
807 #define _RXF9EIDL_EID4 0x10
808 #define _RXF9EIDL_EID5 0x20
809 #define _RXF9EIDL_EID6 0x40
810 #define _RXF9EIDL_EID7 0x80
812 //==============================================================================
815 //==============================================================================
818 extern __at(0x0E58) __sfr RXF10SIDH
;
832 extern __at(0x0E58) volatile __RXF10SIDHbits_t RXF10SIDHbits
;
834 #define _RXF10SIDH_SID3 0x01
835 #define _RXF10SIDH_SID4 0x02
836 #define _RXF10SIDH_SID5 0x04
837 #define _RXF10SIDH_SID6 0x08
838 #define _RXF10SIDH_SID7 0x10
839 #define _RXF10SIDH_SID8 0x20
840 #define _RXF10SIDH_SID9 0x40
841 #define _RXF10SIDH_SID10 0x80
843 //==============================================================================
846 //==============================================================================
849 extern __at(0x0E59) __sfr RXF10SIDL
;
872 extern __at(0x0E59) volatile __RXF10SIDLbits_t RXF10SIDLbits
;
874 #define _RXF10SIDL_EID16 0x01
875 #define _RXF10SIDL_EID17 0x02
876 #define _RXF10SIDL_EXIDEN 0x08
877 #define _RXF10SIDL_SID0 0x20
878 #define _RXF10SIDL_SID1 0x40
879 #define _RXF10SIDL_SID2 0x80
881 //==============================================================================
884 //==============================================================================
887 extern __at(0x0E5A) __sfr RXF10EIDH
;
901 extern __at(0x0E5A) volatile __RXF10EIDHbits_t RXF10EIDHbits
;
903 #define _RXF10EIDH_EID8 0x01
904 #define _RXF10EIDH_EID9 0x02
905 #define _RXF10EIDH_EID10 0x04
906 #define _RXF10EIDH_EID11 0x08
907 #define _RXF10EIDH_EID12 0x10
908 #define _RXF10EIDH_EID13 0x20
909 #define _RXF10EIDH_EID14 0x40
910 #define _RXF10EIDH_EID15 0x80
912 //==============================================================================
915 //==============================================================================
918 extern __at(0x0E5B) __sfr RXF10EIDL
;
932 extern __at(0x0E5B) volatile __RXF10EIDLbits_t RXF10EIDLbits
;
934 #define _RXF10EIDL_EID0 0x01
935 #define _RXF10EIDL_EID1 0x02
936 #define _RXF10EIDL_EID2 0x04
937 #define _RXF10EIDL_EID3 0x08
938 #define _RXF10EIDL_EID4 0x10
939 #define _RXF10EIDL_EID5 0x20
940 #define _RXF10EIDL_EID6 0x40
941 #define _RXF10EIDL_EID7 0x80
943 //==============================================================================
946 //==============================================================================
949 extern __at(0x0E5C) __sfr RXF11SIDH
;
963 extern __at(0x0E5C) volatile __RXF11SIDHbits_t RXF11SIDHbits
;
965 #define _RXF11SIDH_SID3 0x01
966 #define _RXF11SIDH_SID4 0x02
967 #define _RXF11SIDH_SID5 0x04
968 #define _RXF11SIDH_SID6 0x08
969 #define _RXF11SIDH_SID7 0x10
970 #define _RXF11SIDH_SID8 0x20
971 #define _RXF11SIDH_SID9 0x40
972 #define _RXF11SIDH_SID10 0x80
974 //==============================================================================
977 //==============================================================================
980 extern __at(0x0E5D) __sfr RXF11SIDL
;
1001 } __RXF11SIDLbits_t
;
1003 extern __at(0x0E5D) volatile __RXF11SIDLbits_t RXF11SIDLbits
;
1005 #define _RXF11SIDL_EID16 0x01
1006 #define _RXF11SIDL_EID17 0x02
1007 #define _RXF11SIDL_EXIDEN 0x08
1008 #define _RXF11SIDL_SID0 0x20
1009 #define _RXF11SIDL_SID1 0x40
1010 #define _RXF11SIDL_SID2 0x80
1012 //==============================================================================
1015 //==============================================================================
1018 extern __at(0x0E5E) __sfr RXF11EIDH
;
1030 } __RXF11EIDHbits_t
;
1032 extern __at(0x0E5E) volatile __RXF11EIDHbits_t RXF11EIDHbits
;
1034 #define _RXF11EIDH_EID8 0x01
1035 #define _RXF11EIDH_EID9 0x02
1036 #define _RXF11EIDH_EID10 0x04
1037 #define _RXF11EIDH_EID11 0x08
1038 #define _RXF11EIDH_EID12 0x10
1039 #define _RXF11EIDH_EID13 0x20
1040 #define _RXF11EIDH_EID14 0x40
1041 #define _RXF11EIDH_EID15 0x80
1043 //==============================================================================
1046 //==============================================================================
1049 extern __at(0x0E5F) __sfr RXF11EIDL
;
1061 } __RXF11EIDLbits_t
;
1063 extern __at(0x0E5F) volatile __RXF11EIDLbits_t RXF11EIDLbits
;
1065 #define _RXF11EIDL_EID0 0x01
1066 #define _RXF11EIDL_EID1 0x02
1067 #define _RXF11EIDL_EID2 0x04
1068 #define _RXF11EIDL_EID3 0x08
1069 #define _RXF11EIDL_EID4 0x10
1070 #define _RXF11EIDL_EID5 0x20
1071 #define _RXF11EIDL_EID6 0x40
1072 #define _RXF11EIDL_EID7 0x80
1074 //==============================================================================
1077 //==============================================================================
1080 extern __at(0x0E60) __sfr RXF12SIDH
;
1092 } __RXF12SIDHbits_t
;
1094 extern __at(0x0E60) volatile __RXF12SIDHbits_t RXF12SIDHbits
;
1096 #define _RXF12SIDH_SID3 0x01
1097 #define _RXF12SIDH_SID4 0x02
1098 #define _RXF12SIDH_SID5 0x04
1099 #define _RXF12SIDH_SID6 0x08
1100 #define _RXF12SIDH_SID7 0x10
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1382 unsigned EXIDEN
: 1;
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1405 //==============================================================================
1408 //==============================================================================
1411 extern __at(0x0E6A) __sfr RXF14EIDH
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1425 extern __at(0x0E6A) volatile __RXF14EIDHbits_t RXF14EIDHbits
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1439 //==============================================================================
1442 extern __at(0x0E6B) __sfr RXF14EIDL
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1513 unsigned EXIDEN
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1536 //==============================================================================
1539 //==============================================================================
1542 extern __at(0x0E6E) __sfr RXF15EIDH
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1570 //==============================================================================
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;
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;
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: 1;
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: 1;
1654 unsigned F1BP_3
: 1;
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;
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;
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;
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1730 //==============================================================================
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;
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;
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1776 //==============================================================================
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;
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: 1;
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: 1;
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: 1;
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: 1;
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;
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1822 //==============================================================================
1825 extern __at(0x0E75) __sfr RXFBCON4
;
1831 unsigned F8BP_0
: 1;
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: 1;
1833 unsigned F8BP_2
: 1;
1834 unsigned F8BP_3
: 1;
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: 1;
1836 unsigned F9BP_1
: 1;
1837 unsigned F9BP_2
: 1;
1838 unsigned F9BP_3
: 1;
1854 extern __at(0x0E75) volatile __RXFBCON4bits_t RXFBCON4bits
;
1856 #define _F8BP_0 0x01
1857 #define _F8BP_1 0x02
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1865 //==============================================================================
1868 //==============================================================================
1871 extern __at(0x0E76) __sfr RXFBCON5
;
1877 unsigned F10BP_0
: 1;
1878 unsigned F10BP_1
: 1;
1879 unsigned F10BP_2
: 1;
1880 unsigned F10BP_3
: 1;
1881 unsigned F11BP_0
: 1;
1882 unsigned F11BP_1
: 1;
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: 1;
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: 1;
1889 unsigned F10BP_
: 4;
1896 unsigned F11BP_
: 4;
1900 extern __at(0x0E76) volatile __RXFBCON5bits_t RXFBCON5bits
;
1902 #define _F10BP_0 0x01
1903 #define _F10BP_1 0x02
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1905 #define _F10BP_3 0x08
1906 #define _F11BP_0 0x10
1907 #define _F11BP_1 0x20
1908 #define _F11BP_2 0x40
1909 #define _F11BP_3 0x80
1911 //==============================================================================
1914 //==============================================================================
1917 extern __at(0x0E77) __sfr RXFBCON6
;
1923 unsigned F12BP_0
: 1;
1924 unsigned F12BP_1
: 1;
1925 unsigned F12BP_2
: 1;
1926 unsigned F12BP_3
: 1;
1927 unsigned F13BP_0
: 1;
1928 unsigned F13BP_1
: 1;
1929 unsigned F13BP_2
: 1;
1930 unsigned F13BP_3
: 1;
1935 unsigned F12BP_
: 4;
1942 unsigned F13BP_
: 4;
1946 extern __at(0x0E77) volatile __RXFBCON6bits_t RXFBCON6bits
;
1948 #define _F12BP_0 0x01
1949 #define _F12BP_1 0x02
1950 #define _F12BP_2 0x04
1951 #define _F12BP_3 0x08
1952 #define _F13BP_0 0x10
1953 #define _F13BP_1 0x20
1954 #define _F13BP_2 0x40
1955 #define _F13BP_3 0x80
1957 //==============================================================================
1960 //==============================================================================
1963 extern __at(0x0E78) __sfr RXFBCON7
;
1969 unsigned F14BP_0
: 1;
1970 unsigned F14BP_1
: 1;
1971 unsigned F14BP_2
: 1;
1972 unsigned F14BP_3
: 1;
1973 unsigned F15BP_0
: 1;
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: 1;
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: 1;
1981 unsigned F14BP_
: 4;
1988 unsigned F15BP_
: 4;
1992 extern __at(0x0E78) volatile __RXFBCON7bits_t RXFBCON7bits
;
1994 #define _F14BP_0 0x01
1995 #define _F14BP_1 0x02
1996 #define _F14BP_2 0x04
1997 #define _F14BP_3 0x08
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: 1;
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: 1;
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;
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;
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: 1;
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: 2;
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;
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2246 //==============================================================================
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: 1;
2263 extern __at(0x0E7D) volatile __BSEL0bits_t BSEL0bits
;
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2275 //==============================================================================
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2282 unsigned RXB0IE
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: 1;
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2315 unsigned TXB0IE
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: 1;
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2335 extern __at(0x0E80) __sfr B0CON
;
2341 unsigned FILHIT0_TXPRI0
: 1;
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: 1;
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2358 unsigned RXRTRRO
: 1;
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: 1;
2366 unsigned TXPRI1
: 1;
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: 1;
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;
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2435 extern __at(0x0E81) volatile __B0SIDHbits_t B0SIDHbits
;
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;
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;
2505 extern __at(0x0E83) volatile __B0EIDHbits_t B0EIDHbits
;
2516 //==============================================================================
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;
2536 extern __at(0x0E84) volatile __B0EIDLbits_t B0EIDLbits
;
2547 //==============================================================================
2550 //==============================================================================
2553 extern __at(0x0E85) __sfr B0DLC
;
2565 unsigned RXRTR_TXRTR
: 1;
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;
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2622 //==============================================================================
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;
2650 //==============================================================================
2653 //==============================================================================
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;
2670 extern __at(0x0E87) volatile __B0D1bits_t B0D1bits
;
2681 //==============================================================================
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;
2701 extern __at(0x0E88) volatile __B0D2bits_t B0D2bits
;
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;
2732 extern __at(0x0E89) volatile __B0D3bits_t B0D3bits
;
2743 //==============================================================================
2746 //==============================================================================
2749 extern __at(0x0E8A) __sfr B0D4
;
2763 extern __at(0x0E8A) volatile __B0D4bits_t B0D4bits
;
2774 //==============================================================================
2777 //==============================================================================
2780 extern __at(0x0E8B) __sfr B0D5
;
2794 extern __at(0x0E8B) volatile __B0D5bits_t B0D5bits
;
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;
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;
2836 //==============================================================================
2839 //==============================================================================
2842 extern __at(0x0E8D) __sfr B0D7
;
2856 extern __at(0x0E8D) volatile __B0D7bits_t B0D7bits
;
2867 //==============================================================================
2870 //==============================================================================
2873 extern __at(0x0E8E) __sfr CANSTAT_RO9
;
2879 unsigned EICODE0
: 1;
2880 unsigned EICODE1_ICODE0
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
2886 unsigned OPMODE2
: 1;
2892 unsigned EICODE1
: 1;
2893 unsigned EICODE2
: 1;
2894 unsigned EICODE3
: 1;
2904 unsigned ICODE0
: 1;
2905 unsigned ICODE1
: 1;
2906 unsigned ICODE2
: 1;
2915 unsigned EICODE
: 5;
2929 unsigned OPMODE
: 3;
2931 } __CANSTAT_RO9bits_t
;
2933 extern __at(0x0E8E) volatile __CANSTAT_RO9bits_t CANSTAT_RO9bits
;
2935 #define _CANSTAT_RO9_EICODE0 0x01
2936 #define _CANSTAT_RO9_EICODE1_ICODE0 0x02
2937 #define _CANSTAT_RO9_EICODE1 0x02
2938 #define _CANSTAT_RO9_ICODE0 0x02
2939 #define _CANSTAT_RO9_EICODE2_ICODE1 0x04
2940 #define _CANSTAT_RO9_EICODE2 0x04
2941 #define _CANSTAT_RO9_ICODE1 0x04
2942 #define _CANSTAT_RO9_EICODE3_ICODE2 0x08
2943 #define _CANSTAT_RO9_EICODE3 0x08
2944 #define _CANSTAT_RO9_ICODE2 0x08
2945 #define _CANSTAT_RO9_EICODE4 0x10
2946 #define _CANSTAT_RO9_OPMODE0 0x20
2947 #define _CANSTAT_RO9_OPMODE1 0x40
2948 #define _CANSTAT_RO9_OPMODE2 0x80
2950 //==============================================================================
2953 //==============================================================================
2956 extern __at(0x0E8F) __sfr CANCON_RO9
;
2963 unsigned WIN0_FP1
: 1;
2964 unsigned WIN1_FP2
: 1;
2965 unsigned WIN2_FP3
: 1;
3008 } __CANCON_RO9bits_t
;
3010 extern __at(0x0E8F) volatile __CANCON_RO9bits_t CANCON_RO9bits
;
3012 #define _CANCON_RO9_FP0 0x01
3013 #define _CANCON_RO9_WIN0_FP1 0x02
3014 #define _CANCON_RO9_WIN0 0x02
3015 #define _CANCON_RO9_FP1 0x02
3016 #define _CANCON_RO9_WIN1_FP2 0x04
3017 #define _CANCON_RO9_WIN1 0x04
3018 #define _CANCON_RO9_FP2 0x04
3019 #define _CANCON_RO9_WIN2_FP3 0x08
3020 #define _CANCON_RO9_WIN2 0x08
3021 #define _CANCON_RO9_FP3 0x08
3022 #define _CANCON_RO9_ABAT 0x10
3024 //==============================================================================
3027 //==============================================================================
3030 extern __at(0x0E90) __sfr B1CON
;
3036 unsigned FILHIT0_TXPRI0
: 1;
3037 unsigned FILHIT1_TXPRI1
: 1;
3038 unsigned FILHIT2_RTREN
: 1;
3039 unsigned FILHIT3_TXREQ
: 1;
3040 unsigned FILHIT4_TXERR
: 1;
3041 unsigned RXRTRRO_TXLARB
: 1;
3042 unsigned RXM1_TXABT
: 1;
3043 unsigned RXFUL_TXBIF
: 1;
3048 unsigned FILHIT0
: 1;
3049 unsigned FILHIT1
: 1;
3050 unsigned FILHIT2
: 1;
3051 unsigned FILHIT3
: 1;
3052 unsigned FILHIT4
: 1;
3053 unsigned RXRTRRO
: 1;
3060 unsigned TXPRI0
: 1;
3061 unsigned TXPRI1
: 1;
3065 unsigned TXLARB
: 1;
3078 unsigned FILHIT
: 5;
3083 extern __at(0x0E90) volatile __B1CONbits_t B1CONbits
;
3085 #define _B1CON_FILHIT0_TXPRI0 0x01
3086 #define _B1CON_FILHIT0 0x01
3087 #define _B1CON_TXPRI0 0x01
3088 #define _B1CON_FILHIT1_TXPRI1 0x02
3089 #define _B1CON_FILHIT1 0x02
3090 #define _B1CON_TXPRI1 0x02
3091 #define _B1CON_FILHIT2_RTREN 0x04
3092 #define _B1CON_FILHIT2 0x04
3093 #define _B1CON_RTREN 0x04
3094 #define _B1CON_FILHIT3_TXREQ 0x08
3095 #define _B1CON_FILHIT3 0x08
3096 #define _B1CON_TXREQ 0x08
3097 #define _B1CON_FILHIT4_TXERR 0x10
3098 #define _B1CON_FILHIT4 0x10
3099 #define _B1CON_TXERR 0x10
3100 #define _B1CON_RXRTRRO_TXLARB 0x20
3101 #define _B1CON_RXRTRRO 0x20
3102 #define _B1CON_TXLARB 0x20
3103 #define _B1CON_RXM1_TXABT 0x40
3104 #define _B1CON_RXM1 0x40
3105 #define _B1CON_TXABT 0x40
3106 #define _B1CON_RXFUL_TXBIF 0x80
3107 #define _B1CON_RXFUL 0x80
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3110 //==============================================================================
3113 //==============================================================================
3116 extern __at(0x0E91) __sfr B1SIDH
;
3130 extern __at(0x0E91) volatile __B1SIDHbits_t B1SIDHbits
;
3132 #define _B1SIDH_SID3 0x01
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3141 //==============================================================================
3144 //==============================================================================
3147 extern __at(0x0E92) __sfr B1SIDL
;
3170 extern __at(0x0E92) volatile __B1SIDLbits_t B1SIDLbits
;
3172 #define _B1SIDL_EID16 0x01
3173 #define _B1SIDL_EID17 0x02
3174 #define _B1SIDL_EXIDE 0x08
3175 #define _B1SIDL_SRR 0x10
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3177 #define _B1SIDL_SID1 0x40
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3180 //==============================================================================
3183 //==============================================================================
3186 extern __at(0x0E93) __sfr B1EIDH
;
3200 extern __at(0x0E93) volatile __B1EIDHbits_t B1EIDHbits
;
3202 #define _B1EIDH_EID8 0x01
3203 #define _B1EIDH_EID9 0x02
3204 #define _B1EIDH_EID10 0x04
3205 #define _B1EIDH_EID11 0x08
3206 #define _B1EIDH_EID12 0x10
3207 #define _B1EIDH_EID13 0x20
3208 #define _B1EIDH_EID14 0x40
3209 #define _B1EIDH_EID15 0x80
3211 //==============================================================================
3214 //==============================================================================
3217 extern __at(0x0E94) __sfr B1EIDL
;
3231 extern __at(0x0E94) volatile __B1EIDLbits_t B1EIDLbits
;
3233 #define _B1EIDL_EID0 0x01
3234 #define _B1EIDL_EID1 0x02
3235 #define _B1EIDL_EID2 0x04
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3237 #define _B1EIDL_EID4 0x10
3238 #define _B1EIDL_EID5 0x20
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3240 #define _B1EIDL_EID7 0x80
3242 //==============================================================================
3245 //==============================================================================
3248 extern __at(0x0E95) __sfr B1DLC
;
3260 unsigned RXRTR_TXRTR
: 1;
3302 extern __at(0x0E95) volatile __B1DLCbits_t B1DLCbits
;
3304 #define _B1DLC_DLC0 0x01
3305 #define _B1DLC_DLC1 0x02
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3309 #define _B1DLC_RB1 0x20
3310 #define _B1DLC_RXRTR_TXRTR 0x40
3311 #define _B1DLC_RXRTR 0x40
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3314 //==============================================================================
3317 //==============================================================================
3320 extern __at(0x0E96) __sfr B1D0
;
3334 extern __at(0x0E96) volatile __B1D0bits_t B1D0bits
;
3345 //==============================================================================
3348 //==============================================================================
3351 extern __at(0x0E97) __sfr B1D1
;
3365 extern __at(0x0E97) volatile __B1D1bits_t B1D1bits
;
3376 //==============================================================================
3379 //==============================================================================
3382 extern __at(0x0E98) __sfr B1D2
;
3396 extern __at(0x0E98) volatile __B1D2bits_t B1D2bits
;
3407 //==============================================================================
3410 //==============================================================================
3413 extern __at(0x0E99) __sfr B1D3
;
3427 extern __at(0x0E99) volatile __B1D3bits_t B1D3bits
;
3438 //==============================================================================
3441 //==============================================================================
3444 extern __at(0x0E9A) __sfr B1D4
;
3458 extern __at(0x0E9A) volatile __B1D4bits_t B1D4bits
;
3469 //==============================================================================
3472 //==============================================================================
3475 extern __at(0x0E9B) __sfr B1D5
;
3489 extern __at(0x0E9B) volatile __B1D5bits_t B1D5bits
;
3500 //==============================================================================
3503 //==============================================================================
3506 extern __at(0x0E9C) __sfr B1D6
;
3520 extern __at(0x0E9C) volatile __B1D6bits_t B1D6bits
;
3531 //==============================================================================
3534 //==============================================================================
3537 extern __at(0x0E9D) __sfr B1D7
;
3551 extern __at(0x0E9D) volatile __B1D7bits_t B1D7bits
;
3562 //==============================================================================
3565 //==============================================================================
3568 extern __at(0x0E9E) __sfr CANSTAT_RO8
;
3574 unsigned EICODE0
: 1;
3575 unsigned EICODE1_ICODE0
: 1;
3576 unsigned EICODE2_ICODE1
: 1;
3577 unsigned EICODE3_ICODE2
: 1;
3578 unsigned EICODE4
: 1;
3579 unsigned OPMODE0
: 1;
3580 unsigned OPMODE1
: 1;
3581 unsigned OPMODE2
: 1;
3587 unsigned EICODE1
: 1;
3588 unsigned EICODE2
: 1;
3589 unsigned EICODE3
: 1;
3599 unsigned ICODE0
: 1;
3600 unsigned ICODE1
: 1;
3601 unsigned ICODE2
: 1;
3610 unsigned EICODE
: 5;
3624 unsigned OPMODE
: 3;
3626 } __CANSTAT_RO8bits_t
;
3628 extern __at(0x0E9E) volatile __CANSTAT_RO8bits_t CANSTAT_RO8bits
;
3630 #define _CANSTAT_RO8_EICODE0 0x01
3631 #define _CANSTAT_RO8_EICODE1_ICODE0 0x02
3632 #define _CANSTAT_RO8_EICODE1 0x02
3633 #define _CANSTAT_RO8_ICODE0 0x02
3634 #define _CANSTAT_RO8_EICODE2_ICODE1 0x04
3635 #define _CANSTAT_RO8_EICODE2 0x04
3636 #define _CANSTAT_RO8_ICODE1 0x04
3637 #define _CANSTAT_RO8_EICODE3_ICODE2 0x08
3638 #define _CANSTAT_RO8_EICODE3 0x08
3639 #define _CANSTAT_RO8_ICODE2 0x08
3640 #define _CANSTAT_RO8_EICODE4 0x10
3641 #define _CANSTAT_RO8_OPMODE0 0x20
3642 #define _CANSTAT_RO8_OPMODE1 0x40
3643 #define _CANSTAT_RO8_OPMODE2 0x80
3645 //==============================================================================
3648 //==============================================================================
3651 extern __at(0x0E9F) __sfr CANCON_RO8
;
3658 unsigned WIN0_FP1
: 1;
3659 unsigned WIN1_FP2
: 1;
3660 unsigned WIN2_FP3
: 1;
3703 } __CANCON_RO8bits_t
;
3705 extern __at(0x0E9F) volatile __CANCON_RO8bits_t CANCON_RO8bits
;
3707 #define _CANCON_RO8_FP0 0x01
3708 #define _CANCON_RO8_WIN0_FP1 0x02
3709 #define _CANCON_RO8_WIN0 0x02
3710 #define _CANCON_RO8_FP1 0x02
3711 #define _CANCON_RO8_WIN1_FP2 0x04
3712 #define _CANCON_RO8_WIN1 0x04
3713 #define _CANCON_RO8_FP2 0x04
3714 #define _CANCON_RO8_WIN2_FP3 0x08
3715 #define _CANCON_RO8_WIN2 0x08
3716 #define _CANCON_RO8_FP3 0x08
3717 #define _CANCON_RO8_ABAT 0x10
3719 //==============================================================================
3722 //==============================================================================
3725 extern __at(0x0EA0) __sfr B2CON
;
3731 unsigned FILHIT0_TXPRI0
: 1;
3732 unsigned FILHIT1_TXPRI1
: 1;
3733 unsigned FILHIT2_RTREN
: 1;
3734 unsigned FILHIT3_TXREQ
: 1;
3735 unsigned FILHIT4_TXERR
: 1;
3736 unsigned RXRTRRO_TXLARB
: 1;
3737 unsigned RXM1_TXABT
: 1;
3738 unsigned RXFUL_TXBIF
: 1;
3743 unsigned FILHIT0
: 1;
3744 unsigned FILHIT1
: 1;
3745 unsigned FILHIT2
: 1;
3746 unsigned FILHIT3
: 1;
3747 unsigned FILHIT4
: 1;
3748 unsigned RXRTRRO
: 1;
3755 unsigned TXPRI0
: 1;
3756 unsigned TXPRI1
: 1;
3760 unsigned TXLARB
: 1;
3767 unsigned FILHIT
: 5;
3778 extern __at(0x0EA0) volatile __B2CONbits_t B2CONbits
;
3780 #define _B2CON_FILHIT0_TXPRI0 0x01
3781 #define _B2CON_FILHIT0 0x01
3782 #define _B2CON_TXPRI0 0x01
3783 #define _B2CON_FILHIT1_TXPRI1 0x02
3784 #define _B2CON_FILHIT1 0x02
3785 #define _B2CON_TXPRI1 0x02
3786 #define _B2CON_FILHIT2_RTREN 0x04
3787 #define _B2CON_FILHIT2 0x04
3788 #define _B2CON_RTREN 0x04
3789 #define _B2CON_FILHIT3_TXREQ 0x08
3790 #define _B2CON_FILHIT3 0x08
3791 #define _B2CON_TXREQ 0x08
3792 #define _B2CON_FILHIT4_TXERR 0x10
3793 #define _B2CON_FILHIT4 0x10
3794 #define _B2CON_TXERR 0x10
3795 #define _B2CON_RXRTRRO_TXLARB 0x20
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3799 #define _B2CON_RXM1 0x40
3800 #define _B2CON_TXABT 0x40
3801 #define _B2CON_RXFUL_TXBIF 0x80
3802 #define _B2CON_RXFUL 0x80
3803 #define _B2CON_TXBIF 0x80
3805 //==============================================================================
3808 //==============================================================================
3811 extern __at(0x0EA1) __sfr B2SIDH
;
3825 extern __at(0x0EA1) volatile __B2SIDHbits_t B2SIDHbits
;
3827 #define _B2SIDH_SID3 0x01
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3831 #define _B2SIDH_SID7 0x10
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3834 #define _B2SIDH_SID10 0x80
3836 //==============================================================================
3839 //==============================================================================
3842 extern __at(0x0EA2) __sfr B2SIDL
;
3865 extern __at(0x0EA2) volatile __B2SIDLbits_t B2SIDLbits
;
3867 #define _B2SIDL_EID16 0x01
3868 #define _B2SIDL_EID17 0x02
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3871 #define _B2SIDL_SID0 0x20
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3875 //==============================================================================
3878 //==============================================================================
3881 extern __at(0x0EA3) __sfr B2EIDH
;
3895 extern __at(0x0EA3) volatile __B2EIDHbits_t B2EIDHbits
;
3897 #define _B2EIDH_EID8 0x01
3898 #define _B2EIDH_EID9 0x02
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3900 #define _B2EIDH_EID11 0x08
3901 #define _B2EIDH_EID12 0x10
3902 #define _B2EIDH_EID13 0x20
3903 #define _B2EIDH_EID14 0x40
3904 #define _B2EIDH_EID15 0x80
3906 //==============================================================================
3909 //==============================================================================
3912 extern __at(0x0EA4) __sfr B2EIDL
;
3926 extern __at(0x0EA4) volatile __B2EIDLbits_t B2EIDLbits
;
3928 #define _B2EIDL_EID0 0x01
3929 #define _B2EIDL_EID1 0x02
3930 #define _B2EIDL_EID2 0x04
3931 #define _B2EIDL_EID3 0x08
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3933 #define _B2EIDL_EID5 0x20
3934 #define _B2EIDL_EID6 0x40
3935 #define _B2EIDL_EID7 0x80
3937 //==============================================================================
3940 //==============================================================================
3943 extern __at(0x0EA5) __sfr B2DLC
;
3955 unsigned RXRTR_TXRTR
: 1;
3997 extern __at(0x0EA5) volatile __B2DLCbits_t B2DLCbits
;
3999 #define _B2DLC_DLC0 0x01
4000 #define _B2DLC_DLC1 0x02
4001 #define _B2DLC_DLC2 0x04
4002 #define _B2DLC_DLC3 0x08
4003 #define _B2DLC_RB0 0x10
4004 #define _B2DLC_RB1 0x20
4005 #define _B2DLC_RXRTR_TXRTR 0x40
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4007 #define _B2DLC_TXRTR 0x40
4009 //==============================================================================
4012 //==============================================================================
4015 extern __at(0x0EA6) __sfr B2D0
;
4029 extern __at(0x0EA6) volatile __B2D0bits_t B2D0bits
;
4040 //==============================================================================
4043 //==============================================================================
4046 extern __at(0x0EA7) __sfr B2D1
;
4060 extern __at(0x0EA7) volatile __B2D1bits_t B2D1bits
;
4071 //==============================================================================
4074 //==============================================================================
4077 extern __at(0x0EA8) __sfr B2D2
;
4091 extern __at(0x0EA8) volatile __B2D2bits_t B2D2bits
;
4102 //==============================================================================
4105 //==============================================================================
4108 extern __at(0x0EA9) __sfr B2D3
;
4122 extern __at(0x0EA9) volatile __B2D3bits_t B2D3bits
;
4133 //==============================================================================
4136 //==============================================================================
4139 extern __at(0x0EAA) __sfr B2D4
;
4153 extern __at(0x0EAA) volatile __B2D4bits_t B2D4bits
;
4164 //==============================================================================
4167 //==============================================================================
4170 extern __at(0x0EAB) __sfr B2D5
;
4184 extern __at(0x0EAB) volatile __B2D5bits_t B2D5bits
;
4195 //==============================================================================
4198 //==============================================================================
4201 extern __at(0x0EAC) __sfr B2D6
;
4215 extern __at(0x0EAC) volatile __B2D6bits_t B2D6bits
;
4226 //==============================================================================
4229 //==============================================================================
4232 extern __at(0x0EAD) __sfr B2D7
;
4246 extern __at(0x0EAD) volatile __B2D7bits_t B2D7bits
;
4257 //==============================================================================
4260 //==============================================================================
4263 extern __at(0x0EAE) __sfr CANSTAT_RO7
;
4269 unsigned EICODE0
: 1;
4270 unsigned EICODE1_ICODE0
: 1;
4271 unsigned EICODE2_ICODE1
: 1;
4272 unsigned EICODE3_ICODE2
: 1;
4273 unsigned EICODE4
: 1;
4274 unsigned OPMODE0
: 1;
4275 unsigned OPMODE1
: 1;
4276 unsigned OPMODE2
: 1;
4282 unsigned EICODE1
: 1;
4283 unsigned EICODE2
: 1;
4284 unsigned EICODE3
: 1;
4294 unsigned ICODE0
: 1;
4295 unsigned ICODE1
: 1;
4296 unsigned ICODE2
: 1;
4305 unsigned EICODE
: 5;
4319 unsigned OPMODE
: 3;
4321 } __CANSTAT_RO7bits_t
;
4323 extern __at(0x0EAE) volatile __CANSTAT_RO7bits_t CANSTAT_RO7bits
;
4325 #define _CANSTAT_RO7_EICODE0 0x01
4326 #define _CANSTAT_RO7_EICODE1_ICODE0 0x02
4327 #define _CANSTAT_RO7_EICODE1 0x02
4328 #define _CANSTAT_RO7_ICODE0 0x02
4329 #define _CANSTAT_RO7_EICODE2_ICODE1 0x04
4330 #define _CANSTAT_RO7_EICODE2 0x04
4331 #define _CANSTAT_RO7_ICODE1 0x04
4332 #define _CANSTAT_RO7_EICODE3_ICODE2 0x08
4333 #define _CANSTAT_RO7_EICODE3 0x08
4334 #define _CANSTAT_RO7_ICODE2 0x08
4335 #define _CANSTAT_RO7_EICODE4 0x10
4336 #define _CANSTAT_RO7_OPMODE0 0x20
4337 #define _CANSTAT_RO7_OPMODE1 0x40
4338 #define _CANSTAT_RO7_OPMODE2 0x80
4340 //==============================================================================
4343 //==============================================================================
4346 extern __at(0x0EAF) __sfr CANCON_RO7
;
4353 unsigned WIN0_FP1
: 1;
4354 unsigned WIN1_FP2
: 1;
4355 unsigned WIN2_FP3
: 1;
4398 } __CANCON_RO7bits_t
;
4400 extern __at(0x0EAF) volatile __CANCON_RO7bits_t CANCON_RO7bits
;
4402 #define _CANCON_RO7_FP0 0x01
4403 #define _CANCON_RO7_WIN0_FP1 0x02
4404 #define _CANCON_RO7_WIN0 0x02
4405 #define _CANCON_RO7_FP1 0x02
4406 #define _CANCON_RO7_WIN1_FP2 0x04
4407 #define _CANCON_RO7_WIN1 0x04
4408 #define _CANCON_RO7_FP2 0x04
4409 #define _CANCON_RO7_WIN2_FP3 0x08
4410 #define _CANCON_RO7_WIN2 0x08
4411 #define _CANCON_RO7_FP3 0x08
4412 #define _CANCON_RO7_ABAT 0x10
4414 //==============================================================================
4417 //==============================================================================
4420 extern __at(0x0EB0) __sfr B3CON
;
4426 unsigned FILHIT0_TXPRI0
: 1;
4427 unsigned FILHIT1_TXPRI1
: 1;
4428 unsigned FILHIT2_RTREN
: 1;
4429 unsigned FILHIT3_TXREQ
: 1;
4430 unsigned FILHIT4_TXERR
: 1;
4431 unsigned RXRTRRO_TXLARB
: 1;
4432 unsigned RXM1_TXABT
: 1;
4433 unsigned RXFUL_TXBIF
: 1;
4438 unsigned FILHIT0
: 1;
4439 unsigned FILHIT1
: 1;
4440 unsigned FILHIT2
: 1;
4441 unsigned FILHIT3
: 1;
4442 unsigned FILHIT4
: 1;
4443 unsigned RXRTRRO
: 1;
4450 unsigned TXPRI0
: 1;
4451 unsigned TXPRI1
: 1;
4455 unsigned TXLARB
: 1;
4462 unsigned FILHIT
: 5;
4473 extern __at(0x0EB0) volatile __B3CONbits_t B3CONbits
;
4475 #define _B3CON_FILHIT0_TXPRI0 0x01
4476 #define _B3CON_FILHIT0 0x01
4477 #define _B3CON_TXPRI0 0x01
4478 #define _B3CON_FILHIT1_TXPRI1 0x02
4479 #define _B3CON_FILHIT1 0x02
4480 #define _B3CON_TXPRI1 0x02
4481 #define _B3CON_FILHIT2_RTREN 0x04
4482 #define _B3CON_FILHIT2 0x04
4483 #define _B3CON_RTREN 0x04
4484 #define _B3CON_FILHIT3_TXREQ 0x08
4485 #define _B3CON_FILHIT3 0x08
4486 #define _B3CON_TXREQ 0x08
4487 #define _B3CON_FILHIT4_TXERR 0x10
4488 #define _B3CON_FILHIT4 0x10
4489 #define _B3CON_TXERR 0x10
4490 #define _B3CON_RXRTRRO_TXLARB 0x20
4491 #define _B3CON_RXRTRRO 0x20
4492 #define _B3CON_TXLARB 0x20
4493 #define _B3CON_RXM1_TXABT 0x40
4494 #define _B3CON_RXM1 0x40
4495 #define _B3CON_TXABT 0x40
4496 #define _B3CON_RXFUL_TXBIF 0x80
4497 #define _B3CON_RXFUL 0x80
4498 #define _B3CON_TXBIF 0x80
4500 //==============================================================================
4503 //==============================================================================
4506 extern __at(0x0EB1) __sfr B3SIDH
;
4520 extern __at(0x0EB1) volatile __B3SIDHbits_t B3SIDHbits
;
4522 #define _B3SIDH_SID3 0x01
4523 #define _B3SIDH_SID4 0x02
4524 #define _B3SIDH_SID5 0x04
4525 #define _B3SIDH_SID6 0x08
4526 #define _B3SIDH_SID7 0x10
4527 #define _B3SIDH_SID8 0x20
4528 #define _B3SIDH_SID9 0x40
4529 #define _B3SIDH_SID10 0x80
4531 //==============================================================================
4534 //==============================================================================
4537 extern __at(0x0EB2) __sfr B3SIDL
;
4560 extern __at(0x0EB2) volatile __B3SIDLbits_t B3SIDLbits
;
4562 #define _B3SIDL_EID16 0x01
4563 #define _B3SIDL_EID17 0x02
4564 #define _B3SIDL_EXIDE 0x08
4565 #define _B3SIDL_SRR 0x10
4566 #define _B3SIDL_SID0 0x20
4567 #define _B3SIDL_SID1 0x40
4568 #define _B3SIDL_SID2 0x80
4570 //==============================================================================
4573 //==============================================================================
4576 extern __at(0x0EB3) __sfr B3EIDH
;
4590 extern __at(0x0EB3) volatile __B3EIDHbits_t B3EIDHbits
;
4592 #define _B3EIDH_EID8 0x01
4593 #define _B3EIDH_EID9 0x02
4594 #define _B3EIDH_EID10 0x04
4595 #define _B3EIDH_EID11 0x08
4596 #define _B3EIDH_EID12 0x10
4597 #define _B3EIDH_EID13 0x20
4598 #define _B3EIDH_EID14 0x40
4599 #define _B3EIDH_EID15 0x80
4601 //==============================================================================
4604 //==============================================================================
4607 extern __at(0x0EB4) __sfr B3EIDL
;
4621 extern __at(0x0EB4) volatile __B3EIDLbits_t B3EIDLbits
;
4623 #define _B3EIDL_EID0 0x01
4624 #define _B3EIDL_EID1 0x02
4625 #define _B3EIDL_EID2 0x04
4626 #define _B3EIDL_EID3 0x08
4627 #define _B3EIDL_EID4 0x10
4628 #define _B3EIDL_EID5 0x20
4629 #define _B3EIDL_EID6 0x40
4630 #define _B3EIDL_EID7 0x80
4632 //==============================================================================
4635 //==============================================================================
4638 extern __at(0x0EB5) __sfr B3DLC
;
4650 unsigned RXRTR_TXRTR
: 1;
4692 extern __at(0x0EB5) volatile __B3DLCbits_t B3DLCbits
;
4694 #define _B3DLC_DLC0 0x01
4695 #define _B3DLC_DLC1 0x02
4696 #define _B3DLC_DLC2 0x04
4697 #define _B3DLC_DLC3 0x08
4698 #define _B3DLC_RB0 0x10
4699 #define _B3DLC_RB1 0x20
4700 #define _B3DLC_RXRTR_TXRTR 0x40
4701 #define _B3DLC_RXRTR 0x40
4702 #define _B3DLC_TXRTR 0x40
4704 //==============================================================================
4707 //==============================================================================
4710 extern __at(0x0EB6) __sfr B3D0
;
4724 extern __at(0x0EB6) volatile __B3D0bits_t B3D0bits
;
4735 //==============================================================================
4738 //==============================================================================
4741 extern __at(0x0EB7) __sfr B3D1
;
4755 extern __at(0x0EB7) volatile __B3D1bits_t B3D1bits
;
4766 //==============================================================================
4769 //==============================================================================
4772 extern __at(0x0EB8) __sfr B3D2
;
4786 extern __at(0x0EB8) volatile __B3D2bits_t B3D2bits
;
4797 //==============================================================================
4800 //==============================================================================
4803 extern __at(0x0EB9) __sfr B3D3
;
4817 extern __at(0x0EB9) volatile __B3D3bits_t B3D3bits
;
4828 //==============================================================================
4831 //==============================================================================
4834 extern __at(0x0EBA) __sfr B3D4
;
4848 extern __at(0x0EBA) volatile __B3D4bits_t B3D4bits
;
4859 //==============================================================================
4862 //==============================================================================
4865 extern __at(0x0EBB) __sfr B3D5
;
4879 extern __at(0x0EBB) volatile __B3D5bits_t B3D5bits
;
4890 //==============================================================================
4893 //==============================================================================
4896 extern __at(0x0EBC) __sfr B3D6
;
4910 extern __at(0x0EBC) volatile __B3D6bits_t B3D6bits
;
4921 //==============================================================================
4924 //==============================================================================
4927 extern __at(0x0EBD) __sfr B3D7
;
4941 extern __at(0x0EBD) volatile __B3D7bits_t B3D7bits
;
4952 //==============================================================================
4955 //==============================================================================
4958 extern __at(0x0EBE) __sfr CANSTAT_RO6
;
4964 unsigned EICODE0
: 1;
4965 unsigned EICODE1_ICODE0
: 1;
4966 unsigned EICODE2_ICODE1
: 1;
4967 unsigned EICODE3_ICODE2
: 1;
4968 unsigned EICODE4
: 1;
4969 unsigned OPMODE0
: 1;
4970 unsigned OPMODE1
: 1;
4971 unsigned OPMODE2
: 1;
4977 unsigned EICODE1
: 1;
4978 unsigned EICODE2
: 1;
4979 unsigned EICODE3
: 1;
4989 unsigned ICODE0
: 1;
4990 unsigned ICODE1
: 1;
4991 unsigned ICODE2
: 1;
5000 unsigned EICODE
: 5;
5014 unsigned OPMODE
: 3;
5016 } __CANSTAT_RO6bits_t
;
5018 extern __at(0x0EBE) volatile __CANSTAT_RO6bits_t CANSTAT_RO6bits
;
5020 #define _CANSTAT_RO6_EICODE0 0x01
5021 #define _CANSTAT_RO6_EICODE1_ICODE0 0x02
5022 #define _CANSTAT_RO6_EICODE1 0x02
5023 #define _CANSTAT_RO6_ICODE0 0x02
5024 #define _CANSTAT_RO6_EICODE2_ICODE1 0x04
5025 #define _CANSTAT_RO6_EICODE2 0x04
5026 #define _CANSTAT_RO6_ICODE1 0x04
5027 #define _CANSTAT_RO6_EICODE3_ICODE2 0x08
5028 #define _CANSTAT_RO6_EICODE3 0x08
5029 #define _CANSTAT_RO6_ICODE2 0x08
5030 #define _CANSTAT_RO6_EICODE4 0x10
5031 #define _CANSTAT_RO6_OPMODE0 0x20
5032 #define _CANSTAT_RO6_OPMODE1 0x40
5033 #define _CANSTAT_RO6_OPMODE2 0x80
5035 //==============================================================================
5038 //==============================================================================
5041 extern __at(0x0EBF) __sfr CANCON_RO6
;
5048 unsigned WIN0_FP1
: 1;
5049 unsigned WIN1_FP2
: 1;
5050 unsigned WIN2_FP3
: 1;
5093 } __CANCON_RO6bits_t
;
5095 extern __at(0x0EBF) volatile __CANCON_RO6bits_t CANCON_RO6bits
;
5097 #define _CANCON_RO6_FP0 0x01
5098 #define _CANCON_RO6_WIN0_FP1 0x02
5099 #define _CANCON_RO6_WIN0 0x02
5100 #define _CANCON_RO6_FP1 0x02
5101 #define _CANCON_RO6_WIN1_FP2 0x04
5102 #define _CANCON_RO6_WIN1 0x04
5103 #define _CANCON_RO6_FP2 0x04
5104 #define _CANCON_RO6_WIN2_FP3 0x08
5105 #define _CANCON_RO6_WIN2 0x08
5106 #define _CANCON_RO6_FP3 0x08
5107 #define _CANCON_RO6_ABAT 0x10
5109 //==============================================================================
5112 //==============================================================================
5115 extern __at(0x0EC0) __sfr B4CON
;
5121 unsigned FILHIT0_TXPRI0
: 1;
5122 unsigned FILHIT1_TXPRI1
: 1;
5123 unsigned FILHIT2_RTREN
: 1;
5124 unsigned FILHIT3_TXREQ
: 1;
5125 unsigned FILHIT4_TXERR
: 1;
5126 unsigned RXRTRRO_TXLARB
: 1;
5127 unsigned RXM1_TXABT
: 1;
5128 unsigned RXFUL_TXBIF
: 1;
5133 unsigned FILHIT0
: 1;
5134 unsigned FILHIT1
: 1;
5135 unsigned FILHIT2
: 1;
5136 unsigned FILHIT3
: 1;
5137 unsigned FILHIT4
: 1;
5138 unsigned RXRTRRO
: 1;
5145 unsigned TXPRI0
: 1;
5146 unsigned TXPRI1
: 1;
5150 unsigned TXLARB
: 1;
5163 unsigned FILHIT
: 5;
5168 extern __at(0x0EC0) volatile __B4CONbits_t B4CONbits
;
5170 #define _B4CON_FILHIT0_TXPRI0 0x01
5171 #define _B4CON_FILHIT0 0x01
5172 #define _B4CON_TXPRI0 0x01
5173 #define _B4CON_FILHIT1_TXPRI1 0x02
5174 #define _B4CON_FILHIT1 0x02
5175 #define _B4CON_TXPRI1 0x02
5176 #define _B4CON_FILHIT2_RTREN 0x04
5177 #define _B4CON_FILHIT2 0x04
5178 #define _B4CON_RTREN 0x04
5179 #define _B4CON_FILHIT3_TXREQ 0x08
5180 #define _B4CON_FILHIT3 0x08
5181 #define _B4CON_TXREQ 0x08
5182 #define _B4CON_FILHIT4_TXERR 0x10
5183 #define _B4CON_FILHIT4 0x10
5184 #define _B4CON_TXERR 0x10
5185 #define _B4CON_RXRTRRO_TXLARB 0x20
5186 #define _B4CON_RXRTRRO 0x20
5187 #define _B4CON_TXLARB 0x20
5188 #define _B4CON_RXM1_TXABT 0x40
5189 #define _B4CON_RXM1 0x40
5190 #define _B4CON_TXABT 0x40
5191 #define _B4CON_RXFUL_TXBIF 0x80
5192 #define _B4CON_RXFUL 0x80
5193 #define _B4CON_TXBIF 0x80
5195 //==============================================================================
5198 //==============================================================================
5201 extern __at(0x0EC1) __sfr B4SIDH
;
5215 extern __at(0x0EC1) volatile __B4SIDHbits_t B4SIDHbits
;
5217 #define _B4SIDH_SID3 0x01
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5221 #define _B4SIDH_SID7 0x10
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5223 #define _B4SIDH_SID9 0x40
5224 #define _B4SIDH_SID10 0x80
5226 //==============================================================================
5229 //==============================================================================
5232 extern __at(0x0EC2) __sfr B4SIDL
;
5255 extern __at(0x0EC2) volatile __B4SIDLbits_t B4SIDLbits
;
5257 #define _B4SIDL_EID16 0x01
5258 #define _B4SIDL_EID17 0x02
5259 #define _B4SIDL_EXIDE 0x08
5260 #define _B4SIDL_SRR 0x10
5261 #define _B4SIDL_SID0 0x20
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5263 #define _B4SIDL_SID2 0x80
5265 //==============================================================================
5268 //==============================================================================
5271 extern __at(0x0EC3) __sfr B4EIDH
;
5285 extern __at(0x0EC3) volatile __B4EIDHbits_t B4EIDHbits
;
5287 #define _B4EIDH_EID8 0x01
5288 #define _B4EIDH_EID9 0x02
5289 #define _B4EIDH_EID10 0x04
5290 #define _B4EIDH_EID11 0x08
5291 #define _B4EIDH_EID12 0x10
5292 #define _B4EIDH_EID13 0x20
5293 #define _B4EIDH_EID14 0x40
5294 #define _B4EIDH_EID15 0x80
5296 //==============================================================================
5299 //==============================================================================
5302 extern __at(0x0EC4) __sfr B4EIDL
;
5316 extern __at(0x0EC4) volatile __B4EIDLbits_t B4EIDLbits
;
5318 #define _B4EIDL_EID0 0x01
5319 #define _B4EIDL_EID1 0x02
5320 #define _B4EIDL_EID2 0x04
5321 #define _B4EIDL_EID3 0x08
5322 #define _B4EIDL_EID4 0x10
5323 #define _B4EIDL_EID5 0x20
5324 #define _B4EIDL_EID6 0x40
5325 #define _B4EIDL_EID7 0x80
5327 //==============================================================================
5330 //==============================================================================
5333 extern __at(0x0EC5) __sfr B4DLC
;
5345 unsigned RXRTR_TXRTR
: 1;
5387 extern __at(0x0EC5) volatile __B4DLCbits_t B4DLCbits
;
5389 #define _B4DLC_DLC0 0x01
5390 #define _B4DLC_DLC1 0x02
5391 #define _B4DLC_DLC2 0x04
5392 #define _B4DLC_DLC3 0x08
5393 #define _B4DLC_RB0 0x10
5394 #define _B4DLC_RB1 0x20
5395 #define _B4DLC_RXRTR_TXRTR 0x40
5396 #define _B4DLC_RXRTR 0x40
5397 #define _B4DLC_TXRTR 0x40
5399 //==============================================================================
5402 //==============================================================================
5405 extern __at(0x0EC6) __sfr B4D0
;
5419 extern __at(0x0EC6) volatile __B4D0bits_t B4D0bits
;
5430 //==============================================================================
5433 //==============================================================================
5436 extern __at(0x0EC7) __sfr B4D1
;
5450 extern __at(0x0EC7) volatile __B4D1bits_t B4D1bits
;
5461 //==============================================================================
5464 //==============================================================================
5467 extern __at(0x0EC8) __sfr B4D2
;
5481 extern __at(0x0EC8) volatile __B4D2bits_t B4D2bits
;
5492 //==============================================================================
5495 //==============================================================================
5498 extern __at(0x0EC9) __sfr B4D3
;
5512 extern __at(0x0EC9) volatile __B4D3bits_t B4D3bits
;
5523 //==============================================================================
5526 //==============================================================================
5529 extern __at(0x0ECA) __sfr B4D4
;
5543 extern __at(0x0ECA) volatile __B4D4bits_t B4D4bits
;
5554 //==============================================================================
5557 //==============================================================================
5560 extern __at(0x0ECB) __sfr B4D5
;
5574 extern __at(0x0ECB) volatile __B4D5bits_t B4D5bits
;
5585 //==============================================================================
5588 //==============================================================================
5591 extern __at(0x0ECC) __sfr B4D6
;
5605 extern __at(0x0ECC) volatile __B4D6bits_t B4D6bits
;
5616 //==============================================================================
5619 //==============================================================================
5622 extern __at(0x0ECD) __sfr B4D7
;
5636 extern __at(0x0ECD) volatile __B4D7bits_t B4D7bits
;
5647 //==============================================================================
5650 //==============================================================================
5653 extern __at(0x0ECE) __sfr CANSTAT_RO5
;
5659 unsigned EICODE0
: 1;
5660 unsigned EICODE1_ICODE0
: 1;
5661 unsigned EICODE2_ICODE1
: 1;
5662 unsigned EICODE3_ICODE2
: 1;
5663 unsigned EICODE4
: 1;
5664 unsigned OPMODE0
: 1;
5665 unsigned OPMODE1
: 1;
5666 unsigned OPMODE2
: 1;
5672 unsigned EICODE1
: 1;
5673 unsigned EICODE2
: 1;
5674 unsigned EICODE3
: 1;
5684 unsigned ICODE0
: 1;
5685 unsigned ICODE1
: 1;
5686 unsigned ICODE2
: 1;
5695 unsigned EICODE
: 5;
5709 unsigned OPMODE
: 3;
5711 } __CANSTAT_RO5bits_t
;
5713 extern __at(0x0ECE) volatile __CANSTAT_RO5bits_t CANSTAT_RO5bits
;
5715 #define _CANSTAT_RO5_EICODE0 0x01
5716 #define _CANSTAT_RO5_EICODE1_ICODE0 0x02
5717 #define _CANSTAT_RO5_EICODE1 0x02
5718 #define _CANSTAT_RO5_ICODE0 0x02
5719 #define _CANSTAT_RO5_EICODE2_ICODE1 0x04
5720 #define _CANSTAT_RO5_EICODE2 0x04
5721 #define _CANSTAT_RO5_ICODE1 0x04
5722 #define _CANSTAT_RO5_EICODE3_ICODE2 0x08
5723 #define _CANSTAT_RO5_EICODE3 0x08
5724 #define _CANSTAT_RO5_ICODE2 0x08
5725 #define _CANSTAT_RO5_EICODE4 0x10
5726 #define _CANSTAT_RO5_OPMODE0 0x20
5727 #define _CANSTAT_RO5_OPMODE1 0x40
5728 #define _CANSTAT_RO5_OPMODE2 0x80
5730 //==============================================================================
5733 //==============================================================================
5736 extern __at(0x0ECF) __sfr CANCON_RO5
;
5743 unsigned WIN0_FP1
: 1;
5744 unsigned WIN1_FP2
: 1;
5745 unsigned WIN2_FP3
: 1;
5788 } __CANCON_RO5bits_t
;
5790 extern __at(0x0ECF) volatile __CANCON_RO5bits_t CANCON_RO5bits
;
5792 #define _CANCON_RO5_FP0 0x01
5793 #define _CANCON_RO5_WIN0_FP1 0x02
5794 #define _CANCON_RO5_WIN0 0x02
5795 #define _CANCON_RO5_FP1 0x02
5796 #define _CANCON_RO5_WIN1_FP2 0x04
5797 #define _CANCON_RO5_WIN1 0x04
5798 #define _CANCON_RO5_FP2 0x04
5799 #define _CANCON_RO5_WIN2_FP3 0x08
5800 #define _CANCON_RO5_WIN2 0x08
5801 #define _CANCON_RO5_FP3 0x08
5802 #define _CANCON_RO5_ABAT 0x10
5804 //==============================================================================
5807 //==============================================================================
5810 extern __at(0x0ED0) __sfr B5CON
;
5816 unsigned FILHIT0_TXPRI0
: 1;
5817 unsigned FILHIT1_TXPRI1
: 1;
5818 unsigned FILHIT2_RTREN
: 1;
5819 unsigned FILHIT3_TXREQ
: 1;
5820 unsigned FILHIT4_TXERR
: 1;
5821 unsigned RXRTRRO_TXLARB
: 1;
5822 unsigned RXM1_TXABT
: 1;
5823 unsigned RXFUL_TXBIF
: 1;
5828 unsigned FILHIT0
: 1;
5829 unsigned FILHIT1
: 1;
5830 unsigned FILHIT2
: 1;
5831 unsigned FILHIT3
: 1;
5832 unsigned FILHIT4
: 1;
5833 unsigned RXRTRRO
: 1;
5840 unsigned TXPRI0
: 1;
5841 unsigned TXPRI1
: 1;
5845 unsigned TXLARB
: 1;
5852 unsigned FILHIT
: 5;
5863 extern __at(0x0ED0) volatile __B5CONbits_t B5CONbits
;
5865 #define _B5CON_FILHIT0_TXPRI0 0x01
5866 #define _B5CON_FILHIT0 0x01
5867 #define _B5CON_TXPRI0 0x01
5868 #define _B5CON_FILHIT1_TXPRI1 0x02
5869 #define _B5CON_FILHIT1 0x02
5870 #define _B5CON_TXPRI1 0x02
5871 #define _B5CON_FILHIT2_RTREN 0x04
5872 #define _B5CON_FILHIT2 0x04
5873 #define _B5CON_RTREN 0x04
5874 #define _B5CON_FILHIT3_TXREQ 0x08
5875 #define _B5CON_FILHIT3 0x08
5876 #define _B5CON_TXREQ 0x08
5877 #define _B5CON_FILHIT4_TXERR 0x10
5878 #define _B5CON_FILHIT4 0x10
5879 #define _B5CON_TXERR 0x10
5880 #define _B5CON_RXRTRRO_TXLARB 0x20
5881 #define _B5CON_RXRTRRO 0x20
5882 #define _B5CON_TXLARB 0x20
5883 #define _B5CON_RXM1_TXABT 0x40
5884 #define _B5CON_RXM1 0x40
5885 #define _B5CON_TXABT 0x40
5886 #define _B5CON_RXFUL_TXBIF 0x80
5887 #define _B5CON_RXFUL 0x80
5888 #define _B5CON_TXBIF 0x80
5890 //==============================================================================
5893 //==============================================================================
5896 extern __at(0x0ED1) __sfr B5SIDH
;
5910 extern __at(0x0ED1) volatile __B5SIDHbits_t B5SIDHbits
;
5912 #define _B5SIDH_SID3 0x01
5913 #define _B5SIDH_SID4 0x02
5914 #define _B5SIDH_SID5 0x04
5915 #define _B5SIDH_SID6 0x08
5916 #define _B5SIDH_SID7 0x10
5917 #define _B5SIDH_SID8 0x20
5918 #define _B5SIDH_SID9 0x40
5919 #define _B5SIDH_SID10 0x80
5921 //==============================================================================
5924 //==============================================================================
5927 extern __at(0x0ED2) __sfr B5SIDL
;
5950 extern __at(0x0ED2) volatile __B5SIDLbits_t B5SIDLbits
;
5952 #define _B5SIDL_EID16 0x01
5953 #define _B5SIDL_EID17 0x02
5954 #define _B5SIDL_EXIDE 0x08
5955 #define _B5SIDL_SRR 0x10
5956 #define _B5SIDL_SID0 0x20
5957 #define _B5SIDL_SID1 0x40
5958 #define _B5SIDL_SID2 0x80
5960 //==============================================================================
5963 //==============================================================================
5966 extern __at(0x0ED3) __sfr B5EIDH
;
5980 extern __at(0x0ED3) volatile __B5EIDHbits_t B5EIDHbits
;
5982 #define _B5EIDH_EID8 0x01
5983 #define _B5EIDH_EID9 0x02
5984 #define _B5EIDH_EID10 0x04
5985 #define _B5EIDH_EID11 0x08
5986 #define _B5EIDH_EID12 0x10
5987 #define _B5EIDH_EID13 0x20
5988 #define _B5EIDH_EID14 0x40
5989 #define _B5EIDH_EID15 0x80
5991 //==============================================================================
5994 //==============================================================================
5997 extern __at(0x0ED4) __sfr B5EIDL
;
6011 extern __at(0x0ED4) volatile __B5EIDLbits_t B5EIDLbits
;
6013 #define _B5EIDL_EID0 0x01
6014 #define _B5EIDL_EID1 0x02
6015 #define _B5EIDL_EID2 0x04
6016 #define _B5EIDL_EID3 0x08
6017 #define _B5EIDL_EID4 0x10
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6020 #define _B5EIDL_EID7 0x80
6022 //==============================================================================
6025 //==============================================================================
6028 extern __at(0x0ED5) __sfr B5DLC
;
6040 unsigned RXRTR_TXRTR
: 1;
6082 extern __at(0x0ED5) volatile __B5DLCbits_t B5DLCbits
;
6084 #define _B5DLC_DLC0 0x01
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6097 //==============================================================================
6100 extern __at(0x0ED6) __sfr B5D0
;
6114 extern __at(0x0ED6) volatile __B5D0bits_t B5D0bits
;
6125 //==============================================================================
6128 //==============================================================================
6131 extern __at(0x0ED7) __sfr B5D1
;
6145 extern __at(0x0ED7) volatile __B5D1bits_t B5D1bits
;
6156 //==============================================================================
6159 //==============================================================================
6162 extern __at(0x0ED8) __sfr B5D2
;
6176 extern __at(0x0ED8) volatile __B5D2bits_t B5D2bits
;
6187 //==============================================================================
6190 //==============================================================================
6193 extern __at(0x0ED9) __sfr B5D3
;
6207 extern __at(0x0ED9) volatile __B5D3bits_t B5D3bits
;
6218 //==============================================================================
6221 //==============================================================================
6224 extern __at(0x0EDA) __sfr B5D4
;
6238 extern __at(0x0EDA) volatile __B5D4bits_t B5D4bits
;
6249 //==============================================================================
6252 //==============================================================================
6255 extern __at(0x0EDB) __sfr B5D5
;
6269 extern __at(0x0EDB) volatile __B5D5bits_t B5D5bits
;
6280 //==============================================================================
6283 //==============================================================================
6286 extern __at(0x0EDC) __sfr B5D6
;
6300 extern __at(0x0EDC) volatile __B5D6bits_t B5D6bits
;
6311 //==============================================================================
6314 //==============================================================================
6317 extern __at(0x0EDD) __sfr B5D7
;
6331 extern __at(0x0EDD) volatile __B5D7bits_t B5D7bits
;
6342 //==============================================================================
6345 //==============================================================================
6348 extern __at(0x0EDE) __sfr CANSTAT_RO4
;
6354 unsigned EICODE0
: 1;
6355 unsigned EICODE1_ICODE0
: 1;
6356 unsigned EICODE2_ICODE1
: 1;
6357 unsigned EICODE3_ICODE2
: 1;
6358 unsigned EICODE4
: 1;
6359 unsigned OPMODE0
: 1;
6360 unsigned OPMODE1
: 1;
6361 unsigned OPMODE2
: 1;
6367 unsigned EICODE1
: 1;
6368 unsigned EICODE2
: 1;
6369 unsigned EICODE3
: 1;
6379 unsigned ICODE0
: 1;
6380 unsigned ICODE1
: 1;
6381 unsigned ICODE2
: 1;
6390 unsigned EICODE
: 5;
6404 unsigned OPMODE
: 3;
6406 } __CANSTAT_RO4bits_t
;
6408 extern __at(0x0EDE) volatile __CANSTAT_RO4bits_t CANSTAT_RO4bits
;
6410 #define _CANSTAT_RO4_EICODE0 0x01
6411 #define _CANSTAT_RO4_EICODE1_ICODE0 0x02
6412 #define _CANSTAT_RO4_EICODE1 0x02
6413 #define _CANSTAT_RO4_ICODE0 0x02
6414 #define _CANSTAT_RO4_EICODE2_ICODE1 0x04
6415 #define _CANSTAT_RO4_EICODE2 0x04
6416 #define _CANSTAT_RO4_ICODE1 0x04
6417 #define _CANSTAT_RO4_EICODE3_ICODE2 0x08
6418 #define _CANSTAT_RO4_EICODE3 0x08
6419 #define _CANSTAT_RO4_ICODE2 0x08
6420 #define _CANSTAT_RO4_EICODE4 0x10
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6425 //==============================================================================
6428 //==============================================================================
6431 extern __at(0x0EDF) __sfr CANCON_RO4
;
6438 unsigned WIN0_FP1
: 1;
6439 unsigned WIN1_FP2
: 1;
6440 unsigned WIN2_FP3
: 1;
6483 } __CANCON_RO4bits_t
;
6485 extern __at(0x0EDF) volatile __CANCON_RO4bits_t CANCON_RO4bits
;
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6492 #define _CANCON_RO4_WIN1 0x04
6493 #define _CANCON_RO4_FP2 0x04
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6495 #define _CANCON_RO4_WIN2 0x08
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6499 //==============================================================================
6502 //==============================================================================
6505 extern __at(0x0EE0) __sfr RXF0SIDH
;
6519 extern __at(0x0EE0) volatile __RXF0SIDHbits_t RXF0SIDHbits
;
6521 #define _RXF0SIDH_SID3 0x01
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6525 #define _RXF0SIDH_SID7 0x10
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6530 //==============================================================================
6533 //==============================================================================
6536 extern __at(0x0EE1) __sfr RXF0SIDL
;
6545 unsigned EXIDEN
: 1;
6559 extern __at(0x0EE1) volatile __RXF0SIDLbits_t RXF0SIDLbits
;
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6571 //==============================================================================
6574 extern __at(0x0EE2) __sfr RXF0EIDH
;
6588 extern __at(0x0EE2) volatile __RXF0EIDHbits_t RXF0EIDHbits
;
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6599 //==============================================================================
6602 //==============================================================================
6605 extern __at(0x0EE3) __sfr RXF0EIDL
;
6619 extern __at(0x0EE3) volatile __RXF0EIDLbits_t RXF0EIDLbits
;
6621 #define _RXF0EIDL_EID0 0x01
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6627 #define _RXF0EIDL_EID6 0x40
6628 #define _RXF0EIDL_EID7 0x80
6630 //==============================================================================
6633 //==============================================================================
6636 extern __at(0x0EE4) __sfr RXF1SIDH
;
6650 extern __at(0x0EE4) volatile __RXF1SIDHbits_t RXF1SIDHbits
;
6652 #define _RXF1SIDH_SID3 0x01
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6661 //==============================================================================
6664 //==============================================================================
6667 extern __at(0x0EE5) __sfr RXF1SIDL
;
6676 unsigned EXIDEN
: 1;
6690 extern __at(0x0EE5) volatile __RXF1SIDLbits_t RXF1SIDLbits
;
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6696 #define _RXF1SIDL_SID1 0x40
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6699 //==============================================================================
6702 //==============================================================================
6705 extern __at(0x0EE6) __sfr RXF1EIDH
;
6719 extern __at(0x0EE6) volatile __RXF1EIDHbits_t RXF1EIDHbits
;
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6730 //==============================================================================
6733 //==============================================================================
6736 extern __at(0x0EE7) __sfr RXF1EIDL
;
6750 extern __at(0x0EE7) volatile __RXF1EIDLbits_t RXF1EIDLbits
;
6752 #define _RXF1EIDL_EID0 0x01
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6761 //==============================================================================
6764 //==============================================================================
6767 extern __at(0x0EE8) __sfr RXF2SIDH
;
6781 extern __at(0x0EE8) volatile __RXF2SIDHbits_t RXF2SIDHbits
;
6783 #define _RXF2SIDH_SID3 0x01
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6792 //==============================================================================
6795 //==============================================================================
6798 extern __at(0x0EE9) __sfr RXF2SIDL
;
6807 unsigned EXIDEN
: 1;
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;
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6830 //==============================================================================
6833 //==============================================================================
6836 extern __at(0x0EEA) __sfr RXF2EIDH
;
6850 extern __at(0x0EEA) volatile __RXF2EIDHbits_t RXF2EIDHbits
;
6852 #define _RXF2EIDH_EID8 0x01
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6864 //==============================================================================
6867 extern __at(0x0EEB) __sfr RXF2EIDL
;
6881 extern __at(0x0EEB) volatile __RXF2EIDLbits_t RXF2EIDLbits
;
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6892 //==============================================================================
6895 //==============================================================================
6898 extern __at(0x0EEC) __sfr RXF3SIDH
;
6912 extern __at(0x0EEC) volatile __RXF3SIDHbits_t RXF3SIDHbits
;
6914 #define _RXF3SIDH_SID3 0x01
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6923 //==============================================================================
6926 //==============================================================================
6929 extern __at(0x0EED) __sfr RXF3SIDL
;
6938 unsigned EXIDEN
: 1;
6952 extern __at(0x0EED) volatile __RXF3SIDLbits_t RXF3SIDLbits
;
6954 #define _RXF3SIDL_EID16 0x01
6955 #define _RXF3SIDL_EID17 0x02
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6958 #define _RXF3SIDL_SID1 0x40
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6961 //==============================================================================
6964 //==============================================================================
6967 extern __at(0x0EEE) __sfr RXF3EIDH
;
6981 extern __at(0x0EEE) volatile __RXF3EIDHbits_t RXF3EIDHbits
;
6983 #define _RXF3EIDH_EID8 0x01
6984 #define _RXF3EIDH_EID9 0x02
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6987 #define _RXF3EIDH_EID12 0x10
6988 #define _RXF3EIDH_EID13 0x20
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6990 #define _RXF3EIDH_EID15 0x80
6992 //==============================================================================
6995 //==============================================================================
6998 extern __at(0x0EEF) __sfr RXF3EIDL
;
7012 extern __at(0x0EEF) volatile __RXF3EIDLbits_t RXF3EIDLbits
;
7014 #define _RXF3EIDL_EID0 0x01
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7019 #define _RXF3EIDL_EID5 0x20
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7021 #define _RXF3EIDL_EID7 0x80
7023 //==============================================================================
7026 //==============================================================================
7029 extern __at(0x0EF0) __sfr RXF4SIDH
;
7043 extern __at(0x0EF0) volatile __RXF4SIDHbits_t RXF4SIDHbits
;
7045 #define _RXF4SIDH_SID3 0x01
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7047 #define _RXF4SIDH_SID5 0x04
7048 #define _RXF4SIDH_SID6 0x08
7049 #define _RXF4SIDH_SID7 0x10
7050 #define _RXF4SIDH_SID8 0x20
7051 #define _RXF4SIDH_SID9 0x40
7052 #define _RXF4SIDH_SID10 0x80
7054 //==============================================================================
7057 //==============================================================================
7060 extern __at(0x0EF1) __sfr RXF4SIDL
;
7069 unsigned EXIDEN
: 1;
7083 extern __at(0x0EF1) volatile __RXF4SIDLbits_t RXF4SIDLbits
;
7085 #define _RXF4SIDL_EID16 0x01
7086 #define _RXF4SIDL_EID17 0x02
7087 #define _RXF4SIDL_EXIDEN 0x08
7088 #define _RXF4SIDL_SID0 0x20
7089 #define _RXF4SIDL_SID1 0x40
7090 #define _RXF4SIDL_SID2 0x80
7092 //==============================================================================
7095 //==============================================================================
7098 extern __at(0x0EF2) __sfr RXF4EIDH
;
7112 extern __at(0x0EF2) volatile __RXF4EIDHbits_t RXF4EIDHbits
;
7114 #define _RXF4EIDH_EID8 0x01
7115 #define _RXF4EIDH_EID9 0x02
7116 #define _RXF4EIDH_EID10 0x04
7117 #define _RXF4EIDH_EID11 0x08
7118 #define _RXF4EIDH_EID12 0x10
7119 #define _RXF4EIDH_EID13 0x20
7120 #define _RXF4EIDH_EID14 0x40
7121 #define _RXF4EIDH_EID15 0x80
7123 //==============================================================================
7126 //==============================================================================
7129 extern __at(0x0EF3) __sfr RXF4EIDL
;
7143 extern __at(0x0EF3) volatile __RXF4EIDLbits_t RXF4EIDLbits
;
7145 #define _RXF4EIDL_EID0 0x01
7146 #define _RXF4EIDL_EID1 0x02
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7149 #define _RXF4EIDL_EID4 0x10
7150 #define _RXF4EIDL_EID5 0x20
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7154 //==============================================================================
7157 //==============================================================================
7160 extern __at(0x0EF4) __sfr RXF5SIDH
;
7174 extern __at(0x0EF4) volatile __RXF5SIDHbits_t RXF5SIDHbits
;
7176 #define _RXF5SIDH_SID3 0x01
7177 #define _RXF5SIDH_SID4 0x02
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7179 #define _RXF5SIDH_SID6 0x08
7180 #define _RXF5SIDH_SID7 0x10
7181 #define _RXF5SIDH_SID8 0x20
7182 #define _RXF5SIDH_SID9 0x40
7183 #define _RXF5SIDH_SID10 0x80
7185 //==============================================================================
7188 //==============================================================================
7191 extern __at(0x0EF5) __sfr RXF5SIDL
;
7200 unsigned EXIDEN
: 1;
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: 1;
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7820 //==============================================================================
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;
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: 1;
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;
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7851 //==============================================================================
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: 1;
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: 1;
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;
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;
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: 1;
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: 1;
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: 1;
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;
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7913 //==============================================================================
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;
7920 unsigned TXB2D50
: 1;
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: 1;
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: 1;
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: 1;
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;
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7944 //==============================================================================
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;
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: 1;
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: 1;
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: 1;
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: 1;
7961 extern __at(0x0F0C) volatile __TXB2D6bits_t TXB2D6bits
;
7963 #define _TXB2D60 0x01
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7970 #define _TXB2D67 0x80
7972 //==============================================================================
7975 //==============================================================================
7978 extern __at(0x0F0D) __sfr TXB2D7
;
7982 unsigned TXB2D70
: 1;
7983 unsigned TXB2D71
: 1;
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: 1;
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: 1;
7989 unsigned TXB2D77
: 1;
7992 extern __at(0x0F0D) volatile __TXB2D7bits_t TXB2D7bits
;
7994 #define _TXB2D70 0x01
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8003 //==============================================================================
8006 //==============================================================================
8009 extern __at(0x0F0E) __sfr CANSTAT_RO3
;
8015 unsigned EICODE0
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8016 unsigned EICODE1_ICODE0
: 1;
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: 1;
8029 unsigned EICODE2
: 1;
8030 unsigned EICODE3
: 1;
8040 unsigned ICODE0
: 1;
8041 unsigned ICODE1
: 1;
8042 unsigned ICODE2
: 1;
8051 unsigned EICODE
: 5;
8065 unsigned OPMODE
: 3;
8067 } __CANSTAT_RO3bits_t
;
8069 extern __at(0x0F0E) volatile __CANSTAT_RO3bits_t CANSTAT_RO3bits
;
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8089 //==============================================================================
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;
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: 1;
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: 1;
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;
8146 extern __at(0x0F0F) volatile __CANCON_RO3bits_t CANCON_RO3bits
;
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;
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: 1;
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: 1;
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: 1;
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;
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8202 //==============================================================================
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;
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;
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8233 //==============================================================================
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;
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8272 //==============================================================================
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8289 extern __at(0x0F13) volatile __TXB1EIDHbits_t TXB1EIDHbits
;
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8303 //==============================================================================
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;
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;
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8334 //==============================================================================
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;
8360 extern __at(0x0F15) volatile __TXB1DLCbits_t TXB1DLCbits
;
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8371 //==============================================================================
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;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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;
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8402 //==============================================================================
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;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
8419 extern __at(0x0F17) volatile __TXB1D1bits_t TXB1D1bits
;
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8433 //==============================================================================
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;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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;
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8464 //==============================================================================
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;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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;
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8495 //==============================================================================
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;
8502 unsigned TXB1D40
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
8512 extern __at(0x0F1A) volatile __TXB1D4bits_t TXB1D4bits
;
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8526 //==============================================================================
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;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
8543 extern __at(0x0F1B) volatile __TXB1D5bits_t TXB1D5bits
;
8545 #define _TXB1D50 0x01
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8550 #define _TXB1D55 0x20
8551 #define _TXB1D56 0x40
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8554 //==============================================================================
8557 //==============================================================================
8560 extern __at(0x0F1C) __sfr TXB1D6
;
8564 unsigned TXB1D60
: 1;
8565 unsigned TXB1D61
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
8571 unsigned TXB1D67
: 1;
8574 extern __at(0x0F1C) volatile __TXB1D6bits_t TXB1D6bits
;
8576 #define _TXB1D60 0x01
8577 #define _TXB1D61 0x02
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8583 #define _TXB1D67 0x80
8585 //==============================================================================
8588 //==============================================================================
8591 extern __at(0x0F1D) __sfr TXB1D7
;
8595 unsigned TXB1D70
: 1;
8596 unsigned TXB1D71
: 1;
8597 unsigned TXB1D72
: 1;
8598 unsigned TXB1D73
: 1;
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: 1;
8600 unsigned TXB1D75
: 1;
8601 unsigned TXB1D76
: 1;
8602 unsigned TXB1D77
: 1;
8605 extern __at(0x0F1D) volatile __TXB1D7bits_t TXB1D7bits
;
8607 #define _TXB1D70 0x01
8608 #define _TXB1D71 0x02
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8611 #define _TXB1D74 0x10
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8614 #define _TXB1D77 0x80
8616 //==============================================================================
8619 //==============================================================================
8622 extern __at(0x0F1E) __sfr CANSTAT_RO2
;
8628 unsigned EICODE0
: 1;
8629 unsigned EICODE1_ICODE0
: 1;
8630 unsigned EICODE2_ICODE1
: 1;
8631 unsigned EICODE3_ICODE2
: 1;
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: 1;
8633 unsigned OPMODE0
: 1;
8634 unsigned OPMODE1
: 1;
8635 unsigned OPMODE2
: 1;
8641 unsigned EICODE1
: 1;
8642 unsigned EICODE2
: 1;
8643 unsigned EICODE3
: 1;
8653 unsigned ICODE20
: 1;
8654 unsigned ICODE21
: 1;
8655 unsigned ICODE2
: 1;
8664 unsigned EICODE
: 5;
8671 unsigned OPMODE
: 3;
8673 } __CANSTAT_RO2bits_t
;
8675 extern __at(0x0F1E) volatile __CANSTAT_RO2bits_t CANSTAT_RO2bits
;
8677 #define _CANSTAT_RO2_EICODE0 0x01
8678 #define _CANSTAT_RO2_EICODE1_ICODE0 0x02
8679 #define _CANSTAT_RO2_EICODE1 0x02
8680 #define _CANSTAT_RO2_ICODE20 0x02
8681 #define _CANSTAT_RO2_EICODE2_ICODE1 0x04
8682 #define _CANSTAT_RO2_EICODE2 0x04
8683 #define _CANSTAT_RO2_ICODE21 0x04
8684 #define _CANSTAT_RO2_EICODE3_ICODE2 0x08
8685 #define _CANSTAT_RO2_EICODE3 0x08
8686 #define _CANSTAT_RO2_ICODE2 0x08
8687 #define _CANSTAT_RO2_EICODE4 0x10
8688 #define _CANSTAT_RO2_OPMODE0 0x20
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8690 #define _CANSTAT_RO2_OPMODE2 0x80
8692 //==============================================================================
8695 //==============================================================================
8698 extern __at(0x0F1F) __sfr CANCON_RO2
;
8705 unsigned WIN0_FP1
: 1;
8706 unsigned WIN1_FP2
: 1;
8707 unsigned WIN2_FP3
: 1;
8750 } __CANCON_RO2bits_t
;
8752 extern __at(0x0F1F) volatile __CANCON_RO2bits_t CANCON_RO2bits
;
8754 #define _CANCON_RO2_FP0 0x01
8755 #define _CANCON_RO2_WIN0_FP1 0x02
8756 #define _CANCON_RO2_WIN0 0x02
8757 #define _CANCON_RO2_FP1 0x02
8758 #define _CANCON_RO2_WIN1_FP2 0x04
8759 #define _CANCON_RO2_WIN1 0x04
8760 #define _CANCON_RO2_FP2 0x04
8761 #define _CANCON_RO2_WIN2_FP3 0x08
8762 #define _CANCON_RO2_WIN2 0x08
8763 #define _CANCON_RO2_FP3 0x08
8764 #define _CANCON_RO2_ABAT 0x10
8766 //==============================================================================
8769 //==============================================================================
8772 extern __at(0x0F20) __sfr TXB0CON
;
8778 unsigned TXPRI0
: 1;
8779 unsigned TXPRI1
: 1;
8783 unsigned TXLARB
: 1;
8795 extern __at(0x0F20) volatile __TXB0CONbits_t TXB0CONbits
;
8797 #define _TXB0CON_TXPRI0 0x01
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8805 //==============================================================================
8808 //==============================================================================
8811 extern __at(0x0F21) __sfr TXB0SIDH
;
8825 extern __at(0x0F21) volatile __TXB0SIDHbits_t TXB0SIDHbits
;
8827 #define _TXB0SIDH_SID3 0x01
8828 #define _TXB0SIDH_SID4 0x02
8829 #define _TXB0SIDH_SID5 0x04
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8834 #define _TXB0SIDH_SID10 0x80
8836 //==============================================================================
8839 //==============================================================================
8842 extern __at(0x0F22) __sfr TXB0SIDL
;
8865 extern __at(0x0F22) volatile __TXB0SIDLbits_t TXB0SIDLbits
;
8867 #define _TXB0SIDL_EID16 0x01
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8875 //==============================================================================
8878 //==============================================================================
8881 extern __at(0x0F23) __sfr TXB0EIDH
;
8895 extern __at(0x0F23) volatile __TXB0EIDHbits_t TXB0EIDHbits
;
8897 #define _TXB0EIDH_EID8 0x01
8898 #define _TXB0EIDH_EID9 0x02
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8909 //==============================================================================
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;
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;
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: 1;
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;
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: 1;
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;
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: 1;
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;
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9070 //==============================================================================
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: 1;
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;
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9101 //==============================================================================
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;
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: 1;
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: 1;
9118 extern __at(0x0F2A) volatile __TXB0D4bits_t TXB0D4bits
;
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9132 //==============================================================================
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;
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: 1;
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: 1;
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: 1;
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: 1;
9149 extern __at(0x0F2B) volatile __TXB0D5bits_t TXB0D5bits
;
9151 #define _TXB0D50 0x01
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9160 //==============================================================================
9163 //==============================================================================
9166 extern __at(0x0F2C) __sfr TXB0D6
;
9170 unsigned TXB0D60
: 1;
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: 1;
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: 1;
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: 1;
9180 extern __at(0x0F2C) volatile __TXB0D6bits_t TXB0D6bits
;
9182 #define _TXB0D60 0x01
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9191 //==============================================================================
9194 //==============================================================================
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;
9201 unsigned TXB0D70
: 1;
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: 1;
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;
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9222 //==============================================================================
9225 //==============================================================================
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;
9234 unsigned EICODE0
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
9259 unsigned ICODE0
: 1;
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: 1;
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: 1;
9270 unsigned EICODE
: 5;
9284 unsigned OPMODE
: 3;
9286 } __CANSTAT_RO1bits_t
;
9288 extern __at(0x0F2E) volatile __CANSTAT_RO1bits_t CANSTAT_RO1bits
;
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9297 #define _CANSTAT_RO1_EICODE3_ICODE2 0x08
9298 #define _CANSTAT_RO1_EICODE3 0x08
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9300 #define _CANSTAT_RO1_EICODE4 0x10
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9305 //==============================================================================
9308 //==============================================================================
9311 extern __at(0x0F2F) __sfr CANCON_RO1
;
9318 unsigned WIN0_FP1
: 1;
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: 1;
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: 1;
9363 } __CANCON_RO1bits_t
;
9365 extern __at(0x0F2F) volatile __CANCON_RO1bits_t CANCON_RO1bits
;
9367 #define _CANCON_RO1_FP0 0x01
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9372 #define _CANCON_RO1_WIN1 0x04
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9379 //==============================================================================
9382 //==============================================================================
9385 extern __at(0x0F30) __sfr RXB1CON
;
9391 unsigned FILHIT0
: 1;
9392 unsigned FILHIT1
: 1;
9393 unsigned FILHIT2
: 1;
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: 1;
9395 unsigned FILHIT4
: 1;
9396 unsigned RXM0_RTRRO
: 1;
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: 1;
9418 unsigned FILHIT3
: 1;
9427 unsigned FILHIT
: 5;
9439 extern __at(0x0F30) volatile __RXB1CONbits_t RXB1CONbits
;
9441 #define _RXB1CON_FILHIT0 0x01
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9454 //==============================================================================
9457 //==============================================================================
9460 extern __at(0x0F31) __sfr RXB1SIDH
;
9474 extern __at(0x0F31) volatile __RXB1SIDHbits_t RXB1SIDHbits
;
9476 #define _RXB1SIDH_SID3 0x01
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9488 //==============================================================================
9491 extern __at(0x0F32) __sfr RXB1SIDL
;
9514 extern __at(0x0F32) volatile __RXB1SIDLbits_t RXB1SIDLbits
;
9516 #define _RXB1SIDL_EDI16 0x01
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9527 //==============================================================================
9530 extern __at(0x0F33) __sfr RXB1EIDH
;
9544 extern __at(0x0F33) volatile __RXB1EIDHbits_t RXB1EIDHbits
;
9546 #define _RXB1EIDH_EID8 0x01
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9555 //==============================================================================
9558 //==============================================================================
9561 extern __at(0x0F34) __sfr RXB1EIDL
;
9575 extern __at(0x0F34) volatile __RXB1EIDLbits_t RXB1EIDLbits
;
9577 #define _RXB1EIDL_EID0 0x01
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9586 //==============================================================================
9589 //==============================================================================
9592 extern __at(0x0F35) __sfr RXB1DLC
;
9622 extern __at(0x0F35) volatile __RXB1DLCbits_t RXB1DLCbits
;
9624 #define _RXB1DLC_DLC0 0x01
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9630 #define _RXB1DLC_RXRTR 0x40
9632 //==============================================================================
9635 //==============================================================================
9638 extern __at(0x0F36) __sfr RXB1D0
;
9642 unsigned RXB1D00
: 1;
9643 unsigned RXB1D01
: 1;
9644 unsigned RXB1D02
: 1;
9645 unsigned RXB1D03
: 1;
9646 unsigned RXB1D04
: 1;
9647 unsigned RXB1D05
: 1;
9648 unsigned RXB1D06
: 1;
9649 unsigned RXB1D07
: 1;
9652 extern __at(0x0F36) volatile __RXB1D0bits_t RXB1D0bits
;
9654 #define _RXB1D00 0x01
9655 #define _RXB1D01 0x02
9656 #define _RXB1D02 0x04
9657 #define _RXB1D03 0x08
9658 #define _RXB1D04 0x10
9659 #define _RXB1D05 0x20
9660 #define _RXB1D06 0x40
9661 #define _RXB1D07 0x80
9663 //==============================================================================
9666 //==============================================================================
9669 extern __at(0x0F37) __sfr RXB1D1
;
9673 unsigned RXB1D10
: 1;
9674 unsigned RXB1D11
: 1;
9675 unsigned RXB1D12
: 1;
9676 unsigned RXB1D13
: 1;
9677 unsigned RXB1D14
: 1;
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: 1;
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: 1;
9680 unsigned RXB1D17
: 1;
9683 extern __at(0x0F37) volatile __RXB1D1bits_t RXB1D1bits
;
9685 #define _RXB1D10 0x01
9686 #define _RXB1D11 0x02
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9689 #define _RXB1D14 0x10
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9692 #define _RXB1D17 0x80
9694 //==============================================================================
9697 //==============================================================================
9700 extern __at(0x0F38) __sfr RXB1D2
;
9704 unsigned RXB1D20
: 1;
9705 unsigned RXB1D21
: 1;
9706 unsigned RXB1D22
: 1;
9707 unsigned RXB1D23
: 1;
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: 1;
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: 1;
9711 unsigned RXB1D27
: 1;
9714 extern __at(0x0F38) volatile __RXB1D2bits_t RXB1D2bits
;
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9725 //==============================================================================
9728 //==============================================================================
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;
9735 unsigned RXB1D30
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
9740 unsigned RXB1D35
: 1;
9741 unsigned RXB1D36
: 1;
9742 unsigned RXB1D37
: 1;
9745 extern __at(0x0F39) volatile __RXB1D3bits_t RXB1D3bits
;
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9759 //==============================================================================
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;
9766 unsigned RXB1D40
: 1;
9767 unsigned RXB1D41
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
9773 unsigned RXB1D47
: 1;
9776 extern __at(0x0F3A) volatile __RXB1D4bits_t RXB1D4bits
;
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9790 //==============================================================================
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;
9797 unsigned RXB1D50
: 1;
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: 1;
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: 1;
9800 unsigned RXB1D53
: 1;
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: 1;
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: 1;
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: 1;
9804 unsigned RXB1D57
: 1;
9807 extern __at(0x0F3B) volatile __RXB1D5bits_t RXB1D5bits
;
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9818 //==============================================================================
9821 //==============================================================================
9824 extern __at(0x0F3C) __sfr RXB1D6
;
9828 unsigned RXB1D60
: 1;
9829 unsigned RXB1D61
: 1;
9830 unsigned RXB1D62
: 1;
9831 unsigned RXB1D63
: 1;
9832 unsigned RXB1D64
: 1;
9833 unsigned RXB1D65
: 1;
9834 unsigned RXB1D66
: 1;
9835 unsigned RXB1D67
: 1;
9838 extern __at(0x0F3C) volatile __RXB1D6bits_t RXB1D6bits
;
9840 #define _RXB1D60 0x01
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9849 //==============================================================================
9852 //==============================================================================
9855 extern __at(0x0F3D) __sfr RXB1D7
;
9859 unsigned RXB1D70
: 1;
9860 unsigned RXB1D71
: 1;
9861 unsigned RXB1D72
: 1;
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: 1;
9864 unsigned RXB1D75
: 1;
9865 unsigned RXB1D76
: 1;
9866 unsigned RXB1D77
: 1;
9869 extern __at(0x0F3D) volatile __RXB1D7bits_t RXB1D7bits
;
9871 #define _RXB1D70 0x01
9872 #define _RXB1D71 0x02
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9874 #define _RXB1D73 0x08
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9877 #define _RXB1D76 0x40
9878 #define _RXB1D77 0x80
9880 //==============================================================================
9883 //==============================================================================
9886 extern __at(0x0F3E) __sfr CANSTAT_RO0
;
9892 unsigned EICODE0
: 1;
9893 unsigned EICODE1_ICODE0
: 1;
9894 unsigned EICODE2_ICODE1
: 1;
9895 unsigned EICODE3_ICODE2
: 1;
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: 1;
9897 unsigned OPMODE0
: 1;
9898 unsigned OPMODE1
: 1;
9899 unsigned OPMODE2
: 1;
9905 unsigned EICODE1
: 1;
9906 unsigned EICODE2
: 1;
9907 unsigned EICODE3
: 1;
9917 unsigned ICODE0
: 1;
9918 unsigned ICODE1
: 1;
9919 unsigned ICODE2
: 1;
9928 unsigned EICODE
: 5;
9942 unsigned OPMODE
: 3;
9944 } __CANSTAT_RO0bits_t
;
9946 extern __at(0x0F3E) volatile __CANSTAT_RO0bits_t CANSTAT_RO0bits
;
9948 #define _CANSTAT_RO0_EICODE0 0x01
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9954 #define _CANSTAT_RO0_ICODE1 0x04
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9956 #define _CANSTAT_RO0_EICODE3 0x08
9957 #define _CANSTAT_RO0_ICODE2 0x08
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9963 //==============================================================================
9966 //==============================================================================
9969 extern __at(0x0F3F) __sfr CANCON_RO0
;
9976 unsigned WIN0_FP1
: 1;
9977 unsigned WIN1_FP2
: 1;
9978 unsigned WIN2_FP3
: 1;
10021 } __CANCON_RO0bits_t
;
10023 extern __at(0x0F3F) volatile __CANCON_RO0bits_t CANCON_RO0bits
;
10025 #define _CANCON_RO0_FP0 0x01
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10037 //==============================================================================
10040 //==============================================================================
10043 extern __at(0x0F42) __sfr MDCARL
;
10049 unsigned MDCL0
: 1;
10050 unsigned MDCL1
: 1;
10051 unsigned MDCL2
: 1;
10052 unsigned MDCL3
: 1;
10054 unsigned MDCLSYNC
: 1;
10055 unsigned MDCLPOL
: 1;
10056 unsigned MDCLODIS
: 1;
10066 extern __at(0x0F42) volatile __MDCARLbits_t MDCARLbits
;
10068 #define _MDCL0 0x01
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10076 //==============================================================================
10079 //==============================================================================
10082 extern __at(0x0F43) __sfr MDCARH
;
10088 unsigned MDCH0
: 1;
10089 unsigned MDCH1
: 1;
10090 unsigned MDCH2
: 1;
10091 unsigned MDCH3
: 1;
10093 unsigned MDCHSYNC
: 1;
10094 unsigned MDCHPOL
: 1;
10095 unsigned MDCHODIS
: 1;
10105 extern __at(0x0F43) volatile __MDCARHbits_t MDCARHbits
;
10107 #define _MDCH0 0x01
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10110 #define _MDCH3 0x08
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10113 #define _MDCHODIS 0x80
10115 //==============================================================================
10118 //==============================================================================
10121 extern __at(0x0F44) __sfr MDSRC
;
10127 unsigned MDSRC0
: 1;
10128 unsigned MDSRC1
: 1;
10129 unsigned MDSRC2
: 1;
10130 unsigned MDSRC3
: 1;
10134 unsigned MDSODIS
: 1;
10139 unsigned MDSRC
: 4;
10144 extern __at(0x0F44) volatile __MDSRCbits_t MDSRCbits
;
10146 #define _MDSRC0 0x01
10147 #define _MDSRC1 0x02
10148 #define _MDSRC2 0x04
10149 #define _MDSRC3 0x08
10150 #define _MDSODIS 0x80
10152 //==============================================================================
10155 //==============================================================================
10158 extern __at(0x0F45) __sfr MDCON
;
10162 unsigned MDBIT
: 1;
10166 unsigned MDOPOL
: 1;
10167 unsigned MDSLR
: 1;
10172 extern __at(0x0F45) volatile __MDCONbits_t MDCONbits
;
10174 #define _MDBIT 0x01
10176 #define _MDOPOL 0x10
10177 #define _MDSLR 0x20
10181 //==============================================================================
10184 //==============================================================================
10187 extern __at(0x0F46) __sfr PSPCON
;
10195 unsigned PSPMODE
: 1;
10201 extern __at(0x0F46) volatile __PSPCONbits_t PSPCONbits
;
10203 #define _PSPMODE 0x10
10208 //==============================================================================
10211 //==============================================================================
10214 extern __at(0x0F47) __sfr CCP5CON
;
10220 unsigned CCP5M0
: 1;
10221 unsigned CCP5M1
: 1;
10222 unsigned CCP5M2
: 1;
10223 unsigned CCP5M3
: 1;
10224 unsigned DC5B0
: 1;
10225 unsigned DC5B1
: 1;
10236 unsigned CCP5Y
: 1;
10237 unsigned CCP5X
: 1;
10244 unsigned CCP5M
: 4;
10256 extern __at(0x0F47) volatile __CCP5CONbits_t CCP5CONbits
;
10258 #define _CCP5M0 0x01
10259 #define _CCP5M1 0x02
10260 #define _CCP5M2 0x04
10261 #define _CCP5M3 0x08
10262 #define _DC5B0 0x10
10263 #define _CCP5Y 0x10
10264 #define _DC5B1 0x20
10265 #define _CCP5X 0x20
10267 //==============================================================================
10269 extern __at(0x0F48) __sfr CCPR5
;
10270 extern __at(0x0F48) __sfr CCPR5L
;
10271 extern __at(0x0F49) __sfr CCPR5H
;
10273 //==============================================================================
10276 extern __at(0x0F4A) __sfr CCP4CON
;
10282 unsigned CCP4M0
: 1;
10283 unsigned CCP4M1
: 1;
10284 unsigned CCP4M2
: 1;
10285 unsigned CCP4M3
: 1;
10286 unsigned DC4B0
: 1;
10287 unsigned DC4B1
: 1;
10298 unsigned CCP4Y
: 1;
10299 unsigned CCP4X
: 1;
10306 unsigned CCP4M
: 4;
10318 extern __at(0x0F4A) volatile __CCP4CONbits_t CCP4CONbits
;
10320 #define _CCP4M0 0x01
10321 #define _CCP4M1 0x02
10322 #define _CCP4M2 0x04
10323 #define _CCP4M3 0x08
10324 #define _DC4B0 0x10
10325 #define _CCP4Y 0x10
10326 #define _DC4B1 0x20
10327 #define _CCP4X 0x20
10329 //==============================================================================
10331 extern __at(0x0F4B) __sfr CCPR4
;
10332 extern __at(0x0F4B) __sfr CCPR4L
;
10333 extern __at(0x0F4C) __sfr CCPR4H
;
10335 //==============================================================================
10338 extern __at(0x0F4D) __sfr CCP3CON
;
10344 unsigned CCP3M0
: 1;
10345 unsigned CCP3M1
: 1;
10346 unsigned CCP3M2
: 1;
10347 unsigned CCP3M3
: 1;
10348 unsigned DC3B0
: 1;
10349 unsigned DC3B1
: 1;
10360 unsigned CCP3Y
: 1;
10361 unsigned CCP3X
: 1;
10368 unsigned CCP3M
: 4;
10380 extern __at(0x0F4D) volatile __CCP3CONbits_t CCP3CONbits
;
10382 #define _CCP3M0 0x01
10383 #define _CCP3M1 0x02
10384 #define _CCP3M2 0x04
10385 #define _CCP3M3 0x08
10386 #define _DC3B0 0x10
10387 #define _CCP3Y 0x10
10388 #define _DC3B1 0x20
10389 #define _CCP3X 0x20
10391 //==============================================================================
10393 extern __at(0x0F4E) __sfr CCPR3
;
10394 extern __at(0x0F4E) __sfr CCPR3L
;
10395 extern __at(0x0F4F) __sfr CCPR3H
;
10397 //==============================================================================
10400 extern __at(0x0F50) __sfr CCP2CON
;
10406 unsigned CCP2M0
: 1;
10407 unsigned CCP2M1
: 1;
10408 unsigned CCP2M2
: 1;
10409 unsigned CCP2M3
: 1;
10410 unsigned DC2B0
: 1;
10411 unsigned DC2B1
: 1;
10422 unsigned CCP2Y
: 1;
10423 unsigned CCP2X
: 1;
10430 unsigned CCP2M
: 4;
10442 extern __at(0x0F50) volatile __CCP2CONbits_t CCP2CONbits
;
10444 #define _CCP2M0 0x01
10445 #define _CCP2M1 0x02
10446 #define _CCP2M2 0x04
10447 #define _CCP2M3 0x08
10448 #define _DC2B0 0x10
10449 #define _CCP2Y 0x10
10450 #define _DC2B1 0x20
10451 #define _CCP2X 0x20
10453 //==============================================================================
10456 //==============================================================================
10459 extern __at(0x0F50) __sfr ECCP2CON
;
10465 unsigned CCP2M0
: 1;
10466 unsigned CCP2M1
: 1;
10467 unsigned CCP2M2
: 1;
10468 unsigned CCP2M3
: 1;
10469 unsigned DC2B0
: 1;
10470 unsigned DC2B1
: 1;
10481 unsigned CCP2Y
: 1;
10482 unsigned CCP2X
: 1;
10489 unsigned CCP2M
: 4;
10499 } __ECCP2CONbits_t
;
10501 extern __at(0x0F50) volatile __ECCP2CONbits_t ECCP2CONbits
;
10503 #define _ECCP2CON_CCP2M0 0x01
10504 #define _ECCP2CON_CCP2M1 0x02
10505 #define _ECCP2CON_CCP2M2 0x04
10506 #define _ECCP2CON_CCP2M3 0x08
10507 #define _ECCP2CON_DC2B0 0x10
10508 #define _ECCP2CON_CCP2Y 0x10
10509 #define _ECCP2CON_DC2B1 0x20
10510 #define _ECCP2CON_CCP2X 0x20
10512 //==============================================================================
10514 extern __at(0x0F51) __sfr CCPR2
;
10515 extern __at(0x0F51) __sfr CCPR2L
;
10516 extern __at(0x0F52) __sfr CCPR2H
;
10518 //==============================================================================
10521 extern __at(0x0F53) __sfr CTMUICON
;
10527 unsigned IRNG0
: 1;
10528 unsigned IRNG1
: 1;
10529 unsigned ITRIM0
: 1;
10530 unsigned ITRIM1
: 1;
10531 unsigned ITRIM2
: 1;
10532 unsigned ITRIM3
: 1;
10533 unsigned ITRIM4
: 1;
10534 unsigned ITRIM5
: 1;
10546 unsigned ITRIM
: 6;
10548 } __CTMUICONbits_t
;
10550 extern __at(0x0F53) volatile __CTMUICONbits_t CTMUICONbits
;
10552 #define _IRNG0 0x01
10553 #define _IRNG1 0x02
10554 #define _ITRIM0 0x04
10555 #define _ITRIM1 0x08
10556 #define _ITRIM2 0x10
10557 #define _ITRIM3 0x20
10558 #define _ITRIM4 0x40
10559 #define _ITRIM5 0x80
10561 //==============================================================================
10564 //==============================================================================
10567 extern __at(0x0F54) __sfr CTMUCONL
;
10573 unsigned EDG1STAT
: 1;
10574 unsigned EDG2STAT
: 1;
10575 unsigned EDG1SEL0
: 1;
10576 unsigned EDG1SEL1
: 1;
10577 unsigned EDG1POL
: 1;
10578 unsigned EDG2SEL0
: 1;
10579 unsigned EDG2SEL1
: 1;
10580 unsigned EDG2POL
: 1;
10586 unsigned EDG1SEL
: 2;
10593 unsigned EDG2SEL
: 2;
10596 } __CTMUCONLbits_t
;
10598 extern __at(0x0F54) volatile __CTMUCONLbits_t CTMUCONLbits
;
10600 #define _EDG1STAT 0x01
10601 #define _EDG2STAT 0x02
10602 #define _EDG1SEL0 0x04
10603 #define _EDG1SEL1 0x08
10604 #define _EDG1POL 0x10
10605 #define _EDG2SEL0 0x20
10606 #define _EDG2SEL1 0x40
10607 #define _EDG2POL 0x80
10609 //==============================================================================
10612 //==============================================================================
10615 extern __at(0x0F55) __sfr CTMUCONH
;
10619 unsigned CTTRIG
: 1;
10620 unsigned IDISSEN
: 1;
10621 unsigned EDGSEQEN
: 1;
10622 unsigned EDGEN
: 1;
10624 unsigned CTMUSIDL
: 1;
10626 unsigned CTMUEN
: 1;
10627 } __CTMUCONHbits_t
;
10629 extern __at(0x0F55) volatile __CTMUCONHbits_t CTMUCONHbits
;
10631 #define _CTTRIG 0x01
10632 #define _IDISSEN 0x02
10633 #define _EDGSEQEN 0x04
10634 #define _EDGEN 0x08
10636 #define _CTMUSIDL 0x20
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10639 //==============================================================================
10642 //==============================================================================
10645 extern __at(0x0F56) __sfr PADCFG1
;
10649 unsigned CTMUDS
: 1;
10659 extern __at(0x0F56) volatile __PADCFG1bits_t PADCFG1bits
;
10661 #define _CTMUDS 0x01
10667 //==============================================================================
10670 //==============================================================================
10673 extern __at(0x0F57) __sfr PMD2
;
10677 unsigned CMP1MD
: 1;
10678 unsigned CMP2MD
: 1;
10679 unsigned ECANMD
: 1;
10680 unsigned MODMD
: 1;
10687 extern __at(0x0F57) volatile __PMD2bits_t PMD2bits
;
10689 #define _CMP1MD 0x01
10690 #define _CMP2MD 0x02
10691 #define _ECANMD 0x04
10692 #define _MODMD 0x08
10694 //==============================================================================
10697 //==============================================================================
10700 extern __at(0x0F58) __sfr PMD1
;
10704 unsigned TMR0MD
: 1;
10705 unsigned TMR1MD
: 1;
10706 unsigned TMR2MD
: 1;
10707 unsigned TMR3MD
: 1;
10708 unsigned TMR4MD
: 1;
10709 unsigned ADCMD
: 1;
10710 unsigned CTMUMD
: 1;
10711 unsigned PSPMD
: 1;
10714 extern __at(0x0F58) volatile __PMD1bits_t PMD1bits
;
10716 #define _TMR0MD 0x01
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10722 #define _CTMUMD 0x40
10723 #define _PSPMD 0x80
10725 //==============================================================================
10728 //==============================================================================
10731 extern __at(0x0F59) __sfr PMD0
;
10735 unsigned SSPMD
: 1;
10736 unsigned UART1MD
: 1;
10737 unsigned UART2MD
: 1;
10738 unsigned CCP1MD
: 1;
10739 unsigned CCP2MD
: 1;
10740 unsigned CCP3MD
: 1;
10741 unsigned CCP4MD
: 1;
10742 unsigned CCP5MD
: 1;
10745 extern __at(0x0F59) volatile __PMD0bits_t PMD0bits
;
10747 #define _SSPMD 0x01
10748 #define _UART1MD 0x02
10749 #define _UART2MD 0x04
10750 #define _CCP1MD 0x08
10751 #define _CCP2MD 0x10
10752 #define _CCP3MD 0x20
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10756 //==============================================================================
10759 //==============================================================================
10762 extern __at(0x0F5A) __sfr IOCB
;
10770 unsigned IOCB4
: 1;
10771 unsigned IOCB5
: 1;
10772 unsigned IOCB6
: 1;
10773 unsigned IOCB7
: 1;
10776 extern __at(0x0F5A) volatile __IOCBbits_t IOCBbits
;
10778 #define _IOCB4 0x10
10779 #define _IOCB5 0x20
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10781 #define _IOCB7 0x80
10783 //==============================================================================
10786 //==============================================================================
10789 extern __at(0x0F5B) __sfr WPUB
;
10793 unsigned WPUB0
: 1;
10794 unsigned WPUB1
: 1;
10795 unsigned WPUB2
: 1;
10796 unsigned WPUB3
: 1;
10797 unsigned WPUB4
: 1;
10798 unsigned WPUB5
: 1;
10799 unsigned WPUB6
: 1;
10800 unsigned WPUB7
: 1;
10803 extern __at(0x0F5B) volatile __WPUBbits_t WPUBbits
;
10805 #define _WPUB0 0x01
10806 #define _WPUB1 0x02
10807 #define _WPUB2 0x04
10808 #define _WPUB3 0x08
10809 #define _WPUB4 0x10
10810 #define _WPUB5 0x20
10811 #define _WPUB6 0x40
10812 #define _WPUB7 0x80
10814 //==============================================================================
10817 //==============================================================================
10820 extern __at(0x0F5C) __sfr ANCON1
;
10824 unsigned ANSEL8
: 1;
10825 unsigned ANSEL9
: 1;
10826 unsigned ANSEL10
: 1;
10827 unsigned ANSEL11
: 1;
10828 unsigned ANSEL12
: 1;
10829 unsigned ANSEL13
: 1;
10830 unsigned ANSEL14
: 1;
10834 extern __at(0x0F5C) volatile __ANCON1bits_t ANCON1bits
;
10836 #define _ANSEL8 0x01
10837 #define _ANSEL9 0x02
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10840 #define _ANSEL12 0x10
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10842 #define _ANSEL14 0x40
10844 //==============================================================================
10847 //==============================================================================
10850 extern __at(0x0F5D) __sfr ANCON0
;
10854 unsigned ANSEL0
: 1;
10855 unsigned ANSEL1
: 1;
10856 unsigned ANSEL2
: 1;
10857 unsigned ANSEL3
: 1;
10858 unsigned ANSEL4
: 1;
10859 unsigned ANSEL5
: 1;
10860 unsigned ANSEL6
: 1;
10861 unsigned ANSEL7
: 1;
10864 extern __at(0x0F5D) volatile __ANCON0bits_t ANCON0bits
;
10866 #define _ANSEL0 0x01
10867 #define _ANSEL1 0x02
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10870 #define _ANSEL4 0x10
10871 #define _ANSEL5 0x20
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10875 //==============================================================================
10878 //==============================================================================
10881 extern __at(0x0F5E) __sfr CM2CON
;
10890 unsigned EVPOL0
: 1;
10891 unsigned EVPOL1
: 1;
10906 unsigned EVPOL
: 2;
10911 extern __at(0x0F5E) volatile __CM2CONbits_t CM2CONbits
;
10913 #define _CM2CON_CCH0 0x01
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10922 //==============================================================================
10925 //==============================================================================
10928 extern __at(0x0F5E) __sfr CM2CON1
;
10937 unsigned EVPOL0
: 1;
10938 unsigned EVPOL1
: 1;
10953 unsigned EVPOL
: 2;
10958 extern __at(0x0F5E) volatile __CM2CON1bits_t CM2CON1bits
;
10960 #define _CM2CON1_CCH0 0x01
10961 #define _CM2CON1_CCH1 0x02
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10969 //==============================================================================
10972 //==============================================================================
10975 extern __at(0x0F5F) __sfr CM1CON
;
10984 unsigned EVPOL0
: 1;
10985 unsigned EVPOL1
: 1;
11000 unsigned EVPOL
: 2;
11005 extern __at(0x0F5F) volatile __CM1CONbits_t CM1CONbits
;
11010 #define _EVPOL0 0x08
11011 #define _EVPOL1 0x10
11016 //==============================================================================
11019 //==============================================================================
11022 extern __at(0x0F5F) __sfr CM1CON1
;
11031 unsigned EVPOL0
: 1;
11032 unsigned EVPOL1
: 1;
11047 unsigned EVPOL
: 2;
11052 extern __at(0x0F5F) volatile __CM1CON1bits_t CM1CON1bits
;
11054 #define _CM1CON1_CCH0 0x01
11055 #define _CM1CON1_CCH1 0x02
11056 #define _CM1CON1_CREF 0x04
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11059 #define _CM1CON1_CPOL 0x20
11060 #define _CM1CON1_COE 0x40
11061 #define _CM1CON1_CON 0x80
11063 //==============================================================================
11066 //==============================================================================
11069 extern __at(0x0F60) __sfr RXB0CON
;
11075 unsigned FILHIT0
: 1;
11076 unsigned JTOFF_FILHIT1
: 1;
11077 unsigned RB0DBEN_FILHIT2
: 1;
11078 unsigned RXRTRRO_FILHIT3
: 1;
11079 unsigned FILHIT4
: 1;
11080 unsigned RXM0_RTRRO
: 1;
11082 unsigned RXFUL
: 1;
11088 unsigned JTOFF
: 1;
11089 unsigned RB0DBEN
: 1;
11090 unsigned RXRTRRO
: 1;
11092 unsigned RTRRO
: 1;
11100 unsigned FILHIT1
: 1;
11101 unsigned FILHIT2
: 1;
11102 unsigned FILHIT3
: 1;
11111 unsigned FILHIT
: 5;
11123 extern __at(0x0F60) volatile __RXB0CONbits_t RXB0CONbits
;
11125 #define _RXB0CON_FILHIT0 0x01
11126 #define _RXB0CON_JTOFF_FILHIT1 0x02
11127 #define _RXB0CON_JTOFF 0x02
11128 #define _RXB0CON_FILHIT1 0x02
11129 #define _RXB0CON_RB0DBEN_FILHIT2 0x04
11130 #define _RXB0CON_RB0DBEN 0x04
11131 #define _RXB0CON_FILHIT2 0x04
11132 #define _RXB0CON_RXRTRRO_FILHIT3 0x08
11133 #define _RXB0CON_RXRTRRO 0x08
11134 #define _RXB0CON_FILHIT3 0x08
11135 #define _RXB0CON_FILHIT4 0x10
11136 #define _RXB0CON_RXM0_RTRRO 0x20
11137 #define _RXB0CON_RTRRO 0x20
11138 #define _RXB0CON_RXM0 0x20
11139 #define _RXB0CON_RXM1 0x40
11140 #define _RXB0CON_RXFUL 0x80
11142 //==============================================================================
11145 //==============================================================================
11148 extern __at(0x0F61) __sfr RXB0SIDH
;
11159 unsigned SID10
: 1;
11160 } __RXB0SIDHbits_t
;
11162 extern __at(0x0F61) volatile __RXB0SIDHbits_t RXB0SIDHbits
;
11164 #define _RXB0SIDH_SID3 0x01
11165 #define _RXB0SIDH_SID4 0x02
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11168 #define _RXB0SIDH_SID7 0x10
11169 #define _RXB0SIDH_SID8 0x20
11170 #define _RXB0SIDH_SID9 0x40
11171 #define _RXB0SIDH_SID10 0x80
11173 //==============================================================================
11176 //==============================================================================
11179 extern __at(0x0F62) __sfr RXB0SIDL
;
11185 unsigned EID16
: 1;
11186 unsigned EID17
: 1;
11200 } __RXB0SIDLbits_t
;
11202 extern __at(0x0F62) volatile __RXB0SIDLbits_t RXB0SIDLbits
;
11204 #define _RXB0SIDL_EID16 0x01
11205 #define _RXB0SIDL_EID17 0x02
11206 #define _RXB0SIDL_EXID 0x08
11207 #define _RXB0SIDL_SRR 0x10
11208 #define _RXB0SIDL_SID0 0x20
11209 #define _RXB0SIDL_SID1 0x40
11210 #define _RXB0SIDL_SID2 0x80
11212 //==============================================================================
11215 //==============================================================================
11218 extern __at(0x0F63) __sfr RXB0EIDH
;
11224 unsigned EID10
: 1;
11225 unsigned EID11
: 1;
11226 unsigned EID12
: 1;
11227 unsigned EID13
: 1;
11228 unsigned EID14
: 1;
11229 unsigned EID15
: 1;
11230 } __RXB0EIDHbits_t
;
11232 extern __at(0x0F63) volatile __RXB0EIDHbits_t RXB0EIDHbits
;
11234 #define _RXB0EIDH_EID8 0x01
11235 #define _RXB0EIDH_EID9 0x02
11236 #define _RXB0EIDH_EID10 0x04
11237 #define _RXB0EIDH_EID11 0x08
11238 #define _RXB0EIDH_EID12 0x10
11239 #define _RXB0EIDH_EID13 0x20
11240 #define _RXB0EIDH_EID14 0x40
11241 #define _RXB0EIDH_EID15 0x80
11243 //==============================================================================
11246 //==============================================================================
11249 extern __at(0x0F64) __sfr RXB0EIDL
;
11261 } __RXB0EIDLbits_t
;
11263 extern __at(0x0F64) volatile __RXB0EIDLbits_t RXB0EIDLbits
;
11265 #define _RXB0EIDL_EID0 0x01
11266 #define _RXB0EIDL_EID1 0x02
11267 #define _RXB0EIDL_EID2 0x04
11268 #define _RXB0EIDL_EID3 0x08
11269 #define _RXB0EIDL_EID4 0x10
11270 #define _RXB0EIDL_EID5 0x20
11271 #define _RXB0EIDL_EID6 0x40
11272 #define _RXB0EIDL_EID7 0x80
11274 //==============================================================================
11277 //==============================================================================
11280 extern __at(0x0F65) __sfr RXB0DLC
;
11292 unsigned RXRTR
: 1;
11310 extern __at(0x0F65) volatile __RXB0DLCbits_t RXB0DLCbits
;
11312 #define _RXB0DLC_DLC0 0x01
11313 #define _RXB0DLC_DLC1 0x02
11314 #define _RXB0DLC_DLC2 0x04
11315 #define _RXB0DLC_DLC3 0x08
11316 #define _RXB0DLC_RB0 0x10
11317 #define _RXB0DLC_RB1 0x20
11318 #define _RXB0DLC_RXRTR 0x40
11320 //==============================================================================
11323 //==============================================================================
11326 extern __at(0x0F66) __sfr RXB0D0
;
11330 unsigned RXB0D00
: 1;
11331 unsigned RXB0D01
: 1;
11332 unsigned RXB0D02
: 1;
11333 unsigned RXB0D03
: 1;
11334 unsigned RXB0D04
: 1;
11335 unsigned RXB0D05
: 1;
11336 unsigned RXB0D06
: 1;
11337 unsigned RXB0D07
: 1;
11340 extern __at(0x0F66) volatile __RXB0D0bits_t RXB0D0bits
;
11342 #define _RXB0D00 0x01
11343 #define _RXB0D01 0x02
11344 #define _RXB0D02 0x04
11345 #define _RXB0D03 0x08
11346 #define _RXB0D04 0x10
11347 #define _RXB0D05 0x20
11348 #define _RXB0D06 0x40
11349 #define _RXB0D07 0x80
11351 //==============================================================================
11354 //==============================================================================
11357 extern __at(0x0F67) __sfr RXB0D1
;
11361 unsigned RXB0D10
: 1;
11362 unsigned RXB0D11
: 1;
11363 unsigned RXB0D12
: 1;
11364 unsigned RXB0D13
: 1;
11365 unsigned RXB0D14
: 1;
11366 unsigned RXB0D15
: 1;
11367 unsigned RXB0D16
: 1;
11368 unsigned RXB0D17
: 1;
11371 extern __at(0x0F67) volatile __RXB0D1bits_t RXB0D1bits
;
11373 #define _RXB0D10 0x01
11374 #define _RXB0D11 0x02
11375 #define _RXB0D12 0x04
11376 #define _RXB0D13 0x08
11377 #define _RXB0D14 0x10
11378 #define _RXB0D15 0x20
11379 #define _RXB0D16 0x40
11380 #define _RXB0D17 0x80
11382 //==============================================================================
11385 //==============================================================================
11388 extern __at(0x0F68) __sfr RXB0D2
;
11392 unsigned RXB0D20
: 1;
11393 unsigned RXB0D21
: 1;
11394 unsigned RXB0D22
: 1;
11395 unsigned RXB0D23
: 1;
11396 unsigned RXB0D24
: 1;
11397 unsigned RXB0D25
: 1;
11398 unsigned RXB0D26
: 1;
11399 unsigned RXB0D27
: 1;
11402 extern __at(0x0F68) volatile __RXB0D2bits_t RXB0D2bits
;
11404 #define _RXB0D20 0x01
11405 #define _RXB0D21 0x02
11406 #define _RXB0D22 0x04
11407 #define _RXB0D23 0x08
11408 #define _RXB0D24 0x10
11409 #define _RXB0D25 0x20
11410 #define _RXB0D26 0x40
11411 #define _RXB0D27 0x80
11413 //==============================================================================
11416 //==============================================================================
11419 extern __at(0x0F69) __sfr RXB0D3
;
11423 unsigned RXB0D30
: 1;
11424 unsigned RXB0D31
: 1;
11425 unsigned RXB0D32
: 1;
11426 unsigned RXB0D33
: 1;
11427 unsigned RXB0D34
: 1;
11428 unsigned RXB0D35
: 1;
11429 unsigned RXB0D36
: 1;
11430 unsigned RXB0D37
: 1;
11433 extern __at(0x0F69) volatile __RXB0D3bits_t RXB0D3bits
;
11435 #define _RXB0D30 0x01
11436 #define _RXB0D31 0x02
11437 #define _RXB0D32 0x04
11438 #define _RXB0D33 0x08
11439 #define _RXB0D34 0x10
11440 #define _RXB0D35 0x20
11441 #define _RXB0D36 0x40
11442 #define _RXB0D37 0x80
11444 //==============================================================================
11447 //==============================================================================
11450 extern __at(0x0F6A) __sfr RXB0D4
;
11454 unsigned RXB0D40
: 1;
11455 unsigned RXB0D41
: 1;
11456 unsigned RXB0D42
: 1;
11457 unsigned RXB0D43
: 1;
11458 unsigned RXB0D44
: 1;
11459 unsigned RXB0D45
: 1;
11460 unsigned RXB0D46
: 1;
11461 unsigned RXB0D47
: 1;
11464 extern __at(0x0F6A) volatile __RXB0D4bits_t RXB0D4bits
;
11466 #define _RXB0D40 0x01
11467 #define _RXB0D41 0x02
11468 #define _RXB0D42 0x04
11469 #define _RXB0D43 0x08
11470 #define _RXB0D44 0x10
11471 #define _RXB0D45 0x20
11472 #define _RXB0D46 0x40
11473 #define _RXB0D47 0x80
11475 //==============================================================================
11478 //==============================================================================
11481 extern __at(0x0F6B) __sfr RXB0D5
;
11485 unsigned RXB0D50
: 1;
11486 unsigned RXB0D51
: 1;
11487 unsigned RXB0D52
: 1;
11488 unsigned RXB0D53
: 1;
11489 unsigned RXB0D54
: 1;
11490 unsigned RXB0D55
: 1;
11491 unsigned RXB0D56
: 1;
11492 unsigned RXB0D57
: 1;
11495 extern __at(0x0F6B) volatile __RXB0D5bits_t RXB0D5bits
;
11497 #define _RXB0D50 0x01
11498 #define _RXB0D51 0x02
11499 #define _RXB0D52 0x04
11500 #define _RXB0D53 0x08
11501 #define _RXB0D54 0x10
11502 #define _RXB0D55 0x20
11503 #define _RXB0D56 0x40
11504 #define _RXB0D57 0x80
11506 //==============================================================================
11509 //==============================================================================
11512 extern __at(0x0F6C) __sfr RXB0D6
;
11516 unsigned RXB0D60
: 1;
11517 unsigned RXB0D61
: 1;
11518 unsigned RXB0D62
: 1;
11519 unsigned RXB0D63
: 1;
11520 unsigned RXB0D64
: 1;
11521 unsigned RXB0D65
: 1;
11522 unsigned RXB0D66
: 1;
11523 unsigned RXB0D67
: 1;
11526 extern __at(0x0F6C) volatile __RXB0D6bits_t RXB0D6bits
;
11528 #define _RXB0D60 0x01
11529 #define _RXB0D61 0x02
11530 #define _RXB0D62 0x04
11531 #define _RXB0D63 0x08
11532 #define _RXB0D64 0x10
11533 #define _RXB0D65 0x20
11534 #define _RXB0D66 0x40
11535 #define _RXB0D67 0x80
11537 //==============================================================================
11540 //==============================================================================
11543 extern __at(0x0F6D) __sfr RXB0D7
;
11547 unsigned RXB0D70
: 1;
11548 unsigned RXB0D71
: 1;
11549 unsigned RXB0D72
: 1;
11550 unsigned RXB0D73
: 1;
11551 unsigned RXB0D74
: 1;
11552 unsigned RXB0D75
: 1;
11553 unsigned RXB0D76
: 1;
11554 unsigned RXB0D77
: 1;
11557 extern __at(0x0F6D) volatile __RXB0D7bits_t RXB0D7bits
;
11559 #define _RXB0D70 0x01
11560 #define _RXB0D71 0x02
11561 #define _RXB0D72 0x04
11562 #define _RXB0D73 0x08
11563 #define _RXB0D74 0x10
11564 #define _RXB0D75 0x20
11565 #define _RXB0D76 0x40
11566 #define _RXB0D77 0x80
11568 //==============================================================================
11571 //==============================================================================
11574 extern __at(0x0F6E) __sfr CANSTAT
;
11580 unsigned EICODE0
: 1;
11581 unsigned EICODE1_ICODE0
: 1;
11582 unsigned EICODE2_ICODE1
: 1;
11583 unsigned EICODE3_ICODE2
: 1;
11584 unsigned EICODE4
: 1;
11585 unsigned OPMODE0
: 1;
11586 unsigned OPMODE1
: 1;
11587 unsigned OPMODE2
: 1;
11593 unsigned EICODE1
: 1;
11594 unsigned EICODE2
: 1;
11595 unsigned EICODE3
: 1;
11605 unsigned ICODE0
: 1;
11606 unsigned ICODE1
: 1;
11607 unsigned ICODE2
: 1;
11616 unsigned EICODE
: 5;
11623 unsigned ICODE
: 3;
11630 unsigned OPMODE
: 3;
11634 extern __at(0x0F6E) volatile __CANSTATbits_t CANSTATbits
;
11636 #define _EICODE0 0x01
11637 #define _EICODE1_ICODE0 0x02
11638 #define _EICODE1 0x02
11639 #define _ICODE0 0x02
11640 #define _EICODE2_ICODE1 0x04
11641 #define _EICODE2 0x04
11642 #define _ICODE1 0x04
11643 #define _EICODE3_ICODE2 0x08
11644 #define _EICODE3 0x08
11645 #define _ICODE2 0x08
11646 #define _EICODE4 0x10
11647 #define _OPMODE0 0x20
11648 #define _OPMODE1 0x40
11649 #define _OPMODE2 0x80
11651 //==============================================================================
11654 //==============================================================================
11657 extern __at(0x0F6F) __sfr CANCON
;
11664 unsigned WIN0_FP1
: 1;
11665 unsigned WIN1_FP2
: 1;
11666 unsigned WIN2_FP3
: 1;
11711 extern __at(0x0F6F) volatile __CANCONbits_t CANCONbits
;
11714 #define _WIN0_FP1 0x02
11717 #define _WIN1_FP2 0x04
11720 #define _WIN2_FP3 0x08
11725 //==============================================================================
11728 //==============================================================================
11731 extern __at(0x0F70) __sfr CIOCON
;
11735 unsigned CLKSEL
: 1;
11739 unsigned CANCAP
: 1;
11740 unsigned ENDRHI
: 1;
11741 unsigned TX2EN
: 1;
11742 unsigned TX2SRC
: 1;
11745 extern __at(0x0F70) volatile __CIOCONbits_t CIOCONbits
;
11747 #define _CLKSEL 0x01
11748 #define _CANCAP 0x10
11749 #define _ENDRHI 0x20
11750 #define _TX2EN 0x40
11751 #define _TX2SRC 0x80
11753 //==============================================================================
11756 //==============================================================================
11759 extern __at(0x0F71) __sfr COMSTAT
;
11765 unsigned EWARN
: 1;
11766 unsigned RXWARN
: 1;
11767 unsigned TXWARN
: 1;
11771 unsigned RXB1OVFL
: 1;
11772 unsigned RXB0OVFL
: 1;
11784 unsigned NOT_FIFOEMPTY
: 1;
11788 extern __at(0x0F71) volatile __COMSTATbits_t COMSTATbits
;
11790 #define _EWARN 0x01
11791 #define _RXWARN 0x02
11792 #define _TXWARN 0x04
11796 #define _RXB1OVFL 0x40
11797 #define _RXB0OVFL 0x80
11798 #define _NOT_FIFOEMPTY 0x80
11800 //==============================================================================
11803 //==============================================================================
11806 extern __at(0x0F72) __sfr ECANCON
;
11812 unsigned EWIN0
: 1;
11813 unsigned EWIN1
: 1;
11814 unsigned EWIN2
: 1;
11815 unsigned EWIN3
: 1;
11816 unsigned EWIN4
: 1;
11817 unsigned FIFOWM
: 1;
11818 unsigned MDSEL0
: 1;
11819 unsigned MDSEL1
: 1;
11831 unsigned MDSEL
: 2;
11835 extern __at(0x0F72) volatile __ECANCONbits_t ECANCONbits
;
11837 #define _EWIN0 0x01
11838 #define _EWIN1 0x02
11839 #define _EWIN2 0x04
11840 #define _EWIN3 0x08
11841 #define _EWIN4 0x10
11842 #define _FIFOWM 0x20
11843 #define _MDSEL0 0x40
11844 #define _MDSEL1 0x80
11846 //==============================================================================
11848 extern __at(0x0F73) __sfr EEDATA
;
11849 extern __at(0x0F74) __sfr EEADR
;
11850 extern __at(0x0F75) __sfr EEADRH
;
11852 //==============================================================================
11855 extern __at(0x0F76) __sfr PIE5
;
11861 unsigned RXB0IE
: 1;
11862 unsigned RXB1IE
: 1;
11863 unsigned TXB0IE
: 1;
11864 unsigned TXB1IE
: 1;
11865 unsigned TXB2IE
: 1;
11866 unsigned ERRIE
: 1;
11867 unsigned WAKIE
: 1;
11868 unsigned IRXIE
: 1;
11873 unsigned FIFOWMIE
: 1;
11874 unsigned RXBnIE
: 1;
11877 unsigned TXBnIE
: 1;
11884 extern __at(0x0F76) volatile __PIE5bits_t PIE5bits
;
11886 #define _PIE5_RXB0IE 0x01
11887 #define _PIE5_FIFOWMIE 0x01
11888 #define _PIE5_RXB1IE 0x02
11889 #define _PIE5_RXBnIE 0x02
11890 #define _PIE5_TXB0IE 0x04
11891 #define _PIE5_TXB1IE 0x08
11892 #define _PIE5_TXB2IE 0x10
11893 #define _PIE5_TXBnIE 0x10
11894 #define _PIE5_ERRIE 0x20
11895 #define _PIE5_WAKIE 0x40
11896 #define _PIE5_IRXIE 0x80
11898 //==============================================================================
11901 //==============================================================================
11904 extern __at(0x0F77) __sfr PIR5
;
11910 unsigned RXB0IF
: 1;
11911 unsigned RXB1IF
: 1;
11912 unsigned TXB0IF
: 1;
11913 unsigned TXB1IF
: 1;
11914 unsigned TXB2IF
: 1;
11915 unsigned ERRIF
: 1;
11916 unsigned WAKIF
: 1;
11917 unsigned IRXIF
: 1;
11922 unsigned FIFOWMIF
: 1;
11923 unsigned RXBnIF
: 1;
11926 unsigned TXBnIF
: 1;
11933 extern __at(0x0F77) volatile __PIR5bits_t PIR5bits
;
11935 #define _RXB0IF 0x01
11936 #define _FIFOWMIF 0x01
11937 #define _RXB1IF 0x02
11938 #define _RXBnIF 0x02
11939 #define _TXB0IF 0x04
11940 #define _TXB1IF 0x08
11941 #define _TXB2IF 0x10
11942 #define _TXBnIF 0x10
11943 #define _ERRIF 0x20
11944 #define _WAKIF 0x40
11945 #define _IRXIF 0x80
11947 //==============================================================================
11950 //==============================================================================
11953 extern __at(0x0F78) __sfr IPR5
;
11959 unsigned RXB0IP
: 1;
11960 unsigned RXB1IP
: 1;
11961 unsigned TXB0IP
: 1;
11962 unsigned TXB1IP
: 1;
11963 unsigned TXB2IP
: 1;
11964 unsigned ERRIP
: 1;
11965 unsigned WAKIP
: 1;
11966 unsigned IRXIP
: 1;
11971 unsigned FIFOWMIP
: 1;
11972 unsigned RXBnIP
: 1;
11975 unsigned TXBnIP
: 1;
11982 extern __at(0x0F78) volatile __IPR5bits_t IPR5bits
;
11984 #define _RXB0IP 0x01
11985 #define _FIFOWMIP 0x01
11986 #define _RXB1IP 0x02
11987 #define _RXBnIP 0x02
11988 #define _TXB0IP 0x04
11989 #define _TXB1IP 0x08
11990 #define _TXB2IP 0x10
11991 #define _TXBnIP 0x10
11992 #define _ERRIP 0x20
11993 #define _WAKIP 0x40
11994 #define _IRXIP 0x80
11996 //==============================================================================
11998 extern __at(0x0F79) __sfr TXREG2
;
11999 extern __at(0x0F7A) __sfr RCREG2
;
12000 extern __at(0x0F7B) __sfr SPBRG2
;
12001 extern __at(0x0F7C) __sfr SPBRGH2
;
12002 extern __at(0x0F7D) __sfr SPBRGH1
;
12003 extern __at(0x0F7E) __sfr EECON2
;
12005 //==============================================================================
12008 extern __at(0x0F7F) __sfr EECON1
;
12015 unsigned WRERR
: 1;
12019 unsigned EEPGD
: 1;
12022 extern __at(0x0F7F) volatile __EECON1bits_t EECON1bits
;
12027 #define _WRERR 0x08
12030 #define _EEPGD 0x80
12032 //==============================================================================
12035 //==============================================================================
12038 extern __at(0x0F80) __sfr PORTA
;
12052 extern __at(0x0F80) volatile __PORTAbits_t PORTAbits
;
12062 //==============================================================================
12065 //==============================================================================
12068 extern __at(0x0F81) __sfr PORTB
;
12082 extern __at(0x0F81) volatile __PORTBbits_t PORTBbits
;
12084 #define _PORTB_RB0 0x01
12085 #define _PORTB_RB1 0x02
12086 #define _PORTB_RB2 0x04
12087 #define _PORTB_RB3 0x08
12088 #define _PORTB_RB4 0x10
12089 #define _PORTB_RB5 0x20
12090 #define _PORTB_RB6 0x40
12091 #define _PORTB_RB7 0x80
12093 //==============================================================================
12096 //==============================================================================
12099 extern __at(0x0F82) __sfr PORTC
;
12113 extern __at(0x0F82) volatile __PORTCbits_t PORTCbits
;
12124 //==============================================================================
12127 //==============================================================================
12130 extern __at(0x0F83) __sfr PORTD
;
12144 extern __at(0x0F83) volatile __PORTDbits_t PORTDbits
;
12155 //==============================================================================
12158 //==============================================================================
12161 extern __at(0x0F84) __sfr PORTE
;
12175 extern __at(0x0F84) volatile __PORTEbits_t PORTEbits
;
12186 //==============================================================================
12189 //==============================================================================
12192 extern __at(0x0F85) __sfr PORTF
;
12206 extern __at(0x0F85) volatile __PORTFbits_t PORTFbits
;
12217 //==============================================================================
12220 //==============================================================================
12223 extern __at(0x0F86) __sfr PORTG
;
12246 extern __at(0x0F86) volatile __PORTGbits_t PORTGbits
;
12254 //==============================================================================
12256 extern __at(0x0F87) __sfr TMR4
;
12258 //==============================================================================
12261 extern __at(0x0F88) __sfr T4CON
;
12267 unsigned T4CKPS0
: 1;
12268 unsigned T4CKPS1
: 1;
12269 unsigned TMR4ON
: 1;
12270 unsigned T4OUTPS0
: 1;
12271 unsigned T4OUTPS1
: 1;
12272 unsigned T4OUTPS2
: 1;
12273 unsigned T4OUTPS3
: 1;
12279 unsigned T4CKPS
: 2;
12286 unsigned T4OUTPS
: 4;
12291 extern __at(0x0F88) volatile __T4CONbits_t T4CONbits
;
12293 #define _T4CKPS0 0x01
12294 #define _T4CKPS1 0x02
12295 #define _TMR4ON 0x04
12296 #define _T4OUTPS0 0x08
12297 #define _T4OUTPS1 0x10
12298 #define _T4OUTPS2 0x20
12299 #define _T4OUTPS3 0x40
12301 //==============================================================================
12304 //==============================================================================
12307 extern __at(0x0F89) __sfr LATA
;
12311 unsigned LATA0
: 1;
12312 unsigned LATA1
: 1;
12313 unsigned LATA2
: 1;
12314 unsigned LATA3
: 1;
12316 unsigned LATA5
: 1;
12317 unsigned LATA6
: 1;
12318 unsigned LATA7
: 1;
12321 extern __at(0x0F89) volatile __LATAbits_t LATAbits
;
12323 #define _LATA0 0x01
12324 #define _LATA1 0x02
12325 #define _LATA2 0x04
12326 #define _LATA3 0x08
12327 #define _LATA5 0x20
12328 #define _LATA6 0x40
12329 #define _LATA7 0x80
12331 //==============================================================================
12334 //==============================================================================
12337 extern __at(0x0F8A) __sfr LATB
;
12341 unsigned LATB0
: 1;
12342 unsigned LATB1
: 1;
12343 unsigned LATB2
: 1;
12344 unsigned LATB3
: 1;
12345 unsigned LATB4
: 1;
12346 unsigned LATB5
: 1;
12347 unsigned LATB6
: 1;
12348 unsigned LATB7
: 1;
12351 extern __at(0x0F8A) volatile __LATBbits_t LATBbits
;
12353 #define _LATB0 0x01
12354 #define _LATB1 0x02
12355 #define _LATB2 0x04
12356 #define _LATB3 0x08
12357 #define _LATB4 0x10
12358 #define _LATB5 0x20
12359 #define _LATB6 0x40
12360 #define _LATB7 0x80
12362 //==============================================================================
12365 //==============================================================================
12368 extern __at(0x0F8B) __sfr LATC
;
12372 unsigned LATC0
: 1;
12373 unsigned LATC1
: 1;
12374 unsigned LATC2
: 1;
12375 unsigned LATC3
: 1;
12376 unsigned LATC4
: 1;
12377 unsigned LATC5
: 1;
12378 unsigned LATC6
: 1;
12379 unsigned LATC7
: 1;
12382 extern __at(0x0F8B) volatile __LATCbits_t LATCbits
;
12384 #define _LATC0 0x01
12385 #define _LATC1 0x02
12386 #define _LATC2 0x04
12387 #define _LATC3 0x08
12388 #define _LATC4 0x10
12389 #define _LATC5 0x20
12390 #define _LATC6 0x40
12391 #define _LATC7 0x80
12393 //==============================================================================
12396 //==============================================================================
12399 extern __at(0x0F8C) __sfr LATD
;
12403 unsigned LATD0
: 1;
12404 unsigned LATD1
: 1;
12405 unsigned LATD2
: 1;
12406 unsigned LATD3
: 1;
12407 unsigned LATD4
: 1;
12408 unsigned LATD5
: 1;
12409 unsigned LATD6
: 1;
12410 unsigned LATD7
: 1;
12413 extern __at(0x0F8C) volatile __LATDbits_t LATDbits
;
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12424 //==============================================================================
12427 //==============================================================================
12430 extern __at(0x0F8D) __sfr LATE
;
12434 unsigned LATE0
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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;
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12457 //==============================================================================
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;
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: 1;
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: 1;
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: 1;
12474 extern __at(0x0F8E) volatile __LATFbits_t LATFbits
;
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;
12497 unsigned LATG0
: 1;
12498 unsigned LATG1
: 1;
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: 1;
12500 unsigned LATG3
: 1;
12501 unsigned LATG4
: 1;
12514 extern __at(0x0F8F) volatile __LATGbits_t LATGbits
;
12516 #define _LATG0 0x01
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;
12542 extern __at(0x0F90) volatile __SLRCONbits_t SLRCONbits
;
12552 //==============================================================================
12555 //==============================================================================
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;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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;
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12586 //==============================================================================
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
12603 extern __at(0x0F92) volatile __TRISAbits_t TRISAbits
;
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12616 //==============================================================================
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;
12623 unsigned TRISB0
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: 1;
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: 1;
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;
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12647 //==============================================================================
12650 extern __at(0x0F94) __sfr TRISC
;
12654 unsigned TRISC0
: 1;
12655 unsigned TRISC1
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
12660 unsigned TRISC6
: 1;
12661 unsigned TRISC7
: 1;
12664 extern __at(0x0F94) volatile __TRISCbits_t TRISCbits
;
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12678 //==============================================================================
12681 extern __at(0x0F95) __sfr TRISD
;
12685 unsigned TRISD0
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
12695 extern __at(0x0F95) volatile __TRISDbits_t TRISDbits
;
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12706 //==============================================================================
12709 //==============================================================================
12712 extern __at(0x0F96) __sfr TRISE
;
12716 unsigned TRISE0
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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;
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12739 //==============================================================================
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;
12746 unsigned TRISF0
: 1;
12747 unsigned TRISF1
: 1;
12748 unsigned TRISF2
: 1;
12749 unsigned TRISF3
: 1;
12750 unsigned TRISF4
: 1;
12751 unsigned TRISF5
: 1;
12752 unsigned TRISF6
: 1;
12753 unsigned TRISF7
: 1;
12756 extern __at(0x0F97) volatile __TRISFbits_t TRISFbits
;
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12767 //==============================================================================
12770 //==============================================================================
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;
12779 unsigned TRISG0
: 1;
12780 unsigned TRISG1
: 1;
12781 unsigned TRISG2
: 1;
12782 unsigned TRISG3
: 1;
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: 1;
12791 unsigned TRISG
: 5;
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;
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12804 //==============================================================================
12807 //==============================================================================
12810 extern __at(0x0F99) __sfr CCPTMRS
;
12814 unsigned C1TSEL
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
12824 extern __at(0x0F99) volatile __CCPTMRSbits_t CCPTMRSbits
;
12826 #define _C1TSEL 0x01
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12832 //==============================================================================
12835 //==============================================================================
12838 extern __at(0x0F9A) __sfr REFOCON
;
12844 unsigned RODIV0
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 4;
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;
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12874 //==============================================================================
12877 extern __at(0x0F9B) __sfr OSCTUNE
;
12889 unsigned PLLEN
: 1;
12890 unsigned INTSRC
: 1;
12900 extern __at(0x0F9B) volatile __OSCTUNEbits_t OSCTUNEbits
;
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12911 //==============================================================================
12914 //==============================================================================
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;
12927 unsigned STRSYNC
: 1;
12929 unsigned CMPL0
: 1;
12930 unsigned CMPL1
: 1;
12938 } __PSTR1CONbits_t
;
12940 extern __at(0x0F9C) volatile __PSTR1CONbits_t PSTR1CONbits
;
12946 #define _STRSYNC 0x10
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12950 //==============================================================================
12953 //==============================================================================
12956 extern __at(0x0F9D) __sfr PIE1
;
12962 unsigned TMR1IE
: 1;
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: 1;
12964 unsigned TMR1GIE
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
12985 extern __at(0x0F9D) volatile __PIE1bits_t PIE1bits
;
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12998 //==============================================================================
13001 //==============================================================================
13004 extern __at(0x0F9E) __sfr PIR1
;
13010 unsigned TMR1IF
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
13033 extern __at(0x0F9E) volatile __PIR1bits_t PIR1bits
;
13035 #define _TMR1IF 0x01
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13046 //==============================================================================
13049 //==============================================================================
13052 extern __at(0x0F9F) __sfr IPR1
;
13058 unsigned TMR1IP
: 1;
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: 1;
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: 1;
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: 1;
13062 unsigned TX1IP
: 1;
13063 unsigned RC1IP
: 1;
13065 unsigned PSPIP
: 1;
13081 extern __at(0x0F9F) volatile __IPR1bits_t IPR1bits
;
13083 #define _TMR1IP 0x01
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13094 //==============================================================================
13097 //==============================================================================
13100 extern __at(0x0FA0) __sfr PIE2
;
13106 unsigned TMR3GIE
: 1;
13107 unsigned TMR3IE
: 1;
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: 1;
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: 1;
13113 unsigned OSCFIE
: 1;
13120 unsigned LVDIE
: 1;
13129 extern __at(0x0FA0) volatile __PIE2bits_t PIE2bits
;
13131 #define _TMR3GIE 0x01
13132 #define _TMR3IE 0x02
13133 #define _HLVDIE 0x04
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13138 //==============================================================================
13141 //==============================================================================
13144 extern __at(0x0FA1) __sfr PIR2
;
13150 unsigned TMR3GIF
: 1;
13151 unsigned TMR3IF
: 1;
13152 unsigned HLVDIF
: 1;
13153 unsigned BCLIF
: 1;
13157 unsigned OSCFIF
: 1;
13164 unsigned LVDIF
: 1;
13173 extern __at(0x0FA1) volatile __PIR2bits_t PIR2bits
;
13175 #define _TMR3GIF 0x01
13176 #define _TMR3IF 0x02
13177 #define _HLVDIF 0x04
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13179 #define _BCLIF 0x08
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13182 //==============================================================================
13185 //==============================================================================
13188 extern __at(0x0FA2) __sfr IPR2
;
13194 unsigned TMR3GIP
: 1;
13195 unsigned TMR3IP
: 1;
13196 unsigned HLVDIP
: 1;
13197 unsigned BCLIP
: 1;
13201 unsigned OSCFIP
: 1;
13208 unsigned LVDIP
: 1;
13217 extern __at(0x0FA2) volatile __IPR2bits_t IPR2bits
;
13219 #define _TMR3GIP 0x01
13220 #define _TMR3IP 0x02
13221 #define _HLVDIP 0x04
13222 #define _LVDIP 0x04
13223 #define _BCLIP 0x08
13224 #define _OSCFIP 0x80
13226 //==============================================================================
13229 //==============================================================================
13232 extern __at(0x0FA3) __sfr PIE3
;
13237 unsigned CCP1IE
: 1;
13238 unsigned CCP2IE
: 1;
13239 unsigned CTMUIE
: 1;
13240 unsigned TX2IE
: 1;
13241 unsigned RC2IE
: 1;
13246 extern __at(0x0FA3) volatile __PIE3bits_t PIE3bits
;
13248 #define _CCP1IE 0x02
13249 #define _CCP2IE 0x04
13250 #define _CTMUIE 0x08
13251 #define _TX2IE 0x10
13252 #define _RC2IE 0x20
13254 //==============================================================================
13257 //==============================================================================
13260 extern __at(0x0FA4) __sfr PIR3
;
13265 unsigned CCP1IF
: 1;
13266 unsigned CCP2IF
: 1;
13267 unsigned CTMUIF
: 1;
13268 unsigned TX2IF
: 1;
13269 unsigned RC2IF
: 1;
13274 extern __at(0x0FA4) volatile __PIR3bits_t PIR3bits
;
13276 #define _CCP1IF 0x02
13277 #define _CCP2IF 0x04
13278 #define _CTMUIF 0x08
13279 #define _TX2IF 0x10
13280 #define _RC2IF 0x20
13282 //==============================================================================
13285 //==============================================================================
13288 extern __at(0x0FA5) __sfr IPR3
;
13293 unsigned CCP1IP
: 1;
13294 unsigned CCP2IP
: 1;
13295 unsigned CTMUIP
: 1;
13296 unsigned TX2IP
: 1;
13297 unsigned RC2IP
: 1;
13302 extern __at(0x0FA5) volatile __IPR3bits_t IPR3bits
;
13304 #define _CCP1IP 0x02
13305 #define _CCP2IP 0x04
13306 #define _CTMUIP 0x08
13307 #define _TX2IP 0x10
13308 #define _RC2IP 0x20
13310 //==============================================================================
13313 //==============================================================================
13316 extern __at(0x0FA6) __sfr RCSTA2
;
13325 unsigned ADDEN
: 1;
13334 unsigned RX9D2
: 1;
13335 unsigned OERR2
: 1;
13336 unsigned FERR2
: 1;
13337 unsigned ADDEN2
: 1;
13338 unsigned CREN2
: 1;
13339 unsigned SREN2
: 1;
13341 unsigned SPEN2
: 1;
13345 extern __at(0x0FA6) volatile __RCSTA2bits_t RCSTA2bits
;
13347 #define _RCSTA2_RX9D 0x01
13348 #define _RCSTA2_RX9D2 0x01
13349 #define _RCSTA2_OERR 0x02
13350 #define _RCSTA2_OERR2 0x02
13351 #define _RCSTA2_FERR 0x04
13352 #define _RCSTA2_FERR2 0x04
13353 #define _RCSTA2_ADDEN 0x08
13354 #define _RCSTA2_ADDEN2 0x08
13355 #define _RCSTA2_CREN 0x10
13356 #define _RCSTA2_CREN2 0x10
13357 #define _RCSTA2_SREN 0x20
13358 #define _RCSTA2_SREN2 0x20
13359 #define _RCSTA2_RX9 0x40
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13361 #define _RCSTA2_SPEN 0x80
13362 #define _RCSTA2_SPEN2 0x80
13364 //==============================================================================
13367 //==============================================================================
13370 extern __at(0x0FA7) __sfr BAUDCON1
;
13376 unsigned ABDEN
: 1;
13379 unsigned BRG16
: 1;
13380 unsigned TXCKP
: 1;
13381 unsigned RXDTP
: 1;
13382 unsigned RCIDL
: 1;
13383 unsigned ABDOVF
: 1;
13397 } __BAUDCON1bits_t
;
13399 extern __at(0x0FA7) volatile __BAUDCON1bits_t BAUDCON1bits
;
13401 #define _ABDEN 0x01
13403 #define _BRG16 0x08
13404 #define _TXCKP 0x10
13405 #define _RXDTP 0x20
13406 #define _RCIDL 0x40
13408 #define _ABDOVF 0x80
13410 //==============================================================================
13413 //==============================================================================
13416 extern __at(0x0FA8) __sfr HLVDCON
;
13422 unsigned HLVDL0
: 1;
13423 unsigned HLVDL1
: 1;
13424 unsigned HLVDL2
: 1;
13425 unsigned HLVDL3
: 1;
13426 unsigned HLVDEN
: 1;
13427 unsigned IRVST
: 1;
13428 unsigned BGVST
: 1;
13429 unsigned VDIRMAG
: 1;
13434 unsigned HLVDL
: 4;
13439 extern __at(0x0FA8) volatile __HLVDCONbits_t HLVDCONbits
;
13441 #define _HLVDL0 0x01
13442 #define _HLVDL1 0x02
13443 #define _HLVDL2 0x04
13444 #define _HLVDL3 0x08
13445 #define _HLVDEN 0x10
13446 #define _IRVST 0x20
13447 #define _BGVST 0x40
13448 #define _VDIRMAG 0x80
13450 //==============================================================================
13452 extern __at(0x0FA9) __sfr PR4
;
13454 //==============================================================================
13457 extern __at(0x0FAA) __sfr T1GCON
;
13463 unsigned T1GSS0
: 1;
13464 unsigned T1GSS1
: 1;
13465 unsigned T1GVAL
: 1;
13466 unsigned T1GGO_NOT_T1DONE
: 1;
13467 unsigned T1GSPM
: 1;
13468 unsigned T1GTM
: 1;
13469 unsigned T1GPOL
: 1;
13470 unsigned TMR1GE
: 1;
13478 unsigned T1GGO
: 1;
13490 unsigned NOT_T1DONE
: 1;
13499 unsigned T1GSS
: 2;
13504 extern __at(0x0FAA) volatile __T1GCONbits_t T1GCONbits
;
13506 #define _T1GSS0 0x01
13507 #define _T1GSS1 0x02
13508 #define _T1GVAL 0x04
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13510 #define _T1GGO 0x08
13511 #define _NOT_T1DONE 0x08
13512 #define _T1GSPM 0x10
13513 #define _T1GTM 0x20
13514 #define _T1GPOL 0x40
13515 #define _TMR1GE 0x80
13517 //==============================================================================
13520 //==============================================================================
13523 extern __at(0x0FAB) __sfr RCSTA
;
13532 unsigned ADDEN
: 1;
13542 unsigned OERR1
: 1;
13543 unsigned FERR1
: 1;
13545 unsigned CREN1
: 1;
13546 unsigned SREN1
: 1;
13548 unsigned SPEN1
: 1;
13553 unsigned RX9D1
: 1;
13556 unsigned ADDEN1
: 1;
13559 unsigned NOT_RC8
: 1;
13571 unsigned RC8_9
: 1;
13588 extern __at(0x0FAB) volatile __RCSTAbits_t RCSTAbits
;
13592 #define _RX9D1 0x01
13594 #define _OERR1 0x02
13596 #define _FERR1 0x04
13597 #define _ADDEN 0x08
13599 #define _ADDEN1 0x08
13601 #define _CREN1 0x10
13603 #define _SREN1 0x20
13606 #define _NOT_RC8 0x40
13607 #define _RC8_9 0x40
13610 #define _SPEN1 0x80
13612 //==============================================================================
13615 //==============================================================================
13618 extern __at(0x0FAB) __sfr RCSTA1
;
13627 unsigned ADDEN
: 1;
13637 unsigned OERR1
: 1;
13638 unsigned FERR1
: 1;
13640 unsigned CREN1
: 1;
13641 unsigned SREN1
: 1;
13643 unsigned SPEN1
: 1;
13648 unsigned RX9D1
: 1;
13651 unsigned ADDEN1
: 1;
13654 unsigned NOT_RC8
: 1;
13666 unsigned RC8_9
: 1;
13683 extern __at(0x0FAB) volatile __RCSTA1bits_t RCSTA1bits
;
13685 #define _RCSTA1_RX9D 0x01
13686 #define _RCSTA1_RCD8 0x01
13687 #define _RCSTA1_RX9D1 0x01
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13689 #define _RCSTA1_OERR1 0x02
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13691 #define _RCSTA1_FERR1 0x04
13692 #define _RCSTA1_ADDEN 0x08
13693 #define _RCSTA1_ADEN 0x08
13694 #define _RCSTA1_ADDEN1 0x08
13695 #define _RCSTA1_CREN 0x10
13696 #define _RCSTA1_CREN1 0x10
13697 #define _RCSTA1_SREN 0x20
13698 #define _RCSTA1_SREN1 0x20
13699 #define _RCSTA1_RX9 0x40
13700 #define _RCSTA1_RC9 0x40
13701 #define _RCSTA1_NOT_RC8 0x40
13702 #define _RCSTA1_RC8_9 0x40
13703 #define _RCSTA1_RX91 0x40
13704 #define _RCSTA1_SPEN 0x80
13705 #define _RCSTA1_SPEN1 0x80
13707 //==============================================================================
13710 //==============================================================================
13713 extern __at(0x0FAC) __sfr TXSTA
;
13722 unsigned SENDB
: 1;
13732 unsigned TRMT1
: 1;
13733 unsigned BRGH1
: 1;
13734 unsigned SENDB1
: 1;
13735 unsigned SYNC1
: 1;
13736 unsigned TXEN1
: 1;
13737 unsigned TX8_9
: 1;
13738 unsigned CSRC1
: 1;
13743 unsigned TX9D1
: 1;
13749 unsigned NOT_TX8
: 1;
13766 extern __at(0x0FAC) volatile __TXSTAbits_t TXSTAbits
;
13770 #define _TX9D1 0x01
13772 #define _TRMT1 0x02
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13778 #define _SYNC1 0x10
13780 #define _TXEN1 0x20
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13786 #define _CSRC1 0x80
13788 //==============================================================================
13791 //==============================================================================
13794 extern __at(0x0FAC) __sfr TXSTA1
;
13803 unsigned SENDB
: 1;
13813 unsigned TRMT1
: 1;
13814 unsigned BRGH1
: 1;
13815 unsigned SENDB1
: 1;
13816 unsigned SYNC1
: 1;
13817 unsigned TXEN1
: 1;
13818 unsigned TX8_9
: 1;
13819 unsigned CSRC1
: 1;
13824 unsigned TX9D1
: 1;
13830 unsigned NOT_TX8
: 1;
13847 extern __at(0x0FAC) volatile __TXSTA1bits_t TXSTA1bits
;
13849 #define _TXSTA1_TX9D 0x01
13850 #define _TXSTA1_TXD8 0x01
13851 #define _TXSTA1_TX9D1 0x01
13852 #define _TXSTA1_TRMT 0x02
13853 #define _TXSTA1_TRMT1 0x02
13854 #define _TXSTA1_BRGH 0x04
13855 #define _TXSTA1_BRGH1 0x04
13856 #define _TXSTA1_SENDB 0x08
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13861 #define _TXSTA1_TXEN1 0x20
13862 #define _TXSTA1_TX9 0x40
13863 #define _TXSTA1_TX8_9 0x40
13864 #define _TXSTA1_NOT_TX8 0x40
13865 #define _TXSTA1_TX91 0x40
13866 #define _TXSTA1_CSRC 0x80
13867 #define _TXSTA1_CSRC1 0x80
13869 //==============================================================================
13871 extern __at(0x0FAD) __sfr TXREG
;
13872 extern __at(0x0FAD) __sfr TXREG1
;
13873 extern __at(0x0FAE) __sfr RCREG
;
13874 extern __at(0x0FAE) __sfr RCREG1
;
13875 extern __at(0x0FAF) __sfr SPBRG
;
13876 extern __at(0x0FAF) __sfr SPBRG1
;
13878 //==============================================================================
13881 extern __at(0x0FB0) __sfr T3GCON
;
13887 unsigned T3GSS0
: 1;
13888 unsigned T3GSS1
: 1;
13889 unsigned T3GVAL
: 1;
13890 unsigned T3GGO_NOT_T3DONE
: 1;
13891 unsigned T3GSPM
: 1;
13892 unsigned T3GTM
: 1;
13893 unsigned T3GPOL
: 1;
13894 unsigned TMR3GE
: 1;
13902 unsigned T3GGO
: 1;
13914 unsigned NOT_T3DONE
: 1;
13923 unsigned T3GSS
: 2;
13928 extern __at(0x0FB0) volatile __T3GCONbits_t T3GCONbits
;
13930 #define _T3GSS0 0x01
13931 #define _T3GSS1 0x02
13932 #define _T3GVAL 0x04
13933 #define _T3GGO_NOT_T3DONE 0x08
13934 #define _T3GGO 0x08
13935 #define _NOT_T3DONE 0x08
13936 #define _T3GSPM 0x10
13937 #define _T3GTM 0x20
13938 #define _T3GPOL 0x40
13939 #define _TMR3GE 0x80
13941 //==============================================================================
13944 //==============================================================================
13947 extern __at(0x0FB1) __sfr T3CON
;
13953 unsigned TMR3ON
: 1;
13955 unsigned NOT_T3SYNC
: 1;
13956 unsigned SOSCEN
: 1;
13957 unsigned T3CKPS0
: 1;
13958 unsigned T3CKPS1
: 1;
13959 unsigned TMR3CS0
: 1;
13960 unsigned TMR3CS1
: 1;
13966 unsigned T3CKPS
: 2;
13973 unsigned TMR3CS
: 2;
13977 extern __at(0x0FB1) volatile __T3CONbits_t T3CONbits
;
13979 #define _T3CON_TMR3ON 0x01
13980 #define _T3CON_RD16 0x02
13981 #define _T3CON_NOT_T3SYNC 0x04
13982 #define _T3CON_SOSCEN 0x08
13983 #define _T3CON_T3CKPS0 0x10
13984 #define _T3CON_T3CKPS1 0x20
13985 #define _T3CON_TMR3CS0 0x40
13986 #define _T3CON_TMR3CS1 0x80
13988 //==============================================================================
13990 extern __at(0x0FB2) __sfr TMR3
;
13991 extern __at(0x0FB2) __sfr TMR3L
;
13992 extern __at(0x0FB3) __sfr TMR3H
;
13994 //==============================================================================
13997 extern __at(0x0FB4) __sfr CMSTAT
;
14007 unsigned CMP1OUT
: 1;
14008 unsigned CMP2OUT
: 1;
14011 extern __at(0x0FB4) volatile __CMSTATbits_t CMSTATbits
;
14013 #define _CMP1OUT 0x40
14014 #define _CMP2OUT 0x80
14016 //==============================================================================
14019 //==============================================================================
14022 extern __at(0x0FB4) __sfr CMSTATUS
;
14032 unsigned CMP1OUT
: 1;
14033 unsigned CMP2OUT
: 1;
14034 } __CMSTATUSbits_t
;
14036 extern __at(0x0FB4) volatile __CMSTATUSbits_t CMSTATUSbits
;
14038 #define _CMSTATUS_CMP1OUT 0x40
14039 #define _CMSTATUS_CMP2OUT 0x80
14041 //==============================================================================
14044 //==============================================================================
14047 extern __at(0x0FB5) __sfr CVRCON
;
14058 unsigned CVRSS
: 1;
14059 unsigned CVROE
: 1;
14060 unsigned CVREN
: 1;
14070 extern __at(0x0FB5) volatile __CVRCONbits_t CVRCONbits
;
14077 #define _CVRSS 0x20
14078 #define _CVROE 0x40
14079 #define _CVREN 0x80
14081 //==============================================================================
14084 //==============================================================================
14087 extern __at(0x0FB6) __sfr PIE4
;
14091 unsigned CCP3IE
: 1;
14092 unsigned CCP4IE
: 1;
14093 unsigned CCP5IE
: 1;
14095 unsigned CMP1IE
: 1;
14096 unsigned CMP2IE
: 1;
14098 unsigned TMR4IE
: 1;
14101 extern __at(0x0FB6) volatile __PIE4bits_t PIE4bits
;
14103 #define _CCP3IE 0x01
14104 #define _CCP4IE 0x02
14105 #define _CCP5IE 0x04
14106 #define _CMP1IE 0x10
14107 #define _CMP2IE 0x20
14109 #define _TMR4IE 0x80
14111 //==============================================================================
14114 //==============================================================================
14117 extern __at(0x0FB7) __sfr PIR4
;
14121 unsigned CCP3IF
: 1;
14122 unsigned CCP4IF
: 1;
14123 unsigned CCP5IF
: 1;
14125 unsigned CMP1IF
: 1;
14126 unsigned CMP2IF
: 1;
14128 unsigned TMR4IF
: 1;
14131 extern __at(0x0FB7) volatile __PIR4bits_t PIR4bits
;
14133 #define _CCP3IF 0x01
14134 #define _CCP4IF 0x02
14135 #define _CCP5IF 0x04
14136 #define _CMP1IF 0x10
14137 #define _CMP2IF 0x20
14139 #define _TMR4IF 0x80
14141 //==============================================================================
14144 //==============================================================================
14147 extern __at(0x0FB8) __sfr IPR4
;
14151 unsigned CCP3IP
: 1;
14152 unsigned CCP4IP
: 1;
14153 unsigned CCP5IP
: 1;
14155 unsigned CMP1IP
: 1;
14156 unsigned CMP2IP
: 1;
14158 unsigned TMR4IP
: 1;
14161 extern __at(0x0FB8) volatile __IPR4bits_t IPR4bits
;
14163 #define _CCP3IP 0x01
14164 #define _CCP4IP 0x02
14165 #define _CCP5IP 0x04
14166 #define _CMP1IP 0x10
14167 #define _CMP2IP 0x20
14169 #define _TMR4IP 0x80
14171 //==============================================================================
14174 //==============================================================================
14177 extern __at(0x0FB9) __sfr BAUDCON2
;
14183 unsigned ABDEN
: 1;
14186 unsigned BRG16
: 1;
14187 unsigned TXCKP
: 1;
14188 unsigned RXDTP
: 1;
14189 unsigned RCIDL
: 1;
14190 unsigned ABDOVF
: 1;
14204 } __BAUDCON2bits_t
;
14206 extern __at(0x0FB9) volatile __BAUDCON2bits_t BAUDCON2bits
;
14208 #define _BAUDCON2_ABDEN 0x01
14209 #define _BAUDCON2_WUE 0x02
14210 #define _BAUDCON2_BRG16 0x08
14211 #define _BAUDCON2_TXCKP 0x10
14212 #define _BAUDCON2_RXDTP 0x20
14213 #define _BAUDCON2_RCIDL 0x40
14214 #define _BAUDCON2_RCMT 0x40
14215 #define _BAUDCON2_ABDOVF 0x80
14217 //==============================================================================
14220 //==============================================================================
14223 extern __at(0x0FBA) __sfr TXSTA2
;
14232 unsigned SENDB
: 1;
14241 unsigned TX9D2
: 1;
14242 unsigned TRMT2
: 1;
14243 unsigned BRGH2
: 1;
14244 unsigned SENDB2
: 1;
14245 unsigned SYNC2
: 1;
14246 unsigned TXEN2
: 1;
14248 unsigned CSRC2
: 1;
14252 extern __at(0x0FBA) volatile __TXSTA2bits_t TXSTA2bits
;
14254 #define _TXSTA2_TX9D 0x01
14255 #define _TXSTA2_TX9D2 0x01
14256 #define _TXSTA2_TRMT 0x02
14257 #define _TXSTA2_TRMT2 0x02
14258 #define _TXSTA2_BRGH 0x04
14259 #define _TXSTA2_BRGH2 0x04
14260 #define _TXSTA2_SENDB 0x08
14261 #define _TXSTA2_SENDB2 0x08
14262 #define _TXSTA2_SYNC 0x10
14263 #define _TXSTA2_SYNC2 0x10
14264 #define _TXSTA2_TXEN 0x20
14265 #define _TXSTA2_TXEN2 0x20
14266 #define _TXSTA2_TX9 0x40
14267 #define _TXSTA2_TX92 0x40
14268 #define _TXSTA2_CSRC 0x80
14269 #define _TXSTA2_CSRC2 0x80
14271 //==============================================================================
14274 //==============================================================================
14277 extern __at(0x0FBB) __sfr CCP1CON
;
14283 unsigned CCP1M0
: 1;
14284 unsigned CCP1M1
: 1;
14285 unsigned CCP1M2
: 1;
14286 unsigned CCP1M3
: 1;
14287 unsigned DC1B0
: 1;
14288 unsigned DC1B1
: 1;
14299 unsigned CCP1Y
: 1;
14300 unsigned CCP1X
: 1;
14307 unsigned CCP1M
: 4;
14325 extern __at(0x0FBB) volatile __CCP1CONbits_t CCP1CONbits
;
14327 #define _CCP1M0 0x01
14328 #define _CCP1M1 0x02
14329 #define _CCP1M2 0x04
14330 #define _CCP1M3 0x08
14331 #define _DC1B0 0x10
14332 #define _CCP1Y 0x10
14333 #define _DC1B1 0x20
14334 #define _CCP1X 0x20
14338 //==============================================================================
14341 //==============================================================================
14344 extern __at(0x0FBB) __sfr ECCP1CON
;
14350 unsigned CCP1M0
: 1;
14351 unsigned CCP1M1
: 1;
14352 unsigned CCP1M2
: 1;
14353 unsigned CCP1M3
: 1;
14354 unsigned DC1B0
: 1;
14355 unsigned DC1B1
: 1;
14366 unsigned CCP1Y
: 1;
14367 unsigned CCP1X
: 1;
14374 unsigned CCP1M
: 4;
14390 } __ECCP1CONbits_t
;
14392 extern __at(0x0FBB) volatile __ECCP1CONbits_t ECCP1CONbits
;
14394 #define _ECCP1CON_CCP1M0 0x01
14395 #define _ECCP1CON_CCP1M1 0x02
14396 #define _ECCP1CON_CCP1M2 0x04
14397 #define _ECCP1CON_CCP1M3 0x08
14398 #define _ECCP1CON_DC1B0 0x10
14399 #define _ECCP1CON_CCP1Y 0x10
14400 #define _ECCP1CON_DC1B1 0x20
14401 #define _ECCP1CON_CCP1X 0x20
14402 #define _ECCP1CON_P1M0 0x40
14403 #define _ECCP1CON_P1M1 0x80
14405 //==============================================================================
14407 extern __at(0x0FBC) __sfr CCPR1
;
14408 extern __at(0x0FBC) __sfr CCPR1L
;
14409 extern __at(0x0FBD) __sfr CCPR1H
;
14411 //==============================================================================
14414 extern __at(0x0FBE) __sfr ECCP1DEL
;
14420 unsigned P1DC0
: 1;
14421 unsigned P1DC1
: 1;
14422 unsigned P1DC2
: 1;
14423 unsigned P1DC3
: 1;
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: 1;
14425 unsigned P1DC5
: 1;
14426 unsigned P1DC6
: 1;
14427 unsigned P1RSEN
: 1;
14435 } __ECCP1DELbits_t
;
14437 extern __at(0x0FBE) volatile __ECCP1DELbits_t ECCP1DELbits
;
14439 #define _P1DC0 0x01
14440 #define _P1DC1 0x02
14441 #define _P1DC2 0x04
14442 #define _P1DC3 0x08
14443 #define _P1DC4 0x10
14444 #define _P1DC5 0x20
14445 #define _P1DC6 0x40
14446 #define _P1RSEN 0x80
14448 //==============================================================================
14451 //==============================================================================
14454 extern __at(0x0FBE) __sfr PWM1CON
;
14460 unsigned P1DC0
: 1;
14461 unsigned P1DC1
: 1;
14462 unsigned P1DC2
: 1;
14463 unsigned P1DC3
: 1;
14464 unsigned P1DC4
: 1;
14465 unsigned P1DC5
: 1;
14466 unsigned P1DC6
: 1;
14467 unsigned P1RSEN
: 1;
14477 extern __at(0x0FBE) volatile __PWM1CONbits_t PWM1CONbits
;
14479 #define _PWM1CON_P1DC0 0x01
14480 #define _PWM1CON_P1DC1 0x02
14481 #define _PWM1CON_P1DC2 0x04
14482 #define _PWM1CON_P1DC3 0x08
14483 #define _PWM1CON_P1DC4 0x10
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14485 #define _PWM1CON_P1DC6 0x40
14486 #define _PWM1CON_P1RSEN 0x80
14488 //==============================================================================
14491 //==============================================================================
14494 extern __at(0x0FBF) __sfr ECCP1AS
;
14500 unsigned PSS1BD0
: 1;
14501 unsigned PSS1BD1
: 1;
14502 unsigned PSS1AC0
: 1;
14503 unsigned PSS1AC1
: 1;
14504 unsigned ECCP1AS0
: 1;
14505 unsigned ECCP1AS1
: 1;
14506 unsigned ECCP1AS2
: 1;
14507 unsigned ECCP1ASE
: 1;
14512 unsigned PSS1BD
: 2;
14519 unsigned PSS1AC
: 2;
14526 unsigned ECCP1AS
: 3;
14531 extern __at(0x0FBF) volatile __ECCP1ASbits_t ECCP1ASbits
;
14533 #define _PSS1BD0 0x01
14534 #define _PSS1BD1 0x02
14535 #define _PSS1AC0 0x04
14536 #define _PSS1AC1 0x08
14537 #define _ECCP1AS0 0x10
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14540 #define _ECCP1ASE 0x80
14542 //==============================================================================
14545 //==============================================================================
14548 extern __at(0x0FC0) __sfr ADCON2
;
14554 unsigned ADCS0
: 1;
14555 unsigned ADCS1
: 1;
14556 unsigned ADCS2
: 1;
14557 unsigned ACQT0
: 1;
14558 unsigned ACQT1
: 1;
14559 unsigned ACQT2
: 1;
14578 extern __at(0x0FC0) volatile __ADCON2bits_t ADCON2bits
;
14580 #define _ADCS0 0x01
14581 #define _ADCS1 0x02
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14585 #define _ACQT2 0x20
14588 //==============================================================================
14591 //==============================================================================
14594 extern __at(0x0FC1) __sfr ADCON1
;
14600 unsigned CHSN0
: 1;
14601 unsigned CHSN1
: 1;
14602 unsigned CHSN2
: 1;
14603 unsigned VNCFG
: 1;
14604 unsigned VCFG0
: 1;
14605 unsigned VCFG1
: 1;
14606 unsigned TRIGSEL0
: 1;
14607 unsigned TRIGSEL1
: 1;
14626 unsigned TRIGSEL
: 2;
14630 extern __at(0x0FC1) volatile __ADCON1bits_t ADCON1bits
;
14632 #define _CHSN0 0x01
14633 #define _CHSN1 0x02
14634 #define _CHSN2 0x04
14635 #define _VNCFG 0x08
14636 #define _VCFG0 0x10
14637 #define _VCFG1 0x20
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14639 #define _TRIGSEL1 0x80
14641 //==============================================================================
14644 //==============================================================================
14647 extern __at(0x0FC2) __sfr ADCON0
;
14654 unsigned GO_NOT_DONE
: 1;
14690 unsigned NOT_DONE
: 1;
14707 extern __at(0x0FC2) volatile __ADCON0bits_t ADCON0bits
;
14710 #define _GO_NOT_DONE 0x02
14713 #define _NOT_DONE 0x02
14720 //==============================================================================
14722 extern __at(0x0FC3) __sfr ADRES
;
14723 extern __at(0x0FC3) __sfr ADRESL
;
14724 extern __at(0x0FC4) __sfr ADRESH
;
14726 //==============================================================================
14729 extern __at(0x0FC5) __sfr SSPCON2
;
14739 unsigned ACKEN
: 1;
14740 unsigned ACKDT
: 1;
14741 unsigned ACKSTAT
: 1;
14748 unsigned ADMSK1
: 1;
14749 unsigned ADMSK2
: 1;
14750 unsigned ADMSK3
: 1;
14751 unsigned ADMSK4
: 1;
14752 unsigned ADMSK5
: 1;
14758 extern __at(0x0FC5) volatile __SSPCON2bits_t SSPCON2bits
;
14762 #define _ADMSK1 0x02
14764 #define _ADMSK2 0x04
14766 #define _ADMSK3 0x08
14767 #define _ACKEN 0x10
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14769 #define _ACKDT 0x20
14770 #define _ADMSK5 0x20
14771 #define _ACKSTAT 0x40
14774 //==============================================================================
14777 //==============================================================================
14780 extern __at(0x0FC6) __sfr SSPCON1
;
14786 unsigned SSPM0
: 1;
14787 unsigned SSPM1
: 1;
14788 unsigned SSPM2
: 1;
14789 unsigned SSPM3
: 1;
14791 unsigned SSPEN
: 1;
14792 unsigned SSPOV
: 1;
14803 extern __at(0x0FC6) volatile __SSPCON1bits_t SSPCON1bits
;
14805 #define _SSPM0 0x01
14806 #define _SSPM1 0x02
14807 #define _SSPM2 0x04
14808 #define _SSPM3 0x08
14810 #define _SSPEN 0x20
14811 #define _SSPOV 0x40
14814 //==============================================================================
14817 //==============================================================================
14820 extern __at(0x0FC7) __sfr SSPSTAT
;
14828 unsigned R_NOT_W
: 1;
14831 unsigned D_NOT_A
: 1;
14841 unsigned I2C_START
: 1;
14842 unsigned I2C_STOP
: 1;
14852 unsigned NOT_W
: 1;
14855 unsigned NOT_A
: 1;
14864 unsigned NOT_WRITE
: 1;
14867 unsigned NOT_ADDRESS
: 1;
14876 unsigned READ_WRITE
: 1;
14879 unsigned DATA_ADDRESS
: 1;
14888 unsigned I2C_READ
: 1;
14891 unsigned I2C_DAT
: 1;
14897 extern __at(0x0FC7) volatile __SSPSTATbits_t SSPSTATbits
;
14901 #define _R_NOT_W 0x04
14903 #define _NOT_W 0x04
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14905 #define _READ_WRITE 0x04
14906 #define _I2C_READ 0x04
14908 #define _I2C_START 0x08
14910 #define _I2C_STOP 0x10
14911 #define _D_NOT_A 0x20
14913 #define _NOT_A 0x20
14914 #define _NOT_ADDRESS 0x20
14915 #define _DATA_ADDRESS 0x20
14916 #define _I2C_DAT 0x20
14920 //==============================================================================
14923 //==============================================================================
14926 extern __at(0x0FC8) __sfr SSPADD
;
14940 extern __at(0x0FC8) volatile __SSPADDbits_t SSPADDbits
;
14951 //==============================================================================
14953 extern __at(0x0FC9) __sfr SSPBUF
;
14955 //==============================================================================
14958 extern __at(0x0FCA) __sfr T2CON
;
14964 unsigned T2CKPS0
: 1;
14965 unsigned T2CKPS1
: 1;
14966 unsigned TMR2ON
: 1;
14967 unsigned T2OUTPS0
: 1;
14968 unsigned T2OUTPS1
: 1;
14969 unsigned T2OUTPS2
: 1;
14970 unsigned T2OUTPS3
: 1;
14976 unsigned T2CKPS
: 2;
14983 unsigned T2OUTPS
: 4;
14988 extern __at(0x0FCA) volatile __T2CONbits_t T2CONbits
;
14990 #define _T2CKPS0 0x01
14991 #define _T2CKPS1 0x02
14992 #define _TMR2ON 0x04
14993 #define _T2OUTPS0 0x08
14994 #define _T2OUTPS1 0x10
14995 #define _T2OUTPS2 0x20
14996 #define _T2OUTPS3 0x40
14998 //==============================================================================
15000 extern __at(0x0FCB) __sfr PR2
;
15001 extern __at(0x0FCC) __sfr TMR2
;
15003 //==============================================================================
15006 extern __at(0x0FCD) __sfr T1CON
;
15012 unsigned TMR1ON
: 1;
15014 unsigned NOT_T1SYNC
: 1;
15015 unsigned SOSCEN
: 1;
15016 unsigned T1CKPS0
: 1;
15017 unsigned T1CKPS1
: 1;
15018 unsigned TMR1CS0
: 1;
15019 unsigned TMR1CS1
: 1;
15025 unsigned T1CKPS
: 2;
15032 unsigned TMR1CS
: 2;
15036 extern __at(0x0FCD) volatile __T1CONbits_t T1CONbits
;
15038 #define _TMR1ON 0x01
15040 #define _NOT_T1SYNC 0x04
15041 #define _SOSCEN 0x08
15042 #define _T1CKPS0 0x10
15043 #define _T1CKPS1 0x20
15044 #define _TMR1CS0 0x40
15045 #define _TMR1CS1 0x80
15047 //==============================================================================
15049 extern __at(0x0FCE) __sfr TMR1
;
15050 extern __at(0x0FCE) __sfr TMR1L
;
15051 extern __at(0x0FCF) __sfr TMR1H
;
15053 //==============================================================================
15056 extern __at(0x0FD0) __sfr RCON
;
15062 unsigned NOT_BOR
: 1;
15063 unsigned NOT_POR
: 1;
15064 unsigned NOT_PD
: 1;
15065 unsigned NOT_TO
: 1;
15066 unsigned NOT_RI
: 1;
15067 unsigned NOT_CM
: 1;
15068 unsigned SBOREN
: 1;
15085 extern __at(0x0FD0) volatile __RCONbits_t RCONbits
;
15087 #define _NOT_BOR 0x01
15089 #define _NOT_POR 0x02
15091 #define _NOT_PD 0x04
15093 #define _NOT_TO 0x08
15095 #define _NOT_RI 0x10
15097 #define _NOT_CM 0x20
15099 #define _SBOREN 0x40
15102 //==============================================================================
15105 //==============================================================================
15108 extern __at(0x0FD1) __sfr WDTCON
;
15114 unsigned SWDTEN
: 1;
15115 unsigned ULPSINK
: 1;
15116 unsigned ULPEN
: 1;
15118 unsigned SRETEN
: 1;
15119 unsigned ULPLVL
: 1;
15121 unsigned REGSLP
: 1;
15126 unsigned SWDTE
: 1;
15137 extern __at(0x0FD1) volatile __WDTCONbits_t WDTCONbits
;
15139 #define _SWDTEN 0x01
15140 #define _SWDTE 0x01
15141 #define _ULPSINK 0x02
15142 #define _ULPEN 0x04
15143 #define _SRETEN 0x10
15144 #define _ULPLVL 0x20
15145 #define _REGSLP 0x80
15147 //==============================================================================
15150 //==============================================================================
15153 extern __at(0x0FD2) __sfr OSCCON2
;
15159 unsigned MFIOSEL
: 1;
15160 unsigned MFIOFS
: 1;
15161 unsigned LVDL2
: 1;
15162 unsigned SOSCGO
: 1;
15163 unsigned SOSCDRV
: 1;
15165 unsigned SOSCRUN
: 1;
15171 unsigned LVDL0
: 1;
15172 unsigned LVDL1
: 1;
15174 unsigned LVDL3
: 1;
15188 extern __at(0x0FD2) volatile __OSCCON2bits_t OSCCON2bits
;
15190 #define _MFIOSEL 0x01
15191 #define _LVDL0 0x01
15192 #define _MFIOFS 0x02
15193 #define _LVDL1 0x02
15194 #define _LVDL2 0x04
15195 #define _SOSCGO 0x08
15196 #define _LVDL3 0x08
15197 #define _SOSCDRV 0x10
15198 #define _SOSCRUN 0x40
15200 //==============================================================================
15203 //==============================================================================
15206 extern __at(0x0FD3) __sfr OSCCON
;
15214 unsigned HFIOFS
: 1;
15216 unsigned IRCF0
: 1;
15217 unsigned IRCF1
: 1;
15218 unsigned IRCF2
: 1;
15219 unsigned IDLEN
: 1;
15236 extern __at(0x0FD3) volatile __OSCCONbits_t OSCCONbits
;
15240 #define _HFIOFS 0x04
15242 #define _IRCF0 0x10
15243 #define _IRCF1 0x20
15244 #define _IRCF2 0x40
15245 #define _IDLEN 0x80
15247 //==============================================================================
15250 //==============================================================================
15253 extern __at(0x0FD5) __sfr T0CON
;
15259 unsigned T0PS0
: 1;
15260 unsigned T0PS1
: 1;
15261 unsigned T0PS2
: 1;
15265 unsigned T08BIT
: 1;
15266 unsigned TMR0ON
: 1;
15276 extern __at(0x0FD5) volatile __T0CONbits_t T0CONbits
;
15278 #define _T0PS0 0x01
15279 #define _T0PS1 0x02
15280 #define _T0PS2 0x04
15284 #define _T08BIT 0x40
15285 #define _TMR0ON 0x80
15287 //==============================================================================
15289 extern __at(0x0FD6) __sfr TMR0
;
15290 extern __at(0x0FD6) __sfr TMR0L
;
15291 extern __at(0x0FD7) __sfr TMR0H
;
15293 //==============================================================================
15296 extern __at(0x0FD8) __sfr STATUS
;
15310 extern __at(0x0FD8) volatile __STATUSbits_t STATUSbits
;
15318 //==============================================================================
15320 extern __at(0x0FD9) __sfr FSR2L
;
15321 extern __at(0x0FDA) __sfr FSR2H
;
15322 extern __at(0x0FDB) __sfr PLUSW2
;
15323 extern __at(0x0FDC) __sfr PREINC2
;
15324 extern __at(0x0FDD) __sfr POSTDEC2
;
15325 extern __at(0x0FDE) __sfr POSTINC2
;
15326 extern __at(0x0FDF) __sfr INDF2
;
15327 extern __at(0x0FE0) __sfr BSR
;
15328 extern __at(0x0FE1) __sfr FSR1L
;
15329 extern __at(0x0FE2) __sfr FSR1H
;
15330 extern __at(0x0FE3) __sfr PLUSW1
;
15331 extern __at(0x0FE4) __sfr PREINC1
;
15332 extern __at(0x0FE5) __sfr POSTDEC1
;
15333 extern __at(0x0FE6) __sfr POSTINC1
;
15334 extern __at(0x0FE7) __sfr INDF1
;
15335 extern __at(0x0FE8) __sfr WREG
;
15336 extern __at(0x0FE9) __sfr FSR0L
;
15337 extern __at(0x0FEA) __sfr FSR0H
;
15338 extern __at(0x0FEB) __sfr PLUSW0
;
15339 extern __at(0x0FEC) __sfr PREINC0
;
15340 extern __at(0x0FED) __sfr POSTDEC0
;
15341 extern __at(0x0FEE) __sfr POSTINC0
;
15342 extern __at(0x0FEF) __sfr INDF0
;
15344 //==============================================================================
15347 extern __at(0x0FF0) __sfr INTCON3
;
15353 unsigned INT1IF
: 1;
15354 unsigned INT2IF
: 1;
15355 unsigned INT3IF
: 1;
15356 unsigned INT1IE
: 1;
15357 unsigned INT2IE
: 1;
15358 unsigned INT3IE
: 1;
15359 unsigned INT1IP
: 1;
15360 unsigned INT2IP
: 1;
15365 unsigned INT1F
: 1;
15366 unsigned INT2F
: 1;
15367 unsigned INT3F
: 1;
15368 unsigned INT1E
: 1;
15369 unsigned INT2E
: 1;
15370 unsigned INT3E
: 1;
15371 unsigned INT1P
: 1;
15372 unsigned INT2P
: 1;
15376 extern __at(0x0FF0) volatile __INTCON3bits_t INTCON3bits
;
15378 #define _INT1IF 0x01
15379 #define _INT1F 0x01
15380 #define _INT2IF 0x02
15381 #define _INT2F 0x02
15382 #define _INT3IF 0x04
15383 #define _INT3F 0x04
15384 #define _INT1IE 0x08
15385 #define _INT1E 0x08
15386 #define _INT2IE 0x10
15387 #define _INT2E 0x10
15388 #define _INT3IE 0x20
15389 #define _INT3E 0x20
15390 #define _INT1IP 0x40
15391 #define _INT1P 0x40
15392 #define _INT2IP 0x80
15393 #define _INT2P 0x80
15395 //==============================================================================
15398 //==============================================================================
15401 extern __at(0x0FF1) __sfr INTCON2
;
15408 unsigned INT3IP
: 1;
15409 unsigned TMR0IP
: 1;
15410 unsigned INTEDG3
: 1;
15411 unsigned INTEDG2
: 1;
15412 unsigned INTEDG1
: 1;
15413 unsigned INTEDG0
: 1;
15414 unsigned NOT_RBPU
: 1;
15420 unsigned INT3P
: 1;
15430 extern __at(0x0FF1) volatile __INTCON2bits_t INTCON2bits
;
15433 #define _INT3IP 0x02
15434 #define _INT3P 0x02
15435 #define _TMR0IP 0x04
15437 #define _INTEDG3 0x08
15438 #define _INTEDG2 0x10
15439 #define _INTEDG1 0x20
15440 #define _INTEDG0 0x40
15441 #define _NOT_RBPU 0x80
15444 //==============================================================================
15447 //==============================================================================
15450 extern __at(0x0FF2) __sfr INTCON
;
15457 unsigned INT0IF
: 1;
15458 unsigned TMR0IF
: 1;
15460 unsigned INT0IE
: 1;
15461 unsigned TMR0IE
: 1;
15462 unsigned PEIE_GIEL
: 1;
15463 unsigned GIE_GIEH
: 1;
15469 unsigned INT0F
: 1;
15472 unsigned INT0E
: 1;
15491 extern __at(0x0FF2) volatile __INTCONbits_t INTCONbits
;
15494 #define _INT0IF 0x02
15495 #define _INT0F 0x02
15496 #define _TMR0IF 0x04
15499 #define _INT0IE 0x10
15500 #define _INT0E 0x10
15501 #define _TMR0IE 0x20
15503 #define _PEIE_GIEL 0x40
15506 #define _GIE_GIEH 0x80
15510 //==============================================================================
15513 //==============================================================================
15516 extern __at(0x0FF2) __sfr INTCON1
;
15523 unsigned INT0IF
: 1;
15524 unsigned TMR0IF
: 1;
15526 unsigned INT0IE
: 1;
15527 unsigned TMR0IE
: 1;
15528 unsigned PEIE_GIEL
: 1;
15529 unsigned GIE_GIEH
: 1;
15535 unsigned INT0F
: 1;
15538 unsigned INT0E
: 1;
15557 extern __at(0x0FF2) volatile __INTCON1bits_t INTCON1bits
;
15559 #define _INTCON1_RBIF 0x01
15560 #define _INTCON1_INT0IF 0x02
15561 #define _INTCON1_INT0F 0x02
15562 #define _INTCON1_TMR0IF 0x04
15563 #define _INTCON1_T0IF 0x04
15564 #define _INTCON1_RBIE 0x08
15565 #define _INTCON1_INT0IE 0x10
15566 #define _INTCON1_INT0E 0x10
15567 #define _INTCON1_TMR0IE 0x20
15568 #define _INTCON1_T0IE 0x20
15569 #define _INTCON1_PEIE_GIEL 0x40
15570 #define _INTCON1_PEIE 0x40
15571 #define _INTCON1_GIEL 0x40
15572 #define _INTCON1_GIE_GIEH 0x80
15573 #define _INTCON1_GIE 0x80
15574 #define _INTCON1_GIEH 0x80
15576 //==============================================================================
15578 extern __at(0x0FF3) __sfr PROD
;
15579 extern __at(0x0FF3) __sfr PRODL
;
15580 extern __at(0x0FF4) __sfr PRODH
;
15581 extern __at(0x0FF5) __sfr TABLAT
;
15582 extern __at(0x0FF6) __sfr TBLPTR
;
15583 extern __at(0x0FF6) __sfr TBLPTRL
;
15584 extern __at(0x0FF7) __sfr TBLPTRH
;
15585 extern __at(0x0FF8) __sfr TBLPTRU
;
15586 extern __at(0x0FF9) __sfr PC
;
15587 extern __at(0x0FF9) __sfr PCL
;
15588 extern __at(0x0FFA) __sfr PCLATH
;
15589 extern __at(0x0FFB) __sfr PCLATU
;
15591 //==============================================================================
15594 extern __at(0x0FFC) __sfr STKPTR
;
15606 unsigned STKUNF
: 1;
15607 unsigned STKFUL
: 1;
15619 unsigned STKOVF
: 1;
15629 extern __at(0x0FFC) volatile __STKPTRbits_t STKPTRbits
;
15636 #define _STKUNF 0x40
15637 #define _STKFUL 0x80
15638 #define _STKOVF 0x80
15640 //==============================================================================
15642 extern __at(0x0FFD) __sfr TOS
;
15643 extern __at(0x0FFD) __sfr TOSL
;
15644 extern __at(0x0FFE) __sfr TOSH
;
15645 extern __at(0x0FFF) __sfr TOSU
;
15647 //==============================================================================
15649 // Configuration Bits
15651 //==============================================================================
15653 #define __CONFIG1L 0x300000
15654 #define __CONFIG1H 0x300001
15655 #define __CONFIG2L 0x300002
15656 #define __CONFIG2H 0x300003
15657 #define __CONFIG3H 0x300005
15658 #define __CONFIG4L 0x300006
15659 #define __CONFIG5L 0x300008
15660 #define __CONFIG5H 0x300009
15661 #define __CONFIG6L 0x30000A
15662 #define __CONFIG6H 0x30000B
15663 #define __CONFIG7L 0x30000C
15664 #define __CONFIG7H 0x30000D
15666 //----------------------------- CONFIG1L Options -------------------------------
15668 #define _RETEN_ON_1L 0xFE // Ultra low-power regulator is Enabled (Controlled by SRETEN bit).
15669 #define _RETEN_OFF_1L 0xFF // Ultra low-power regulator is Disabled (Controlled by REGSLP bit).
15670 #define _INTOSCSEL_LOW_1L 0xFB // LF-INTOSC in Low-power mode during Sleep.
15671 #define _INTOSCSEL_HIGH_1L 0xFF // LF-INTOSC in High-power mode during Sleep.
15672 #define _SOSCSEL_LOW_1L 0xEF // Low Power SOSC circuit selected.
15673 #define _SOSCSEL_DIG_1L 0xF7 // Digital (SCLKI) mode.
15674 #define _SOSCSEL_HIGH_1L 0xFF // High Power SOSC circuit selected.
15675 #define _XINST_OFF_1L 0xBF // Disabled.
15676 #define _XINST_ON_1L 0xFF // Enabled.
15678 //----------------------------- CONFIG1H Options -------------------------------
15680 #define _FOSC_LP_1H 0xF0 // LP oscillator.
15681 #define _FOSC_XT_1H 0xF1 // XT oscillator.
15682 #define _FOSC_HS2_1H 0xF2 // HS oscillator (High power, 16 MHz - 25 MHz).
15683 #define _FOSC_HS1_1H 0xF3 // HS oscillator (Medium power, 4 MHz - 16 MHz).
15684 #define _FOSC_EC3IO_1H 0xF4 // EC oscillator, CLKOUT function on OSC2 (High power, 16 MHz - 64 MHz).
15685 #define _FOSC_EC3_1H 0xF5 // EC oscillator (High power, 16 MHz - 64 MHz).
15686 #define _FOSC_RC_1H 0xF6 // External RC oscillator, CLKOUT function on OSC2.
15687 #define _FOSC_RCIO_1H 0xF7 // External RC oscillator.
15688 #define _FOSC_INTIO2_1H 0xF8 // Internal RC oscillator.
15689 #define _FOSC_INTIO1_1H 0xF9 // Internal RC oscillator, CLKOUT function on OSC2.
15690 #define _FOSC_EC2IO_1H 0xFA // EC oscillator, CLKOUT function on OSC2 (Medium power, 160 kHz - 16 MHz).
15691 #define _FOSC_EC2_1H 0xFB // EC oscillator (Medium power, 160 kHz - 16 MHz).
15692 #define _FOSC_EC1IO_1H 0xFC // EC oscillator, CLKOUT function on OSC2 (Low power, DC - 160 kHz).
15693 #define _FOSC_EC1_1H 0xFD // EC oscillator (Low power, DC - 160 kHz).
15694 #define _PLLCFG_OFF_1H 0xEF // Disabled.
15695 #define _PLLCFG_ON_1H 0xFF // Enabled.
15696 #define _FCMEN_OFF_1H 0xBF // Disabled.
15697 #define _FCMEN_ON_1H 0xFF // Enabled.
15698 #define _IESO_OFF_1H 0x7F // Disabled.
15699 #define _IESO_ON_1H 0xFF // Enabled.
15701 //----------------------------- CONFIG2L Options -------------------------------
15703 #define _PWRTEN_ON_2L 0xFE // Enabled.
15704 #define _PWRTEN_OFF_2L 0xFF // Disabled.
15705 #define _BOREN_OFF_2L 0xF9 // Disabled in hardware, SBOREN disabled.
15706 #define _BOREN_ON_2L 0xFB // Controlled with SBOREN bit.
15707 #define _BOREN_NOSLP_2L 0xFD // Enabled while active, disabled in SLEEP, SBOREN disabled.
15708 #define _BOREN_SBORDIS_2L 0xFF // Enabled in hardware, SBOREN disabled.
15709 #define _BORV_0_2L 0xE7 // 3.0V.
15710 #define _BORV_1_2L 0xEF // 2.7V.
15711 #define _BORV_2_2L 0xF7 // 2.0V.
15712 #define _BORV_3_2L 0xFF // 1.8V.
15713 #define _BORPWR_LOW_2L 0x9F // BORMV set to low power level.
15714 #define _BORPWR_MEDIUM_2L 0xBF // BORMV set to medium power level.
15715 #define _BORPWR_HIGH_2L 0xDF // BORMV set to high power level.
15716 #define _BORPWR_ZPBORMV_2L 0xFF // ZPBORMV instead of BORMV is selected.
15718 //----------------------------- CONFIG2H Options -------------------------------
15720 #define _WDTEN_OFF_2H 0xFC // WDT disabled in hardware; SWDTEN bit disabled.
15721 #define _WDTEN_NOSLP_2H 0xFD // WDT enabled only while device is active and disabled in Sleep mode; SWDTEN bit disabled.
15722 #define _WDTEN_ON_2H 0xFE // WDT controlled by SWDTEN bit setting.
15723 #define _WDTEN_SWDTDIS_2H 0xFF // WDT enabled in hardware; SWDTEN bit disabled.
15724 #define _WDTPS_1_2H 0x83 // 1:1.
15725 #define _WDTPS_2_2H 0x87 // 1:2.
15726 #define _WDTPS_4_2H 0x8B // 1:4.
15727 #define _WDTPS_8_2H 0x8F // 1:8.
15728 #define _WDTPS_16_2H 0x93 // 1:16.
15729 #define _WDTPS_32_2H 0x97 // 1:32.
15730 #define _WDTPS_64_2H 0x9B // 1:64.
15731 #define _WDTPS_128_2H 0x9F // 1:128.
15732 #define _WDTPS_256_2H 0xA3 // 1:256.
15733 #define _WDTPS_512_2H 0xA7 // 1:512.
15734 #define _WDTPS_1024_2H 0xAB // 1:1024.
15735 #define _WDTPS_2048_2H 0xAF // 1:2048.
15736 #define _WDTPS_4096_2H 0xB3 // 1:4096.
15737 #define _WDTPS_8192_2H 0xB7 // 1:8192.
15738 #define _WDTPS_16384_2H 0xBB // 1:16384.
15739 #define _WDTPS_32768_2H 0xBF // 1:32768.
15740 #define _WDTPS_65536_2H 0xC3 // 1:65536.
15741 #define _WDTPS_131072_2H 0xC7 // 1:131072.
15742 #define _WDTPS_262144_2H 0xCB // 1:262144.
15743 #define _WDTPS_524288_2H 0xCF // 1:524288.
15744 #define _WDTPS_1048576_2H 0xFF // 1:1048576.
15746 //----------------------------- CONFIG3H Options -------------------------------
15748 #define _CANMX_PORTE_3H 0xFE // ECAN TX and RX pins are located on RE5 and RE4, respectively.
15749 #define _CANMX_PORTB_3H 0xFF // ECAN TX and RX pins are located on RB2 and RB3, respectively.
15750 #define _T0CKMX_PORTG_3H 0xFD // Timer0 gets its clock input from the RG4/T0CKI pin on 64-pin packages.
15751 #define _T0CKMX_PORTB_3H 0xFF // Timer0 gets its clock input from the RB5/T0CKI pin on 64-pin packages.
15752 #define _T3CKMX_PORTB_3H 0xFB // Timer3 gets its clock input from the RB5/T3CKI pin on 64-pin packages.
15753 #define _T3CKMX_PORTG_3H 0xFF // Timer3 gets its clock input from the RG2/T3CKI pin on 64-pin packages.
15754 #define _MSSPMSK_MSK5_3H 0xF7 // 5 bit address masking mode.
15755 #define _MSSPMSK_MSK7_3H 0xFF // 7 Bit address masking mode.
15756 #define _MCLRE_OFF_3H 0x7F // MCLR Disabled, RG5 Enabled.
15757 #define _MCLRE_ON_3H 0xFF // MCLR Enabled, RE3 Disabled.
15759 //----------------------------- CONFIG4L Options -------------------------------
15761 #define _STVREN_OFF_4L 0xFE // Disabled.
15762 #define _STVREN_ON_4L 0xFF // Enabled.
15763 #define _BBSIZ_BB1K_4L 0xEF // 1K word Boot Block size.
15764 #define _BBSIZ_BB2K_4L 0xFF // 2K word Boot Block size.
15766 //----------------------------- CONFIG5L Options -------------------------------
15768 #define _CP0_ON_5L 0xFE // Enabled.
15769 #define _CP0_OFF_5L 0xFF // Disabled.
15770 #define _CP1_ON_5L 0xFD // Enabled.
15771 #define _CP1_OFF_5L 0xFF // Disabled.
15772 #define _CP2_ON_5L 0xFB // Enabled.
15773 #define _CP2_OFF_5L 0xFF // Disabled.
15774 #define _CP3_ON_5L 0xF7 // Enabled.
15775 #define _CP3_OFF_5L 0xFF // Disabled.
15777 //----------------------------- CONFIG5H Options -------------------------------
15779 #define _CPB_ON_5H 0xBF // Enabled.
15780 #define _CPB_OFF_5H 0xFF // Disabled.
15781 #define _CPD_ON_5H 0x7F // Enabled.
15782 #define _CPD_OFF_5H 0xFF // Disabled.
15784 //----------------------------- CONFIG6L Options -------------------------------
15786 #define _WRT0_ON_6L 0xFE // Enabled.
15787 #define _WRT0_OFF_6L 0xFF // Disabled.
15788 #define _WRT1_ON_6L 0xFD // Enabled.
15789 #define _WRT1_OFF_6L 0xFF // Disabled.
15790 #define _WRT2_ON_6L 0xFB // Enabled.
15791 #define _WRT2_OFF_6L 0xFF // Disabled.
15792 #define _WRT3_ON_6L 0xF7 // Enabled.
15793 #define _WRT3_OFF_6L 0xFF // Disabled.
15795 //----------------------------- CONFIG6H Options -------------------------------
15797 #define _WRTC_ON_6H 0xDF // Enabled.
15798 #define _WRTC_OFF_6H 0xFF // Disabled.
15799 #define _WRTB_ON_6H 0xBF // Enabled.
15800 #define _WRTB_OFF_6H 0xFF // Disabled.
15801 #define _WRTD_ON_6H 0x7F // Enabled.
15802 #define _WRTD_OFF_6H 0xFF // Disabled.
15804 //----------------------------- CONFIG7L Options -------------------------------
15806 #define _EBTR0_ON_7L 0xFE // Enabled.
15807 #define _EBTR0_OFF_7L 0xFF // Disabled.
15808 #define _EBTR1_ON_7L 0xFD // Enabled.
15809 #define _EBTR1_OFF_7L 0xFF // Disabled.
15810 #define _EBTR2_ON_7L 0xFB // Enabled.
15811 #define _EBTR2_OFF_7L 0xFF // Disabled.
15812 #define _EBTR3_ON_7L 0xF7 // Enabled.
15813 #define _EBTR3_OFF_7L 0xFF // Disabled.
15815 //----------------------------- CONFIG7H Options -------------------------------
15817 #define _EBTRB_ON_7H 0xBF // Enabled.
15818 #define _EBTRB_OFF_7H 0xFF // Disabled.
15820 //==============================================================================
15822 #define __DEVID1 0x3FFFFE
15823 #define __DEVID2 0x3FFFFF
15825 #define __IDLOC0 0x200000
15826 #define __IDLOC1 0x200001
15827 #define __IDLOC2 0x200002
15828 #define __IDLOC3 0x200003
15829 #define __IDLOC4 0x200004
15830 #define __IDLOC5 0x200005
15831 #define __IDLOC6 0x200006
15832 #define __IDLOC7 0x200007
15834 #endif // #ifndef __PIC18LF65K80_H__