2 * This declarations of the PIC18LF6621 MCU.
4 * This file is part of the GNU PIC library for SDCC, originally
5 * created by Molnar Karoly <molnarkaroly@users.sf.net> 2016.
7 * This file is generated automatically by the cinc2h.pl, 2016-04-13 17:24:06 UTC.
9 * SDCC is licensed under the GNU Public license (GPL) v2. Note that
10 * this license covers the code to the compiler and other executables,
11 * but explicitly does not cover any code or objects generated by sdcc.
13 * For pic device libraries and header files which are derived from
14 * Microchip header (.inc) and linker script (.lkr) files Microchip
15 * requires that "The header files should state that they are only to be
16 * used with authentic Microchip devices" which makes them incompatible
17 * with the GPL. Pic device libraries and header files are located at
18 * non-free/lib and non-free/include directories respectively.
19 * Sdcc should be run with the --use-non-free command line option in
20 * order to include non-free header files and libraries.
22 * See http://sdcc.sourceforge.net/ for the latest information on sdcc.
25 #ifndef __PIC18LF6621_H__
26 #define __PIC18LF6621_H__
28 //==============================================================================
30 //==============================================================================
32 // Register Definitions
34 //==============================================================================
37 //==============================================================================
40 extern __at(0x0F67) __sfr ECCP2DEL
;
81 extern __at(0x0F67) volatile __ECCP2DELbits_t ECCP2DELbits
;
83 #define _ECCP2DEL_P2DC0 0x01
84 #define _ECCP2DEL_PDC0 0x01
85 #define _ECCP2DEL_P2DC1 0x02
86 #define _ECCP2DEL_PDC1 0x02
87 #define _ECCP2DEL_P2DC2 0x04
88 #define _ECCP2DEL_PDC2 0x04
89 #define _ECCP2DEL_P2DC3 0x08
90 #define _ECCP2DEL_PDC3 0x08
91 #define _ECCP2DEL_P2DC4 0x10
92 #define _ECCP2DEL_PDC4 0x10
93 #define _ECCP2DEL_P2DC5 0x20
94 #define _ECCP2DEL_PDC5 0x20
95 #define _ECCP2DEL_P2DC6 0x40
96 #define _ECCP2DEL_PDC6 0x40
97 #define _ECCP2DEL_P2RSEN 0x80
98 #define _ECCP2DEL_PRSEN 0x80
100 //==============================================================================
103 //==============================================================================
106 extern __at(0x0F67) __sfr PWM2CON
;
147 extern __at(0x0F67) volatile __PWM2CONbits_t PWM2CONbits
;
149 #define _PWM2CON_P2DC0 0x01
150 #define _PWM2CON_PDC0 0x01
151 #define _PWM2CON_P2DC1 0x02
152 #define _PWM2CON_PDC1 0x02
153 #define _PWM2CON_P2DC2 0x04
154 #define _PWM2CON_PDC2 0x04
155 #define _PWM2CON_P2DC3 0x08
156 #define _PWM2CON_PDC3 0x08
157 #define _PWM2CON_P2DC4 0x10
158 #define _PWM2CON_PDC4 0x10
159 #define _PWM2CON_P2DC5 0x20
160 #define _PWM2CON_PDC5 0x20
161 #define _PWM2CON_P2DC6 0x40
162 #define _PWM2CON_PDC6 0x40
163 #define _PWM2CON_P2RSEN 0x80
164 #define _PWM2CON_PRSEN 0x80
166 //==============================================================================
169 //==============================================================================
172 extern __at(0x0F68) __sfr ECCP2AS
;
178 unsigned PSS2BD0
: 1;
179 unsigned PSS2BD1
: 1;
180 unsigned PSS2AC0
: 1;
181 unsigned PSS2AC1
: 1;
182 unsigned ECCP2AS0
: 1;
183 unsigned ECCP2AS1
: 1;
184 unsigned ECCP2AS2
: 1;
185 unsigned ECCP2ASE
: 1;
229 unsigned ECCP2AS
: 3;
234 extern __at(0x0F68) volatile __ECCP2ASbits_t ECCP2ASbits
;
236 #define _ECCP2AS_PSS2BD0 0x01
237 #define _ECCP2AS_PSSBD0 0x01
238 #define _ECCP2AS_PSS2BD1 0x02
239 #define _ECCP2AS_PSSBD1 0x02
240 #define _ECCP2AS_PSS2AC0 0x04
241 #define _ECCP2AS_PSSAC0 0x04
242 #define _ECCP2AS_PSS2AC1 0x08
243 #define _ECCP2AS_PSSAC1 0x08
244 #define _ECCP2AS_ECCP2AS0 0x10
245 #define _ECCP2AS_ECCP2AS1 0x20
246 #define _ECCP2AS_ECCP2AS2 0x40
247 #define _ECCP2AS_ECCP2ASE 0x80
249 //==============================================================================
252 //==============================================================================
255 extern __at(0x0F69) __sfr ECCP3DEL
;
296 extern __at(0x0F69) volatile __ECCP3DELbits_t ECCP3DELbits
;
298 #define _ECCP3DEL_P3DC0 0x01
299 #define _ECCP3DEL_PDC0 0x01
300 #define _ECCP3DEL_P3DC1 0x02
301 #define _ECCP3DEL_PDC1 0x02
302 #define _ECCP3DEL_P3DC2 0x04
303 #define _ECCP3DEL_PDC2 0x04
304 #define _ECCP3DEL_P3DC3 0x08
305 #define _ECCP3DEL_PDC3 0x08
306 #define _ECCP3DEL_P3DC4 0x10
307 #define _ECCP3DEL_PDC4 0x10
308 #define _ECCP3DEL_P3DC5 0x20
309 #define _ECCP3DEL_PDC5 0x20
310 #define _ECCP3DEL_P3DC6 0x40
311 #define _ECCP3DEL_PDC6 0x40
312 #define _ECCP3DEL_P3RSEN 0x80
313 #define _ECCP3DEL_PRSEN 0x80
315 //==============================================================================
318 //==============================================================================
321 extern __at(0x0F69) __sfr PWM3CON
;
362 extern __at(0x0F69) volatile __PWM3CONbits_t PWM3CONbits
;
364 #define _PWM3CON_P3DC0 0x01
365 #define _PWM3CON_PDC0 0x01
366 #define _PWM3CON_P3DC1 0x02
367 #define _PWM3CON_PDC1 0x02
368 #define _PWM3CON_P3DC2 0x04
369 #define _PWM3CON_PDC2 0x04
370 #define _PWM3CON_P3DC3 0x08
371 #define _PWM3CON_PDC3 0x08
372 #define _PWM3CON_P3DC4 0x10
373 #define _PWM3CON_PDC4 0x10
374 #define _PWM3CON_P3DC5 0x20
375 #define _PWM3CON_PDC5 0x20
376 #define _PWM3CON_P3DC6 0x40
377 #define _PWM3CON_PDC6 0x40
378 #define _PWM3CON_P3RSEN 0x80
379 #define _PWM3CON_PRSEN 0x80
381 //==============================================================================
384 //==============================================================================
387 extern __at(0x0F6A) __sfr ECCP3AS
;
393 unsigned PSS3BD0
: 1;
394 unsigned PSS3BD1
: 1;
395 unsigned PSS3AC0
: 1;
396 unsigned PSS3AC1
: 1;
397 unsigned ECCP3AS0
: 1;
398 unsigned ECCP3AS1
: 1;
399 unsigned ECCP3AS2
: 1;
400 unsigned ECCP3ASE
: 1;
444 unsigned ECCP3AS
: 3;
449 extern __at(0x0F6A) volatile __ECCP3ASbits_t ECCP3ASbits
;
451 #define _ECCP3AS_PSS3BD0 0x01
452 #define _ECCP3AS_PSSBD0 0x01
453 #define _ECCP3AS_PSS3BD1 0x02
454 #define _ECCP3AS_PSSBD1 0x02
455 #define _ECCP3AS_PSS3AC0 0x04
456 #define _ECCP3AS_PSSAC0 0x04
457 #define _ECCP3AS_PSS3AC1 0x08
458 #define _ECCP3AS_PSSAC1 0x08
459 #define _ECCP3AS_ECCP3AS0 0x10
460 #define _ECCP3AS_ECCP3AS1 0x20
461 #define _ECCP3AS_ECCP3AS2 0x40
462 #define _ECCP3AS_ECCP3ASE 0x80
464 //==============================================================================
467 //==============================================================================
470 extern __at(0x0F6B) __sfr RCSTA2
;
523 extern __at(0x0F6B) volatile __RCSTA2bits_t RCSTA2bits
;
525 #define _RCSTA2_RX9D 0x01
526 #define _RCSTA2_RX9D2 0x01
527 #define _RCSTA2_OERR 0x02
528 #define _RCSTA2_OERR2 0x02
529 #define _RCSTA2_FERR 0x04
530 #define _RCSTA2_FERR2 0x04
531 #define _RCSTA2_ADDEN 0x08
532 #define _RCSTA2_ADEN 0x08
533 #define _RCSTA2_ADDEN2 0x08
534 #define _RCSTA2_ADEN2 0x08
535 #define _RCSTA2_CREN 0x10
536 #define _RCSTA2_CREN2 0x10
537 #define _RCSTA2_SREN 0x20
538 #define _RCSTA2_SREN2 0x20
539 #define _RCSTA2_RX9 0x40
540 #define _RCSTA2_RX92 0x40
541 #define _RCSTA2_SPEN 0x80
542 #define _RCSTA2_SPEN2 0x80
544 //==============================================================================
547 //==============================================================================
550 extern __at(0x0F6C) __sfr TXSTA2
;
579 extern __at(0x0F6C) volatile __TXSTA2bits_t TXSTA2bits
;
581 #define _TXSTA2_TX9D 0x01
582 #define _TXSTA2_TX9D2 0x01
583 #define _TXSTA2_TRMT 0x02
584 #define _TXSTA2_TRMT2 0x02
585 #define _TXSTA2_BRGH 0x04
586 #define _TXSTA2_BRGH2 0x04
587 #define _TXSTA2_SENDB 0x08
588 #define _TXSTA2_SENDB2 0x08
589 #define _TXSTA2_SYNC 0x10
590 #define _TXSTA2_SYNC2 0x10
591 #define _TXSTA2_TXEN 0x20
592 #define _TXSTA2_TXEN2 0x20
593 #define _TXSTA2_TX9 0x40
594 #define _TXSTA2_TX92 0x40
595 #define _TXSTA2_CSRC 0x80
596 #define _TXSTA2_CSRC2 0x80
598 //==============================================================================
600 extern __at(0x0F6D) __sfr TXREG2
;
601 extern __at(0x0F6E) __sfr RCREG2
;
602 extern __at(0x0F6F) __sfr SPBRG2
;
604 //==============================================================================
607 extern __at(0x0F70) __sfr CCP5CON
;
649 extern __at(0x0F70) volatile __CCP5CONbits_t CCP5CONbits
;
660 //==============================================================================
662 extern __at(0x0F71) __sfr CCPR5
;
663 extern __at(0x0F71) __sfr CCPR5L
;
664 extern __at(0x0F72) __sfr CCPR5H
;
666 //==============================================================================
669 extern __at(0x0F73) __sfr CCP4CON
;
711 extern __at(0x0F73) volatile __CCP4CONbits_t CCP4CONbits
;
722 //==============================================================================
724 extern __at(0x0F74) __sfr CCPR4
;
725 extern __at(0x0F74) __sfr CCPR4L
;
726 extern __at(0x0F75) __sfr CCPR4H
;
728 //==============================================================================
731 extern __at(0x0F76) __sfr T4CON
;
737 unsigned T4CKPS0
: 1;
738 unsigned T4CKPS1
: 1;
740 unsigned TOUTPS0
: 1;
741 unsigned TOUTPS1
: 1;
742 unsigned TOUTPS2
: 1;
743 unsigned TOUTPS3
: 1;
752 unsigned T4OUTPS0
: 1;
753 unsigned T4OUTPS1
: 1;
754 unsigned T4OUTPS2
: 1;
755 unsigned T4OUTPS3
: 1;
768 unsigned T4OUTPS
: 4;
780 extern __at(0x0F76) volatile __T4CONbits_t T4CONbits
;
782 #define _T4CKPS0 0x01
783 #define _T4CKPS1 0x02
785 #define _TOUTPS0 0x08
786 #define _T4OUTPS0 0x08
787 #define _TOUTPS1 0x10
788 #define _T4OUTPS1 0x10
789 #define _TOUTPS2 0x20
790 #define _T4OUTPS2 0x20
791 #define _TOUTPS3 0x40
792 #define _T4OUTPS3 0x40
794 //==============================================================================
796 extern __at(0x0F77) __sfr PR4
;
797 extern __at(0x0F78) __sfr TMR4
;
799 //==============================================================================
802 extern __at(0x0F79) __sfr ECCP1DEL
;
849 extern __at(0x0F79) volatile __ECCP1DELbits_t ECCP1DELbits
;
869 //==============================================================================
872 //==============================================================================
875 extern __at(0x0F79) __sfr PWM1CON
;
922 extern __at(0x0F79) volatile __PWM1CONbits_t PWM1CONbits
;
924 #define _PWM1CON_P1DC0 0x01
925 #define _PWM1CON_PDC0 0x01
926 #define _PWM1CON_P1DC1 0x02
927 #define _PWM1CON_PDC1 0x02
928 #define _PWM1CON_P1DC2 0x04
929 #define _PWM1CON_PDC2 0x04
930 #define _PWM1CON_P1DC3 0x08
931 #define _PWM1CON_PDC3 0x08
932 #define _PWM1CON_P1DC4 0x10
933 #define _PWM1CON_PDC4 0x10
934 #define _PWM1CON_P1DC5 0x20
935 #define _PWM1CON_PDC5 0x20
936 #define _PWM1CON_P1DC6 0x40
937 #define _PWM1CON_PDC6 0x40
938 #define _PWM1CON_P1RSEN 0x80
939 #define _PWM1CON_P1DC7 0x80
940 #define _PWM1CON_PRSEN 0x80
942 //==============================================================================
945 //==============================================================================
948 extern __at(0x0F7C) __sfr BAUDCON2
;
989 extern __at(0x0F7C) volatile __BAUDCON2bits_t BAUDCON2bits
;
991 #define _BAUDCON2_ABDEN 0x01
992 #define _BAUDCON2_ABDEN2 0x01
993 #define _BAUDCON2_WUE 0x02
994 #define _BAUDCON2_WUE2 0x02
995 #define _BAUDCON2_BRG16 0x08
996 #define _BAUDCON2_BRG162 0x08
997 #define _BAUDCON2_SCKP 0x10
998 #define _BAUDCON2_SCKP2 0x10
999 #define _BAUDCON2_RCIDL 0x40
1000 #define _BAUDCON2_RCMT 0x40
1001 #define _BAUDCON2_RCIDL2 0x40
1003 //==============================================================================
1006 //==============================================================================
1009 extern __at(0x0F7C) __sfr BAUDCTL2
;
1027 unsigned ABDEN2
: 1;
1030 unsigned BRG162
: 1;
1045 unsigned RCIDL2
: 1;
1050 extern __at(0x0F7C) volatile __BAUDCTL2bits_t BAUDCTL2bits
;
1052 #define _BAUDCTL2_ABDEN 0x01
1053 #define _BAUDCTL2_ABDEN2 0x01
1054 #define _BAUDCTL2_WUE 0x02
1055 #define _BAUDCTL2_WUE2 0x02
1056 #define _BAUDCTL2_BRG16 0x08
1057 #define _BAUDCTL2_BRG162 0x08
1058 #define _BAUDCTL2_SCKP 0x10
1059 #define _BAUDCTL2_SCKP2 0x10
1060 #define _BAUDCTL2_RCIDL 0x40
1061 #define _BAUDCTL2_RCMT 0x40
1062 #define _BAUDCTL2_RCIDL2 0x40
1064 //==============================================================================
1066 extern __at(0x0F7D) __sfr SPBRGH2
;
1068 //==============================================================================
1071 extern __at(0x0F7E) __sfr BAUDCON
;
1100 extern __at(0x0F7E) volatile __BAUDCONbits_t BAUDCONbits
;
1109 //==============================================================================
1112 //==============================================================================
1115 extern __at(0x0F7E) __sfr BAUDCON1
;
1144 extern __at(0x0F7E) volatile __BAUDCON1bits_t BAUDCON1bits
;
1146 #define _BAUDCON1_ABDEN 0x01
1147 #define _BAUDCON1_WUE 0x02
1148 #define _BAUDCON1_BRG16 0x08
1149 #define _BAUDCON1_SCKP 0x10
1150 #define _BAUDCON1_RCIDL 0x40
1151 #define _BAUDCON1_RCMT 0x40
1153 //==============================================================================
1156 //==============================================================================
1159 extern __at(0x0F7E) __sfr BAUDCTL1
;
1188 extern __at(0x0F7E) volatile __BAUDCTL1bits_t BAUDCTL1bits
;
1190 #define _BAUDCTL1_ABDEN 0x01
1191 #define _BAUDCTL1_WUE 0x02
1192 #define _BAUDCTL1_BRG16 0x08
1193 #define _BAUDCTL1_SCKP 0x10
1194 #define _BAUDCTL1_RCIDL 0x40
1195 #define _BAUDCTL1_RCMT 0x40
1197 //==============================================================================
1199 extern __at(0x0F7F) __sfr SPBRGH
;
1200 extern __at(0x0F7F) __sfr SPBRGH1
;
1202 //==============================================================================
1205 extern __at(0x0F80) __sfr PORTA
;
1252 extern __at(0x0F80) volatile __PORTAbits_t PORTAbits
;
1254 #define _PORTA_RA0 0x01
1255 #define _PORTA_AN0 0x01
1256 #define _PORTA_RA1 0x02
1257 #define _PORTA_AN1 0x02
1258 #define _PORTA_RA2 0x04
1259 #define _PORTA_AN2 0x04
1260 #define _PORTA_VREFM 0x04
1261 #define _PORTA_RA3 0x08
1262 #define _PORTA_AN3 0x08
1263 #define _PORTA_VREFP 0x08
1264 #define _PORTA_RA4 0x10
1265 #define _PORTA_T0CKI 0x10
1266 #define _PORTA_RA5 0x20
1267 #define _PORTA_AN4 0x20
1268 #define _PORTA_LVDIN 0x20
1269 #define _PORTA_RA6 0x40
1270 #define _PORTA_OSC2 0x40
1271 #define _PORTA_CLKO 0x40
1273 //==============================================================================
1276 //==============================================================================
1279 extern __at(0x0F81) __sfr PORTB
;
1332 extern __at(0x0F81) volatile __PORTBbits_t PORTBbits
;
1334 #define _PORTB_RB0 0x01
1335 #define _PORTB_INT0 0x01
1336 #define _PORTB_RB1 0x02
1337 #define _PORTB_INT1 0x02
1338 #define _PORTB_RB2 0x04
1339 #define _PORTB_INT2 0x04
1340 #define _PORTB_RB3 0x08
1341 #define _PORTB_INT3 0x08
1342 #define _PORTB_RB4 0x10
1343 #define _PORTB_KBI0 0x10
1344 #define _PORTB_RB5 0x20
1345 #define _PORTB_KBI1 0x20
1346 #define _PORTB_PGM 0x20
1347 #define _PORTB_RB6 0x40
1348 #define _PORTB_KBI2 0x40
1349 #define _PORTB_PGC 0x40
1350 #define _PORTB_RB7 0x80
1351 #define _PORTB_KBI3 0x80
1352 #define _PORTB_PGD 0x80
1354 //==============================================================================
1357 //==============================================================================
1360 extern __at(0x0F82) __sfr PORTC
;
1390 unsigned T13CKI
: 1;
1401 extern __at(0x0F82) volatile __PORTCbits_t PORTCbits
;
1403 #define _PORTC_RC0 0x01
1404 #define _PORTC_T1OSO 0x01
1405 #define _PORTC_T13CKI 0x01
1406 #define _PORTC_RC1 0x02
1407 #define _PORTC_T1OSI 0x02
1408 #define _PORTC_RC2 0x04
1409 #define _PORTC_CCP1 0x04
1410 #define _PORTC_P1A 0x04
1411 #define _PORTC_RC3 0x08
1412 #define _PORTC_SCK 0x08
1413 #define _PORTC_SCL 0x08
1414 #define _PORTC_RC4 0x10
1415 #define _PORTC_SDI 0x10
1416 #define _PORTC_SDA 0x10
1417 #define _PORTC_RC5 0x20
1418 #define _PORTC_SDO 0x20
1419 #define _PORTC_RC6 0x40
1420 #define _PORTC_TX1 0x40
1421 #define _PORTC_CK1 0x40
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1426 //==============================================================================
1429 //==============================================================================
1432 extern __at(0x0F83) __sfr PORTD
;
1461 extern __at(0x0F83) volatile __PORTDbits_t PORTDbits
;
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1480 //==============================================================================
1483 //==============================================================================
1486 extern __at(0x0F84) __sfr PORTE
;
1527 extern __at(0x0F84) volatile __PORTEbits_t PORTEbits
;
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1548 //==============================================================================
1551 //==============================================================================
1554 extern __at(0x0F85) __sfr PORTF
;
1585 unsigned C2OUTF
: 1;
1586 unsigned C1OUTF
: 1;
1589 unsigned CVREFF
: 1;
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;
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1617 //==============================================================================
1620 //==============================================================================
1623 extern __at(0x0F86) __sfr PORTG
;
1670 extern __at(0x0F86) volatile __PORTGbits_t PORTGbits
;
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1691 //==============================================================================
1694 //==============================================================================
1697 extern __at(0x0F89) __sfr LATA
;
1720 extern __at(0x0F89) volatile __LATAbits_t LATAbits
;
1730 //==============================================================================
1733 //==============================================================================
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;
1750 extern __at(0x0F8A) volatile __LATBbits_t LATBbits
;
1761 //==============================================================================
1764 //==============================================================================
1767 extern __at(0x0F8B) __sfr LATC
;
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;
1792 //==============================================================================
1795 //==============================================================================
1798 extern __at(0x0F8C) __sfr LATD
;
1812 extern __at(0x0F8C) volatile __LATDbits_t LATDbits
;
1823 //==============================================================================
1826 //==============================================================================
1829 extern __at(0x0F8D) __sfr LATE
;
1843 extern __at(0x0F8D) volatile __LATEbits_t LATEbits
;
1854 //==============================================================================
1857 //==============================================================================
1860 extern __at(0x0F8E) __sfr LATF
;
1874 extern __at(0x0F8E) volatile __LATFbits_t LATFbits
;
1885 //==============================================================================
1888 //==============================================================================
1891 extern __at(0x0F8F) __sfr LATG
;
1914 extern __at(0x0F8F) volatile __LATGbits_t LATGbits
;
1922 //==============================================================================
1925 //==============================================================================
1928 extern __at(0x0F92) __sfr DDRA
;
1934 unsigned TRISA0
: 1;
1935 unsigned TRISA1
: 1;
1936 unsigned TRISA2
: 1;
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: 1;
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: 1;
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: 1;
1940 unsigned TRISA6
: 1;
1969 extern __at(0x0F92) volatile __DDRAbits_t DDRAbits
;
1971 #define _TRISA0 0x01
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1986 //==============================================================================
1989 //==============================================================================
1992 extern __at(0x0F92) __sfr TRISA
;
1998 unsigned TRISA0
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
2033 extern __at(0x0F92) volatile __TRISAbits_t TRISAbits
;
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2050 //==============================================================================
2053 //==============================================================================
2056 extern __at(0x0F93) __sfr DDRB
;
2062 unsigned TRISB0
: 1;
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: 1;
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: 1;
2085 extern __at(0x0F93) volatile __DDRBbits_t DDRBbits
;
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2107 //==============================================================================
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;
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: 1;
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: 1;
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: 1;
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2139 extern __at(0x0F93) volatile __TRISBbits_t TRISBbits
;
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2158 //==============================================================================
2161 //==============================================================================
2164 extern __at(0x0F94) __sfr DDRC
;
2170 unsigned TRISC0
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
2193 extern __at(0x0F94) volatile __DDRCbits_t DDRCbits
;
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2215 //==============================================================================
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;
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: 1;
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: 1;
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: 1;
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: 1;
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: 1;
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;
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2269 //==============================================================================
2272 extern __at(0x0F95) __sfr DDRD
;
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: 1;
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: 1;
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: 1;
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: 1;
2301 extern __at(0x0F95) volatile __DDRDbits_t DDRDbits
;
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2326 extern __at(0x0F95) __sfr TRISD
;
2332 unsigned TRISD0
: 1;
2333 unsigned TRISD1
: 1;
2334 unsigned TRISD2
: 1;
2335 unsigned TRISD3
: 1;
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: 1;
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: 1;
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: 1;
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: 1;
2355 extern __at(0x0F95) volatile __TRISDbits_t TRISDbits
;
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2377 //==============================================================================
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;
2386 unsigned TRISE0
: 1;
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: 1;
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: 1;
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;
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;
2440 unsigned TRISE0
: 1;
2441 unsigned TRISE1
: 1;
2442 unsigned TRISE2
: 1;
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;
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2472 #define _TRISE_RE3 0x08
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2485 //==============================================================================
2488 extern __at(0x0F97) __sfr DDRF
;
2494 unsigned TRISF0
: 1;
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: 1;
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: 1;
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: 1;
2517 extern __at(0x0F97) volatile __DDRFbits_t DDRFbits
;
2519 #define _TRISF0 0x01
2521 #define _TRISF1 0x02
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2527 #define _TRISF4 0x10
2529 #define _TRISF5 0x20
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2536 //==============================================================================
2539 //==============================================================================
2542 extern __at(0x0F97) __sfr TRISF
;
2548 unsigned TRISF0
: 1;
2549 unsigned TRISF1
: 1;
2550 unsigned TRISF2
: 1;
2551 unsigned TRISF3
: 1;
2552 unsigned TRISF4
: 1;
2553 unsigned TRISF5
: 1;
2554 unsigned TRISF6
: 1;
2555 unsigned TRISF7
: 1;
2571 extern __at(0x0F97) volatile __TRISFbits_t TRISFbits
;
2573 #define _TRISF_TRISF0 0x01
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2590 //==============================================================================
2593 //==============================================================================
2596 extern __at(0x0F98) __sfr DDRG
;
2602 unsigned TRISG0
: 1;
2603 unsigned TRISG1
: 1;
2604 unsigned TRISG2
: 1;
2605 unsigned TRISG3
: 1;
2606 unsigned TRISG4
: 1;
2637 extern __at(0x0F98) volatile __DDRGbits_t DDRGbits
;
2639 #define _TRISG0 0x01
2641 #define _TRISG1 0x02
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2650 //==============================================================================
2653 //==============================================================================
2656 extern __at(0x0F98) __sfr TRISG
;
2662 unsigned TRISG0
: 1;
2663 unsigned TRISG1
: 1;
2664 unsigned TRISG2
: 1;
2665 unsigned TRISG3
: 1;
2666 unsigned TRISG4
: 1;
2697 extern __at(0x0F98) volatile __TRISGbits_t TRISGbits
;
2699 #define _TRISG_TRISG0 0x01
2700 #define _TRISG_RG0 0x01
2701 #define _TRISG_TRISG1 0x02
2702 #define _TRISG_RG1 0x02
2703 #define _TRISG_TRISG2 0x04
2704 #define _TRISG_RG2 0x04
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2706 #define _TRISG_RG3 0x08
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2710 //==============================================================================
2713 //==============================================================================
2716 extern __at(0x0F9D) __sfr PIE1
;
2722 unsigned TMR1IE
: 1;
2723 unsigned TMR2IE
: 1;
2724 unsigned CCP1IE
: 1;
2745 extern __at(0x0F9D) volatile __PIE1bits_t PIE1bits
;
2747 #define _TMR1IE 0x01
2748 #define _TMR2IE 0x02
2749 #define _CCP1IE 0x04
2758 //==============================================================================
2761 //==============================================================================
2764 extern __at(0x0F9E) __sfr PIR1
;
2770 unsigned TMR1IF
: 1;
2771 unsigned TMR2IF
: 1;
2772 unsigned CCP1IF
: 1;
2793 extern __at(0x0F9E) volatile __PIR1bits_t PIR1bits
;
2795 #define _TMR1IF 0x01
2796 #define _TMR2IF 0x02
2797 #define _CCP1IF 0x04
2806 //==============================================================================
2809 //==============================================================================
2812 extern __at(0x0F9F) __sfr IPR1
;
2818 unsigned TMR1IP
: 1;
2819 unsigned TMR2IP
: 1;
2820 unsigned CCP1IP
: 1;
2841 extern __at(0x0F9F) volatile __IPR1bits_t IPR1bits
;
2843 #define _TMR1IP 0x01
2844 #define _TMR2IP 0x02
2845 #define _CCP1IP 0x04
2854 //==============================================================================
2857 //==============================================================================
2860 extern __at(0x0FA0) __sfr PIE2
;
2864 unsigned CCP2IE
: 1;
2865 unsigned TMR3IE
: 1;
2874 extern __at(0x0FA0) volatile __PIE2bits_t PIE2bits
;
2876 #define _CCP2IE 0x01
2877 #define _TMR3IE 0x02
2883 //==============================================================================
2886 //==============================================================================
2889 extern __at(0x0FA1) __sfr PIR2
;
2893 unsigned CCP2IF
: 1;
2894 unsigned TMR3IF
: 1;
2903 extern __at(0x0FA1) volatile __PIR2bits_t PIR2bits
;
2905 #define _CCP2IF 0x01
2906 #define _TMR3IF 0x02
2912 //==============================================================================
2915 //==============================================================================
2918 extern __at(0x0FA2) __sfr IPR2
;
2922 unsigned CCP2IP
: 1;
2923 unsigned TMR3IP
: 1;
2932 extern __at(0x0FA2) volatile __IPR2bits_t IPR2bits
;
2934 #define _CCP2IP 0x01
2935 #define _TMR3IP 0x02
2941 //==============================================================================
2944 //==============================================================================
2947 extern __at(0x0FA3) __sfr PIE3
;
2951 unsigned CCP3IE
: 1;
2952 unsigned CCP4IE
: 1;
2953 unsigned CCP5IE
: 1;
2954 unsigned TMR4IE
: 1;
2961 extern __at(0x0FA3) volatile __PIE3bits_t PIE3bits
;
2963 #define _CCP3IE 0x01
2964 #define _CCP4IE 0x02
2965 #define _CCP5IE 0x04
2966 #define _TMR4IE 0x08
2970 //==============================================================================
2973 //==============================================================================
2976 extern __at(0x0FA4) __sfr PIR3
;
2980 unsigned CCP3IF
: 1;
2981 unsigned CCP4IF
: 1;
2982 unsigned CCP5IF
: 1;
2983 unsigned TMR4IF
: 1;
2990 extern __at(0x0FA4) volatile __PIR3bits_t PIR3bits
;
2992 #define _CCP3IF 0x01
2993 #define _CCP4IF 0x02
2994 #define _CCP5IF 0x04
2995 #define _TMR4IF 0x08
2999 //==============================================================================
3002 //==============================================================================
3005 extern __at(0x0FA5) __sfr IPR3
;
3009 unsigned CCP3IP
: 1;
3010 unsigned CCP4IP
: 1;
3011 unsigned CCP5IP
: 1;
3012 unsigned TMR4IP
: 1;
3019 extern __at(0x0FA5) volatile __IPR3bits_t IPR3bits
;
3021 #define _CCP3IP 0x01
3022 #define _CCP4IP 0x02
3023 #define _CCP5IP 0x04
3024 #define _TMR4IP 0x08
3028 //==============================================================================
3031 //==============================================================================
3034 extern __at(0x0FA6) __sfr EECON1
;
3048 extern __at(0x0FA6) volatile __EECON1bits_t EECON1bits
;
3058 //==============================================================================
3060 extern __at(0x0FA7) __sfr EECON2
;
3061 extern __at(0x0FA8) __sfr EEDATA
;
3062 extern __at(0x0FA9) __sfr EEADR
;
3063 extern __at(0x0FAA) __sfr EEADRH
;
3065 //==============================================================================
3068 extern __at(0x0FAB) __sfr RCSTA
;
3101 unsigned ADDEN1
: 1;
3109 extern __at(0x0FAB) volatile __RCSTAbits_t RCSTAbits
;
3119 #define _ADDEN1 0x08
3129 //==============================================================================
3132 //==============================================================================
3135 extern __at(0x0FAB) __sfr RCSTA1
;
3168 unsigned ADDEN1
: 1;
3176 extern __at(0x0FAB) volatile __RCSTA1bits_t RCSTA1bits
;
3178 #define _RCSTA1_RX9D 0x01
3179 #define _RCSTA1_RX9D1 0x01
3180 #define _RCSTA1_OERR 0x02
3181 #define _RCSTA1_OERR1 0x02
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3183 #define _RCSTA1_FERR1 0x04
3184 #define _RCSTA1_ADDEN 0x08
3185 #define _RCSTA1_ADEN 0x08
3186 #define _RCSTA1_ADDEN1 0x08
3187 #define _RCSTA1_CREN 0x10
3188 #define _RCSTA1_CREN1 0x10
3189 #define _RCSTA1_SREN 0x20
3190 #define _RCSTA1_SREN1 0x20
3191 #define _RCSTA1_RX9 0x40
3192 #define _RCSTA1_RX91 0x40
3193 #define _RCSTA1_SPEN 0x80
3194 #define _RCSTA1_SPEN1 0x80
3196 //==============================================================================
3199 //==============================================================================
3202 extern __at(0x0FAC) __sfr TXSTA
;
3223 unsigned SENDB1
: 1;
3231 extern __at(0x0FAC) volatile __TXSTAbits_t TXSTAbits
;
3240 #define _SENDB1 0x08
3250 //==============================================================================
3253 //==============================================================================
3256 extern __at(0x0FAC) __sfr TXSTA1
;
3277 unsigned SENDB1
: 1;
3285 extern __at(0x0FAC) volatile __TXSTA1bits_t TXSTA1bits
;
3287 #define _TXSTA1_TX9D 0x01
3288 #define _TXSTA1_TX9D1 0x01
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3296 #define _TXSTA1_SYNC1 0x10
3297 #define _TXSTA1_TXEN 0x20
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3300 #define _TXSTA1_TX91 0x40
3301 #define _TXSTA1_CSRC 0x80
3302 #define _TXSTA1_CSRC1 0x80
3304 //==============================================================================
3306 extern __at(0x0FAD) __sfr TXREG
;
3307 extern __at(0x0FAD) __sfr TXREG1
;
3308 extern __at(0x0FAE) __sfr RCREG
;
3309 extern __at(0x0FAE) __sfr RCREG1
;
3310 extern __at(0x0FAF) __sfr SPBRG
;
3311 extern __at(0x0FAF) __sfr SPBRG1
;
3313 //==============================================================================
3316 extern __at(0x0FB0) __sfr PSPCON
;
3324 unsigned PSPMODE
: 1;
3330 extern __at(0x0FB0) volatile __PSPCONbits_t PSPCONbits
;
3332 #define _PSPMODE 0x10
3337 //==============================================================================
3340 //==============================================================================
3343 extern __at(0x0FB1) __sfr T3CON
;
3349 unsigned TMR3ON
: 1;
3350 unsigned TMR3CS
: 1;
3351 unsigned NOT_T3SYNC
: 1;
3352 unsigned T3CCP1
: 1;
3353 unsigned T3CKPS0
: 1;
3354 unsigned T3CKPS1
: 1;
3355 unsigned T3CCP2
: 1;
3363 unsigned T3SYNC
: 1;
3375 unsigned T3NSYNC
: 1;
3386 unsigned T3CKPS
: 2;
3391 extern __at(0x0FB1) volatile __T3CONbits_t T3CONbits
;
3393 #define _T3CON_TMR3ON 0x01
3394 #define _T3CON_TMR3CS 0x02
3395 #define _T3CON_NOT_T3SYNC 0x04
3396 #define _T3CON_T3SYNC 0x04
3397 #define _T3CON_T3NSYNC 0x04
3398 #define _T3CON_T3CCP1 0x08
3399 #define _T3CON_T3CKPS0 0x10
3400 #define _T3CON_T3CKPS1 0x20
3401 #define _T3CON_T3CCP2 0x40
3402 #define _T3CON_RD16 0x80
3404 //==============================================================================
3406 extern __at(0x0FB2) __sfr TMR3
;
3407 extern __at(0x0FB2) __sfr TMR3L
;
3408 extern __at(0x0FB3) __sfr TMR3H
;
3410 //==============================================================================
3413 extern __at(0x0FB4) __sfr CMCON
;
3436 extern __at(0x0FB4) volatile __CMCONbits_t CMCONbits
;
3447 //==============================================================================
3450 //==============================================================================
3453 extern __at(0x0FB5) __sfr CVRCON
;
3488 extern __at(0x0FB5) volatile __CVRCONbits_t CVRCONbits
;
3500 //==============================================================================
3503 //==============================================================================
3506 extern __at(0x0FB6) __sfr ECCP1AS
;
3512 unsigned PSS1BD0
: 1;
3513 unsigned PSS1BD1
: 1;
3514 unsigned PSS1AC0
: 1;
3515 unsigned PSS1AC1
: 1;
3516 unsigned ECCP1AS0
: 1;
3517 unsigned ECCP1AS1
: 1;
3518 unsigned ECCP1AS2
: 1;
3519 unsigned ECCP1ASE
: 1;
3524 unsigned PSSBD0
: 1;
3525 unsigned PSSBD1
: 1;
3526 unsigned PSSAC0
: 1;
3527 unsigned PSSAC1
: 1;
3536 unsigned PSS1BD
: 2;
3549 unsigned PSS1AC
: 2;
3563 unsigned ECCP1AS
: 3;
3568 extern __at(0x0FB6) volatile __ECCP1ASbits_t ECCP1ASbits
;
3570 #define _PSS1BD0 0x01
3571 #define _PSSBD0 0x01
3572 #define _PSS1BD1 0x02
3573 #define _PSSBD1 0x02
3574 #define _PSS1AC0 0x04
3575 #define _PSSAC0 0x04
3576 #define _PSS1AC1 0x08
3577 #define _PSSAC1 0x08
3578 #define _ECCP1AS0 0x10
3579 #define _ECCP1AS1 0x20
3580 #define _ECCP1AS2 0x40
3581 #define _ECCP1ASE 0x80
3583 //==============================================================================
3586 //==============================================================================
3589 extern __at(0x0FB7) __sfr CCP3CON
;
3595 unsigned CCP3M0
: 1;
3596 unsigned CCP3M1
: 1;
3597 unsigned CCP3M2
: 1;
3598 unsigned CCP3M3
: 1;
3637 extern __at(0x0FB7) volatile __CCP3CONbits_t CCP3CONbits
;
3639 #define _CCP3M0 0x01
3640 #define _CCP3M1 0x02
3641 #define _CCP3M2 0x04
3642 #define _CCP3M3 0x08
3650 //==============================================================================
3652 extern __at(0x0FB8) __sfr CCPR3
;
3653 extern __at(0x0FB8) __sfr CCPR3L
;
3654 extern __at(0x0FB9) __sfr CCPR3H
;
3656 //==============================================================================
3659 extern __at(0x0FBA) __sfr CCP2CON
;
3665 unsigned CCP2M0
: 1;
3666 unsigned CCP2M1
: 1;
3667 unsigned CCP2M2
: 1;
3668 unsigned CCP2M3
: 1;
3707 extern __at(0x0FBA) volatile __CCP2CONbits_t CCP2CONbits
;
3709 #define _CCP2M0 0x01
3710 #define _CCP2M1 0x02
3711 #define _CCP2M2 0x04
3712 #define _CCP2M3 0x08
3720 //==============================================================================
3722 extern __at(0x0FBB) __sfr CCPR2
;
3723 extern __at(0x0FBB) __sfr CCPR2L
;
3724 extern __at(0x0FBC) __sfr CCPR2H
;
3726 //==============================================================================
3729 extern __at(0x0FBD) __sfr CCP1CON
;
3735 unsigned CCP1M0
: 1;
3736 unsigned CCP1M1
: 1;
3737 unsigned CCP1M2
: 1;
3738 unsigned CCP1M3
: 1;
3777 extern __at(0x0FBD) volatile __CCP1CONbits_t CCP1CONbits
;
3779 #define _CCP1M0 0x01
3780 #define _CCP1M1 0x02
3781 #define _CCP1M2 0x04
3782 #define _CCP1M3 0x08
3790 //==============================================================================
3792 extern __at(0x0FBE) __sfr CCPR1
;
3793 extern __at(0x0FBE) __sfr CCPR1L
;
3794 extern __at(0x0FBF) __sfr CCPR1H
;
3796 //==============================================================================
3799 extern __at(0x0FC0) __sfr ADCON2
;
3829 extern __at(0x0FC0) volatile __ADCON2bits_t ADCON2bits
;
3839 //==============================================================================
3842 //==============================================================================
3845 extern __at(0x0FC1) __sfr ADCON1
;
3875 extern __at(0x0FC1) volatile __ADCON1bits_t ADCON1bits
;
3884 //==============================================================================
3887 //==============================================================================
3890 extern __at(0x0FC2) __sfr ADCON0
;
3897 unsigned GO_NOT_DONE
: 1;
3909 unsigned GO_DONE
: 1;
3945 unsigned NOT_DONE
: 1;
3957 unsigned GODONE
: 1;
3974 extern __at(0x0FC2) volatile __ADCON0bits_t ADCON0bits
;
3977 #define _GO_NOT_DONE 0x02
3978 #define _GO_DONE 0x02
3981 #define _NOT_DONE 0x02
3982 #define _GODONE 0x02
3988 //==============================================================================
3990 extern __at(0x0FC3) __sfr ADRES
;
3991 extern __at(0x0FC3) __sfr ADRESL
;
3992 extern __at(0x0FC4) __sfr ADRESH
;
3994 //==============================================================================
3997 extern __at(0x0FC5) __sfr SSPCON2
;
4007 unsigned ACKSTAT
: 1;
4011 extern __at(0x0FC5) volatile __SSPCON2bits_t SSPCON2bits
;
4019 #define _ACKSTAT 0x40
4022 //==============================================================================
4025 //==============================================================================
4028 extern __at(0x0FC6) __sfr SSPCON1
;
4051 extern __at(0x0FC6) volatile __SSPCON1bits_t SSPCON1bits
;
4062 //==============================================================================
4065 //==============================================================================
4068 extern __at(0x0FC7) __sfr SSPSTAT
;
4076 unsigned R_NOT_W
: 1;
4079 unsigned D_NOT_A
: 1;
4089 unsigned I2C_START
: 1;
4090 unsigned I2C_STOP
: 1;
4100 unsigned I2C_READ
: 1;
4103 unsigned I2C_DAT
: 1;
4124 unsigned NOT_WRITE
: 1;
4127 unsigned NOT_ADDRESS
: 1;
4136 unsigned READ_WRITE
: 1;
4139 unsigned DATA_ADDRESS
: 1;
4157 extern __at(0x0FC7) volatile __SSPSTATbits_t SSPSTATbits
;
4161 #define _R_NOT_W 0x04
4163 #define _I2C_READ 0x04
4165 #define _NOT_WRITE 0x04
4166 #define _READ_WRITE 0x04
4169 #define _I2C_START 0x08
4171 #define _I2C_STOP 0x10
4172 #define _D_NOT_A 0x20
4174 #define _I2C_DAT 0x20
4176 #define _NOT_ADDRESS 0x20
4177 #define _DATA_ADDRESS 0x20
4182 //==============================================================================
4184 extern __at(0x0FC8) __sfr SSPADD
;
4185 extern __at(0x0FC9) __sfr SSPBUF
;
4187 //==============================================================================
4190 extern __at(0x0FCA) __sfr T2CON
;
4196 unsigned T2CKPS0
: 1;
4197 unsigned T2CKPS1
: 1;
4198 unsigned TMR2ON
: 1;
4199 unsigned T2OUTPS0
: 1;
4200 unsigned T2OUTPS1
: 1;
4201 unsigned T2OUTPS2
: 1;
4202 unsigned T2OUTPS3
: 1;
4208 unsigned T2CKPS
: 2;
4215 unsigned T2OUTPS
: 4;
4220 extern __at(0x0FCA) volatile __T2CONbits_t T2CONbits
;
4222 #define _T2CKPS0 0x01
4223 #define _T2CKPS1 0x02
4224 #define _TMR2ON 0x04
4225 #define _T2OUTPS0 0x08
4226 #define _T2OUTPS1 0x10
4227 #define _T2OUTPS2 0x20
4228 #define _T2OUTPS3 0x40
4230 //==============================================================================
4232 extern __at(0x0FCB) __sfr PR2
;
4233 extern __at(0x0FCC) __sfr TMR2
;
4235 //==============================================================================
4238 extern __at(0x0FCD) __sfr T1CON
;
4244 unsigned TMR1ON
: 1;
4245 unsigned TMR1CS
: 1;
4246 unsigned NOT_T1SYNC
: 1;
4247 unsigned T1OSCEN
: 1;
4248 unsigned T1CKPS0
: 1;
4249 unsigned T1CKPS1
: 1;
4258 unsigned T1SYNC
: 1;
4270 unsigned T1INSYNC
: 1;
4281 unsigned T1CKPS
: 2;
4286 extern __at(0x0FCD) volatile __T1CONbits_t T1CONbits
;
4288 #define _TMR1ON 0x01
4289 #define _TMR1CS 0x02
4290 #define _NOT_T1SYNC 0x04
4291 #define _T1SYNC 0x04
4292 #define _T1INSYNC 0x04
4293 #define _T1OSCEN 0x08
4294 #define _T1CKPS0 0x10
4295 #define _T1CKPS1 0x20
4298 //==============================================================================
4300 extern __at(0x0FCE) __sfr TMR1
;
4301 extern __at(0x0FCE) __sfr TMR1L
;
4302 extern __at(0x0FCF) __sfr TMR1H
;
4304 //==============================================================================
4307 extern __at(0x0FD0) __sfr RCON
;
4313 unsigned NOT_BOR
: 1;
4314 unsigned NOT_POR
: 1;
4315 unsigned NOT_PD
: 1;
4316 unsigned NOT_TO
: 1;
4317 unsigned NOT_RI
: 1;
4332 unsigned NOT_IPEN
: 1;
4336 extern __at(0x0FD0) volatile __RCONbits_t RCONbits
;
4338 #define _NOT_BOR 0x01
4340 #define _NOT_POR 0x02
4342 #define _NOT_PD 0x04
4344 #define _NOT_TO 0x08
4346 #define _NOT_RI 0x10
4349 #define _NOT_IPEN 0x80
4351 //==============================================================================
4354 //==============================================================================
4357 extern __at(0x0FD1) __sfr WDTCON
;
4363 unsigned SWDTEN
: 1;
4386 extern __at(0x0FD1) volatile __WDTCONbits_t WDTCONbits
;
4388 #define _SWDTEN 0x01
4391 //==============================================================================
4394 //==============================================================================
4397 extern __at(0x0FD2) __sfr LVDCON
;
4438 extern __at(0x0FD2) volatile __LVDCONbits_t LVDCONbits
;
4452 //==============================================================================
4455 //==============================================================================
4458 extern __at(0x0FD3) __sfr OSCCON
;
4481 extern __at(0x0FD3) volatile __OSCCONbits_t OSCCONbits
;
4488 //==============================================================================
4491 //==============================================================================
4494 extern __at(0x0FD5) __sfr T0CON
;
4506 unsigned T08BIT
: 1;
4507 unsigned TMR0ON
: 1;
4517 extern __at(0x0FD5) volatile __T0CONbits_t T0CONbits
;
4525 #define _T08BIT 0x40
4526 #define _TMR0ON 0x80
4528 //==============================================================================
4530 extern __at(0x0FD6) __sfr TMR0
;
4531 extern __at(0x0FD6) __sfr TMR0L
;
4532 extern __at(0x0FD7) __sfr TMR0H
;
4534 //==============================================================================
4537 extern __at(0x0FD8) __sfr STATUS
;
4551 extern __at(0x0FD8) volatile __STATUSbits_t STATUSbits
;
4559 //==============================================================================
4561 extern __at(0x0FD9) __sfr FSR2L
;
4562 extern __at(0x0FDA) __sfr FSR2H
;
4563 extern __at(0x0FDB) __sfr PLUSW2
;
4564 extern __at(0x0FDC) __sfr PREINC2
;
4565 extern __at(0x0FDD) __sfr POSTDEC2
;
4566 extern __at(0x0FDE) __sfr POSTINC2
;
4567 extern __at(0x0FDF) __sfr INDF2
;
4568 extern __at(0x0FE0) __sfr BSR
;
4569 extern __at(0x0FE1) __sfr FSR1L
;
4570 extern __at(0x0FE2) __sfr FSR1H
;
4571 extern __at(0x0FE3) __sfr PLUSW1
;
4572 extern __at(0x0FE4) __sfr PREINC1
;
4573 extern __at(0x0FE5) __sfr POSTDEC1
;
4574 extern __at(0x0FE6) __sfr POSTINC1
;
4575 extern __at(0x0FE7) __sfr INDF1
;
4576 extern __at(0x0FE8) __sfr WREG
;
4577 extern __at(0x0FE9) __sfr FSR0L
;
4578 extern __at(0x0FEA) __sfr FSR0H
;
4579 extern __at(0x0FEB) __sfr PLUSW0
;
4580 extern __at(0x0FEC) __sfr PREINC0
;
4581 extern __at(0x0FED) __sfr POSTDEC0
;
4582 extern __at(0x0FEE) __sfr POSTINC0
;
4583 extern __at(0x0FEF) __sfr INDF0
;
4585 //==============================================================================
4588 extern __at(0x0FF0) __sfr INTCON3
;
4594 unsigned INT1IF
: 1;
4595 unsigned INT2IF
: 1;
4596 unsigned INT3IF
: 1;
4597 unsigned INT1IE
: 1;
4598 unsigned INT2IE
: 1;
4599 unsigned INT3IE
: 1;
4600 unsigned INT1IP
: 1;
4601 unsigned INT2IP
: 1;
4617 extern __at(0x0FF0) volatile __INTCON3bits_t INTCON3bits
;
4619 #define _INT1IF 0x01
4621 #define _INT2IF 0x02
4623 #define _INT3IF 0x04
4625 #define _INT1IE 0x08
4627 #define _INT2IE 0x10
4629 #define _INT3IE 0x20
4631 #define _INT1IP 0x40
4633 #define _INT2IP 0x80
4636 //==============================================================================
4639 //==============================================================================
4642 extern __at(0x0FF1) __sfr INTCON2
;
4649 unsigned INT3IP
: 1;
4650 unsigned TMR0IP
: 1;
4651 unsigned INTEDG3
: 1;
4652 unsigned INTEDG2
: 1;
4653 unsigned INTEDG1
: 1;
4654 unsigned INTEDG0
: 1;
4655 unsigned NOT_RBPU
: 1;
4671 extern __at(0x0FF1) volatile __INTCON2bits_t INTCON2bits
;
4674 #define _INT3IP 0x02
4676 #define _TMR0IP 0x04
4678 #define _INTEDG3 0x08
4679 #define _INTEDG2 0x10
4680 #define _INTEDG1 0x20
4681 #define _INTEDG0 0x40
4682 #define _NOT_RBPU 0x80
4685 //==============================================================================
4688 //==============================================================================
4691 extern __at(0x0FF2) __sfr INTCON
;
4698 unsigned INT0IF
: 1;
4699 unsigned TMR0IF
: 1;
4701 unsigned INT0IE
: 1;
4702 unsigned TMR0IE
: 1;
4703 unsigned PEIE_GIEL
: 1;
4704 unsigned GIE_GIEH
: 1;
4732 extern __at(0x0FF2) volatile __INTCONbits_t INTCONbits
;
4735 #define _INT0IF 0x02
4737 #define _TMR0IF 0x04
4740 #define _INT0IE 0x10
4742 #define _TMR0IE 0x20
4744 #define _PEIE_GIEL 0x40
4747 #define _GIE_GIEH 0x80
4751 //==============================================================================
4753 extern __at(0x0FF3) __sfr PROD
;
4754 extern __at(0x0FF3) __sfr PRODL
;
4755 extern __at(0x0FF4) __sfr PRODH
;
4756 extern __at(0x0FF5) __sfr TABLAT
;
4757 extern __at(0x0FF6) __sfr TBLPTR
;
4758 extern __at(0x0FF6) __sfr TBLPTRL
;
4759 extern __at(0x0FF7) __sfr TBLPTRH
;
4760 extern __at(0x0FF8) __sfr TBLPTRU
;
4761 extern __at(0x0FF9) __sfr PC
;
4762 extern __at(0x0FF9) __sfr PCL
;
4763 extern __at(0x0FFA) __sfr PCLATH
;
4764 extern __at(0x0FFB) __sfr PCLATU
;
4766 //==============================================================================
4769 extern __at(0x0FFC) __sfr STKPTR
;
4775 unsigned STKPTR0
: 1;
4776 unsigned STKPTR1
: 1;
4777 unsigned STKPTR2
: 1;
4778 unsigned STKPTR3
: 1;
4779 unsigned STKPTR4
: 1;
4781 unsigned STKUNF
: 1;
4782 unsigned STKFUL
: 1;
4794 unsigned STKOVF
: 1;
4799 unsigned STKPTR
: 5;
4804 extern __at(0x0FFC) volatile __STKPTRbits_t STKPTRbits
;
4806 #define _STKPTR0 0x01
4807 #define _STKPTR1 0x02
4808 #define _STKPTR2 0x04
4809 #define _STKPTR3 0x08
4810 #define _STKPTR4 0x10
4811 #define _STKUNF 0x40
4812 #define _STKFUL 0x80
4813 #define _STKOVF 0x80
4815 //==============================================================================
4817 extern __at(0x0FFD) __sfr TOS
;
4818 extern __at(0x0FFD) __sfr TOSL
;
4819 extern __at(0x0FFE) __sfr TOSH
;
4820 extern __at(0x0FFF) __sfr TOSU
;
4822 //==============================================================================
4824 // Configuration Bits
4826 //==============================================================================
4828 #define __CONFIG1H 0x300001
4829 #define __CONFIG2L 0x300002
4830 #define __CONFIG2H 0x300003
4831 #define __CONFIG3L 0x300004
4832 #define __CONFIG3H 0x300005
4833 #define __CONFIG4L 0x300006
4834 #define __CONFIG5L 0x300008
4835 #define __CONFIG5H 0x300009
4836 #define __CONFIG6L 0x30000A
4837 #define __CONFIG6H 0x30000B
4838 #define __CONFIG7L 0x30000C
4839 #define __CONFIG7H 0x30000D
4841 //----------------------------- CONFIG1H Options -------------------------------
4843 #define _OSC_LP_1H 0xF0 // LP oscillator.
4844 #define _OSC_XT_1H 0xF1 // XT oscillator.
4845 #define _OSC_HS_1H 0xF2 // HS oscillator.
4846 #define _OSC_RC_1H 0xF3 // RC oscillator with OSC2 configured as divide by 4 clock output.
4847 #define _OSC_EC_1H 0xF4 // EC oscillator with OSC2 configured as divide by 4 clock output.
4848 #define _OSC_ECIO_1H 0xF5 // EC oscillator with OSC2 configured as RA6.
4849 #define _OSC_HSPLL_1H 0xF6 // HS oscillator with HW enabled 4x PLL.
4850 #define _OSC_RCIO_1H 0xF7 // RC oscillator with OSC2 configured as RA6.
4851 #define _OSC_ECIOPLL_1H 0xFC // EC oscillator with OSC2 configured as RA6 and HW enabled 4x PLL.
4852 #define _OSC_ECIOSWPLL_1H 0xFD // EC oscillator with OSC2 configured as RA6 and SW enabled 4x PLL.
4853 #define _OSC_HSSWPLL_1H 0xFE // HS oscillator with SW enabled 4x PLL.
4854 #define _OSCS_ON_1H 0xDF // Timer1 oscillator system clock switch option is enabled (oscillator switching is enabled).
4855 #define _OSCS_OFF_1H 0xFF // Oscillator system clock switch option is disabled (main oscillator is source).
4857 //----------------------------- CONFIG2L Options -------------------------------
4859 #define _PWRT_ON_2L 0xFE // PWRT enabled.
4860 #define _PWRT_OFF_2L 0xFF // PWRT disabled.
4861 #define _BOR_OFF_2L 0xFD // Brown-out Reset disabled.
4862 #define _BOR_ON_2L 0xFF // Brown-out Reset enabled.
4863 #define _BORV_45_2L 0xF3 // VBOR set to 4.5V.
4864 #define _BORV_42_2L 0xF7 // VBOR set to 4.2V.
4865 #define _BORV_27_2L 0xFB // VBOR set to 2.7V.
4866 #define _BORV_20_2L 0xFF // VBOR set to 2.0V.
4868 //----------------------------- CONFIG2H Options -------------------------------
4870 #define _WDT_OFF_2H 0xFE // WDT disabled (control is placed on the SWDTEN bit).
4871 #define _WDT_ON_2H 0xFF // WDT enabled.
4872 #define _WDTPS_1_2H 0xE1 // 1:1.
4873 #define _WDTPS_2_2H 0xE3 // 1:2.
4874 #define _WDTPS_4_2H 0xE5 // 1:4.
4875 #define _WDTPS_8_2H 0xE7 // 1:8.
4876 #define _WDTPS_16_2H 0xE9 // 1:16.
4877 #define _WDTPS_32_2H 0xEB // 1:32.
4878 #define _WDTPS_64_2H 0xED // 1:64.
4879 #define _WDTPS_128_2H 0xEF // 1:128.
4880 #define _WDTPS_256_2H 0xF1 // 1:256.
4881 #define _WDTPS_512_2H 0xF3 // 1:512.
4882 #define _WDTPS_1024_2H 0xF5 // 1:1024.
4883 #define _WDTPS_2048_2H 0xF7 // 1:2048.
4884 #define _WDTPS_4096_2H 0xF9 // 1:4096.
4885 #define _WDTPS_8192_2H 0xFB // 1:8192.
4886 #define _WDTPS_16384_2H 0xFD // 1:16384.
4887 #define _WDTPS_32768_2H 0xFF // 1:32768.
4889 //----------------------------- CONFIG3L Options -------------------------------
4891 #define _CCP2MX_PORTBE_3H 0xFE // Multiplexed with RB3 or RE7.
4892 #define _CCP2MX_PORTC_3H 0xFF // Multiplexed with RC1.
4893 #define _MCLRE_OFF_3H 0x7F // RG5 input enabled, MCLR disabled.
4894 #define _MCLRE_ON_3H 0xFF // MCLR pin enabled, RG5 input pin disabled.
4896 //----------------------------- CONFIG3H Options -------------------------------
4898 #define _CCP2MX_PORTBE_3H 0xFE // Multiplexed with RB3 or RE7.
4899 #define _CCP2MX_PORTC_3H 0xFF // Multiplexed with RC1.
4900 #define _MCLRE_OFF_3H 0x7F // RG5 input enabled, MCLR disabled.
4901 #define _MCLRE_ON_3H 0xFF // MCLR pin enabled, RG5 input pin disabled.
4903 //----------------------------- CONFIG4L Options -------------------------------
4905 #define _STVR_OFF_4L 0xFE // Stack full/underflow will not cause Reset.
4906 #define _STVR_ON_4L 0xFF // Stack full/underflow will cause Reset.
4907 #define _LVP_OFF_4L 0xFB // Low-Voltage ICSP disabled.
4908 #define _LVP_ON_4L 0xFF // Low-Voltage ICSP enabled.
4909 #define _DEBUG_ON_4L 0x7F // Background debugger enabled. RB6 and RB7 are dedicated to in-circuit debug.
4910 #define _DEBUG_OFF_4L 0xFF // Background debugger disabled. RB6 and RB7 configured as general purpose I/O pins.
4912 //----------------------------- CONFIG5L Options -------------------------------
4914 #define _CP0_ON_5L 0xFE // Block 0 (000800-003FFFh) code-protected.
4915 #define _CP0_OFF_5L 0xFF // Block 0 (000800-003FFFh) not code-protected.
4916 #define _CP1_ON_5L 0xFD // Block 1 (004000-007FFFh) code-protected.
4917 #define _CP1_OFF_5L 0xFF // Block 1 (004000-007FFFh) not code-protected.
4918 #define _CP2_ON_5L 0xFB // Block 2 (008000-00BFFFh) code-protected.
4919 #define _CP2_OFF_5L 0xFF // Block 2 (008000-00BFFFh) not code-protected.
4920 #define _CP3_ON_5L 0xF7 // Block 3 (00C000-00FFFFh) code-protected.
4921 #define _CP3_OFF_5L 0xFF // Block 3 (00C000-00FFFFh) not code-protected.
4923 //----------------------------- CONFIG5H Options -------------------------------
4925 #define _CPB_ON_5H 0xBF // Boot block (000000-0007FFh) code-protected.
4926 #define _CPB_OFF_5H 0xFF // Boot block (000000-0007FFh) not code-protected.
4927 #define _CPD_ON_5H 0x7F // Data EEPROM code-protected.
4928 #define _CPD_OFF_5H 0xFF // Data EEPROM not code-protected.
4930 //----------------------------- CONFIG6L Options -------------------------------
4932 #define _WRT0_ON_6L 0xFE // Block 0 (000800-003FFFh) write-protected.
4933 #define _WRT0_OFF_6L 0xFF // Block 0 (000800-003FFFh) not write-protected.
4934 #define _WRT1_ON_6L 0xFD // Block 1 (004000-007FFFh) write-protected.
4935 #define _WRT1_OFF_6L 0xFF // Block 1 (004000-007FFFh) not write-protected.
4936 #define _WRT2_ON_6L 0xFB // Block 2 (008000-00BFFFh) write-protected.
4937 #define _WRT2_OFF_6L 0xFF // Block 2 (008000-00BFFFh) not write-protected.
4938 #define _WRT3_ON_6L 0xF7 // Block 3 (00C000-00FFFFh) write-protected.
4939 #define _WRT3_OFF_6L 0xFF // Block 3 (00C000-00FFFFh) not write-protected.
4941 //----------------------------- CONFIG6H Options -------------------------------
4943 #define _WRTC_ON_6H 0xDF // Configuration registers (300000-3000FFh) write-protected.
4944 #define _WRTC_OFF_6H 0xFF // Configuration registers (300000-3000FFh) not write-protected.
4945 #define _WRTB_ON_6H 0xBF // Boot block (000000-0007FFh) write-protected.
4946 #define _WRTB_OFF_6H 0xFF // Boot block (000000-0007FFh) not write-protected.
4947 #define _WRTD_ON_6H 0x7F // Data EEPROM write-protected.
4948 #define _WRTD_OFF_6H 0xFF // Data EEPROM not write-protected.
4950 //----------------------------- CONFIG7L Options -------------------------------
4952 #define _EBTR0_ON_7L 0xFE // Block 0 (000800-003FFFh) protected from table reads executed in other blocks.
4953 #define _EBTR0_OFF_7L 0xFF // Block 0 (000800-003FFFh) not protected from table reads executed in other blocks.
4954 #define _EBTR1_ON_7L 0xFD // Block 1 (004000-007FFFh) protected from table reads executed in other blocks.
4955 #define _EBTR1_OFF_7L 0xFF // Block 1 (004000-007FFFh) not protected from table reads executed in other blocks.
4956 #define _EBTR2_ON_7L 0xFB // Block 2 (008000-00BFFFh) protected from table reads executed in other blocks.
4957 #define _EBTR2_OFF_7L 0xFF // Block 2 (008000-00BFFFh) not protected from table reads executed in other blocks.
4958 #define _EBTR3_ON_7L 0xF7 // Block 3 (00C000-00FFFFh) protected from table reads executed in other blocks.
4959 #define _EBTR3_OFF_7L 0xFF // Block 3 (00C000-00FFFFh) not protected from table reads executed in other blocks.
4961 //----------------------------- CONFIG7H Options -------------------------------
4963 #define _EBTRB_ON_7H 0xBF // Boot block (000000-0007FFh) protected from table reads executed in other blocks.
4964 #define _EBTRB_OFF_7H 0xFF // Boot block (000000-0007FFh) not protected from table reads executed in other blocks.
4966 //==============================================================================
4968 #define __DEVID1 0x3FFFFE
4969 #define __DEVID2 0x3FFFFF
4971 #define __IDLOC0 0x200000
4972 #define __IDLOC1 0x200001
4973 #define __IDLOC2 0x200002
4974 #define __IDLOC3 0x200003
4975 #define __IDLOC4 0x200004
4976 #define __IDLOC5 0x200005
4977 #define __IDLOC6 0x200006
4978 #define __IDLOC7 0x200007
4980 #endif // #ifndef __PIC18LF6621_H__