package/develop/iverilog/iverilog.desc

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  10 [COPY] it under the terms of the GNU General Public License as published by
  11 [COPY] the Free Software Foundation; version 2 of the License. A copy of the
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  14
  15 [I] A Verilog simulation and synthesis tool
  16
  17 [T] Icarus Verilog is a Verilog simulation and synthesis tool. It operates
  18 [T] as a compiler, compiling source code writen in Verilog (IEEE-1364) into
  19 [T] some target format.
  20
  21 [U] http://iverilog.icarus.com/
  22
  23 [A] David Evans yevans@virginia.edu>
  24 [M] T2 Project <t2@t2-project.org>
  25
  26 [C] extra/development
  27
  28 [L] GPL
  29 [S] Beta
  30 [V] 11.0
  31 [P] X -----5---9 800.000
  32
  33 [O] var_append makeinstopt ' ' '-j1'
  34
  35 [D] 21f95132f2c3ff2652ed931193d29c974c6adfac5c96a9f7c3949f3d verilog-11.0.tar.gz http://dl.sourceforge.net/iverilog/