mb/google/nissa/var/rull: add ssd timing and modify ssd GPIO pins of rtd3
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1 /* SPDX-License-Identifier: GPL-2.0-only */
3 #include <southbridge/intel/common/gpio.h>
5 static const struct pch_gpio_set1 pch_gpio_set1_mode = {
6 .gpio0 = GPIO_MODE_GPIO,
7 .gpio1 = GPIO_MODE_GPIO,
8 .gpio2 = GPIO_MODE_NATIVE,
9 .gpio3 = GPIO_MODE_NATIVE,
10 .gpio4 = GPIO_MODE_NATIVE,
11 .gpio5 = GPIO_MODE_NATIVE,
12 .gpio6 = GPIO_MODE_GPIO,
13 .gpio7 = GPIO_MODE_GPIO,
14 .gpio8 = GPIO_MODE_GPIO,
15 .gpio9 = GPIO_MODE_NATIVE,
16 .gpio10 = GPIO_MODE_NATIVE,
17 .gpio11 = GPIO_MODE_NATIVE,
18 .gpio12 = GPIO_MODE_GPIO,
19 .gpio13 = GPIO_MODE_GPIO,
20 .gpio14 = GPIO_MODE_NATIVE,
21 .gpio15 = GPIO_MODE_GPIO,
22 .gpio16 = GPIO_MODE_GPIO,
23 .gpio17 = GPIO_MODE_GPIO,
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25 .gpio19 = GPIO_MODE_NATIVE,
26 .gpio20 = GPIO_MODE_NATIVE,
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30 .gpio24 = GPIO_MODE_GPIO,
31 .gpio25 = GPIO_MODE_NATIVE,
32 .gpio26 = GPIO_MODE_NATIVE,
33 .gpio27 = GPIO_MODE_GPIO,
34 .gpio28 = GPIO_MODE_GPIO,
35 .gpio29 = GPIO_MODE_GPIO,
36 .gpio30 = GPIO_MODE_NATIVE,
37 .gpio31 = GPIO_MODE_GPIO,
40 static const struct pch_gpio_set1 pch_gpio_set1_direction = {
41 .gpio0 = GPIO_DIR_INPUT,
42 .gpio1 = GPIO_DIR_INPUT,
43 .gpio6 = GPIO_DIR_INPUT,
44 .gpio7 = GPIO_DIR_INPUT,
45 .gpio8 = GPIO_DIR_OUTPUT,
46 .gpio12 = GPIO_DIR_OUTPUT,
47 .gpio13 = GPIO_DIR_INPUT,
48 .gpio15 = GPIO_DIR_OUTPUT,
49 .gpio16 = GPIO_DIR_INPUT,
50 .gpio17 = GPIO_DIR_INPUT,
51 .gpio22 = GPIO_DIR_INPUT,
52 .gpio24 = GPIO_DIR_OUTPUT,
53 .gpio27 = GPIO_DIR_INPUT,
54 .gpio28 = GPIO_DIR_OUTPUT,
55 .gpio29 = GPIO_DIR_OUTPUT,
56 .gpio31 = GPIO_DIR_INPUT,
59 static const struct pch_gpio_set1 pch_gpio_set1_level = {
60 .gpio8 = GPIO_LEVEL_HIGH,
61 .gpio12 = GPIO_LEVEL_HIGH,
62 .gpio15 = GPIO_LEVEL_LOW,
63 .gpio24 = GPIO_LEVEL_LOW,
64 .gpio28 = GPIO_LEVEL_LOW,
65 .gpio29 = GPIO_LEVEL_HIGH,
68 static const struct pch_gpio_set1 pch_gpio_set1_reset = {
71 static const struct pch_gpio_set1 pch_gpio_set1_invert = {
74 static const struct pch_gpio_set1 pch_gpio_set1_blink = {
77 static const struct pch_gpio_set2 pch_gpio_set2_mode = {
78 .gpio32 = GPIO_MODE_GPIO,
79 .gpio33 = GPIO_MODE_GPIO,
80 .gpio34 = GPIO_MODE_GPIO,
81 .gpio35 = GPIO_MODE_NATIVE,
82 .gpio36 = GPIO_MODE_GPIO,
83 .gpio37 = GPIO_MODE_GPIO,
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86 .gpio40 = GPIO_MODE_NATIVE,
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90 .gpio44 = GPIO_MODE_NATIVE,
91 .gpio45 = GPIO_MODE_NATIVE,
92 .gpio46 = GPIO_MODE_NATIVE,
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109 .gpio63 = GPIO_MODE_NATIVE,
112 static const struct pch_gpio_set2 pch_gpio_set2_direction = {
113 .gpio32 = GPIO_DIR_OUTPUT,
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127 static const struct pch_gpio_set2 pch_gpio_set2_level = {
128 .gpio32 = GPIO_LEVEL_HIGH,
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136 static const struct pch_gpio_set2 pch_gpio_set2_reset = {
139 static const struct pch_gpio_set3 pch_gpio_set3_mode = {
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154 static const struct pch_gpio_set3 pch_gpio_set3_direction = {
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157 .gpio70 = GPIO_DIR_INPUT,
158 .gpio71 = GPIO_DIR_INPUT,
159 .gpio72 = GPIO_DIR_INPUT,
162 static const struct pch_gpio_set3 pch_gpio_set3_level = {
165 static const struct pch_gpio_set3 pch_gpio_set3_reset = {
168 const struct pch_gpio_map mainboard_gpio_map = {
169 .set1 = {
170 .mode = &pch_gpio_set1_mode,
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173 .blink = &pch_gpio_set1_blink,
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175 .reset = &pch_gpio_set1_reset,
177 .set2 = {
178 .mode = &pch_gpio_set2_mode,
179 .direction = &pch_gpio_set2_direction,
180 .level = &pch_gpio_set2_level,
181 .reset = &pch_gpio_set2_reset,
183 .set3 = {
184 .mode = &pch_gpio_set3_mode,
185 .direction = &pch_gpio_set3_direction,
186 .level = &pch_gpio_set3_level,
187 .reset = &pch_gpio_set3_reset,