verilog: add sv_maps iteratorsverilog
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tree384ce94d8d5d5fec7c63a686eb8b5c149c532313
drwxr-xr-x   ..
-rw-r--r-- 389 ent.vhdl
-rw-r--r-- 428 ent2.vhdl
-rw-r--r-- 416 ent3.vhdl
-rw-r--r-- 640 tb_ent2.vhdl
-rwxr-xr-x 104 testsuite.sh