[MIParser] Set RegClassOrRegBank during instruction parsing
[llvm-complete.git] / test / CodeGen / ARM / 2012-08-04-DtripleSpillReload.ll
blob6e0b828ad24f8547838f24416388b0adf30bdcd9
1 ; RUN: llc < %s
2 ; PR13377
4 target datalayout = "e-p:32:32:32-i1:8:8-i8:8:8-i16:16:16-i32:32:32-i64:64:64-f32:32:32-f64:64:64-v64:64:64-v128:64:128-a0:0:64-n32-S64"
5 target triple = "armv7-none-linux-gnueabi"
7 %0 = type { <4 x float> }
9 define arm_aapcs_vfpcc void @foo(float, i1 zeroext, i1 zeroext) nounwind uwtable {
10   br i1 undef, label %4, label %5
12 ; <label>:4                                       ; preds = %3
13   unreachable
15 ; <label>:5                                       ; preds = %3
16   br i1 undef, label %7, label %6
18 ; <label>:6                                       ; preds = %5
19   unreachable
21 ; <label>:7                                       ; preds = %5
22   br i1 undef, label %8, label %10
24 ; <label>:8                                       ; preds = %7
25   br i1 undef, label %9, label %10
27 ; <label>:9                                       ; preds = %8
28   br i1 undef, label %11, label %10
30 ; <label>:10                                      ; preds = %9, %8, %7
31   unreachable
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34   br i1 undef, label %13, label %12
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37   unreachable
39 ; <label>:13                                      ; preds = %11
40   br i1 undef, label %15, label %14
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43   unreachable
45 ; <label>:15                                      ; preds = %13
46   br i1 undef, label %18, label %16
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49   br i1 undef, label %17, label %18
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52   unreachable
54 ; <label>:18                                      ; preds = %16, %15
55   br i1 undef, label %68, label %19
57 ; <label>:19                                      ; preds = %18
58   br label %20
60 ; <label>:20                                      ; preds = %20, %19
61   br i1 undef, label %21, label %20
63 ; <label>:21                                      ; preds = %20
64   br i1 undef, label %22, label %68
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67   br i1 undef, label %23, label %24
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70   unreachable
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73   br i1 undef, label %26, label %25
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79   br i1 undef, label %28, label %27
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85   br i1 undef, label %29, label %30, !prof !0
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88   br label %30
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91   br i1 undef, label %31, label %32, !prof !0
93 ; <label>:31                                      ; preds = %30
94   br label %32
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97   br i1 undef, label %34, label %33
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100   unreachable
102 ; <label>:34                                      ; preds = %32
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109   br i1 undef, label %37, label %38, !prof !0
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115   br i1 undef, label %39, label %67
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118   br i1 undef, label %40, label %41
120 ; <label>:40                                      ; preds = %39
121   br i1 undef, label %64, label %41
123 ; <label>:41                                      ; preds = %40, %39
124   br i1 undef, label %64, label %42
126 ; <label>:42                                      ; preds = %41
127   %43 = fadd <4 x float> undef, undef
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129   %45 = fmul <4 x float> undef, undef
130   %46 = fmul <4 x float> %45, %43
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132   %48 = load <4 x float>, <4 x float>* undef, align 8
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134   %50 = shufflevector <2 x i64> %49, <2 x i64> undef, <1 x i32> <i32 1>
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137   %53 = bitcast <4 x float> %52 to <2 x i64>
138   %54 = shufflevector <2 x i64> %53, <2 x i64> undef, <1 x i32> zeroinitializer
139   %55 = bitcast <1 x i64> %54 to <2 x float>
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147   %63 = fadd <4 x float> %47, %62
148   store <4 x float> %46, <4 x float>* undef, align 8
149   call arm_aapcs_vfpcc  void @bar(%0* undef, float 0.000000e+00) nounwind
150   call arm_aapcs_vfpcc  void @bar(%0* undef, float 0.000000e+00) nounwind
151   store <4 x float> %63, <4 x float>* undef, align 8
152   unreachable
154 ; <label>:64                                      ; preds = %41, %40
155   br i1 undef, label %65, label %66
157 ; <label>:65                                      ; preds = %64
158   unreachable
160 ; <label>:66                                      ; preds = %64
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164   unreachable
166 ; <label>:68                                      ; preds = %21, %18
167   ret void
170 declare arm_aapcs_vfpcc void @bar(%0*, float)
172 !0 = !{!"branch_weights", i32 64, i32 4}