[MIParser] Set RegClassOrRegBank during instruction parsing
[llvm-complete.git] / test / CodeGen / Thumb2 / mve-bitcasts.ll
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1 ; NOTE: Assertions have been autogenerated by utils/update_llc_test_checks.py
2 ; RUN: llc -mtriple=thumbv8.1m.main-arm-none-eabi -mattr=+mve,+fullfp16 -verify-machineinstrs %s -o - | FileCheck %s
3 ; RUN: llc -mtriple=thumbv8.1m.main-arm-none-eabi -mattr=+mve.fp -verify-machineinstrs %s -o - | FileCheck %s
5 define arm_aapcs_vfpcc <2 x i64> @bitcast_i64_i64(<2 x i64> %src) {
6 ; CHECK-LABEL: bitcast_i64_i64:
7 ; CHECK:       @ %bb.0: @ %entry
8 ; CHECK-NEXT:    bx lr
9 entry:
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11   ret <2 x i64> %r
14 define arm_aapcs_vfpcc <2 x i64> @bitcast_i64_i32(<4 x i32> %src) {
15 ; CHECK-LABEL: bitcast_i64_i32:
16 ; CHECK:       @ %bb.0: @ %entry
17 ; CHECK-NEXT:    bx lr
18 entry:
19   %r = bitcast <4 x i32> %src to <2 x i64>
20   ret <2 x i64> %r
23 define arm_aapcs_vfpcc <2 x i64> @bitcast_i64_i16(<8 x i16> %src) {
24 ; CHECK-LABEL: bitcast_i64_i16:
25 ; CHECK:       @ %bb.0: @ %entry
26 ; CHECK-NEXT:    bx lr
27 entry:
28   %r = bitcast <8 x i16> %src to <2 x i64>
29   ret <2 x i64> %r
32 define arm_aapcs_vfpcc <2 x i64> @bitcast_i64_i8(<16 x i8> %src) {
33 ; CHECK-LABEL: bitcast_i64_i8:
34 ; CHECK:       @ %bb.0: @ %entry
35 ; CHECK-NEXT:    bx lr
36 entry:
37   %r = bitcast <16 x i8> %src to <2 x i64>
38   ret <2 x i64> %r
41 define arm_aapcs_vfpcc <2 x i64> @bitcast_i64_f64(<2 x double> %src) {
42 ; CHECK-LABEL: bitcast_i64_f64:
43 ; CHECK:       @ %bb.0: @ %entry
44 ; CHECK-NEXT:    bx lr
45 entry:
46   %r = bitcast <2 x double> %src to <2 x i64>
47   ret <2 x i64> %r
50 define arm_aapcs_vfpcc <2 x i64> @bitcast_i64_f32(<4 x float> %src) {
51 ; CHECK-LABEL: bitcast_i64_f32:
52 ; CHECK:       @ %bb.0: @ %entry
53 ; CHECK-NEXT:    bx lr
54 entry:
55   %r = bitcast <4 x float> %src to <2 x i64>
56   ret <2 x i64> %r
59 define arm_aapcs_vfpcc <2 x i64> @bitcast_i64_f16(<8 x half> %src) {
60 ; CHECK-LABEL: bitcast_i64_f16:
61 ; CHECK:       @ %bb.0: @ %entry
62 ; CHECK-NEXT:    bx lr
63 entry:
64   %r = bitcast <8 x half> %src to <2 x i64>
65   ret <2 x i64> %r
69 define arm_aapcs_vfpcc <4 x i32> @bitcast_i32_i64(<2 x i64> %src) {
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73 entry:
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78 define arm_aapcs_vfpcc <4 x i32> @bitcast_i32_i32(<4 x i32> %src) {
79 ; CHECK-LABEL: bitcast_i32_i32:
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82 entry:
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91 entry:
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114 define arm_aapcs_vfpcc <4 x i32> @bitcast_i32_f32(<4 x float> %src) {
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133 define arm_aapcs_vfpcc <8 x i16> @bitcast_i16_i64(<2 x i64> %src) {
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142 define arm_aapcs_vfpcc <8 x i16> @bitcast_i16_i32(<4 x i32> %src) {
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151 define arm_aapcs_vfpcc <8 x i16> @bitcast_i16_i16(<8 x i16> %src) {
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155 entry:
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160 define arm_aapcs_vfpcc <8 x i16> @bitcast_i16_i8(<16 x i8> %src) {
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164 entry:
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169 define arm_aapcs_vfpcc <8 x i16> @bitcast_i16_f64(<2 x double> %src) {
170 ; CHECK-LABEL: bitcast_i16_f64:
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173 entry:
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178 define arm_aapcs_vfpcc <8 x i16> @bitcast_i16_f32(<4 x float> %src) {
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181 ; CHECK-NEXT:    bx lr
182 entry:
183   %r = bitcast <4 x float> %src to <8 x i16>
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187 define arm_aapcs_vfpcc <8 x i16> @bitcast_i16_f16(<8 x half> %src) {
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191 entry:
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197 define arm_aapcs_vfpcc <16 x i8> @bitcast_i8_i64(<2 x i64> %src) {
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201 entry:
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206 define arm_aapcs_vfpcc <16 x i8> @bitcast_i8_i32(<4 x i32> %src) {
207 ; CHECK-LABEL: bitcast_i8_i32:
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215 define arm_aapcs_vfpcc <16 x i8> @bitcast_i8_i16(<8 x i16> %src) {
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261 define arm_aapcs_vfpcc <2 x double> @bitcast_f64_i64(<2 x i64> %src) {
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279 define arm_aapcs_vfpcc <2 x double> @bitcast_f64_i16(<8 x i16> %src) {
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283 entry:
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288 define arm_aapcs_vfpcc <2 x double> @bitcast_f64_i8(<16 x i8> %src) {
289 ; CHECK-LABEL: bitcast_f64_i8:
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297 define arm_aapcs_vfpcc <2 x double> @bitcast_f64_f64(<2 x double> %src) {
298 ; CHECK-LABEL: bitcast_f64_f64:
299 ; CHECK:       @ %bb.0: @ %entry
300 ; CHECK-NEXT:    bx lr
301 entry:
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306 define arm_aapcs_vfpcc <2 x double> @bitcast_f64_f32(<4 x float> %src) {
307 ; CHECK-LABEL: bitcast_f64_f32:
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315 define arm_aapcs_vfpcc <2 x double> @bitcast_f64_f16(<8 x half> %src) {
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319 entry:
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325 define arm_aapcs_vfpcc <4 x float> @bitcast_f32_i64(<2 x i64> %src) {
326 ; CHECK-LABEL: bitcast_f32_i64:
327 ; CHECK:       @ %bb.0: @ %entry
328 ; CHECK-NEXT:    bx lr
329 entry:
330   %r = bitcast <2 x i64> %src to <4 x float>
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334 define arm_aapcs_vfpcc <4 x float> @bitcast_f32_i32(<4 x i32> %src) {
335 ; CHECK-LABEL: bitcast_f32_i32:
336 ; CHECK:       @ %bb.0: @ %entry
337 ; CHECK-NEXT:    bx lr
338 entry:
339   %r = bitcast <4 x i32> %src to <4 x float>
340   ret <4 x float> %r
343 define arm_aapcs_vfpcc <4 x float> @bitcast_f32_i16(<8 x i16> %src) {
344 ; CHECK-LABEL: bitcast_f32_i16:
345 ; CHECK:       @ %bb.0: @ %entry
346 ; CHECK-NEXT:    bx lr
347 entry:
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352 define arm_aapcs_vfpcc <4 x float> @bitcast_f32_i8(<16 x i8> %src) {
353 ; CHECK-LABEL: bitcast_f32_i8:
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355 ; CHECK-NEXT:    bx lr
356 entry:
357   %r = bitcast <16 x i8> %src to <4 x float>
358   ret <4 x float> %r
361 define arm_aapcs_vfpcc <4 x float> @bitcast_f32_f64(<2 x double> %src) {
362 ; CHECK-LABEL: bitcast_f32_f64:
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365 entry:
366   %r = bitcast <2 x double> %src to <4 x float>
367   ret <4 x float> %r
370 define arm_aapcs_vfpcc <4 x float> @bitcast_f32_f32(<4 x float> %src) {
371 ; CHECK-LABEL: bitcast_f32_f32:
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373 ; CHECK-NEXT:    bx lr
374 entry:
375   %r = bitcast <4 x float> %src to <4 x float>
376   ret <4 x float> %r
379 define arm_aapcs_vfpcc <4 x float> @bitcast_f32_f16(<8 x half> %src) {
380 ; CHECK-LABEL: bitcast_f32_f16:
381 ; CHECK:       @ %bb.0: @ %entry
382 ; CHECK-NEXT:    bx lr
383 entry:
384   %r = bitcast <8 x half> %src to <4 x float>
385   ret <4 x float> %r
389 define arm_aapcs_vfpcc <8 x half> @bitcast_f16_i64(<2 x i64> %src) {
390 ; CHECK-LABEL: bitcast_f16_i64:
391 ; CHECK:       @ %bb.0: @ %entry
392 ; CHECK-NEXT:    bx lr
393 entry:
394   %r = bitcast <2 x i64> %src to <8 x half>
395   ret <8 x half> %r
398 define arm_aapcs_vfpcc <8 x half> @bitcast_f16_i32(<4 x i32> %src) {
399 ; CHECK-LABEL: bitcast_f16_i32:
400 ; CHECK:       @ %bb.0: @ %entry
401 ; CHECK-NEXT:    bx lr
402 entry:
403   %r = bitcast <4 x i32> %src to <8 x half>
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407 define arm_aapcs_vfpcc <8 x half> @bitcast_f16_i16(<8 x i16> %src) {
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412   %r = bitcast <8 x i16> %src to <8 x half>
413   ret <8 x half> %r
416 define arm_aapcs_vfpcc <8 x half> @bitcast_f16_i8(<16 x i8> %src) {
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421   %r = bitcast <16 x i8> %src to <8 x half>
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425 define arm_aapcs_vfpcc <8 x half> @bitcast_f16_f64(<2 x double> %src) {
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434 define arm_aapcs_vfpcc <8 x half> @bitcast_f16_f32(<4 x float> %src) {
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443 define arm_aapcs_vfpcc <8 x half> @bitcast_f16_f16(<8 x half> %src) {
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