verilog: add sv_maps iteratorsverilog
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tree3db1cff4730eeeab3fef5be73c25050c54c883d5
drwxr-xr-x   ..
-rw-r--r-- 386 add03.vhdl
-rw-r--r-- 2749 adds.vhdl
-rw-r--r-- 792 cmpeq.vhdl
-rw-r--r-- 800 cmpge.vhdl
-rw-r--r-- 792 cmpgt.vhdl
-rw-r--r-- 800 cmple.vhdl
-rw-r--r-- 792 cmplt.vhdl
-rw-r--r-- 800 cmpne.vhdl
-rw-r--r-- 357 exts.vhdl
-rw-r--r-- 1113 muls.vhdl
-rw-r--r-- 578 reduce.vhdl
-rw-r--r-- 721 shrs.vhdl
-rw-r--r-- 363 sns01.vhdl
-rw-r--r-- 2749 subs.vhdl
-rw-r--r-- 625 tb_add03.vhdl
-rw-r--r-- 5984 tb_adds.vhdl
-rw-r--r-- 2022 tb_cmpeq.vhdl
-rw-r--r-- 2030 tb_cmpge.vhdl
-rw-r--r-- 2022 tb_cmpgt.vhdl
-rw-r--r-- 2030 tb_cmple.vhdl
-rw-r--r-- 2022 tb_cmplt.vhdl
-rw-r--r-- 2030 tb_cmpne.vhdl
-rw-r--r-- 1134 tb_exts.vhdl
-rw-r--r-- 2614 tb_muls.vhdl
-rw-r--r-- 1931 tb_reduce.vhdl
-rw-r--r-- 1851 tb_shrs.vhdl
-rw-r--r-- 5984 tb_subs.vhdl
-rw-r--r-- 2075 tb_unaries.vhdl
-rwxr-xr-x 616 testsuite.sh
-rw-r--r-- 980 unaries.vhdl