[MIParser] Set RegClassOrRegBank during instruction parsing
[llvm-complete.git] / test / CodeGen / Thumb2 / mve-fmas.ll
blob5b53bcf149a78e66db7efefe8d10d6af5ea453f4
1 ; NOTE: Assertions have been autogenerated by utils/update_llc_test_checks.py
2 ; RUN: llc -mtriple=thumbv8.1m.main-arm-none-eabi, -mattr=+mve.fp -verify-machineinstrs %s -o - | FileCheck %s --check-prefix=CHECK-MVE-FP
3 ; RUN: llc -mtriple=thumbv8.1m.main-arm-none-eabi, -mattr=+mve.fp -fp-contract=fast -verify-machineinstrs %s -o - | FileCheck %s --check-prefix=CHECK-MVE-VMLA
4 ; RUN: llc -mtriple=thumbv8.1m.main-arm-none-eabi -mattr=+mve,+fullfp16 -verify-machineinstrs %s -o - | FileCheck %s --check-prefix=CHECK-MVE
6 define arm_aapcs_vfpcc <8 x half> @vfma16_v1(<8 x half> %src1, <8 x half> %src2, <8 x half> %src3) {
7 ; CHECK-MVE-FP-LABEL: vfma16_v1:
8 ; CHECK-MVE-FP:       @ %bb.0: @ %entry
9 ; CHECK-MVE-FP-NEXT:    vmul.f16 q1, q1, q2
10 ; CHECK-MVE-FP-NEXT:    vadd.f16 q0, q0, q1
11 ; CHECK-MVE-FP-NEXT:    bx lr
13 ; CHECK-MVE-VMLA-LABEL: vfma16_v1:
14 ; CHECK-MVE-VMLA:       @ %bb.0: @ %entry
15 ; CHECK-MVE-VMLA-NEXT:    vfma.f16 q0, q1, q2
16 ; CHECK-MVE-VMLA-NEXT:    bx lr
18 ; CHECK-MVE-LABEL: vfma16_v1:
19 ; CHECK-MVE:       @ %bb.0: @ %entry
20 ; CHECK-MVE-NEXT:    .vsave {d8, d9, d10}
21 ; CHECK-MVE-NEXT:    vpush {d8, d9, d10}
22 ; CHECK-MVE-NEXT:    vmovx.f16 s13, s0
23 ; CHECK-MVE-NEXT:    vmla.f16 s0, s4, s8
24 ; CHECK-MVE-NEXT:    vmovx.f16 s12, s8
25 ; CHECK-MVE-NEXT:    vmovx.f16 s14, s4
26 ; CHECK-MVE-NEXT:    vmov.f32 s16, s1
27 ; CHECK-MVE-NEXT:    vmla.f16 s13, s14, s12
28 ; CHECK-MVE-NEXT:    vmov r1, s0
29 ; CHECK-MVE-NEXT:    vmla.f16 s16, s5, s9
30 ; CHECK-MVE-NEXT:    vmov r0, s13
31 ; CHECK-MVE-NEXT:    vmov.16 q3[0], r1
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36 ; CHECK-MVE-NEXT:    vmovx.f16 s20, s1
37 ; CHECK-MVE-NEXT:    vmov.16 q3[2], r0
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45 ; CHECK-MVE-NEXT:    vmovx.f16 s18, s6
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62 ; CHECK-MVE-NEXT:    vpop {d8, d9, d10}
63 ; CHECK-MVE-NEXT:    bx lr
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65   %0 = fmul <8 x half> %src2, %src3
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70 define arm_aapcs_vfpcc <8 x half> @vfma16_v2(<8 x half> %src1, <8 x half> %src2, <8 x half> %src3) {
71 ; CHECK-MVE-FP-LABEL: vfma16_v2:
72 ; CHECK-MVE-FP:       @ %bb.0: @ %entry
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82 ; CHECK-MVE-LABEL: vfma16_v2:
83 ; CHECK-MVE:       @ %bb.0: @ %entry
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127 ; CHECK-MVE-NEXT:    bx lr
128 entry:
129   %0 = fmul <8 x half> %src2, %src3
130   %1 = fadd <8 x half> %0, %src1
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134 define arm_aapcs_vfpcc <8 x half> @vfms16(<8 x half> %src1, <8 x half> %src2, <8 x half> %src3) {
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136 ; CHECK-MVE-FP:       @ %bb.0: @ %entry
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141 ; CHECK-MVE-VMLA-LABEL: vfms16:
142 ; CHECK-MVE-VMLA:       @ %bb.0: @ %entry
143 ; CHECK-MVE-VMLA-NEXT:    vfms.f16 q0, q1, q2
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191 ; CHECK-MVE-NEXT:    bx lr
192 entry:
193   %0 = fmul <8 x half> %src2, %src3
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198 define arm_aapcs_vfpcc <4 x float> @vfma32_v1(<4 x float> %src1, <4 x float> %src2, <4 x float> %src3) {
199 ; CHECK-MVE-FP-LABEL: vfma32_v1:
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201 ; CHECK-MVE-FP-NEXT:    vmul.f32 q1, q1, q2
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217 entry:
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223 define arm_aapcs_vfpcc <4 x float> @vfma32_v2(<4 x float> %src1, <4 x float> %src2, <4 x float> %src3) {
224 ; CHECK-MVE-FP-LABEL: vfma32_v2:
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248 define arm_aapcs_vfpcc <4 x float> @vfms32(<4 x float> %src1, <4 x float> %src2, <4 x float> %src3) {
249 ; CHECK-MVE-FP-LABEL: vfms32:
250 ; CHECK-MVE-FP:       @ %bb.0: @ %entry
251 ; CHECK-MVE-FP-NEXT:    vmul.f32 q1, q1, q2
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255 ; CHECK-MVE-VMLA-LABEL: vfms32:
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260 ; CHECK-MVE-LABEL: vfms32:
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266 ; CHECK-MVE-NEXT:    bx lr
267 entry:
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270   ret <4 x float> %1